KR100581945B1 - 플라즈마 디스플레이 패널구동방법 - Google Patents

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Abstract

본 발명은 소정 개수로 분할된 패널 사이에서 각 어드레스 구간마다 휴지기를 두어 프라이밍 전하가 인접셀에 영향을 미치는 것을 방지하는 플라즈마 디스플레이 패널구동방법에 관한 것이다. 이를 위한 방법은 어드레스구간에서, 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 제1 주사전극 라인들에 순차적으로 주사펄스가 인가된 후, 제2 주사전극 라인들에 순차적으로 주사펄스가 인가되며, 제2 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 휴지기를 두는 단계를 포함하는 것을 특징으로 한다. 이로써, 본 발명에 따르면, 어드레스 중간에 휴지기를 인가함으로써 프라이밍 전하가 인접 셀에 영향을 미치지 않도록 할 수 있고, 따라서 방전후 전체 셀에서의 벽전하 상태가 균일하게 되어 패널 방전이 안정화될 수 있다.

Description

플라즈마 디스플레이 패널구동방법{Driving method of plasma display panel}
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 평면도이다.
도 2는 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 나타내는 타이밍도이다.
도 3은 플라즈마 디스플레이 패널의 구동 신호의 일예를 설명하기 위한 타이밍도이다.
도 4는 3개의 부분으로 분할된 패널을 나타내는 도면이다.
도 5는 종래의 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다.
도 6은 통상적인 플라즈마 디스플레이 패널의 구조를 나타내는 도면이다.
도 7은 본 발명에 따른 플라즈마 디스플레이 패널의 구동 장치를 나타내는 도면이다.
도 8은 2개의 부분으로 분할된 패널을 나타내는 도면이다.
도 9는 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다.
도 10은 본 발명의 다른 일 실시예에 따른 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다.
<도면의 주요 부분에 대한 부호의 설명>
A1, A4, ..., Am-2 : 적색발광용 어드레스 전극라인,
A2, A5, ..., Am-1 : 녹색발광용 어드레스 전극라인,
A3, A6, ..., Am : 청색발광용 어드레스 전극라인,
112R : 적색발광 형광체, 112G : 녹색발광 형광체,
112B : 청색발광 형광체,
PR : 리셋구간, PA : 어드레스구간,
PS : 유지방전구간.
본 발명은 플라즈마 디스플레이 패널(PDP)과 같이 컬러 형광체가 도포된 표시셀을 형성하는 전극구조에 방전용 펄스를 인가함으로써 화면을 표시하는 플라즈마 디스플레이 패널구동방법에 관한 것으로서, 더욱 상세하게는 소정 개수로 분할된 패널 사이에서 각 어드레스 구간마다 휴지기를 두어 프라이밍 전하가 인접셀에 영향을 미치는 것을 방지하는 플라즈마 디스플레이 패널구동방법에 관한 것이다.
도 1은 플라즈마 디스플레이 패널의 전극 배치를 간략히 보여주는 평면도이다. 도 1을 참조하면, 주사전극 라인들(Y1, Y2, ..., Yn)과 공통전극 라인들(X 1, X2, ..., Xn)이 플라즈마 디스플레이 패널의 수평방향에 평행하게 배치되어 있으며(이들을 유지전극 라인들이라고 통칭한다), 상기 주사전극 라인들(Y1, Y2, ..., Y n) 및 공통전극 라인들(X1, X2, ..., Xn)에 교차하여 배치되는 어드레스 전극 라인들(A1, A2, ..., Am)이 있다. 주사전극 라인들, 공통전극 라인들 및 어드레스 전극 라인들(A1, A2, ..., Am)이 교차하는 부분에서, 격벽에 의해 방전셀(Ce)이 구획되며, 상기 방전셀(Ce)은 플라즈마 디스플레이 패널의 한 화소로서의 역할을 한다. 방전셀(Ce)의 공간내에는 R, G, B 형광체와 플라즈마 형성용 가스가 있으며, 상기 주사전극, 공통전극 및 어드레스 전극 각각에 인가되는 전압에 의해, 방전셀(Ce) 내부에 벽전하가 생성된다. 상기 벽전하에 의해 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 방전셀(Ce)들의 형광체가 여기되어 빛이 발생하게 된다.
이하에서는, 주사전극 라인들(Y1, Y2, ..., Yn)을 Y 전극 라인들이라고 호칭하고, 공통전극 라인들(X1, X2, ..., Xn)을 X 전극 라인들이라고 호칭한다.
한편, 미국특허 제5,541,618호에는, 플라즈마 디스플레이 패널의 구동방법으로서, 주로 사용되는 어드레스-디스플레이 분리 구동방법이 개시되어 있다. 도 2는 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 보여준다.
도면을 참조하면, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정개수 예를 들어 8 개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ..., SF8)는 리셋 구간(미도시)과, 어드레스구간(A1, ..., A8) 및 유지방전 구간(S1, ..., S8)으로 분할된다.
각 어드레스구간(A1, ..., A8)에서는, 어드레스 전극 라인들에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, Y2, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다.
각 유지방전 구간(S1, ..., S8)에서는, Y 전극 라인들(Y1, Y2, ..., Yn )과 X 전극 라인들(X1, X2, ..., Xn)에 디스플레이 방전용 펄스가 교호하게 인가되어, 어드레스구간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 표시 방전을 일으킨다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지방전 구간(S1, ..., S8)내의 유지방전 펄스 개수에 비례한다. 1 화상을 형성하는 하나의 프레임이, 8개의 서브필드와 256 계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64, 128의 비율로 서로 다른 유지펄스의 수가 할당될 수 있다. 만일 133 계조의 휘도를 얻기 위해서는, 서브필드1 기간, 서브필드3 기간 및 서브필드8 기간 동안 셀들을 어드레싱하여 유지방전하면 된다.
각 서브필드에 할당되는 유지방전 수는, APC(Automatic power control) 단계 에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 또한 각 서브필드에 할당되는 유지방전 수는 감마특성이나 패널특성을 고려하여 다양하게 변형하는 것이 가능하다. 예를 들어 서브필드4에 할당된 계조도를 8에서 6으로 낮추고, 서브필드6에 할당된 계조도를 32에서 34로 높일 수 있다. 또한, 한 프레임을 형성하는 서브필드의 수도 설계사양에 따라 다양하게 변형하는 것이 가능하다.
도 3은 플라즈마 디스플레이 패널의 구동 신호의 일예를 설명하기 위한 타이밍도로서, AC PDP의 ADS 구동방식에서 한 서브필드(SF)내에 어드레스 전극 라인들(A1, A2, ..., Am), 공통전극 라인들(X1, X2, ..., Xn) 및 주사전극 라인들(Y1, Y2, ..., Yn)에 인가되는 구동신호를 나타낸다. 도 3을 참조하면, 하나의 서브필드(SF)는 리셋구간(PR), 어드레스구간(PA) 및 유지방전구간(PS)를 구비한다.
리셋구간(PR)은 모든 그룹의 주사라인에 대해 리셋펄스를 인가하여, 강제로 기입방전을 수행함으로써, 전체 셀의 벽전하 상태를 초기화한다. 어드레스구간(PA)에 들어가기 전에 리셋구간(PR)이 수행되며, 이는 전 화면에 걸쳐 수행하므로, 상당히 고르면서도 원하는 분포의 벽전하 배치를 만들 수 있다. 리셋구간(PR)에 의해 초기화된 셀들은, 셀 내부의 벽전하 조건이 모두 비슷하게 형성된다.
리셋구간(PR)이 수행된 후에 어드레스구간(PA)이 수행된다. 이 때 어드레스구간(PA)에는, 공통전극(X)에 바이어스 전압(Ve)이 인가되고, 표시되어야 할 셀 위치에서 주사전극(Y1, Y2, ..., Yn)과 어드레스 전극(A1, A 2, ..., Am)을 동시에 턴온시킴으로써, 표시 셀을 선택한다. 상기 어드레스구간(PA)에서는, 주사전극(Y1, Y2, ..., Yn)에 음극성 주사펄스가 인가되고 어드레스 전극(A1, A2, ..., A m)에는 어드레스 데이터 전압(VA)이 인가됨으로써 어드레스 방전이 발생한다.
어드레스구간(PA)이 수행된 후에, 공통전극(X1, X2, ..., Xn)과 주사전극(Y 1, Y2, ..., Yn)에 유지펄스(Vs)를 교대로 인가하여, 유지방전구간(PS)이 수행된다. 어드레스 방전에 의해 형성된 벽전하 분포(주사전극 근처에 다량의 음전하 축적되는 것)에 의하여 표시셀이 선택되어 유지방전이 발생된다. 유지방전시에 주사전극과 공통전극 사이의 방전에 의하여 형성된 자외선 방사로 어드레스 전극 상에 도포된 형광체가 여기되어 빛이 방출된다. 유지방전구간(PS) 중에 어드레스 전극(A1, A2, ..., Am)에는 로우레벨의 전압(VG)이 인가된다. PDP에서 휘도는 유지방전 펄스수에 의하여 조정된다. 하나의 서브필드 또는 하나의 TV 필드에서의 유지방전 펄스수가 많으면 휘도가 증가한다.
도 4는 3개의 부분으로 분할된 패널을 나타내는 도면이고, 도 5는 종래의 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다. 도 4를 참조하면, 패널이 3개의 부분으로 분할되어 상부에는 제1 주사전극 라인들(Y1, Y2, ..., Yn/3)이 배치되고 중부에는 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3)이 배치되며 하부에는 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Yn)이 배치된다. 이하 도 5를 참조하여 어드레스구간(PA)에서의 구동신호를 설명한다.
도 5를 참조하면, 어드레스구간(PA)에서, 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 제1 주사전극 라인들(Y1, Y2, ..., Yn/3)에 순차적으로 주사펄스가 인가된 후, 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3 )에 순차적으로 주사펄스가 인가되며, 그 다음 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Y n)에 순차적으로 주사펄스가 인가된다. 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3 )에 순차적인 주사펄스가 인가되기 전에 보조 리셋이 수행된다. 또한, 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Yn)에 순차적인 주사펄스가 인가되기 전에 보조 리셋이 수행된다. 상기 보조 리셋은 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3 ) 또는 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Yn)에 제1 전압(VSC-H )에서 그라운드 전압으로 하강하는 신호가 인가된 후 곧바로 그라운드 전압에서 제2 전압(VSC-L1)으로 하강 램프 신호를 인가함으로써 수행될 수 있다. 보조 리셋을 수행함으로써 중부 패널 및 하부 패널에서 어드레스 방전이 더 잘 이루어질 수 있다.
한편, 녹색 형광체(예를 들어, Zn2SiO4:Mn)는 음전하의 특성을 띠는 음극성을 가지므로 방전을 위해 적색 형광체 및 청색 형광체에 비해 높은 전압을 인가한다. R, G, B 형광체에 일정한 전압을 인가해주기 위하여, 녹색 형광체에 양전하 특성을 갖는 YBO3 :TB3+를 혼합해 2종 형광체(Zn2SiO4:Mn 2+ + YBO3 :TB3+)를 형성할 수 있다. 상기 형광체를 적용한 패널에서 순차적인 어드레스를 구동하는 경우, 전극에 스캔 펄스를 인가함에 따라 발생하는 프라이밍 전하가 많아져 라인별로 순차주사가 진행됨에 따라 어드레스 방전 시기가 빨라지고 어드레스 방전후의 벽전하 상태가 균일하게 되지 않는 문제점이 발생할 수 있다. 따라서, 프라이밍 전하가 인접셀에 영향을 미치는 것을 방지할 필요가 있다.
본 발명이 이루고자 하는 기술적 과제는, 상기와 같은 단점들을 해결하기 위하여, 소정 개수로 분할된 패널 사이에서 각 어드레스 구간마다 휴지기를 두어 프라이밍 전하가 인접셀에 영향을 미치는 것을 방지하는 플라즈마 디스플레이 패널구동방법을 제공하는 데 있다.
본 발명은 상기한 기술적 과제를 달성하기 위하여, 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 공통전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 상기 플라즈마 디스플레이 패널을 2개의 부분으로 분할하여 구동하기 위하여 상기 주사전극 라인들은 제1 주사전극 라인들 및 제2 주사전극 라인들을 포함하며, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각은 리셋구간, 어드레스구간, 및 유지방전구간으로 이루어진 플라즈마 디스플레이 패널구동방법에 있어서,
상기 어드레스구간에서, 상기 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 상기 제1 주사전극 라인들에 순차적으로 주사펄스가 인가된 후, 상기 제2 주사전극 라인들에 순차적으로 주사펄스가 인가되며,
상기 제2 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 휴지기를 두는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널구동방법을 제공한다.
본 발명은 또한, 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 공통전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 상기 플라즈마 디스플레이 패널을 3개의 부분으로 분할하여 구동하기 위하여 상기 주사전극 라인들은 제1 주사전극 라인들, 제2 주사전극 라인들 및 제3 주사전극 라인들을 포함하며, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각은 리셋구간, 어드레스구간, 및 유지방전구간으로 이루어진 플라즈마 디스플레이 패널구동방법에 있어서,
상기 어드레스구간에서, 상기 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 상기 제1 주사전극 라인들에 순차적으로 주사펄스가 인가된 후, 상기 제2 주사전극 라인들에 순차적으로 주사펄스가 인가되며, 그 다음 상기 제3 주사전극 라인들에 순차적으로 주사펄스가 인가되고,
상기 제2 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 보조 리셋을 수행하는 단계; 및
상기 제3 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 휴지기를 두는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널구동방법을 제공한다.
한편, 상기 방법들은 컴퓨터에서 실행시키기 위한 프로그램을 기록한 기록매 체에 의하여, 컴퓨터를 통해 실현될 수 있다.
이하, 본 발명의 바람직한 실시예에 의한 플라즈마 디스플레이 패널구동방법의 구성 및 동작을 첨부한 도면들을 참조하여 상세히 설명한다.
도 6은 통상적인 플라즈마 디스플레이 패널의 구조를 나타내는 도면이다. 일본공개공보 1999-120924호에는 통상적인 플라즈마 디스플레이 패널의 구조가 개시되어 있다. 도 6을 참조하면, 통상적인 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(100, 106) 사이에는, 어드레스 전극 라인들(A1, A2, ..., Am), 유전층(102, 110), Y 전극 라인들(Y1, Y2, ..., Yn), X 전극 라인들(X1, X2, ..., Xn), 형광층(112), 격벽(114) 및 보호층으로서 예를 들어 일산화마그네슘 (MgO)층(104)이 마련되어 있다. Y 전극 라인들(Y1, Y2, ..., Yn)과 X 전극 라인들(X1, X2, ..., Xn)은 '유지전극 라인들'이라고 통칭되며, Y 전극 라인들(Y 1, Y2, ..., Yn)은 주사전극 라인들이라고도 호칭되고, X 전극 라인들(X1, X2, ..., Xn)은 공통전극 라인들이라고도 호칭된다.
어드레스 전극 라인들(A1, A2, ..., Am)은 뒤쪽 글라스 기판(106)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(110)은 어드레스 전극 라인들(A1, A2, ..., Am)의 앞쪽에 도포된다. 아래쪽 유전층(110)의 앞쪽에는 격벽(114)들이 어드레스 전극 라인들(A1, A2, ..., Am)과 평행한 방향으로 형성된다. 이 격벽(114)들은 각 디스플레이 셀의 방전 영역을 구획하고, 각 디스플레이 셀 사이의 광학적 간섭을 방지하는 기능을 한다. 형광층(112R,112G,112B)은, 격벽(114)들 사이에서 어드레스 전극 라인들(A1, A2, ..., Am) 상의 유전층(110)의 앞에 도포되며, 순차적으로 적색 형광층(112R), 녹색 형광층(112G), 청색 형광층(112B)이 배치된다.
어드레스 전극 라인들(A1, A2, ..., Am) 상의 형광층(112)을 이루는 형광체 중에서 통상적으로 채용되는 적색 형광체(112R; 예를 들어, (Y,Gd)BO3:Eu)는 양 전하를 띠는 양극(陽極)성을 가지고 청색 형광체(112G; 예를 들어, BaMgAl10O17:Eu)는 약한 양전하 특성을 가지는 반면, 녹색 형광체(112B; 예를 들어, Zn2SiO4:Mn)는 음 전하를 띠는 음극(陰極)성을 가진다.
X 전극 라인들(X1, X2, ..., Xn)과 Y 전극 라인들(Y1, Y 2, ..., Yn)은 어드레스 전극 라인들(A1, A2, ..., Am)과 직교되도록 앞쪽 글라스 기판(100)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X 전극 라인(X1, X2, ..., Xn)과 각 Y 전극 라인(Y1, Y 2, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(Xnb, Ynb)이 결합되어 형성될 수 있다. 앞쪽 유전층(102)은 X 전극 라인들(X1, X2, ..., Xn)과 Y 전극 라인들(Y1, Y 2, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(104) 예 를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층(102)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(108)에는 플라즈마 형성용 가스가 밀봉된다.
플라즈마 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 리셋, 어드레스 및 디스플레이 유지 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 리셋 단계에서는 구동될 디스플레이 셀들의 전하 상태가 균일하게 된다. 어드레스 단계에서는, 선택될 디스플레이 셀들의 전하 상태와 선택되지 않을 디스플레이 셀들의 전하 상태가 설정된다. 디스플레이 유지 단계에서는, 선택될 디스플레이 셀들에서 디스플레이 방전이 수행된다. 이때, 디스플레이 방전을 수행하는 디스플레이 셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 디스플레이 셀들의 형광층이 여기되어 빛이 발생된다.
본 발명에 따른 플라즈마 디스플레이 패널구동방법은, 상기 구조의 플라즈마 디스플레이 패널에 한정되는 것이 아니며, 리셋구간을 가지는 모든 구동 파형에 의해 구동되는 플라즈마 디스플레이 패널에 적용될 수 있음에 유의해야 한다.
도 7은 플라즈마 디스플레이 패널의 일반적인 구동 장치를 나타내는 블록도이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 통상적인 구동 장치는 영상 처리부(200), 논리제어부(202), 어드레스 구동부(206), X 구동부(208) 및 Y 구동부(204)를 포함한다. 영상 처리부(200)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 논리제어부(202)는 영상 처리부(200)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 어드레스 구동부(206)는, 논리제어부(202)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(208)는 논리제어부(202)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(204)는 논리제어부(202)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(S Y)를 처리하여 Y 전극 라인들에 인가한다.
이하, 도 8 및 도 9를 본 발명의 일 실시예를 설명한다.
도 8은 2개의 부분으로 분할된 패널을 나타내는 도면이고, 도 9는 본 발명의 일 실시예에 따른 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다. 도 8을 참조하면, 패널이 2개의 부분으로 분할되어 상부에는 제1 주사전극 라인들(Y1, Y2, ..., Yn/2)이 배치되고 하부에는 제2 주사전극 라인들(Y n/2+1, Yn/2+2, ..., Yn)이 배치된다.
도 9를 참조하면, 어드레스구간(PA)에서, 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 제1 주사전극 라인들(Y1, Y2, ..., Yn/2)에 순차적으로 주 사펄스가 인가된 후, 제2 주사전극 라인들(Yn/2+1, Yn/2+2, ..., Yn)에 순차적으로 주사펄스가 인가된다. 제2 주사전극 라인들(Yn/2+1, Yn/2+2, ..., Yn)에 순차적인 주사펄스가 인가되기 전에 소정 시간의 휴지기를 둔다.
따라서, 도 9에 도시된 바와 같이 어드레스 중간에 휴지기를 인가함으로써 프라이밍 전하가 인접 셀에 영향을 미치지 않도록 한다. 따라서, 방전후 전체 셀에서의 벽전하 상태가 균일하게 되어 패널 방전이 안정화될 수 있다.
이제, 도 4 및 도 10을 참조하여 본 발명의 다른 일 실시예를 설명한다. 도 4는 3개의 부분으로 분할된 패널을 나타내는 도면이고, 도 10은 본 발명의 다른 일 실시예에 따른 플라즈마 디스플레이 패널의 구동신호를 설명하기 위한 타이밍도이다.
도 10에 도시된 구동신호는 도 4에 도시된 바와 같이 패널을 3개의 부분으로 분할하여 어드레스 구동을 수행하는데 이용될 수 있다. 도 4를 참조하면, 패널이 3개의 부분으로 분할되어 상부에는 제1 주사전극 라인들(Y1, Y2, ..., Yn/3 )이 배치되고 중부에는 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3)이 배치되며 하부에는 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Yn)이 배치된다.
도 10을 참조하면, 어드레스구간(PA)에서, 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 제1 주사전극 라인들(Y1, Y2, ..., Yn/3)에 순차적으로 주사펄스가 인가된 후, 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3 )에 순차적으로 주 사펄스가 인가되며, 그 다음 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Y n)에 순차적으로 주사펄스가 인가된다. 제2 주사전극 라인들(Yn/3+1, Yn/3+2, ..., Y2n/3 )에 순차적인 주사펄스가 인가되기 전에 소정 시간의 휴지기를 둔다. 또한, 제3 주사전극 라인들(Y2n/3+1, Y2n/3+2, ..., Yn)에 순차적인 주사펄스가 인가되기 전에 소정 시간의 휴지기를 둔다.
따라서, 도 10에 도시된 바와 같이 어드레스 중간에 휴지기를 인가함으로써 프라이밍 전하가 인접 셀에 영향을 미치지 않도록 한다. 따라서, 방전후 전체 셀에서의 벽전하 상태가 균일하게 되어 패널 방전이 안정화될 수 있다.
본 발명은 2개 또는 3개로 분할된 패널의 구동방법을 설명하였으나 이에 한정되는 것이 아니며, 4개 이상으로 분할된 패널의 구동방법에 적용될 수 있음에 유의해야 한다. 또한, 본 발명은 2개 또는 3개로 균등하게 분할된 패널의 구동방법을 설명하였으나, 상이하게 분할된 패널의 구동방법에도 적용될 수 있음에 유의해야 한다.
한편, 전술한 본 발명에 의한 디스플레이 패널구동방법은 컴퓨터로 읽을 수 있는 기록매체에 컴퓨터가 읽을 수 있는 코드로서 구현하는 것이 가능하다. 컴퓨터가 읽을 수 있는 기록매체는 컴퓨터 시스템에 의하여 읽혀질 수 있는 프로그램이나 데이터가 저장되는 모든 종류의 기록장치를 포함한다. 컴퓨터가 읽을 수 있는 기록매체의 예로는 ROM, RAM, CD-ROM, 자기 테이프, 하드디스크, 플로피디스크, 플래쉬 메모리, 광데이터 저장장치 등이 있다. 여기서, 기록매체에 저장되는 프로그램 이라 함은 특정한 결과를 얻기 위하여 컴퓨터 등의 정보처리능력을 갖는 장치 내에서 직접 또는 간접적으로 사용되는 일련의 지시 명령으로 표현된 것을 말한다. 따라서, 컴퓨터라는 용어도 실제 사용되는 명칭의 여하에 불구하고 메모리, 입출력장치, 연산장치를 구비하여 프로그램에 의하여 특정의 기능을 수행하기 위한 정보처리능력을 가진 모든 장치를 총괄하는 의미로 사용된다. 패널을 구동하는 장치의 경우에도 그 용도가 패널구동이라는 특정된 분야에 한정된 것일 뿐 그 실체에 있어서는 일종의 컴퓨터라고 할 수 있는 것이다.
특히, 본 발명에 의한 디스플레이 패널구동방법은, 컴퓨터상에서 스키매틱(schematic) 또는 초고속 집적회로 하드웨어 기술언어(VHDL) 등에 의해 작성되고, 컴퓨터에 연결되어 프로그램 가능한 집적회로 예컨대 FPGA(Field Programmable Gate Array)에 의해 구현될 수 있다. 상기 기록매체는, 이러한 프로그램 가능한 집적회로를 포함한다.
이상 본 발명의 바람직한 실시예에 대해 상세히 기술하였지만, 본 발명이 속하는 기술분야에 있어서 통상의 지식을 가진 사람이라면, 첨부된 청구범위에 정의된 본 발명의 정신 및 범위를 벗어나지 않으면서 본 발명을 여러 가지로 변형 또는 변경하여 실시할 수 있음을 알 수 있을 것이다. 따라서, 본 발명의 앞으로의 실시예들의 변경은 본 발명의 기술을 벗어날 수 없을 것이다.
상술한 바와 같이, 본 발명을 이용하면 어드레스 중간에 휴지기를 인가함으로써 프라이밍 전하가 인접 셀에 영향을 미치지 않도록 할 수 있고, 따라서 방전후 전체 셀에서의 벽전하 상태가 균일하게 되어 패널 방전이 안정화될 수 있다.

Claims (3)

  1. 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 공통전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 상기 플라즈마 디스플레이 패널을 2개의 부분으로 분할하여 구동하기 위하여 상기 주사전극 라인들은 제1 주사전극 라인들 및 제2 주사전극 라인들을 포함하며, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각은 리셋구간, 어드레스구간, 및 유지방전구간으로 이루어진 플라즈마 디스플레이 패널구동방법에 있어서,
    상기 어드레스구간에서, 상기 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 상기 제1 주사전극 라인들에 순차적으로 주사펄스가 인가된 후, 상기 제2 주사전극 라인들에 순차적으로 주사펄스가 인가되며,
    상기 제2 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 휴지기를 두는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널구동방법.
  2. 어드레스 전극 라인들과, 상기 어드레스 전극 라인들에 교차하는 주사전극 라인들 및 공통전극 라인들을 구비하는 플라즈마 디스플레이 패널에 대하여, 상기 플라즈마 디스플레이 패널을 3개의 부분으로 분할하여 구동하기 위하여 상기 주사전극 라인들은 제1 주사전극 라인들, 제2 주사전극 라인들 및 제3 주사전극 라인들 을 포함하며, 단위 프레임이 시분할 계조 디스플레이를 위한 복수의 서브필드들로 구분되고, 서브필드들 각각은 리셋구간, 어드레스구간, 및 유지방전구간으로 이루어진 플라즈마 디스플레이 패널구동방법에 있어서,
    상기 어드레스구간에서, 상기 어드레스 전극 라인들에 어드레스 데이터 전압이 인가되고, 상기 제1 주사전극 라인들에 순차적으로 주사펄스가 인가된 후, 상기 제2 주사전극 라인들에 순차적으로 주사펄스가 인가되며, 그 다음 상기 제3 주사전극 라인들에 순차적으로 주사펄스가 인가되고,
    상기 제2 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 보조 리셋을 수행하는 단계; 및
    상기 제3 주사전극 라인들에 순차적인 주사펄스가 인가되기 전에 휴지기를 두는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널구동방법.
  3. 제1항 또는 제2항의 방법을 컴퓨터에서 실행시키기 위한 프로그램을 기록한 기록매체.
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