KR100524311B1 - 플라즈마 디스플레이 패널의 구동방법 및 장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 장치 Download PDF

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Abstract

본 발명은 화면을 2 개 이상의 블럭들로 분할 구동하는 경우에 블럭간 휘도차를 최소화하도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널의 구동방법은 한 프레임기간을 어드레스기간과 서스테인기간을 각각 포함하는 다수의 서브필드로 시분할 구동하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 화면을 두 개 이상의 블록들로 분할하는 단계와; 상기 블록들 중 제1 블록에서 어드레스를 행한 후에 제2 블록에서 어드레스를 행하는 단계를 포함하며; 상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 0 보다 크고 5ms 보다 작은 범위 내로 설정되고; 상기 한 프레임 기간 내에서 상기 제 1 블록의 어드레스 기간과 제 2 블록의 어드레스 기간이 일부 중첩되고, 상기 제 1 블록의 서스테인 기간과 상기 제 2 블록의 서스테인 기간이 일부 중첩되며; 상기 제1 서스테인 기간과 제2 블록의 상기 어드레스기간이 중첩된다.

Description

플라즈마 디스플레이 패널의 구동방법 및 장치{METHOD AND APPARATUS FOR DRIVING PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 화면을 2 개 이상의 블럭들로 분할 구동하는 경우에 블럭간 휘도차를 최소화하도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 He+Xe, Ne+Xe, He+Xe+Ne 가스의 방전시 발생하는 자외선에 의해 형광체를 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 크게 향상된 화질을 제공한다. 특히, 3전극 교류 면방전형 PDP는 방전시 표면에 축적된 벽전하를 이용하여 방전에 필요한 전압을 낮추게 되며, 방전에 의해 발생되는 스퍼터링으로부터 전극들을 보호하기 때문에 저전압 구동과 장수명의 장점을 가진다.
도 1을 참조하면, 종래의 3 전극 교류 면방전형 PDP는 n 개의 스캔전극들(Y1 내지 Yn) 및 n 개의 공통서스테인전극들(Z)이 방전공간을 사이에 두고 m 개의 데이터전극들(X1 내지 Xm)에 교차되며, 그 교차부에 m×n 개의 셀들(1)이 형성된다. 인접한 데이터전극들(X1 내지 Xm) 사이에는 수평으로 인접한 셀들(1) 사이의 전기적, 광학적 혼신을 차단하기 위한 격벽(2)이 형성된다.
스캔전극들(Y1 내지 Yn)은 스캔신호가 순차적으로 인가되어 스캔라인을 선택한 후에, 서스테인펄스가 공통으로 인가되어 선택된 셀에 대하여 서스테인방전을 일으킨다. 공통서스테인전극들(Z)은 스캔전극들(Y1 내지 Yn)에 공급되는 서스테인펄스와 교번하는 서스테인펄스가 인가되어 선택된 셀에 대하여 서스테인방전을 일으킨다. 데이터전극들(X1 내지 Xm)은 스캔신호와 동기되는 데이터펄스가 인가되어 셀(1)을 선택하게 된다.
PDP는 화상의 계조를 구현하기 위하여, 한 화면을 구성하는 프레임 기간(NTSC 방식 : 16.67ms)을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간, 스캔라인을 선택하고 선택된 스캔라인에서 셀을 선택하기 위한 어드레스기간 및 방전횟수에 따라 계조를 표현하는 서스테인기간(또는 표시기간)으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임 기간(16.67ms)은 도 2와 같이 8 개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8 개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 리셋기간, 스캔기간 및 표시기간으로 나누어진다. 여기서, 각 서브필드의 리셋기간과 어드레스기간은 각 서브필드마다 동일한 반면에 표시기간은 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
그런데 PDP의 전체 주사라인들(SC1 내지 SCn)을 도 2와 같이 어드레스기간과 서스테인기간이 분리되는 소위 "ADS(Address & Display Seperated)" 방식으로 구동하게 되면 어드레스기간의 증가로 인하여 서스테인기간이 감소되어 고휘도, 고화질로 화상을 표현할 수 없는 문제점이 있다. 여기서, 하나의 주사라인은 동일한 스캔신호에 응답하여 각각 데이터가 공급되는 한 행의 셀들을 포함한다. 예컨대, 주사라인(SC1 내지 SCn) 수와 셀(1) 수의 증가를 수반하는 해상도 증가나 동영상에서 의사윤곽 노이즈(Contour noise)를 줄이기 위하여 서브필드를 추가하는 경우에는 한정된 시간 내에서 비표시기간 특히, 어드레스기간이 길어지게 되어 표시기간인 서스테인기간이 상대적으로 줄어든다.
이러한 구동시간의 부족을 해결하기 위하여, 본원 출원인은 미국특허 US 6,288,693호 등을 통하여 도 1에서 서스테인전극을 스캐닝이 가능한 스캔전극들로 대체하고 화면을 다수의 블록들로 분할하여 블록들 각각에서 스캐닝이 가능하게 함으로써 어드레스기간을 줄이는 방법 및 장치를 제안한 바 있다. 그런데 이 방법 및 장치에 의하면, 다수의 블록들 중에서 어느 하나의 블록은 어드레스기간으로 동작하여 스캐닝이 진행하고 그와 다른 적어도 어느 하나의 블록은 서스테인기간으로 동작하여 서스테인방전이 일어나는 기간이 존재한다. 예컨대, 도 3과 같이 PDP를 두 개의 블록으로 2 분할 구동하는 경우에 상반부 블록이 어드레스기간으로 동작할 때, 이와 동시에 하반부 블록은 서스테인기간으로 동작한다. 이와 같이 일정 기간 동안 동일 화면 내에서 일부가 어드레스기간으로 동작함과 동시에 다른 부분이 서스테인기간으로 동작하면 동일한 한 화면 내에서 휘도차가 나타나는 문제점이 있다.
또한, PDP의 분할 구동방법의 다른 예로써 도 4와 같이 서로 다른 블록들이 동시에 어드레스기간으로 동작하거나 서스테인기간으로 동작하게 하는 방법이 있을 수 있다. 그런데 이 분할 구동방법은 매 프레임마다 발광 중심점이 동일한 시점에서 나타나게 되므로 플리커(Flicker)가 발생되는 문제점이 있다.
따라서, 본 발명의 목적은 화면을 2 개 이상의 블럭들로 분할 구동하는 경우에 블럭간 휘도차를 최소화하도록 한 PDP의 구동방법 및 장치를 제공함에 있다.
상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 PDP의 구동방법은 한 프레임기간을 어드레스기간과 서스테인기간을 각각 포함하는 다수의 서브필드로 시분할 구동하는 PDP의 구동방법에 있어서, 화면을 두 개 이상의 블록들로 분할하는 단계와; 상기 블록들 중 제1 블록에서 어드레스를 행한 후에 제2 블록에서 어드레스를 행하는 단계를 포함하며; 상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 0 보다 크고 5ms 보다 작은 범위 내로 설정되고; 상기 한 프레임 기간 내에서 상기 제 1 블록의 어드레스 기간과 제 2 블록의 어드레스 기간이 일부 중첩되고, 상기 제 1 블록의 서스테인 기간과 상기 제 2 블록의 서스테인 기간이 일부 중첩되며; 상기 제1 서스테인 기간과 제2 블록의 상기 어드레스기간이 중첩된다. 상기 어드레스를 행하는 단계는 상기 제1 블록의 데이터전극들에 데이터 펄스를 인가하는 동안 동시에 상기 제1 블록의 스캔전극들에 스캔펄스를 공급하는 단계와; 상기 제1 블록의 데이터전극들과 분리된 상기 제2 블록의 데이터전극들에 데이터 펄스를 인가하는 동안 상기 제2 블록의 스캔전극들에 스캔펄스를 공급하는 단계를 포함한다. 상기 데이터 펄스는 켜져야 할 온셀을 선택하기 위한 쓰기 데이터 펄스와 꺼져야할 오프셀을 선택하기 위한 소거 데이터 펄스 중 어느 하나이다. 상기 어드레스를 행하는 단계는 선택적 쓰기 서브필드에서 상기 쓰기 데이터 펄스를 상기 데이터전극들에 공급하는 단계와; 선택적 소거 서브필드에서 상기 소거 데이터 펄스를 상기 데이터전극들에 공급하는 단계를 더 포함한다. 상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 최대 휘도 가중치의 서브필드기간보다 작다. 본 발명의 실시예에 따른 PDP의 구동장치는 한 프레임기간을 어드레스기간과 서스테인기간을 각각 포함하는 다수의 서브필드로 시분할 구동하는 PDP의 구동장치에 있어서, 두 개 이상의 블록들로 분할된 PDP와; 상기 블록들 중 제1 블록에서 어드레스를 행한 후에 제2 블록에서 어드레스를 행하는 구동부를 구비하며; 상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 0 보다 크고 5ms 보다 작은 범위 내로 설정되고; 상기 한 프레임 기간 내에서 상기 제 1 블록의 어드레스 기간과 제 2 블록의 어드레스 기간이 일부 중첩되고, 상기 제 1 블록의 서스테인 기간과 상기 제 2 블록의 서스테인 기간이 일부 중첩되며; 상기 제1 서스테인 기간과 제2 블록의 상기 어드레스기간이 중첩된다. 상기 구동부는 상기 제1 블록의 데이터전극들에 데이터 펄스를 공급하는 동안 상기 제1 블록의 스캔전극들에 스캔펄스를 공급하는 제1 구동부와; 상기 제1 블록의 데이터전극들과 분리된 상기 제2 블록의 데이터전극들에 데이터 펄스를 공급하는 동안 상기 제2 블록의 스캔전극들에 스캔펄스를 공급하는 제2 구동부를 구비한다. 상기 PDP의 구동장치는 상기 어드레스에 이어서 상기 블록들 각각에서 서스테인방전을 일으키는 서스테인 구동부를 더 구비한다. 상기 구동부는 선택적 쓰기 서브필드에서 상기 쓰기 데이터 펄스를 상기 데이터전극들에 공급하고; 선택적 소거 서브필드에서 상기 소거 데이터 펄스를 상기 데이터전극들에 공급한다. 상기 구동부는 상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차를 최대 휘도 가중치의 서브필드기간보다 작게 한다. 상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부한 도면들을 참조한 실시예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
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이하, 도 5 내지 도 7을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 5를 참조하면, 본 발명의 제1 실시예에 따른 PDP의 구동방법은 PDP를 상반부 블록(BL1)과 하반부 블록(BL2)의 두 개로 분할 구동하며 상반부 블록(BL1)과 하반부 블록(BL2)의 어드레스 또는 스캐닝을 소정의 시간차(Δt)를 두고 개시하게 된다.
상반부 블록(BL1)과 하반부 블록(BL2) 각각은 1 프레임기간 동안 N 개의 서브필도로 시분할 구동된다. 각 블록들(BL1, BL2)에서의 서브필드의 배치는 도 5와 같이 휘도 가중치가 낮은 서브필드에서 높은 서브필드 순으로 또는 그 역순으로 배치된다. 또한, 각 블록들(BL1, BL2)에서의 서브필드의 배치는 동영상 의사윤곽 노이즈 등의 화질 저하요인을 줄이기 위하여 서브필드들의 휘도 가중치가 불연속적으로 또는 랜덤하게 되도록 서브필드들이 배치될 수도 있다. 또한, 각 블록들(BL1, BL2)에서의 서브필드의 배치는 미국특허 US 6,288,693호에 개시된 바와 같이 짧은 시간 동안 각 서브필드의 어드레스기간들이 집중되고 그 어드레스 집중기간이 블록들(BL1, BL2) 사이에 겹치지 않게 배치할 수도 있다.
본 발명에 따른 PDP의 구동방법에 있어서 서브필드들이 어떠한 방식으로 배치되더라도 한 프레임기간 내에서 적어도 일부 기간 동안 상반부 블록(BL1)과 하반부 블록(BL2)의 어드레스기간과 서스테인기간이 중첩되고 두 블록들(BL1, BL1)의 어드레스 개시시점 또는 스캐닝 개시시점이 소정의 시간차(Δt) 만큼 분리되어야 한다. 어드레스 시간차(Δt)는 두 블록들(BL1, BL2)을 육안으로 동시에 볼 때 두 블록들(BL1, BL2) 간에 휘도차가 나타나지 않는 시간차로 설정된다. 이 어드레스 시간차(Δt)는 0sec 보다 크고 5ms 이하의 시간, 바람직하게는 0sec 보다 크고 2ms 이하의 시간이다. 또한, 어드레스 시간차(Δt)는 휘도 가중치가 가장 높은 서브필드 예컨대 도 5에서 N 번째 서브필드(SFN)의 기간 이내로 설정되어 두 블록들(BL1, BL2) 간에 휘도차가 나타나지 않아야 한다.
본원 출원인은 기출원된 대한민국 특허출원 제10-2000-0012669호, 특허출원 제10-2000-0053214호, 특허출원 제10-2001-0003003호, 특허출원 제10-2001-0006492호, 특허출원 제10-2002-0082512호, 특허출원 제10-2002-0082513호, 특허출원 제10-2002-0082576호 등을 통하여 한 프레임기간 내에 존재하는 서브필드의 일부를 어드레스기간 동안 쓰기방전으로 온셀(On-cell)을 선택함과 아울러 그와 다른 서브필드에서 어드레스기간 동안 소거방전으로 오프셀(Off-cell)을 선택하는 소위 'SWSE(Selective Witing and Selective Erasure) 방식'을 제안한 바 있다. 본 발명에 따른 PDP의 구동방법에 있어서, 한 프레임기간 내의 서브필드 배치는 전술한 SWSE 방식의 서브필드들을 포함할 수 있다. 이 경우, 어드레스기간이 더 줄어들 수 있으므로 고속 구동에 더 유리하다. 또한, 본 발명에 따른 PDP의 구동방법은 어드레스기간 동안 온셀을 선택하는 다수의 서브필드만을 포함하는 선택적 쓰기방식이나 어드레스기간 동안 오프셀을 선택하는 다수의 서브필드만을 포함하는 선택적 소거방식으로 서브필드들이 배치될 수 있다.
도 6은 본 발명의 제1 실시예에 따른 PDP의 구동장치를 나타낸다.
도 6을 참조하면, 본 발명의 제1 실시예에 따른 PDP의 구동장치는 상반부와 하반부 사이에서 데이터전극들(XU1 내지 XUm, XD1 내지 XDm)이 분할된 PDP(60)와, 상반부 블록(BL1)의 데이터전극들(XU1 내지 XUm)에 데이터를 공급하기 위한 제1 데이터 구동부(61A)와, 하반부 블록(BL2)의 데이터전극들(XD1 내지 XDm)에 데이터를 공급하기 위한 제2 데이터 구동부(61B)와, 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(62)와, 서스테인전극들(Z1 내지 Zn)을 구동하기 위한 서스테인 구동부(63)를 구비한다.
PDP(60)에 있어서, 분할된 데이터전극들(XU1 내지 XUn, XD1 내지 XDn)은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z1 내지 Zn)과 교차된다. 이 교차부들에는 셀(101)이 형성된다.
제1 데이터 구동부(61A)는 도시하지 않은 타이밍 제어수단의 제어 하에 상반부 블록(BL1)의 어드레스기간 동안 상반부 블록(BL1)의 데이터전극들(XU1 내지 XUm)에 쓰기 데이터 또는 소거 데이터를 공급한다.
제2 데이터 구동부(61B)는 타이밍 제어수단의 제어 하에 하반부 블록(BL2)의 어드레스기간 동안 하반부 블록(BL1)의 데이터전극들(XD1 내지 XDm)에 쓰기 데이터 또는 소거 데이터를 공급한다. 이 제2 데이터 구동부(60B)는 제1 데이터 구동부(60A)에 의해 첫 번째 데이터가 발생되는 시점부터 소정 시간차(Δt) 뒤에 첫 번째 데이터를 발생한다. 쓰기 데이터는 전술한 선택적 쓰기 방식의 서브필드에서 쓰기 방전에 의해 켜져야 할 온셀을 선택하는 데이터이다. 이에 반하여, 소거 데이터는 전술한 선택적 소거 방식의 서브필드에서 소거 방전에 의해 꺼져야 할 오프셀을 선택하는 데이터이다.
스캔 구동부(62)는 타이밍 제어수단의 제어 하에 상반부 블록(BL1)의 어드레스기간 동안 스캔펄스를 스캔전극들(Y1 내지 Yn/2)에 순차적으로 공급함과 동시에 상반부 블록(BL1)에서 첫 번째 발생되는 최초 스캔펄스로부터 소정 시간차(Δt) 뒤부터 시작되는 하반부 블록(BL1)의 어드레스기간 동안 스캔펄스를 스캔전극들(Yn/2 +1 내지 Yn)에 순차적으로 공급한다. 그리고 스캔 구동부(62)는 상반부 블록(BL1)과 하반부 블록(BL2)의 서스테인기간 동안 서스테인펄스를 스캔전극들(Y1 내지 Yn)에 공급한다.
서스테인 구동부(63)는 타이밍 제어수단의 제어 하에 상반부 블록(BL1)과 하반부 블록(BL2)의 어드레스기간 동안 정극성의 직류 바이어스전압을 서스테인전극들(Z1 내지 Zn)에 공급하고 서스테인기간 동안 스캔구동부(62)와 교대로 동작하여 서스테인펄스를 서스테인전극들(Z1 내지 Zn)에 공급하게 된다.
도 7은 도 6에 도시된 각 구동부(61A, 61B, 62, 63)에 의해 발생되는 구동 파형을 나타낸다. 도 7에 있어서, 리셋기간에 발생되는 초기화파형은 생략된다.
도 7을 참조하면, 상반부 블록(BL1)의 어드레스기간 동안 제1 데이터 구동부(61A)는 상반부 블록(BL1)의 어드레스전극들(XU1 내지 XUn)에 쓰기 또는 소거 데이터(Dp)를 공급하고 스캔 구동부(62)는 상반부 블록(BL1)의 데이터에 동기되는 스캔펄스(Sp)를 제1 내지 제n/2 스캔전극들(Y1 내지 Yn/2)에 순차적으로 공급한다.
상반 부 블록(BL1)에서 첫 번째 데이터펄스(Dp) 및 스캔펄스(Sp)가 발생된 후 소정 시간차(Δt) 뒤에 하반부 블록(BL2)의 어드레스기간이 개시된다. 하반부 블록(BL2)의 어드레스기간 동안 제2 데이터 구동부(62A)는 하반부 블록(BL2)의 어드레스전극들(XD1 내지 XDn)에 쓰기 또는 소거 데이터(Dp)를 공급하고 스캔 구동부(62)는 하반부 블록(BL2)의 데이터에 동기되는 스캔펄스(Sp)를 제n/2 +1 내지 제n 스캔전극들(Yn/2 +1 내지 Yn)에 순차적으로 공급한다.
이렇게 상반부 블록(BL1)과 하반부 블록(BL2)에서 어드레스기간이 중첩되고 그 중첩기간 내에서 적어도 두 개의 라인이 동시에 스캐닝되므로 어드레스기간이 감소된다.
이렇게 상반부 블록(BL1)과 하반부 블록(BL2) 각각에서 어드레스 방전이 일어나게 되어 온셀이나 오프셀이 선택된 후 상반부 블록(BL1)과 하반부 블록(BL2) 각각에서 스캔전극들(Y1 내지 Yn)과 서스테인전극들(Z1 내지 Zn)에 서스테인펄스(sus)가 공급되어 온셀들 내에서 서스테인방전이 일어난다.
한편, 도 5 및 도 7과 달리 하반부 블록(BL2)이 먼저 스캐닝되기 시작하고 소정 시간차 뒤에 하반부 블록(BL1)이 스캐닝될 수도 있다.
본 발명의 실시예에서는 PDP를 상반부와 하반부의 2 개 블록으로 분할 구동하는 예를 중심으로 설명되었지만 이에 국한되지 않고 본 발명에 따른 PDP의 구동방법 및 장치는 어드레스전극을 k 개의 블록 수만큼 분할하여 k 개의 블록들로 분할 구동할 수도 있다.
상술한 바와 같이, 본 발명에 따른 PDP의 구동방법 및 장치는 화면을 2 개 이상의 블럭들로 분할 구동하는 경우에 각 블록들 간의 어드레스 개시시점을 다르게 하여 블록들 사이에 휘도차가 나타나지 않게 하고 각 블록들 사이에서 어드레스기간과 서스테인기간을 중첩시켜 블럭간 휘도차를 최소화할 수 있다. 나아가, 본 발명에 따른 PDP의 구동방법 및 장치는 두 개의 블록들이 시간차 없이 동일하게 구동할 때 나타나는 플리커 등이 예방될 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.
도 1은 종래의 3 전극 교류 면방전형 플라즈마 디스플레이 패널의 전극 배치를 나타내는 평면도이다.
도 2는 종래의 플라즈마 디스플레이 패널의 한 프레임 구성을 나타내는 도면이다.
도 3은 분할 구동의 일예를 나타내는 도면이다.
도 4는 분할 구동의 다른 예를 나타내는 도면이다.
도 5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동방법에 있어서 상반부 블록과 하반부 블록의 한 프레임 구성을 나타내는 도면이다.
도 6은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도이다.
도 7은 도 6에 도시된 구동부에 의해 발생되는 구동신호를 나타내는 파형도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
60 : 플라즈마 디스플레이 패널 61A, 61B : 어드레스 구동부
62 : 스캔 구동부 63 : 서스테인 구동부
101 : 셀

Claims (12)

  1. 한 프레임기간을 어드레스기간과 서스테인기간을 각각 포함하는 다수의 서브필드로 시분할 구동하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    화면을 두 개 이상의 블록들로 분할하는 단계와;
    상기 블록들 중 제1 블록에서 어드레스를 행한 후에 제2 블록에서 어드레스를 행하는 단계를 포함하며;
    상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 0 보다 크고 5ms 보다 작은 범위 내로 설정되고;
    상기 한 프레임 기간 내에서 상기 제 1 블록의 어드레스 기간과 제 2 블록의 어드레스 기간이 일부 중첩되고, 상기 제 1 블록의 서스테인 기간과 상기 제 2 블록의 서스테인 기간이 일부 중첩되며;
    상기 제1 서스테인 기간과 제2 블록의 상기 어드레스기간이 중첩되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 어드레스를 행하는 단계는,
    상기 제1 블록의 데이터전극들에 데이터 펄스를 인가하는 동안 동시에 상기 제1 블록의 스캔전극들에 스캔펄스를 공급하는 단계와;
    상기 제1 블록의 데이터전극들과 분리된 상기 제2 블록의 데이터전극들에 데이터 펄스를 인가하는 동안 상기 제2 블록의 스캔전극들에 스캔펄스를 공급하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 삭제
  4. 제 2 항에 있어서,
    상기 데이터 펄스는 켜져야 할 온셀을 선택하기 위한 쓰기 데이터 펄스와 꺼져야할 오프셀을 선택하기 위한 소거 데이터 펄스 중 어느 하나인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 4 항에 있어서,
    상기 어드레스를 행하는 단계는,
    선택적 쓰기 서브필드에서 상기 쓰기 데이터 펄스를 상기 데이터전극들에 공급하는 단계와;
    선택적 소거 서브필드에서 상기 소거 데이터 펄스를 상기 데이터전극들에 공급하는 단계를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 1 항에 있어서,
    상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 최대 휘도 가중치의 서브필드기간보다 작은 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 한 프레임기간을 어드레스기간과 서스테인기간을 각각 포함하는 다수의 서브필드로 시분할 구동하는 플라즈마 디스플레이 패널의 구동장치에 있어서,
    두 개 이상의 블록들로 분할된 플라즈마 디스플레이 패널과;
    상기 블록들 중 제1 블록에서 어드레스를 행한 후에 제2 블록에서 어드레스를 행하는 구동부를 구비하며;
    상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차는 0 보다 크고 5ms 보다 작은 범위 내로 설정되고;
    상기 한 프레임 기간 내에서 상기 제 1 블록의 어드레스 기간과 제 2 블록의 어드레스 기간이 일부 중첩되고, 상기 제 1 블록의 서스테인 기간과 상기 제 2 블록의 서스테인 기간이 일부 중첩되며;
    상기 제1 서스테인 기간과 제2 블록의 상기 어드레스기간이 중첩되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 제 7 항에 있어서,
    상기 구동부는,
    상기 제1 블록의 데이터전극들에 데이터 펄스를 공급하는 동안 상기 제1 블록의 스캔전극들에 스캔펄스를 공급하는 제1 구동부와;
    상기 제1 블록의 데이터전극들과 분리된 상기 제2 블록의 데이터전극들에 데이터 펄스를 공급하는 동안 상기 제2 블록의 스캔전극들에 스캔펄스를 공급하는 제2 구동부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  9. 제 7 항에 있어서,
    상기 어드레스에 이어서 상기 블록들 각각에서 서스테인방전을 일으키는 서스테인 구동부를 더 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  10. 제 8 항에 있어서,
    상기 데이터 펄스는 켜져야 할 온셀을 선택하기 위한 쓰기 데이터 펄스와 꺼져야할 오프셀을 선택하기 위한 소거 데이터 펄스 중 어느 하나인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  11. 제 10 항에 있어서,
    상기 구동부는,
    선택적 쓰기 서브필드에서 상기 쓰기 데이터 펄스를 상기 데이터전극들에 공급하고;
    선택적 소거 서브필드에서 상기 소거 데이터 펄스를 상기 데이터전극들에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  12. 제 7 항에 있어서,
    상기 구동부는,
    상기 제1 블록의 어드레스 개시부터 상기 제2 블록의 어드레스 개시 사이의 시간차를 최대 휘도 가중치의 서브필드기간보다 작게 하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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