KR100467077B1 - 플라즈마 디스플레이 패널의 소거방법 및 장치 - Google Patents

플라즈마 디스플레이 패널의 소거방법 및 장치 Download PDF

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Abstract

본 발명은 소거방전 이후에 잔류하는 불필요한 벽전하를 최소화하도록 한 플라즈마 디스플레이 패널의 소거방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널의 소거방법 및 장치는 소거신호로 인한 소거방전 이후에 소거신호의 전압을 소거방전시의 전압으로 유지시키게 된다.

Description

플라즈마 디스플레이 패널의 소거방법 및 장치{ERASING METHOD AND APPARATUS OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 소거방전 이후에 잔류하는 불필요한 벽전하를 최소화하도록 한 플라즈마 디스플레이 패널의 소거방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이용하여 형광체를 여기 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 스캔전극(Y) 및 서스테인전극(Z)과, 스캔전극(Y) 및 서스테인전극(Z)과 직교하는 어드레스전극(X)을 구비한다.
스캔전극(Y), 서스테인전극(Z) 및 어드레스전극(X)의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 셀(1)이 형성된다. 스캔전극(Y) 및 서스테인전극(Z)은 도시하지 않은 상부기판 상에 형성된다. 상부기판에는 도시하지 않는 유전체층과 MgO 보호층이 적층된다. 어드레스전극(X)은 도시하지 않은 하부기판 상에 형성된다. 하부기판 상에는 수평으로 인접한 셀들 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하부기판과 격벽 표면에는 진공자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다. 상부기판과 하부기판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 초기화기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간 및 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
초기화기간에 있어서, 셋업기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 방전이 일어난다. 이 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성의 벽전하가 쌓이게 된다. 셋다운기간(SD)에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(Ramp-down)은 셀들 내에 미약한 소거방전을 일으킴으로써 과도하게 형성된 벽전하를 일부 소거시키게 된다. 이 셋다운방전에 의해 어드레스방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스기간에는 부극성 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 이 스캔펄스(scan)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인전극(Z)에는 셋다운기간과 어드레스기간 동안에 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 일어나게 된다. 서스테인펄스(sus)는 방전이 안정화될 수 있도록 그 펄스폭이 2∼3μs 정도이며, 180∼200[V] 정도의 서스테인전압(Vs)을 유지한다. 이 서스테인펄스(sus)가 발생되는 시점 이후로 대략 0.3∼1.0μs 내에서 방전이 일어나게 되며, 그 이후 서스테인전압(Vs)이 유지되는 기간에 다음 방전을 일으킬 수 있는 정도의 벽전하가 셀 내에 형성된다.
서스테인방전이 완료된 후에는 서스테인 방전에 의해 형성된 공간전하 및 벽전하를 소거시키기 위한 소거신호가 스캔전극(Y)이나 서스테인전극(Z)에 공급된다. 이 소거신호는 도 4와 같은 구형파의 세폭소거펄스(rect-ers)나 도 5a 및 도 5b와 같은 램프파형 형태의 소거파형(이하, "램프소거파형"이라 한다)(ramp-ers)이 주로 이용된다. 세폭소거펄스(rect-ers)나 램프소거파형(ramp-ers)은 서스테인펄스가교대로 공급되는 스캔전극(Y)과 서스테인전극(Z) 중 마지막 서스테인펄스(sus)가 인가된 전극에 대향하는 전극에 공급된다. 즉, 스캔전극(Y)에 마지막 서스테인펄스(sus)가 인가되면 세폭소거펄스(rect-ers)나 램프소거파형(ramp-ers)은 서스테인전극(Z)에 인가되며, 서스테인전극(Z)에 마지막 서스테인펄스(sus)가 인가되면 세폭소거펄스(rect-ers)나 램프소거파형(ramp-ers)은 스캔전극(Y)에 인가된다.
그런데, 현재 적용되는 세폭소거펄스(rect-ers)나 램프소거파형(ramp-ers)은 방전특성편차를 고려하지 않거나 소거방전 이후에 공급되는 전압에 의해 추가로 벽전하가 발생하여 셀 내에 잔류하는 문제점이 있다. 이를 상세히 하면, 다음과 같다.
구형파의 세폭소거펄스(rect-ers)는 도 4와 같이 대략 1μs 이내 펄스폭 기간 동안에 서스테인전압(Vs)을 유지한다. 그런데 PDP의 셀들은 셀 내의 물리적 내지 전기적 편차가 존재하기 때문에 방전지연 특성이 다소 차이가 있다. 이 때문에, 구형파의 세폭소거펄스(rect-ers)가 전셀들의 스캔전극(Y)이나 서스테인전극(Z)에 인가되면 방전지연이 짧은 셀에서는 소거방전이 일어나게 되지만 방전지연이 대략 1μs 이상으로 긴 셀에서는 소거방전이 일어나지 않는다. 소거방전이 일어나지 않는 셀은 서스테인방전에 의해 생성된 벽전하가 그대로 잔류하여 다음 서브필드에 영향을 주게 된다.
이에 비하여, 램프소거파형(ramp-ers)은 도 5a와 같이 0V 또는 기저전압(GND)에서 서스테인전압(Vs)까지 상승하는 상승기간이 대략 5μs 이상이고 서스테인전압(Vs)을 유지하는 기간이 대략 5μs 이상이다. 전압이 상승하는 기간동안에 도 5b와 같이 대부분의 셀들은 소거방전이 일어나게 되지만, 서스테인전압(Vs)이 비교적 높고 그 유지기간이 비교적 길기 때문에 소거방전이 일어난 후에 셀 내의 공간전하가 벽전하로 변하여 셀 내의 유전체 상에 축적된다. 이렇게 소거방전 이후에 발생된 벽전하는 다음 서브필드에 영향을 주게 된다. 도 5a는 소거방전이 일어나지 않을 때의 램프소거파형(ramp-ers)을 나타내며, 도 5b는 소거방전이 일어나는 지점에 발생된 방전전류로 인한 램프소거파형(ramp-ers)의 전압강하(51)를 나타낸다.
따라서, 본 발명의 목적은 소거방전 이후에 잔류하는 불필요한 벽전하를 최소화하도록 한 PDP의 소거방법 및 장치를 제공함에 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 256 계조를 구현하기 위한 8 비트 디폴트 코드의 프레임 구성을 나타내는 도면이다.
도 3은 종래의 PDP를 구동하기 위한 구동 파형을 나타내는 파형도이다.
도 4는 종래의 구형파 폭소거펄스를 나타내는 파형도이다.
도 5a는 소거방전이 일어나지 않을 때의 종래의 램프소거파형을 나타내는 파형도이다.
도 5b는 소거방전이 일어날 때의 종래의 램프소거파형을 나타내는 파형도이다.
도 6은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도이다.
도 7은 도 6에 도시된 스캔 구동부 및 서스테인 구동부의 소거신호발생용 스위치를 개략적으로 나타내는 회로도이다.
도 8a는 소거방전이 일어나지 않을 때의 본 발명의 실시예에 따른 램프소거파형을 나타내는 파형도이다.
도 8b는 소거방전이 일어날 때의 본 발명의 실시예에 따른 램프소거파형을 나타내는 파형도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
61 : 타이밍 콘트롤러 62 : 소거 타이밍 콘트롤러
63 : 데이터 구동부 64 : 스캔 구동부
65 : 서스테인 구동부 66 : 구동전압 발생부
S1 : 스위치
상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 PDP의 소거방법은 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스기간, 선택된 셀의 방전을 유지시키기 위한 서스테인기간 및 서스테인방전에 의해 형성된 공간전하 및 벽전하를 소거시키기 위한 소거기간으로 나누어지는 플라즈마 디스플레이 패널의 구동방법에 있어서, 상기 소거기간에 서스테인방전을 교대로 일으키기 위한 제1 및 제2 전극 중 적어도 어느 하나에 램프파 형태의 소거신호를 공급하는 단계와, 상기 소거신호로 인한 소거방전 이후에 상기 소거신호의 전압을 상기 소거방전시의 전압으로 유지시키는 단계를 포함한다.
본 발명의 실시예에 따른 PDP의 소거방법에 있어서, 소거방전시의 전압으로 유지시키는 단계는 미리 저장된 상기 소거방전정보를 독출하는 단계와, 소거방전정보에 응답하여 소거 신호가 공급되는 전극과 전압을 발생하기 위한 전압원 사이의전류패스를 개방시키는 단계를 포함한다.
본 발명의 실시예에 따른 PDP의 소거방법에 있어서, 서스테인전압보다 낮은 전압으로 유지시키는 단계는 소거방전을 감지하는 단계와, 감지된 소거방전에 응답하여 소거 신호가 공급되는 전극과 전압을 발생하기 위한 전압원 사이의 전류패스를 개방시키는 단계를 포함한다.
본 발명의 실시예에 따른 PDP의 소거방법은 소거방전 이후에 소거신호의 전압을 서스테인방전에 필요한 서스테인전압보다 낮은 전압으로 유지하는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 소거방법에 있어서, 전압원은 서스테인전압을 발생하는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 소거장치는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스기간, 선택된 셀의 방전을 유지시키기 위한 서스테인기간 및 서스테인방전에 의해 형성된 공간전하 및 벽전하를 소거시키기 위한 소거기간으로 나누어져 구동되는 플라즈마 디스플레이 패널에 있어서, 상기 소거기간에 서스테인방전을 교대로 일으키기 위한 제1 및 제2 전극 중 적어도 어느 하나에 램프파 형태의 소거신호를 공급하기 위한 소거신호 공급부와, 소거신호로 인한 소거방전 이후에 소거신호의 전압을 소거방전시의 전압으로 유지시키는 소거제어부를 구비한다.
본 발명의 실시예에 따른 PDP의 소거장치 있어서, 소거제어부는 전압을 발생하는 전압원과, 전압원과 전극 사이에 접속된 스위치와, 스위치를 제어하기 위한 스위치제어부를 구비한다.
본 발명의 실시예에 따른 PDP의 소거장치의 스위치제어부는 미리 저장된 소거방전정보를 독출하고 소거방전정보에 응답하여 스위치를 턴-오프시킴으로써 전극과 전압원 사이의 전류패스를 개방시키는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 소거장치에서 있어서, 소거제어부는 전압을 발생하는 전압원과, 방전전류에 따라 소거방전을 감지하는 감지부와, 전압원과 전극 사이에 접속된 스위치와, 감지부로부터의 신호에 따라 스위치를 제어하기 위한 스위치제어부를 구비한다.
본 발명의 실시예에 따른 PDP의 소거장치의 스위치제어부는 감지부로부터의 신호에 응답하여 스위치를 턴-오프시킴으로써 전극과 전압원 사이의 전류패스를 개방시키는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 소거장치는 소거방전 이후에 소거신호의 전압을 서스테인방전에 필요한 서스테인전압보다 낮은 전압으로 유지하는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 소거장치의 전압원은 서스테인전압을 발생하는 것을 특징으로 한다.
이하, 도 6 내지 도 8b를 참조하여 본 발명의 바람직한 실시예들에 대하여 설명하기로 한다.
도 6을 참조하면, 본 발명의 실시예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터 구동부(63)와, PDP의 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(64)와, 공통전극인 서스테인전극(Z)을 구동하기 위한 서스테인 구동부(65)와, 각 전극구동부들(63 내지 65)을 제어하기 위한 타이밍 콘트롤러(61)와, 스캔 구동부(64)와 서스테인 구동부(65)의 소거 타이밍을 제어하기 위한 소거 타이밍 콘트롤러(62)와, 구동전압(Vdata,Vscan,Vs,Vset-up,Vset-down)을 발생하기 위한 구동전압 발생부(66)를 구비한다.
데이터 구동부(63)는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드맵핑회로에 의해 각 서브필드별로 맵핑된 데이터를 타이밍 콘트롤러(61)의 제어 하에 어드레스전극들(X1 내지 Xm)에 동시에 공급하게 된다. 여기서, 데이터전압(Vdata)은 데이터 구동부(63)에 입력되는 데이터의 논리값에 따라 선택된 어드레스전극들(X1 내지 Xm)에 공급된다.
스캔 구동부(64)는 타이밍 콘트롤러(61)의 제어 하에 초기화기간 또는 리셋기간에 셋업전압(Vset-up)까지 상승하는 상승 램프파형과 셋다운전압(Vset-down) 까지 떨어지는 하강 램프파형을 공급하여 전화면의 셀들을 초기화시키게 된다. 또한, 스캔 구동부(64)는 어드레스기간에 스캔전압(Vscan)에서 부극성의 셋다운전압(Vset-down)이나 0V 또는 기저전압(GND)까지 하강하는 스캔펄스를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급한 후, 서스테인 기간 동안 0V 또는 기저전압(GND)에서 서스테인전압(Vs)까지 상승하는 서스테인펄스를 스캔전극들(Y1 내지 Yn)에 동시에 공급하게 된다.
서스테인 구동부(65)는 스캔 구동부(64)와 교대로 동작하여 서스테인 기간 동안 0V 또는 기저전압(GND)에서 서스테인전압(Vs)까지 상승하는 서스테인펄스를 에 동시에 공급하게 된다.
스캔전극 구동부(64)와 서스테인 구동부(65) 중 적어도 어느 하나는 서스테인 방전이 모두 끝난 다음에, 스캔전극들(Y1 내지 Yn)이나 서스테인전극(Z)에 소거방전을 일으키기 위한 램프소거파형을 공급하게 된다. 스캔전극 구동부(64)와 서스테인 구동부(65)로부터 발생되는 램프소거파형은 소거방전이 일어난 후에 0V보다 높고 서스테인전압(Vs)보다 낮은 전압을 유지하게 된다. 램프소거파형을 발생하기 위하여, 스캔전극 구동부(64) 및/또는 서스테인 구동부(65)는 도 7과 같이 구동전압 발생부(66)의 서스테인전압원과 스캔전극(Y1 내지 Yn) 또는 서스테인전극(Z) 사이에 접속된 스위치(S1)를 구비한다. 이 스위치(S1)는 소거제어신호(Ce)에 의해 온/오프(on/off)된다. 램프소거파형이 상승하는 구간에, 스위치(S1)는 온(on) 상태를 유지하여 스캔전극(Y1 내지 Yn) 또는 서스테인전극(Z) 상의 전압이 상승되게 하며 소거방전이 일어나게 되면 논리값이 반전되는 소거 제어신호(Ce)에 응답하여 턴-오프(turn-off)된다. 스위치(S1)가 턴-오프되는 시점부터 일정 기간 동안 스위치(S1)의 출력은 플로팅 상태로 되며, 그에 따라 스캔전극(Y1 내지 Yn) 또는 서스테인전극(Z)은 스위치(S1)의 턴-오프 시점 즉, 소거방전이 일어난 시점의 전압을 유지하게 된다. 소거방전이 일어난 시점에서의 스캔전극(Y1 내지 Yn) 또는 서스테인전극(Z)의 전압은 거의 모든 셀의 소거방전이 램프소거파형의 상승구간 내에서 일어나기 때문에 0V보다 높고 서스테인전압(Vs)보다 낮은 전압이다.
한편, 스위치소자(S1)는 적어도 하나 이상의 MOS-FET소자로 구현된다.
도시하지 않았지만 램프소거파형의 상승기울기는 스캔 구동부(64) 및 서스테인구동부(65) 내에 설치된 저항(R)과 캐패시터(C)의 RC 시정수에 의해 결정된다.
타이밍 콘트롤러(61)는 수직/수평 동기신호(H,V)를 입력받아, 각 전극 구동부(63 내지 65)에 필요한 타이밍 제어신호(Cx,Cy,Cz)를 발생하고, 그 타이밍 제어신호(Cx,Cy,Cz)를 해당 구동부(63 내지 65)에 공급하게 된다.
소거 타이밍 콘트롤러(62)는 스캔 구동부(64) 또는 서스테인 구동부(65)로부터 발생되는 램프소거파형이 소거 방전 후에 서스테인전압(Vs)보다 낮은 전압을 유지하도록 소거제어신호(Ce)를 발생하여 스캔 구동부(64)와 서스테인 구동부(65)를 제어하게 된다. 이 소거 타이밍 콘트롤러(62)는 PDP에 대하여 소거방전을 수십회 일으키고 램프소거파형의 개시시점부터 소거방전이 발생된 시점까지의 기간에 대한 평균으로 산출된 소거방전정보를 저장하고 있으며, 이 소거방전정보에 기초하여 소거제어신호(Ce)를 발생한다. 또한, 소거 타이밍 콘트롤러(62)는 소거 방전시의 방전전류를 감지하여 소거 방전시점을 검출하기 위한 감지회로(도시하지 않음)로부터 인가되는 소거감지신호에 응답하여 소거제어신호(Ce)를 발생할 수도 있다. 이 소거 타이밍 콘트롤러(62)는 타이밍 콘트롤러(61)와 함께 원칩으로 패키지화될 수도 있다.
구동전압 발생부(66)는 데이터전압(Vdata)을 발생하여 그 전압을 데이터 구동부(63)에 공급하고, 스캔전압(Vscan), 서스테인전압(Vs), 셋업전압(Vset-up) 및 셋다운전압(Vset-down)을 발생하여 그 전압들을 스캔 구동부(64)에 공급하게 된다. 그리고 구동전압 발생부(66)는 서스테인전압(Vs)을 서스테인 구동부(65)에 공급한다.
이러한 본 발명의 PDP의 구동장치는 한 프레임기간을 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 PDP를 시분할 구동하게 된다.
도 8a 및 도 8b는 본 발명의 실시예에 따른 램프소거파형(RAMP-ERS)을 나타낸다.
도 8a는 소거방전이 일어나지 않았을 때의 램프소거파형(RAMP-ERS)을 나타내며, 도 8b는 소거방전이 일어날 때의 램프소거파형(RAMP-ERS)을 나타낸다.
도 8a 및 도 8b를 참조하면, 본 발명의 실시예에 따른 램프소거파형(RAMP-ERS)은 스캔전극(Y1 내지 Yn) 또는 공통전극인 서스테인전극(Z)에 공급되며, 스위치(S1)가 온-상태를 유지하는 기간 동안(ton)에 전압이 상승되며, 소거방전이 일어난 후에 스위치(S1)가 턴-오프됨으로써 서스테인전압(Vs)보다 낮은 소거방전전압(Ve)을 유지하게 된다. 도면부호 '81'은 소거 방전이 일어난 후 소거방전전류로 인하여 발생되는 램프소거파형(RAMP-ERS)의 전압강하를 보여준다. 스위치(S1)의 온타임(ton)은 대략 2μs 이상이고, 스위치(S1)의 오프타임(toff)은 대략 5μs 이상이다.
이 램프소거파형(RAMP-ERS)에 의해, 소거방전 후에 셀 내에 인가되는 전압(Ve)이 낮기 때문에 셀 내의 공간전하가 벽전하로 변환되지 않는다. 따라서, 본 발명의 실시예에 따른 램프소거파형(RAMP-ERS)을 서스테인방전이 모두 끝난 다음에, 스캔전극(Y1 내지 Yn)이나 서스테인전극(Z)에 인가하게 되면 소거방전이 안정되게 일어나게 되므로 서스테인방전에 의해 생성된 공간전하 및 벽전하를 소거시킬 수 있게 됨은 물론, 셀 내의 공간전하가 벽전하로 변하게 되는 것을 예방할 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 PDP의 소거방법 및 장치는 소거방전이 일어난 후에 램프소거파형의 전압을 서스테인전압보다 낮게 유지하게 한다. 그 결과, 본 발명에 따른 PDP의 소거방법 및 장치는 소거방전 이후에 잔류하는 불필요한 벽전하를 최소화할 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (12)

  1. 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스기간, 선택된 셀의 방전을 유지시키기 위한 서스테인기간 및 서스테인방전에 의해 형성된 공간전하 및 벽전하를 소거시키기 위한 소거기간으로 나누어지는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 소거기간에 서스테인방전을 교대로 일으키기 위한 제1 및 제2 전극 중 적어도 어느 하나에 램프파 형태의 소거신호를 공급하는 단계와,
    상기 소거신호로 인한 소거방전 이후에 상기 소거신호의 전압을 상기 소거방전시의 전압으로 유지시키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 소거방전시의 전압으로 유지시키는 단계는,
    미리 저장된 상기 소거방전정보를 독출하는 단계와,
    상기 소거방전정보에 응답하여 상기 소거 신호가 공급되는 전극과 전압을 발생하기 위한 전압원 사이의 전류패스를 개방시키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1 항에 있어서,
    상기 서스테인전압보다 낮은 전압으로 유지시키는 단계는,
    상기 소거방전을 감지하는 단계와,
    상기 감지된 소거방전에 응답하여 상기 소거 신호가 공급되는 전극과 전압을 발생하기 위한 전압원 사이의 전류패스를 개방시키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 1 항에 있어서,
    상기 소거방전 이후에 상기 소거신호의 전압은 상기 서스테인방전에 필요한 서스테인전압보다 낮은 전압으로 유지되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 2 항 내지 제 4 항 중 어느 한 항에 있어서,
    상기 전압원은 상기 서스테인전압을 발생하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스기간, 선택된 셀의 방전을 유지시키기 위한 서스테인기간 및 서스테인방전에 의해 형성된 공간전하 및 벽전하를 소거시키기 위한 소거기간으로 나누어져 구동되는 플라즈마 디스플레이 패널에 있어서,
    상기 소거기간에 서스테인방전을 교대로 일으키기 위한 제1 및 제2 전극 중 적어도 어느 하나에 램프파 형태의 소거신호를 공급하기 위한 소거신호 공급부와,
    상기 소거신호로 인한 소거방전 이후에 상기 소거신호의 전압을 상기 소거방전시의 전압으로 유지시키는 소거제어부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  7. 제 6 항에 있어서,
    상기 소거제어부는,
    전압을 발생하는 전압원과,
    상기 전압원과 상기 전극 사이에 접속된 스위치와,
    상기 스위치를 제어하기 위한 스위치제어부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 제 7 항에 있어서,
    상기 스위치제어부는 미리 저장된 상기 소거방전정보를 독출하고 상기 소거방전정보에 응답하여 상기 스위치를 턴-오프시킴으로써 상기 전극과 상기 전압원 사이의 전류패스를 개방시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  9. 제 6 항에 있어서,
    상기 소거제어부는,
    전압을 발생하는 전압원과,
    방전전류에 따라 상기 소거방전을 감지하는 감지부와,
    상기 전압원과 상기 전극 사이에 접속된 스위치와,
    상기 감지부로부터의 신호에 따라 상기 스위치를 제어하기 위한 스위치제어부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  10. 제 9 항에 있어서,
    상기 스위치제어부는 상기 감지부로부터의 신호에 응답하여 상기 스위치를턴-오프시킴으로써 상기 전극과 상기 전압원 사이의 전류패스를 개방시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  11. 제 6 항에 있어서,
    상기 소거방전 이후에 상기 소거신호의 전압은 상기 서스테인방전에 필요한 서스테인전압보다 낮은 전압으로 유지되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  12. 제 6 항 내지 제 11 항 중 어느 한 항에 있어서,
    상기 전압원은 상기 서스테인전압을 발생하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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