KR100323690B1 - 플라즈마 디스플레이 패널의 구동방법 - Google Patents
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Abstract
본 발명은 피디피와 피디피 구동방법에 관한 것으로, Y 전극 라인 중, 일부가 그룹화된 제 1 블록의 Y 전극들에 소정의 스캔펄스의 홀수번째 주기에 차례로 제 1 펄스를 인가하여 제 1 블록에 해당하는 일부영역의 Y 전극과 X 전극 사이에 방전을 일으키는 단계와, Y 전극 라인 중, 제 1 블록을 제외한 일부가 그룹화된 제 2 블록의 Y 전극들에 소정의 스캔펄스의 짝수번째 주기에 차례로 제 1 펄스를 인가하여 제 2 블록에 해당하는 일부영역의 Y 전극과 X 전극 사이에 방전을 일으키는 단계 그리고, 모든 Y 전극 라인에 제 1 펄스가 인가된 후, Y 전극 라인에 제 2 펄스를 인가하여 Y 전극과 Z 전극 사이에 방전을 일으키는 단계를 포함하여 이루어진 것이 특징으로서, 종래의 피디피 구동방법에 비해 스캔데이터를 래치할 수 있는 시간이 충분하여 피디피 구동회로의 동작이 안정화되는 효과가 있다.
Description
본 발명의 플라즈마 디스플레이 패널의 구동방법에 관한 것으로, 특히 유지전극을 구동하기 위한 방법 및 구동회로에 관한 것이다.
플라즈마 디스플레이 패널과 액정표시장치(LCD)는 평판형 표시장치 중에서 가장 실용성이 높은 차세대 표시장치로 각광받고 있다. 특히 플라즈마 디스플레이 패널(이하 피디피 : Plasma Display Panel)은 액정표시장치보다 휘도가 높고 시야각이 넓어 옥외 광고탑 또는, 벽걸이 티브이, 극장용 디스플레이와 같이 박형의 대형 디스플레이로서 응용성이 넓다.
도 1은 일반적인 피디피의 단면구조를 도시한 것으로, 전면 유리기판(1)의 동일면 상에 Y 전극과 Z 전극을 형성하고, 그 Y 전극과 Z 전극 위에 유전층을 인쇄기법으로 형성하며, 유전층(2) 위에 보호층을 증착방식으로 형성한 상부구조와, 그 상부구조의 배면 유리기판(11) 위에 X 전극(12)을 형성하고, X 전극(12) 간에 인접한 셀(cell)과의 누화(crosstalk) 현상을 방지하기 위해 격벽(6)을 형성하며, 격벽(6)과 X 전극(12) 주위에 형광체(8, 9, 10)를 형성한 하부 구조로 구성되어 상부구조와 하부구조의 사이 공간에 불활성 가스를 봉입하여 방전영역(5)을 가지도록 구성된다.
이와 같은 구조에서 먼저, X 전극과 Y 전극 사이에 구동전압을 인가하면 X 전극과 Y 전극 사이에 대향방전이 일어나서 상부구조의 보호층 표면에 벽전하가 발생한다. 그리고, Y 전극과 Z 전극에 서로 극성이 반대인 방전전압을 지속적으로 인가하고 X 전극에 인가되던 구동전압을 차단하면, 벽전하에 의해 Y 전극과 Z 전극 상호간에 소정의 전위차가 유지되어 유전층(2)과 보호층(3) 표면의 방전영역에서 면방전이 일어난다. 그 결과, 방전영역의 불활성 가스로부터 자외선(7)이 발생된다. 이 자외선(7)에 의해 형광체(8, 9, 10)를 여기시키고, 발광된 형광체(8, 9, 10)에 의해 칼라(color) 표시가 이루어진다.
즉, 방전셀(cell) 내부에 존재하는 전자들이 인가된 구동전압에 의해 음극(-)으로 가속하면서, 상기 방전셀 안에 400∼500 torr 정도의 압력으로 채워진 불활성 혼합가스 즉, 헬륨(He)을 주성분으로 하여 크세논(Xe), 네온(Ne) 가스 등을 첨가한 페닝(Penning) 혼합가스와 충돌하여 불활성 가스가 여기되면서 147nm의 파장을 갖는 자외선이 발생한다. 이러한 자외선(7)이 하부전극(12)과 격벽(6) 주위를 둘러싸고 있는 형광체(8, 9, 10)와 충돌하여 가시광선 영역에 발광이 된다.
이러한 피디피는 X 전극과 Y 전극 그리고, Z 전극에 전압의 인가를 제어하여 화소(pixel)를 구성하는 셀(cell)을 방전시키며, 이 방전에 의해 발광된 빛의 양은 셀의 방전시간을 변화시켜 조절한다. 즉, 영상표시를 위해 필요한 계조(grey scale)는 전체영상을 표시하기 위해 필요한 시간(NTSC TV 신호의 경우, 1/30초) 내에서 개개의 셀이 방전되는 시간의 길이를 서로 다르게 하여 구현시킨다. 이 때, 화면의 휘도는 각각의 셀을 최대로 방전되었을 때의 밝기에 의해 결정된다. 또, 피디피 화면의 휘도를 최대로 높이려면, 한 화면을 구성시키기 위해 필요한 시간 내에서 셀의 방전시간을 최대로 길게 유지되어야 한다.
도 2는 구동회로부가 포함된 피디피의 개략적인 구조를 도시한 블록도로서,패널(50)과 X 전극 드라이버(10)와 Y 전극 드라이버(20) 그리고, Z 전극 드라이버(30)를 도시한 것이다. 도 1에 도시된 피디피의 각 셀에 형성된 X 전극(11)은 X 전극 드라이버(10)에 연결되어 어드레스전압(address voltage)을 인가받고, Y 전극(21)은 Y 전극 드라이버(20)에 연결되어 스캔전압(scan voltage)을 인가받으며, Z 전극(31)은 Z 전극 드라이버(30)에 연결되어 서스테인전압(sustain voltage)을 인가받는다.
도 2에 도시된 것과 같이 구성된 피디피 구동회로부의 제어부(40)는 외부로부터 클럭신호와, RGB 데이터, 수직동기신호 및 수평동기신호, 그리고 스캔전압을 출력여부를 제어하는 'BLANK'신호 등, 각종 제어신호들을 입력받아 스캔데이터를 생성하여 Y 전극 드라이버(20)에 인가하고, 어드레스데이터를 생성하여 X 전극 드라이버(10)에 인가한다. 따라서, 각각의 드라이버에 인가된 신호에 따라 X 전극(11)과 Y 전극(21) 및 Z 전극(31)이 구동되어 피디피에 화상이 표시된다.
이 때, 피디피의 Y 전극 드라이버(20)는 피디피의 구동여부를 결정하는 매우 중요한 소자로서, 'BLANK'신호의 입력여부에 따라 스캔전압을 출력여부가 제어된다. 즉, Y 전극 드라이버에 제어부가 'BLANK'신호를 입력하면 Y 전극 드라이버가 스캔전압을 Y 전극으로 출력하지만, Y 전극 드라이버에 제어부가 'BLANK'신호를 입력하지 않으면 Y 전극 드라이버가 스캔전압을 Y 전극으로 출력하지 않는다. 이러한 Y 전극 드라이버의 상세한 구성은 도 3에 도시된 것과 같다.
Y 전극 드라이버는 1비트 씩의 스캔데이터를 소정의 클럭펄스에 따라 각각의 전극라인으로 병렬 전송하는 쉬프트 레지스터(23)와, 쉬프트 레지스터의 스캔 데이터를 계수하여 출력하는 래치부(24)와, 래치부를 통해 출력된 스캔 데이터를 AC 고압펄스에 합성하여 스캔전압을 출력하는 고압펄스 출력부(25)로 구성되어 있다. 이 때, 고압펄스 출력부는 프로그래머블 신호와 선택신호에 따라 스캔데이터의 출력파형을 변경하여 출력할 수 있다. 그리고, 쉬프트 레지스터(23)는 1비트씩 스캔데이터를 25MHz 클럭펄스에 따라 쉬프트하므로, 스캔데이터의 로딩에 필요한 시간은 32비트일 경우에 1.28 마이크로초(㎲)가 소요되고 40비트일 경우에 1.6 마이크로초(㎲)가 소요된다. 쉬프트 레지스터(23)가 쉬프트하는 스캔데이터의 총 개수는 피디피의 수평라인의 개수와 동일하다.
Y 전극 드라이버(20)에서 출력되는 스캔전압의 파형은 도 4에 나타낸 것과 같다. 종래의 피디피 구동회로부는 첫번째 라인의 Y 전극에 스캔펄스(71)가 인가된 시점과 두번째 라인의 Y 전극에 스캔펄스(72)가 인가된 시점 사이에 Y 전극 드라이버의 래치회로에 데이터가 모두 래치되어야 한다. 그 이유를 설명하기 위해 도 1과 도 2 및 도 3을 참조하여 종래의 피디피의 구동에 대하여 언급하면 다음과 같다.
Y 전극 드라이버(20)에서 출력되는 스캔전압은 피디피의 각 방전셀에 방전을 유지시키는 면방전을 일으키므로, 모든 라인에 동시에 인가된다. 그리고, Y 전극 드라이버(20)는 스캔데이터를 참조하여, X 전극 드라이버(10)에서 출력되는 어드레스전압을 인가받는 X 전극(11)과 대향방전을 일으키기 위해 Y 전극(21)에 인가된 스캔전압의 서스테인 펄스(80) 사이에 스캔펄스를 삽입한다.
이 때, Z 전극에 인가되는 서스테인전압은 스캔전압의 서스테인 펄스(80)에 비해 위상이 반대이고 주기가 동일한 펄스이다. 그리고, X 전극(11)에 인가되는 어드레스전압은 Y 전극(21)에 인가된 스캔전압의 스캔펄스에 동기하고 위상이 스캔펄스의 반대인 파형을 가지고 있다. 따라서, 어드레스전압의 펄스와 스캔전압의 스캔펄스의 전압차에 의해 X 전극(11)과 Y 전극(21)이 대향방전을 일으키고, 스캔전압의 서스테인 펄스와 서스테인전압의 전압차에 의해 Y 전극(21)과 Z 전극(31)이 면방전을 일으킨다. 그 후, 스캔전압에 소거펄스(도면미도시)가 인가되면, 면방전이 중단되어 방전셀이 꺼진다.
그런데, 종래의 피디피는 다음과 같은 문제점이 있다.
도 4에 도시된 것과 같이 Y 전극 드라이버는 스캔전압을 모든 Y 전극에 동시에 인가하고, 콘트롤러 IC로부터 입력받은 스캔데이터를 참조하여 새롭게 대향방전을 일으킬 셀의 Y 전극에 스캔펄스(71, 72, 73)를 차례로 인가한다. 그리고, 하나의 라인에 스캔펄스가 인가되면, 그 다음번 주기의 스캔펄스를 인가할 라인을 결정하기 위해서 콘트롤러 IC로부터 새로운 스캔데이터를 다시 입력받아야 한다. 다시 말해, Y 전극 드라이버는 스캔펄스의 발생주기마다 지속적으로 새로운 스캔데이터를 콘트롤러 IC로부터 입력받아야 하는 것이다.
그런데, Y 전극 드라이버(20)는 쉬프트 레지스터(23)와 래치회로(24)로 구성되어 한 라인의 스캔데이터를 입력받으려면, 쉬프트 레지스터(23)가 소정의 클럭신호에 동기하여 콘트롤러 IC(22)로부터 스캔데이터를 1 비트씩 입력받아 한 라인씩 쉬프트시켜 모든 라인의 스캔데이터를 한꺼번에 래치회로(24)에 인가한다. 그리고, 래치회로(24)는 소정의 래치신호에 의해 그 스캔데이터를 고전압펄스발생부(25)로출력한다. 그 후, 고전압펄스발생부(25)가 스캔데이터를 스캔전압으로 변환하여 피디피의 모든 Y 전극에 한꺼번에 인가함으로써, 피디피가 구동되는 것이다.
이 때, 스캔전압에 포함된 각 스캔펄스의 주기(tL)는 1 내지 2 마이크로초(㎲)로서 매우 짧다. 바로 이 시간동안에 Y 전극 드라이버의 래치회로는 모든 Y 전극의 구동에 필요한 한 주기의 스캔데이터를 저장하고 있어야 하는데, 상술한 바와 같이 쉬프트 레지스터(23)는 콘트롤러 IC(40)로부터 스캔데이터를 1 비트씩 입력받으므로, XGA급의 고해상도 화상을 구현하는 피디피는 콘트롤러 IC(40)의 동작속도가 VGA급 이하의 저해상도 화상을 구현하는 피디피에 비해 훨씬 빠르게 동작해야 한다. 이러한 연유로 말미암아 고해상도 화상을 구현하는 피디피는 저해상도 화상을 구현하는 피디피에 비해 스캔펄스의 주기가 훨씬 짧아 스캔데이터를 모두 래치할 시간이 부족해지는 문제점이 있다.
본 발명은 이러한 문제점을 해결하기 위한 것으로, 고해상도 화상을 구현하는 피디피에서 스캔데이터의 래치시간을 충분히 확보할 수 있는 피디피의 구동방법을 제공하는 것이 그 목적이다.
도 1은 일반적인 피디피의 단면구조를 도시한 단면도.
도 2는 구동회로부가 포함된 피디피의 개략적인 구조를 도시한 블록도.
도 3은 상기 도 2의 구동회로부에서 Y 전극 드라이버의 구성을 도시한 블록도.
도 4는 상기 도 2와 도 3의 피디피 구동회로부가 Y 전극라인에 인가하는 구동펄스를 도시한 파형도.
도 5는 본 발명의 구동방법에 의한 Y 전극라인의 구동펄스를 도시한 파형도.
도 6은 상기 도 5의 구동펄스를 Y 전극라인에 인가하는 피디피의 Y 전극구동블록
도 7a는 3 개의 블록으로 구성된 본 발명의 Y 전극라인의 구동블록을 도시한 블록도.
도 7b는 상기 도 7a의 구동블록이 Y 전극라인에 인가하는 구동펄스를 도시한 파형도.
도 8a는 4 개의 블록으로 구성된 본 발명의 Y 전극라인의 구동블록을 도시한 블록도.
도 8b는 상기 도 8a의 구동블록이 Y 전극라인에 인가하는 구동펄스를 도시한 파형도.
도면의 주요부분에 대한 부호의 설명
100 : Y 전극구동회로부 110 : 제 1 구동블록
111 : 제 1 구동블록의 첫번째 Y 전극 120 : 제 2 구동블록
121 : 제 2 구동블록의 첫번째 Y 전극 130 : 제 3 구동블록
131 : 제 3 구동블록의 첫번째 Y 전극 140 : 제 4 구동블록
141 : 제 4 구동블록의 첫번째 Y 전극 200 : X 전극 구동회로부
201 : X 전극 300 : 공통회로부
301 : Z 전극 400 : 패널부
500 : 제어부(콘트롤러 IC)
710 : 제 1 구동블록의 첫번째 스캔펄스
711 : 제 1 구동블록의 두번째 스캔펄스
720 : 제 2 구동블록의 첫번째 스캔펄스
721 : 제 2 구동블록의 두번째 스캔펄스
730 : 제 3 구동블록의 첫번째 스캔펄스
731 : 제 3 구동블록의 두번째 스캔펄스
740 : 제 4 구동블록의 첫번째 스캔펄스
741 : 제 4 구동블록의 두번째 스캔펄스 800 : 서스테인 펄스
본 발명의 피디피 구동방법은 Y 전극 드라이버를 복수개의 블록으로 나누고, 각각의 블록에 별도의 제어신호를 인가하여 스캔전압에 포함된 스캔펄스 주기의 변동없이 스캔데이터의 래치시간을 늘리는 것이 특징이다.
본 발명의 피디피 구동방법은 제 1 블록의 Y 전극에 스캔주기의 홀수번째 주기로 제 1 펄스를 인가하여 피디피 표시영역의 일부에 방전을 일으키는 단계와, 제 2 블록의 Y 전극에 스캔주기의 짝수번째 주기로 제 1 펄스를 인가하여 피디피 표시영역의 일부에 방전을 일으키는 단계, 그리고 모든 Y 전극라인에 제 2 펄스를 인가하여 상기 표시영역의 방전을 유지하는 단계가 포함되어 이루어져 있다.
본 발명의 피디피 구동방법은 도 5에 도시된 파형을 피디피의 각 전극에 인가하여 실시된다.
본 발명에 의해 구동되는 피디피가 도 5에 도시된 파형을 입력받으려면, 본 발명의 피디피는 도 6에 도시된 것과 같이 방전셀이 매트릭스 형태로 형성된 패널(400)과, 패널의 Y 전극라인(111, 121)을 그룹화하여 각각 별개의 구동신호를 인가하는 구동회로부(100)와, 패널의 Z 전극라인(301)에 구동신호를 인가하는 공통회로부(300), 그리고 구동회로부(100)에 제어신호를 인가하는 콘트롤러 IC(20)를 포함하여 구성되어야 한다.
본 발명의 피디피를 이루는 패널(400)은 복수개의 Y 전극라인(111, 121)과 Z 전극라인(301)이 평행하게 형성되어 있고, X 전극라인(201)은 Y 전극라인(111, 121) 또는, Z 전극라인(301)에 직교하도록 형성되어 있다. 도면에는 도시되지 않았지만, 패널은 서로 합착된 상판과 하판으로 구분되어 있고, X 전극라인은 하판에 형성되어 있으며, Y 전극라인과 Z 전극라인은 상판에 형성되어 있다. 그리고, 하판의 X 전극라인과 상판의 Y 전극라인 및 Z 전극라인의 교차부에 방전셀이 형성되어 있다. 이러한 구조는 도 1에 도시된 종래의 피디피의 방전셀과 동일하다.
또, 본 발명의 피디피에 포함된 구동회로부(100)는 복수개의 블록으로서, 최소 2 개 이상의 블록으로 이루어져 있다. 각 블록은 패널에 구성된 Y 전극라인이 m 개씩 그룹화된 것이고, 각 블록은 콘트롤러 IC로부터 'BLANK'신호를 인가받아 동작한다. 즉, 각 블록은 각각 별개의 Y 전극라인을 구동시킨다.
본 발명의 구동회로부(100)의 동작은 다음과 같이 동작한다.
먼저, 콘트롤러 IC로부터 스캔데이터를 모든 블록이 한꺼번에 입력받는다. 그리고, 각 블록 중, 어느 하나의 블록이 콘트롤러 IC로부터 'BLANK'신호를 입력받아 콘트롤러 IC로부터 입력받은 스캔데이터를 스캔전압으로 변환하여 Y 전극라인으로 인가한다.
'BLANK'신호가 입력되지 않은 블록은 스캔데이터를 입력받지만, 스캔전압을 출력하지는 않는다. 즉, 콘트롤러 IC는 'BLANK'신호의 인가여부를 조절하여 각 블록의 스캔전압 출력을 제어한다.
Y 전극라인에 구동신호를 인가하는 구동회로부에 대응하는 공통회로부(300)는 Z 전극라인(301)에 구동신호를 인가하고, 구동회로부(100)의 블록의 개수와 동일한 개수로 그룹화된다. 또, 콘트롤러 IC(500)는 구동회로부(100)의 각 블록에서 구동신호가 발생되도록 구동회로부(100)의 각 블록에 제어신호를 인가한다.
이하, 본 발명의 피디피 구동방법을 첨부된 도 5와 도 6을 참조하여 설명하도록 한다.
그 후, 본 발명의 구동회로부의 제 1 블록(110)은 콘트롤러 IC로부터 'BLANK'신호를 인가받아 첫번째 Y 전극라인(111)부터 m번째 Y 전극라인까지 차례로 스캔펄스를 소정의 주기로 인가한다. 그리고, 동시에 본 발명의 구동회로부의 제 2블록(120)은 콘트롤러 IC로부터 'BLANK'신호를 인가받아 m+1번째 Y 전극라인, 즉 제 2 블록의 첫번째 Y 전극라인(121)부터 2m번째 Y 전극라인까지 차례로 스캔펄스를 인가한다. 이 때, 제 2 블록(120)에 의해 Y 전극라인에 인가되는 스캔펄스(720, 721)의 인가시점은 제 1 블록으로부터 스캔펄스를 인가받는 Y 전극라인의 스캔펄스(710, 711)의 인가시점 사이이다.
즉, 본 발명의 피디피 구동방법은 제 1 블록의 첫번째 Y 전극라인(111)에 스캔펄스(710)를 인가한 후, 제 2 블록의 첫번째 Y 전극라인(121)에 스캔펄스(720)를 인가한다. 그리고, 제 1 블록의 두번째 Y 전극라인에 스캔펄스(711)가 인가된 후, 제 2 블록의 두번째 Y 전극라인에 스캔펄스(721)가 인가된다. 결국, 제 1 블록과 제 2 블록은 각각의 Y 전극라인에 번갈아 스캔펄스를 인가하는 것이다. 그 결과, 스캔펄스가 인가된 Y 전극라인과 어드레스전압이 인가된 X 전극라인 사이의 교차부에 형성된 방전셀이 방전을 일으킨다. 방전셀이 방전을 일으키면, 방전셀 내부의 방전영역에 벽전하가 소거된다.
그리고, 본 발명은 모든 Y 전극라인에 스캔펄스가 인가된 후, 각 Y 전극라인에 서스테인 펄스(800)를 인가하여 Y 전극라인과 Z 전극라인 사이에 방전을 일으킨다. 그 결과, Y 전극라인과 X 전극라인 사이의 방전이 지속적으로 유지된다.
이 때, 제 1 블록의 Y 전극라인에 인가되는 스캔펄스의 주기(tL1)는 제 1 블록의 Y 전극라인에 인가될 스캔데이터의 래치주기이고, 제 2 블록의 Y 전극라인에 인가되는 스캔펄스의 주기(tL2)는 제 2 블록의 Y 전극라인에 인가될 스캔데이터의래치주기이다.
종래의 피디피는 Y 전극라인에 스캔펄스를 인가하는 Y 전극 드라이버 IC가 그룹화되어 있지 않아 모든 Y 전극라인에 하나의 블록이 스캔펄스를 인가했었다. 반면, 본 발명의 피디피는 Y 전극라인을 복수개의 블록으로 그룹화하고, 각각의 블록이 개별적으로 Y 전극라인에 스캔펄스를 인가하므로, 각 Y 전극라인에 인가되는 스캔펄스의 스캔주기(tL1, tL2)가 종래의 피디피의 스캔주기(tL)보다 길어진다. 산술적으로 스캔주기의 변화량은 블록의 개수에 비례한다. 즉, 블록의 개수가 2 개라면, 스캔주기는 종래보다 2 배로 증가한다.
제 1 블록에 연결된 Y 전극라인의 스캔펄스 주기(tL1)와 제 2 블록에 연결된 Y 전극라인의 스캔펄스 주기(tL2)는 동일하지만, 제 1 블록에 연결된 Y 전극라인의 스캔펄스(710, 711) 인가시점은 제 2 블록에 연결된 Y 전극라인의 스캔펄스(720, 721) 인가시점과 다르다. 즉, 제 1 블록의 첫번째 Y 전극라인의 스캔펄스 인가시점과 두번째 Y 전극라인의 스캔펄스 인가시점 사이에 제 2 블록의 첫번째 Y 전극라인에 스캔펄스가 인가되고, 제 2 블록의 첫번째 Y 전극라인의 스캔펄스 인가시점과 두번째 Y 전극라인의 스캔펄스 인가시점 사이에 제 1 블록의 두번째 Y 전극라인에 스캔펄스가 인가된다.
본 발명의 피디피 및 그 구동방법은 Y 전극라인의 구동블록을 반드시 2 개로 나누어야 하는 것은 아니다. 도 7a와 도 7b는 Y 전극라인의 구동블록을 3 개로 나눈 피디피와 구동신호의 펄스를 나타낸 것이고, 도 8a와 도 8b는 Y 전극라인의 구동블록을 4 개로 나눈 피디피와 구동신호의 펄스를 나타낸 것이다.
즉, 본 발명의 구동방법은 m 개의 Y 전극라인으로 그룹화된 n 개의 구동블록을 포함하여 구성된 플라즈마 디스플레이 패널에서 각 블록의 첫번째 Y 전극라인부터 m번째 Y 전극라인에 차례로 스캔펄스를 인가하여 상기 각 블록의 Y 전극라인과 X 전극 사이에 해당하는 방전영역에 방전을 일으키는 단계, 그리고 모든 Y 전극라인에 스캔펄스가 인가된 후에 서스테인펄스를 인가하여 Y 전극과 Z 전극 사이에 방전을 일으키는 단계를 포함하여 이루어진다.
이 때, n 개의 각각의 블록에 연결된 Y 전극라인의 스캔펄스 인가시점은 각각의 블록에서 모두 다르다. 결국, Y 전극라인의 구동블록을 n 개로 나눈 본 발명의 피디피 구동방법은 종래의 피디피 구동방법에 비해 스캔데이터의 래치시간이 n 배로 증가한다.
본 발명은 종래의 피디피 구동방법에 비해 각 Y 전극라인의 스캔펄스 인가주기가 길어 Y 전극 드라이버 IC의 스캔데이터 래치시간이 충분히 확보되는 장점이 있다. 따라서, Y 전극 드라이버 IC의 스캔데이터 래치동작이 안정화되어 Y 전극라인에 인가될 스캔데이터를 Y 전극 드라이버 IC가 정확하게 입력받을 수 있으므로, Y 전극라인에 스캔펄스가 안정적으로 인가시킬 수 있다. 그 결과, 본 발명은 종래의 피디피 구동방법에 비해 피디피의 구동이 안정되는 효과가 있다.
또, 본 발명의 구동방법은 각각의 스캔펄스의 인가시점 간의 시간차이를 줄여 종래보다 많은 Y 전극라인을 구동시킬 수 있다. 즉, 본 발명의 피디피 구동방법은 n번째 Y 전극라인의 스캔펄스 인가시점과 n+1번째 Y 전극라인의 스캔펄스 인가시점 사이의 시간차이를 줄임으로써, Y 전극라인의 스캔펄스 인가동작이 종래보다 빠르게 이루어지므로, 고해상도의 피디피의 구동이 용이해지는 효과가 있다.
Claims (8)
- 플라즈마 디스플레이 패널에서,상기 Y 전극 라인 중, 일부가 그룹화된 제 1 블록의 Y 전극들 중 소정의 홀수번째 Y전극에 차례로 스캔펄스를 인가하여 상기 제 1 블록에 해당하는 일부영역의 Y 전극과 X 전극 사이에 어드레스 방전을 일으키는 단계;상기 Y 전극 라인 중, 상기 제 1 블록을 제외한 일부가 그룹화된 제 2 블록의 Y 전극들 중 소정의 짝수번째 Y전극에 차례로 스캔펄스를 인가하여 상기 제 2 블록에 해당하는 일부영역의 Y 전극과 X 전극 사이에 어드레스 방전을 일으키는 단계; 그리고,상기 모든 Y 전극 라인에 스캔펄스가 인가된 후, 상기 Y 전극 라인에 서스테인펄스를 인가하여 Y 전극과 Z 전극 사이에 서스테인 방전을 일으키는 단계를 포함하여 이루어진 피디피의 구동방법.
- 제 1 항에 있어서, 상기 제 1 그룹의 Y 전극에 인가되는 제 1 스캔펄스의 주기는 제 1 그룹의 모든 Y 전극에 인가될 스캔데이터의 래치주기인 것을 특징으로 하는 피디피의 구동방법.
- 제 1 항에 있어서, 상기 제 2 그룹의 Y 전극에 인가되는 제 1 스캔펄스의 주기는 제 2 그룹의 모든 Y 전극에 인가될 스캔데이터의 래치주기인 것을 특징으로하는 피디피의 구동방법.
- 제 1 항에 있어서, 상기 스캔펄스의 주기는 피디피의 Y 전극라인 중 어느 하나에 스캔펄스가 인가된 시점과, 다른 하나에 스캔펄스가 인가된 시점 사이의 주기인 것을 특징으로 하는 피디피의 구동방법.
- 각각 m 개의 Y 전극라인으로 그룹화된 n 개의 구동블록을 포함하여 구성된 플라즈마 디스플레이 패널에서,상기 모든 Y 전극라인 중에서 상기 각 블록마다 각각 다른 인가시점으로 첫번째 Y 전극라인부터 m번째 Y 전극라인까지 차례로 제 1 스캔펄스를 인가하여 상기 각 블록의 Y 전극라인과 X 전극 사이에 해당하는 방전영역에 어드레스 방전을 일으키는 단계; 그리고,상기 모든 Y 전극 라인에 제 1 스캔펄스가 인가된 후, 상기 모든 Y 전극 라인에 제 2 스캔펄스를 인가하여 Y 전극과 Z 전극 사이에 서스테인 방전을 일으키는 단계를 포함하여 이루어진 피디피의 구동방법.
- 복수개의 Y 전극라인과 Z 전극라인이 서로 평행하게 형성되고 상기 Y 전극라인에 직교하도록 X 전극라인이 형성되어 상기 Y 전극라인과 X 전극라인의 교차부에 방전셀이 형성된 패널;상기 Y 전극라인을 m 개씩 그룹화하여 각각의 그룹에 스캔데이터의 래치 주기만큼 시차를 가지는 스캔펄스를 인가하는 복수개의 구동회로부;상기 Z 전극라인에 서스테인펄스를 인가하는 공통회로부; 그리고,상기 구동회로부 각각에 제어신호를 인가하는 콘트롤러 IC를 포함하여 구성된 플라즈마 디스플레이 패널.
- 제 6 항에 있어서, 상기 구동회로부는 2 개 이상의 그룹으로 이루어진 것을 특징으로 하는 플라즈마 디스플레이 패널.
- 제 6 항에 있어서, 상기 공통회로부는 상기 구동회로부와 동일한 개수의 그룹으로 이루어진 것을 특징으로 하는 플라즈마 디스플레이 패널.
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