KR100297700B1 - 플라즈마 표시 패널의 구동방법 - Google Patents

플라즈마 표시 패널의 구동방법 Download PDF

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Abstract

본 발명에 따른 플라즈마 표시 패널의 구동 방법은, n 개의 공통전극 라인들을 k(k는 2 이상의 정수) 개의 공통전극 그룹들로 분산시키기 위하여, p(p는 1 이상의 정수)번째 공통전극 그룹에

Description

플라즈마 표시 패널의 구동 방법{Method for driving plasma display panel}
본 발명은, 플라즈마 표시 패널의 구동 방법에 관한 것으로서, 보다 상세하게는, 3-전극 면방전 교류 플라즈마 표시 패널을 구동하는 방법에 관한 것이다.
도 1은 일반적인 3-전극 면방전 교류 플라즈마 표시 패널의 구조를 보여준다. 도 2는 도 1의 플라즈마 표시 패널의 전극 라인 패턴을 보여준다. 도 3은 도1의 패널의 한 화소의 또다른 예를 보여준다. 도면들을 참조하면, 일반적인 면방전 플라즈마 표시 패널(1)의 전면 및 배면 글라스 기판들(10, 13) 사이에는, 어드레스전극 라인들(A1, A2, A3, ..., Am-2, Am-1, Am), 유전체층(11 또는 도 3의 141), 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn), 공통전극 라인들(X1, X2, ..., Xn-1, Xn) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스전극 라인들(A1, A2, A3, ..., Am-2, Am-1, Am)은 배면 글라스 기판(13)의 전면에 일정한 패턴으로 도포된다. 형광체(도 3의 142)는, 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn)의 전면에 도포되거나, 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn)의 전면에 유전체층(도 3의 141)이 도포된 경우에는 그 유전체층(141) 위에 도포될 수 있다.
공통전극 라인들(X1, X2, ..., Xn-1, Xn)과 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn)은 어드레스전극 라인들(A1, A2, A3, ..., Am-2, Am-1, Am)과 직교되도록 전면 글라스 기판(10)의 배면에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 화소를 규정한다. 각 공통전극 라인(X1, X2, ..., Xn-1, Xn)과 각 주사전극 라인(Y1, Y2, ..., Yn-1, Yn)은 ITO(Indium Tin Oxide) 전극 라인(도 3의 Xna, Yna)과 금속 재질의 버스 전극 라인(Xnb, Ynb)으로 구성된다. 유전체층(11)은 공통전극 라인들(X1, X2, ..., Xn-1, Xn)과 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn)의 배면에전면 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 일산화마그네슘(MgO)층(12)은 유전체층(11)의 배면에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
이와 같은 플라즈마 표시 패널에 기본적으로 적용되는 구동 방식은, 리셋, 어드레스 및 유지 방전 단계가 단위 서브필드에서 순차적으로 수행되게 하는 방식이다. 리셋 단계에서는 이전(以前) 서브필드에서의 잔여 벽전하들이 소거되고 공간 전하들이 고르게 생성되도록 구동한다. 어드레스 단계에서는 선택된 화소들에서 벽전하들이 형성되도록 구동한다. 그리고 유지 방전 단계에서는 어드레싱 방전 단계에서 벽전하들이 형성된 화소들에서 빛이 발생되도록 구동한다. 즉, 공통전극 라인들(X1, X2, ..., Xn-1, Xn)과 주사전극 라인들(Y1, Y2, ..., Yn-1, Yn) 사이에 상대적으로 높은 전압의 교류 펄스를 인가하면, 벽전하들이 형성된 화소들에서 면 방전을 일으킨다. 이때, 가스층에서 플라즈마가 형성되고, 그 자외선 방사에 의하여 형광체(142)가 여기되어 빛이 발생된다.
여기서, 상기와 같은 기본적 동작 원리를 가진 단위 서브필드들이 단위 프레임에 여러개 포함됨으로써, 각 서브필드의 유지 방전 시간폭들에 의하여 원하는 계조 표시가 수행될 수 있다.
상기와 같은 플라즈마 표시 패널(1)의 구동 방법에 있어서, 종래에는, 상기 리셋 단계에서 모든 공통전극 라인들(X1, X2, ..., Xn-1, Xn)에 상대적으로 높은 방전 전압을 인가함으로써, 이전 서브필드에서 화소들에 형성되었던 벽전하들을 소거하고 공간 전하들을 고르게 생성한다. 그런데, 이와 같은 구동 방법은, 모든 공통전극 라인들(X1, X2, ..., Xn-1, Xn) 주위에서 소거 방전이 일어나므로, 화면의 콘트라스트(Contrast)를 떨어뜨리는 요인이 되고 있다.
본 발명의 목적은, 플라즈마 표시 패널의 콘트라스트를 보다 높일 수 있는 구동 방법을 제공하는 것이다.
도 1은 일반적인 3-전극 면방전 교류 플라즈마 표시 패널의 구조를 보여주는 도면이다.
도 2는 도 1의 플라즈마 표시 패널의 전극 라인 패턴도이다.
도 3은 도 1의 패널의 한 화소의 또다른 예를 보여주는 단면도이다.
도 4는 본 발명의 제1 실시예를 실현하기 위한 구동 장치를 보여주는 블록도이다.
도 5a 및 5b는 본 발명의 제1 실시예에 의하여 도 4의 구동 장치로부터 플라즈마 표시 패널의 각 전극 라인에 인가되는 전압의 파형도이다.
도 6은 본 발명의 제2 실시예를 실현하기 위한 구동 장치를 보여주는 블록도이다.
도 7a, 7b 및 7c는 본 발명의 제2 실시예에 의하여 도 6의 구동 장치로부터 플라즈마 표시 패널의 각 전극 라인에 인가되는 전압의 파형도이다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 표시 패널, 10...전면 글라스 기판,
11, 141...유전체층, 12...일산화마그네슘층,
13...배면 글라스 기판, 14...방전 공간,
142...형광체,
X1, X2, ..., Xn-1, Xn...공통전극 라인,
Y1, Y2, ..., Yn-1, Yn...주사전극 라인,
A1, A2, A3, ..., Am-2, Am-1, Am...어드레스전극 라인,
Xna, Yna...ITO 전극 라인, Xnb, Ynb...버스 전극 라인,
21, 31...제어부, 221..어드레스 구동부,
231, 331...주사 구동부, 241, 341...공통 구동부,
242, 243, 342, 343, 344...공통 출력부,
, ...,...어드레스 구동신호,
...홀수-공통 구동신호,...짝수-공통 구동신호,
, ...,...주사 구동신호,...제1 공통 구동신호,
...제2 공통 구동신호,...제3 공통 구동신호.
상기 목적을 이루기 위한 본 발명의 구동 방법은, 서로 대향 이격된 전면 기판과 배면 기판을 갖고, 상기 전면 및 배면 기판들 사이에 n 개의 공통전극 라인들, n 개의 주사전극 라인들 및 m 개의 어드레스전극 라인들이 정렬되며, 상기 공통전극 라인들과 주사전극 라인들이 서로 나란하게 정렬되고, 상기 어드레스전극 라인들이 상기 주사전극 라인들에 대하여 직교하게 정렬되어, 각 교차점에 상응하는 화소가 규정된 플라즈마 표시 패널을 구동하는 방법이다.
이 방법은, 상기 n 개의 공통전극 라인들을 k(k는 2 이상의 정수) 개의 공통전극 그룹들로 분산시키기 위하여, p(p는 1 이상의 정수)번째 공통전극 그룹에(j는 0 이상의 정수)번째 공통 전극 라인들이 포함되도록 설정하는 단계를 포함한다. 또한, 표시될 단위 프레임이 상기 k 개의 서브필드들로 등분되도록 설정된다. 그리고, 상기 각 서브필드들 중 p번째 서브필드에서 상기 p번째 공통전극 그룹의 라인들에 상대적으로 높은 방전 전압이 인가됨으로써, p-1번째 서브필드에서 상기 화소들에 형성되었던 벽전하들이 소거되고 공간 전하들이 고르게 생성된다.
본 발명의 상기 구동 방법에 의하면, 각 서브필드에서 상응하는 공통전극 그룹의 라인들에만 상대적으로 높은 방전 전압이 인가된다. 이에 따라, 각 서브필드에서 상응하는 공통전극 그룹의 라인들 주위에서만 소거 방전이 일어나므로, 화면의 콘트라스트를 보다 높일 수 있다. 한편, 상기번째 공통전극 라인들이 상기 p번째 그룹에 포함되도록 설정되므로, 방전 공간의 모든 영역에 대하여 균일한 간격으로 소거 방전이 일어난다. 이에 따라, 소거 방전의 효과가 유지되고 플리커가 발생되지 않는다.
이하, 본 발명에 따른 바람직한 실시예들을 상세히 설명한다.
도 4는 본 발명의 제1 실시예를 실현하기 위한 구동 장치를 보여준다. 도 5a 및 5b는 본 발명의 제1 실시예에 의하여 도 4의 구동 장치로부터 플라즈마 표시 패널(1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다.
도 4를 참조하면, 본 발명에 따른 구동 장치는 제어부(21), 어드레스 구동부(221), 공통파형 발생부(232), 주사 구동부(231), 공통 구동부(241), 홀수 공통 출력부(242) 및 짝수 공통 출력부(243)를 포함한다. 플라즈마 표시 패널(1)의 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)은 홀수 공통 출력부(242)의 출력 단자에 공통 연결된다. 플라즈마 표시 패널(1)의 짝수번째 공통전극 라인들(X2, X4, ..., Xn)은 짝수 공통 출력부(243)의 출력 단자에 공통 연결된다. 플라즈마 표시 패널(1)의 각 주사전극 라인(Y1, Y2, ..., Yn-1, Yn)은 주사 구동부(231)의 상응하는 출력단자와 연결된다. 각 어드레스전극 라인(A1, A2, ..., Am-1, Am)은 어드레스 구동부(221)의 상응하는 출력단자와 연결된다.
제어부(21)는 표시데이터 제어부(211)와 패널구동 제어부(212)를 포함하여, 호스트 예를 들어, 노트북 컴퓨터로부터의 클럭 신호(CLK), 데이터 신호(DATA), 수직동기 신호() 및 수평동기 신호()를 입력받는다. 표시데이터 제어부(211)는, 클럭 신호(CLK)에 따라 데이터 신호(DATA)를 내부의 프레임 메모리(201)에 저장하여, 상응하는 어드레스 제어 신호를 상부 및 하부 어드레스 구동부(221, 222)에 입력한다. 수직동기 신호() 및 수평동기 신호()를 처리하는 패널구동 제어부(212)는 주사구동 제어부(202) 및 공통구동 제어부(203)를 포함한다. 주사구동 제어부(202)는 주사 구동부(231)를 제어하는 신호들을 발생시키고, 공통구동 제어부(203)는 공통파형 발생부(232) 및 공통 구동부(24)를 제어하는 신호들을 발생시킨다. 공통 구동부(241)는 각 공통 출력부(242)에 상응하는 구동 제어 신호를 입력시킨다. 이에 따라, 홀수 공통 출력부(242)는 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에 상응하는 구동 신호를 출력하고, 짝수 공통 출력부(243)는 짝수번째 공통전극 라인들(X2, X4, ..., Xn)에 상응하는 구동 신호를 출력한다.
도 5a는 제p(p는 홀수) 서브필드에서 플라즈마 표시 패널(도 4의 1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다. 도 5a에서,, ...,은 어드레스 구동부(도 4의 221)로부터 각 어드레스전극 라인(도 4의 A1, A2, ..., Am-1, Am)에 인가되는 어드레스 구동신호를 가리킨다.는 홀수 공통 출력부(도 4의 242)로부터 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에 인가되는 홀수-공통 구동신호를 가리킨다.는 짝수 공통 출력부(도 4의 243)로부터 짝수번째 공통전극 라인들(X2, X4, ..., Xn)에 인가되는 짝수-공통 구동신호를 가리킨다., ...,은 주사 구동부(도 4의 231)로부터 상응하는 주사전극 라인(Y1, Y2, ..., Yn-1, Yn)에 인가되는 주사 구동신호를 가리킨다.
도 5a를 참조하면, 리셋 주기(a-d)의 b-c 구간에서는, 모든 어드레스전극 라인들(A1, ..., Am)에 정극성 전압 Va가, 모든 주사전극 라인들(Y1, ...., Yn)에 0 [V](볼트)가, 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에 정극성의 소거방전 전압 Vw가, 그리고 짝수번째 공통전극 라인들(X2, X4, ..., Xn)에 정극성의 유지방전 전압 Vs가 각각 인가된다. 이에 따라, 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1) 주위에서만 소거 방전이 수행되어 벽전하들이 상응하는 전극들 주위에 집적된다. 여기서, 짝수번째 공통전극 라인들(X2, X4, ..., Xn)에 인가되는 유지방전 전압 Vs가 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에 인가되는 소거방전 전압 Vw에 비하여 그 극성이 같고 그 레벨이 낮다. 즉, 유지방전 전압 Vs와 소거방전 전압 Vw와의 차이가 상대적으로 낮으므로, 짝수번째 공통전극 라인들(X2, X4, ..., Xn)과 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1) 사이에 방전이 일어나지 않는다. 리셋 주기(a-d)의 c-d 구간에서는, 모든 전극 라인들에 0 [V]가 인가된다. 이에 따라, 전극 라인들에 집적되었던 벽전하들이 자체적 방전에 의하여 소거되고, 공간 전하들이 고르게 생성된다.
어드레스 주기(d-r)의 d-e 구간에서는 어드레스전극 라인들(A1, ..., Am)에 상응하는 어드레스 구동 전압이, 제1 주사전극 라인(Y1)에 주사 구동 전압 -Vy가, 그리고 모든 공통전극 라인들(X1, X2, ..., Xn-1, Xn)에 상대적으로 낮은 정극성 전압 Vax가 각각 인가된다. 이에 따라, 제1 주사전극 라인(Y1)에 대하여, 선택 어드레스 전압 Va가 인가된 어드레스전극 라인들(A1, ..., Am)과의 교차 지점들의 화소들에서 어드레스 방전이 수행되어 벽전하들이 형성된다.
어드레스 주기(d-r)의 d-e 구간과 같은 어드레스 과정은 순차적으로 반복 수행된다. 어드레스 주기(d-r)의 p-q 구간에서는, 어드레스전극 라인들(A1, ..., Am)에 상응하는 어드레스 구동 전압이, 제n 주사전극 라인(Yn)에 주사 구동 전압 -Vy가, 그리고 모든 공통전극 라인들(X1, X2, ..., Xn-1, Xn)에 상대적으로 낮은 정극성 전압 Vax가 각각 인가된다. 이에 따라, 제n 주사전극 라인(Yn)에 대하여, 선택 어드레스 전압 Va가 인가된 어드레스전극 라인들(A1, ..., Am)과의 교차 지점들의 화소들에서 어드레스 방전이 수행되어 벽전하들이 형성된다.
상기와 같이 동작하는 어드레스 주기(d-r)가 종료되면, 선택된 화소들에서의 벽전하 형성이 완료된다. 이에 따라, 이어지는 유지방전 주기(r-v)에서 모든 주사전극 라인들(Y1, ...., Yn)과 모든 공통전극 라인들(X1, X2, ..., Xn-1, Xn) 사이에 유지방전 전압 Vs가 교호하게 인가됨으로써, 어드레스 주기(d-r)에서 벽전하가 형성되었던 화소들에서 유지방전이 수행되어 표시된다. 여기서, 주사전극 라인들(Y1, ...., Yn)에 인가될 공통 신호는 공통파형 발생부(도 4의 232)에 의하여 발생된다. 유지방전 주기(r-v)에서는, 모든 어드레스전극 라인들(A1, ..., Am)에 상대적으로 낮은 선택 어드레스 전압 Va가 인가됨으로써, 유지방전의 효율성이 높아진다.
도 5b는 제p+1(p는 홀수) 서브필드에서 플라즈마 표시 패널(도 4의 1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다. 즉, 도 5a가 홀수번째 서브필드에 대한 구동 파형도이고, 도 5b가 짝수번째 서브필드에 대한 구동 파형도이다. 도 5b에서 도 5a와 동일한 참조부호들은 동일한 기능의 요소들이다. 도 5b를 도 5a와 비교하여 보면, 리셋 주기(a-d)의 b-c 구간에 그 차이점이 있음을 알 수 있다. 즉, 짝수번째 서브필드의 리셋 주기(a-d)의 b-c 구간에서는, 짝수번째 공통전극 라인들(X2, X4, ..., Xn)에 정극성의 소거방전 전압 Vw가, 그리고 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에 정극성의 유지방전 전압 Vs가 각각 인가된다. 이에 따라, 짝수번째 공통전극 라인들(X2, X4, ..., Xn) 주위에서만 소거 방전이 수행되어 벽전하들이 상응하는 전극들 주위에 집적된다. 리셋 주기(a-d)의 c-d 구간에서는, 모든 전극 라인들에 0 [V]가 인가된다. 이에 따라, 전극 라인들에 집적되었던 벽전하들이 자체적 방전에 의하여 소거되고, 공간 전하들이 고르게 생성된다.
상기 제1 실시예를 요약하면, 각 서브필드에서 상응하는 공통전극 그룹의 라인들에만 상대적으로 높은 방전 전압이 인가된다. 이에 따라, 각 서브필드에서 상응하는 공통전극 그룹의 라인들 주위에서만 소거 방전이 일어나므로, 화면의 콘트라스트를 보다 높일 수 있다. 한편, 짝수번째 공통전극 라인들(X2, X4, ..., Xn)과 홀수번째 공통전극 라인들(X1, X3, ..., Xn-1)에서 교호하게 소거방전 전압 Vw가 인가되므로, 방전 공간의 모든 영역에 대하여 균일한 간격으로 소거 방전이 일어난다. 이에 따라, 소거 방전의 효과가 유지되고 플리커가 발생되지 않는다.
도 6은 본 발명의 제2 실시예를 실현하기 위한 구동 장치를 보여준다. 도 7a, 7b 및 7c는 본 발명의 제2 실시예에 의하여 도 6의 구동 장치로부터 플라즈마 표시 패널의 각 전극 라인에 인가되는 전압의 파형을 보여준다.
도 6에서 도 4와 동일한 참조부호들은 동일한 기능의 요소들이다. 도 6을 도 4와 비교하여 보면, 3 개의 공통 출력부들(342, 343, 344)이 있다는 차이점을 알 수 있다. 즉, 제1 공통 출력부(342)는 제1 공통전극 라인들(X1, X4, ..., Xn-2)에 상응하는 구동 신호를 출력하고, 제2 공통 출력부(343)는 제2 공통전극 라인들(X2, X5, ..., Xn-1)에 상응하는 구동 신호를 출력하고, 제3 공통 출력부(344)는 제3 공통전극 라인들(X3, X6, ..., Xn)에 상응하는 구동 신호를 출력한다. 각공통 출력부(342, 343, 344)와 상응하는 공통전극 라인들과의 관계를 상술하면 다음과 같다.
n 개의 공통전극 라인들을 3 개의 공통 출력부(342, 343, 344)로 분산시키기 위하여, 제1 공통 출력부(342)에는(j는 0 이상의 정수)번째 공통 전극 라인들(X1, X4, ..., Xn-2)이 연결되도록 설정한다. 또한, 제2 공통 출력부(343)에는번째 공통 전극 라인들(X2, X5, ..., Xn-1)이 연결되도록 설정한다. 그리고, 제3 공통 출력부(344)에는번째 공통 전극 라인들(X3, X6, ..., Xn)이 연결되도록 설정한다. 이들을 일반화시키면, n 개의 공통전극 라인들을 k(k는 2 이상의 정수) 개의 공통전극 그룹들로 분산시키기 위하여, p(p는 1 이상의 정수)번째 공통전극 그룹에(j는 0 이상의 정수)번째 공통 전극 라인들이 포함되도록 설정된다.
도 7a는 제p 서브필드에서 플라즈마 표시 패널(도 4의 1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다. 도 7a에서 도 5a와 동일한 참조부호들은 동일한 기능의 요소들이다. 도 7a를 도 5a와 비교하여 보면, 3 개의 공통 구동 신호들(,,)이 있다는 차이점을 알 수 있다. 즉, 제p 서브필드의 리셋 주기(a-d)의 b-c 구간에서는, 제1 공통전극 라인들(X1, X4, ..., Xn-2)에 정극성의 소거방전 전압 Vw가, 그리고 나머지 공통전극 라인들(X2, X5, ..., Xn-1및 X3, X6, ..., Xn)에 정극성의 유지방전 전압 Vs가 각각 인가된다. 이에 따라, 제1 공통전극 라인들(X1, X4, ..., Xn-2) 주위에서만 소거 방전이 수행되어 벽전하들이 상응하는 전극들 주위에 집적된다. 리셋 주기(a-d)의 c-d 구간에서는, 모든 전극 라인들에 0 [V]가 인가된다. 이에 따라, 전극 라인들에 집적되었던 벽전하들이 자체적 방전에 의하여 소거되고, 공간 전하들이 고르게 생성된다.
도 7b는 제p+1 서브필드에서 플라즈마 표시 패널(도 4의 1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다. 도 7b에서 도 7a와 동일한 참조부호들은 동일한 기능의 요소들이다. 도 7b를 도 7a와 비교하여 보면, 리셋 주기(a-d)의 b-c 구간에 그 차이점이 있음을 알 수 있다. 즉, 제p+1 서브필드의 리셋 주기(a-d)의 b-c 구간에서는, 제2 공통전극 라인들(X2, X5, ..., Xn-1)에 정극성의 소거방전 전압 Vw가, 그리고 나머지 공통전극 라인들(X1, X4, ..., Xn-2및 X3, X6, ..., Xn)에 정극성의 유지방전 전압 Vs가 각각 인가된다. 이에 따라, 제2 공통전극 라인들(X2, X5, ..., Xn-1) 주위에서만 소거 방전이 수행되어 벽전하들이 상응하는 전극들 주위에 집적된다. 리셋 주기(a-d)의 c-d 구간에서는, 모든 전극 라인들에 0 [V]가 인가된다. 이에 따라, 전극 라인들에 집적되었던 벽전하들이 자체적 방전에 의하여 소거되고, 공간 전하들이 고르게 생성된다.
도 7c는 제p+2 서브필드에서 플라즈마 표시 패널(도 4의 1)의 각 전극 라인에 인가되는 전압의 파형을 보여준다. 도 7c에서 도 7b와 동일한 참조부호들은 동일한 기능의 요소들이다. 도 7c를 도 7b와 비교하여 보면, 리셋 주기(a-d)의 b-c 구간에 그 차이점이 있음을 알 수 있다. 즉, 제p+2 서브필드의 리셋 주기(a-d)의b-c 구간에서는, 제3 공통전극 라인들(X3, X6, ..., Xn)에 정극성의 소거방전 전압 Vw가, 그리고 나머지 공통전극 라인들(X1, X4, ..., Xn-2및 X2, X5, ..., Xn-1)에 정극성의 유지방전 전압 Vs가 각각 인가된다. 이에 따라, 제3 공통전극 라인들(X3, X6, ..., Xn) 주위에서만 소거 방전이 수행되어 벽전하들이 상응하는 전극들 주위에 집적된다. 리셋 주기(a-d)의 c-d 구간에서는, 모든 전극 라인들에 0 [V]가 인가된다. 이에 따라, 전극 라인들에 집적되었던 벽전하들이 자체적 방전에 의하여 소거되고, 공간 전하들이 고르게 생성된다. 여기서, 한 프레임당 3 개의 서브 필드들이 할당되어 있으므로, 이어지는 제p+2 서브필드에서는 제p 서브필드에서와 동일한 방법으로 구동된다.
상기 제2 실시예를 요약하면, 각 서브필드에서 상응하는 공통전극 그룹의 라인들에만 상대적으로 높은 방전 전압이 인가된다. 이에 따라, 각 서브필드에서 상응하는 공통전극 그룹의 라인들 주위에서만 소거 방전이 일어나므로, 화면의 콘트라스트를 보다 높일 수 있다. 한편, 제1 공통전극 라인들(X1, X4, ..., Xn-2), 제2 공통전극 라인들(X2, X5, ..., Xn-1) 및 제3 공통전극 라인들(X3, X6, ..., Xn)에서 연쇄적으로 소거방전 전압 Vw가 인가되므로, 방전 공간의 모든 영역에 대하여 균일한 간격으로 소거 방전이 일어난다. 이에 따라, 소거 방전의 효과가 유지되고 플리커가 발생되지 않는다.
이상 설명된 바와 같이, 본 발명에 따른 구동 방법에 의하면, 각 서브필드에서 상응하는 공통전극 그룹의 라인들에만 상대적으로 높은 방전 전압이 인가된다. 이에 따라, 각 서브필드에서 상응하는 공통전극 그룹의 라인들 주위에서만 소거 방전이 일어나므로, 화면의 콘트라스트를 보다 높일 수 있다. 한편,번째 공통전극 라인들이 p번째 그룹에 포함되도록 설정되므로, 방전 공간의 모든 영역에 대하여 균일한 간격으로 소거 방전이 일어난다. 이에 따라, 소거 방전의 효과가 유지되고 플리커가 발생되지 않는다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.

Claims (3)

  1. 서로 대향 이격된 전면 기판과 배면 기판을 갖고, 상기 전면 및 배면 기판들 사이에 n 개의 공통전극 라인들, n 개의 주사전극 라인들 및 m 개의 어드레스전극 라인들이 정렬되며, 상기 공통전극 라인들과 주사전극 라인들이 서로 나란하게 정렬되고, 상기 어드레스전극 라인들이 상기 주사전극 라인들에 대하여 직교하게 정렬되어, 각 교차점에 상응하는 화소가 규정된 플라즈마 표시 패널을 구동하는 방법에 있어서,
    (1) 상기 n 개의 공통전극 라인들을 k(k는 2 이상의 정수) 개의 공통전극 그룹들로 분산시키기 위하여, p(p는 1 이상의 정수)번째 공통전극 그룹에(j는 0 이상의 정수)번째 공통 전극 라인들이 포함되도록 설정하는 단계;
    (2) 표시될 단위 프레임이 상기 k 개의 서브필드들로 등분되도록 설정하는 단계; 및
    (3) 상기 각 서브필드들 중 p번째 서브필드에서 상기 p번째 공통전극 그룹의 라인들에 상대적으로 높은 방전 전압을 인가함으로써, p-1번째 서브필드에서 상기 화소들에 형성되었던 벽전하들을 소거하고 공간 전하들을 고르게 생성하는 단계를 포함한 구동 방법.
  2. 제1항에 있어서, 상기 각 서브필드가,
    상기 단계 (3)이 수행되는 리셋 주기;
    선택된 화소들에 벽전하들이 형성되게 하는 어드레스 주기, 및
    상기 어드레스 주기에서 벽전하들이 형성된 화소들에 대하여 표시 방전이 수행되게 하는 유지방전 주기를 포함한 구동 방법.
  3. 제1항에 있어서, 상기 p번째 서브필드의 리셋 주기에서,
    상기 p번째 공통전극 그룹에 인가되는 전압의 극성과 같고 그 레벨이 낮은 전압을 상기 p번째 공통전극 그룹이 아닌 공통전극 그룹에 인가하는 구동 방법.
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