KR0176586B1 - 씨디롬 디코더의 외부 메모리 제어 방법 - Google Patents

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Abstract

본 발명은 씨디롬 (CD-ROM : Compact Disk Read Only Memory) 디코더의 제어 방법에 관한 것으로서, 특히 씨디롬 디코더의 디지털 신호처리와 서브코드 저장, 마이컴 인터페이스 등의 기능을 위한 외부 메모리 제어 방법에 관한 것이다.
씨디롬 디코더의 기본 동작이외에 별도의 기능을 수행하기 위해 외부 메모리를 억세스를 할 수 있도록 매스터 클락의 소정의 주기의 제1레벨의 구간에 별도의 기능을 수행하도록 할당하여 외부 메모리의 리프레쉬, 서브코드의 외부 메모리에 저장과 마이컴 데이터의 외부 메모리에 대한 리드/라이트를 수행할 수 있도록 한다.
본 발명에 따른 씨디롬 디코더의 외부 메모리 제어 방법은 매스터 사이클의 소정의 주기의 구간에 할당된 리프레쉬와 서브코드 저장, 마이컴데이터 리드/라이트의 수행을 우선순위에 따라 할당하여 수행시킴으로써, 씨디롬의 버퍼링이나 에러정정, 호스트에 픽업 데이터를 전송시에 처리속도에 영향없이 다양한 기능을 추가시킬 수 있다.

Description

씨디롬 디코더의 외부 메모리 제어 방법
제1도는 일반적인 씨디롬 디코더를 설명하기 위한 블록도이다.
제2도는 제1도에 도시된 씨디 제어부와 씨디 디코더부에서 변환되는 데이터 포맷도이다.
제3도는 본 발명에 따른 외부 메모리 제어 장치를 도시한 블록도이다.
제4도는 제3도에 도시된 외부 메모리의 데이터 영역을 도시한다.
제5도는 본 발명에 따른 외부 메모리 제어 방법을 설명하기 위한 타이밍도이다.
제6도는 본 발명에 따른 외부 메모리 억세스 제어 블록도이다.
본 발명은 씨디롬 (CD-ROM : Compact Disk Read Only Memory) 디코더의 제어 방법에 관한 것으로서, 특히 씨디롬 디코더의 디지털 신호처리와 서브코드 저장, 마이컴 인터페이스 등의 기능을 위한 외부 메모리 제어 방법에 관한 것이다.
종래의 씨디롬 디코더는 기본 동작인 에러 정정이나 외부 메모리에 데이터의 저장, 호스트와 외부 메모리와의 데이터 송수신을 위한 구간 중에 외부 메모리에 대한 리프레쉬 사이클, 서브코드의 저장과 마이컴 데이터의 리드와 라이트를 위한 수행 구간을 별도로 할당되지 못하여 외부 메모리를 DRAM으로 적용하거나 외부 메모리의 억세스를 위한 다양한 기능을 제공하기가 곤란하였다.
본 발명은 상기 문제점을 해결하기 위해 창안한 것으로서, 씨디롬 디코더의 기본 동작인 에러정정이나 버퍼링, 호스트 동작 등에 영향을 미치지 않고 기타의 동작 즉, 서브코드의 저장, 마이컴 데이터의 리드 라이트, 외부 메모리가 디램메모리일 경우 리프레쉬 싸이클 등을 원활히 수행하기 위한 씨디롬 디코더 외부 메모리 제어 방법을 제공하는 데 목적이 있다.
픽업된 씨디롬 데이터를 마이컴의 제어에 의해 호스트에 전송하며 외부 메모리를 갖는 씨디롬 장치에서 한 주기에 1 바이트 단위로 전송하는 바이트 클락과 상기 바이트 클락의 주기에 동기되어 각 명령의 수행구간이 할당된 매스터 클락을 형성하는 씨디롬 디코더의 외부 메모리 제어 방법에 있어서, 상기 바이트 클락 1주기 마다 상기 매스터 클락을 복수의 주기로 상응시켜 출력시키고 상기 매스터 클락의 한주기의 제1레벨의 구간에 버퍼링 수행을 할당하며, 상기 매스터 클락의 다른 주기의 각 제1레벨의 구간에 에러정정 수행을 할당하고, 상기 매스터 클락의 제1레벨과 상보적인 레벨의 구간에 상기 호스트에 픽업된 데이터의 전송을 위하여 할당하며, 상기 매스터 클락의 또 다른 한 주기의 제1레벨의 구간에 상기 외부 메모리의 리프레쉬 수행 및 서브코드 저장, 마이컴과의 리드/라이트를 위해 할당함을 특징으로 한다.
이하 본 발명의 이해를 돕기 위하여 씨디롬 디코더의 동작을 설명하기로 한다.
제1도는 일반적인 씨디롬 디코더를 설명하기 위한 블록도이다.
제2도는 제1도에 도시된 씨디 제어부와 씨디 디코더부에서 변환되는 데이터 포맷도이다.
제1도에서 씨디 제어부(100)는 서보제어 마이컴(102), 서보부(104), 픽업부(106), 이퀄라이저부(108), 제1신호처리부(110)를 포함한다. 또한 씨디 디코더부(114)는 씨디롬 제어마이컴(116), 제2신호처리부(118), 호스트인터페이스부(120), 외부 메모리부(122)를 포함한다.
서보제어 마이컴(102)의 제어에 의해 서보부(104)는 픽업부(106)를 제어하여 미도시된 광디스크에서 채널 데이터를 픽업한다. 픽업된 채널 데이터는 제2도에 도시된 EFM(Eight-to-Fourteen Modulation)신호의 588 채널 비트를 읽어 한 프레임으로 구성된다. 이퀄라이저부(108)는 픽업된 데이터를 이퀄라이즈하여 제1신호처리부(110)에 출력한다. 제1신호처리부(110)는 동기신호, 접속비트, 서브코드 등의 신호를 제외하고 EFM 데이터를 복조하여 서브코드 8비트와 CD 데이터 32바이트를 얻는다.
제1신호처리부(110)는 유입된 32바이트 단위로 CD 데이터를 CIRC(Cross-Interleave Reed-Solomon Code) 에러 정정을 하여 최종 데이터 24바이트를 생성한다. 만약, 픽업된 데이터가 오디오 데이터이면 한 프레임당 좌우(L,R)채널을 각 16 비트씩 1 워드로 하여 12 워드를 구성한다. 상기 12워드의 오디오 데이터는 미도시된 오디오 신호처리부로 출력하며, CIRC 에러 정정된 데이터가 씨디롬 데이터이면 한 프레임당 24 바이트를 구성하여 씨디 디코더부(114)로 출력한다.
씨디 제어부(100)에서 처리된 씨디롬 데이터는 바이트 단위로 씨디 디코더부(114)에 출력된다. 씨디 디코더부(114)의 제2신호처리부(118)는 한 프레임에 24 비트로 조합된 데이터로 98 프레임으로 구성한다. 또한, 2352 바이트의 98 프레임은 외부 메모리(122) 내에서 씨디롬 한 블록을 구성한다. 따라서, 씨디 디코더부(114)의 제2신호처리부(118)는 2352 바이트 단위로 씨디롬 블록들을 외부 메모리(122)에 저장하여 신호처리한다. 씨디롬 블록들은 처음 12 바이트가 동기 데이터 패턴으로 조합되어 블록간을 구분하여 신호처리된다.
씨디 디코더부(114)의 제2신호처리부(118)에서 디지털 신호처리과정을 거친 후 순수 사용자 데이터인 2048 바이트는 호스트인터페이스(120)을 통하여 미도시된 호스트로 전송된다.
종래의 씨디롬 디코더는 기본 동작이외에 별도로 외부 메모리(122)를 억세스하여 다른 기능을 수행하기 위한 매스터 클락상에서의 구간이 별도로 할당되어 있지 않기 때문에 외부 메모리(122)를 억세스하는 리프레쉬나 마이컴의 리드, 라이트와 서브코드의 저장 등을 수행하지 못하는 문제점이 있었다.
제3도는 본 발명에 따른 외부 메모리 제어 장치를 도시한 블록도이다.
제3도에서 씨디 제어부(100)와 인터페이스를 위한 씨디제어 I/F부(302)는 바이트 단위로 유입되는 픽업 데이터를 바이트 클럭에 맞추어 씨디 디코더부(114)로 출력한다.
상기 바이트 단위의 데이터는 각 동기부(306), 디스크램블부(308)로 유입되어 씨디롬 제1블록의 동기 패턴을 검출하고, 동기 패턴 이후의 2340 바이트에 대해 디스크램블을 수행한다. 디스크램블 처리된 데이터를 외부 메모리부(320)에 저장하는 버퍼링의 동작은 씨디롬 블록 데이터 단위로하여 외부 메모리부(320)에 저장하며, 현재 저장하고 있는 블록 이전에 저장된 블록에 대해 순차적으로 에러정정을 수행한다. 또한, 에러정정 과정을 거친 씨디롬 블록 데이터는 미도시된 호스트로 전송된다. ECC(Error Correction Code)부(312), EDC(Error Detection Code)부(314)와 헤더레지스터(316)부에서 픽업된 데이터의 에러정정을 수행하고, 호스트 I/F부(318)는 픽업된 데이터를 미도시된 호스트에 전송하기 위해 호스트를 인터페이스한다.
서브코드부(310)는 씨디 제어부(100)에서 생성된 서브코드 데이터를 외부 메모리부(320)에 저장하고, CPU I/F부(304)는 상기 각 블록(306 내지 316)과 씨디롬 제어마이컴(116)을 인터페이스한다. 씨디롬 제어마이컴(116)은 상술된 각 부(306 내지 316)를 제어하며, 또한 외부 메모리부(320)상에 제어마이컴 데이터의 리드와 라이트를 수행한다.
제4도는 제3도에 도시된 외부 메모리의 데이터 영역을 도시한다.
외부 메모리는 씨디롬 데이터 영역(410), 마이컴 데이터 영역(420), 서브코드 데이터 영역(430)으로 할당된다. 여기서, 씨디롬 데이터 영역(410)내의 씨디롬 블록 데이터들은 각각 2352 바이트를 포함한다.
현재 처리되고 있는 데이터블록 번호에 맞추어 생성된 어드레스로 외부 메모리(332)를 억세스한다. 씨디롬 블록 데이터의 어드레스를 생성하기 위해 씨디롬 제어마이컴(116)에 의해 블록 포인터 즉, 씨디롬 블록 데이터의 번호가 지정되고 상기 블록 데이터의 오프셋 어드레스를 역시 지정 받은 다음 블록포인터에 한 블록 사이즈를 승산한 다음 오프셋 어드레스에 가산하여 물리(Physical) 어드레스를 생성하게 된다. 또한 서브코드인 경우 역시 블록포인터에 한 서브코드 블록 사이즈를 승산한 다음 오프셋 어드레스에 가산하여 어드레스를 생성한다.
씨디롬 마이컴 영역(420)은 씨디롬 제어마이컴(116)에 의해 직접 물리 어드레스가 할당되어 억세스된다. 또한, 서브코드는 서브코드데이터 영역(430)에 저장된다.
제5도는 본 발명에 따른 외부 메모리 제어 방법을 설명하기 위한 타이밍도이다.
바이트 클락(BTCK)의 1주기 마다 1 바이트씩 출력되어 입력된 바이트가 2352 바이트가 되면 하나의 씨디롬 블록 데이터가 구성된다. 외부 메모리를 억세스하는 동작은 버퍼링, 에러정정, 호스트에 픽업데이터의 전송, 서브코드 저장, 씨디롬 제어마이컴의 리드/라이트 수행과 DRAM 메모리일 경우 리프레쉬 사이클이 있다. 상기 열거된 각 동작이 다른 동작과 무관하게 외부 메모리를 억세스하기 위해 바이트 클락(BTCK) 1주기에 매스터 클락(MCK) 6주기를 대응시켜 출력한다.
매스터 클락 하이 레벨 구간을 호스트 동작에 할당하고, 매스터 클락의 3,4,5,6 주기의 로우(LOW) 레벨 구간에 에러정정 동작을 할당하고 매스터 클락의 첫 번째 로우 레벨 구간을 버퍼링 동작에 할당한다. 그리고 두 번째 매스터 클락의 로우 레벨구간에 리프레쉬 사이클, 서브코드 라이트 동작, 마이컴의 외부 메모리 리드/라이트 동작의 3가지 동작이 사전에 설정된 우선순위로 수행 구간을 할당하여 외부 메모리를 억세스하게 된다. 여기서, 매스터 클락의 로우와 하이레벨의 구간은 각레벨이 반전된 구간으로하여 각 동작에 따라 할당될 수도 있다.
제6도는 본 발명에 따른 외부 메모리 억세스 제어 블록도이다.
제6도의 제어 블록도 구성은 어드레스생성부(600), 우선순위 제어부(610), 타이밍 제어부(620), 외부 메모리제어부(630), 멀티플렉서(640), 외부 메모리(650)를 포함한다.
어드레스 생성부(600)는 각 동작 수행에 따라 외부 메모리(650)를 억세스하기 위한 어드레스를 생성하는 버퍼링어드레스부(601), ECC어드레스부(602), 호스트어드레스부(603), 서브코드어드레스부(604), 마이컴어드레스부(605)를 포함한다.
우선순위 제어부(610)로부터 출력된 제어신호에 따라 멀티플렉서(640)는 버퍼링과 ECC, 호스트, 서브코드, 마이컴억세스를 위한 어드레스를 선택하여 외부 메모리(650)에 출력한다. 또한 우선순위 제어부(610)의 제어신호를 유입한 외부 메모리제어부(630)는 외부 메모리(650)의 제어신호를 출력하여 외부 메모리(650)를 제어한다.
버퍼링 어드레스부(601)는 씨디 제어부(100)에서 출력된 데이터를 유입하여 동기 패턴 검출과 디스크램블링을 거친 데이터를 외부 메모리(650)에 저장하기 위해 어드레스를 생성하고, 에러정정 어드레스부(602)는 씨디 디코더부(114)의 에러정정을 위한 어드레스를 생성한다. 호스트 어드레스부(603)는 미도시된 호스트로부터 데이터 전송요구에 의해 외부 메모리의 데이터를 읽어내기 위한 어드레스를 생성하며, 서브코드 어드레스부(604)는 씨디 제어부(100)에서 생성된 서브코드 데이터를 서브코드 블록 단위로 외부 메모리에 저장하기 위한 어드레스를 생성하며 마이컴 어드레스부(605)는 씨디롬 제어마이컴(116)이 직접 외부 메모리(650)에 데이터를 읽고 쓰기 위한 어드레스를 생성한다. 우선순위 제어부(610)는 리프레쉬 사이클, 서브코드 저장 명령, 마이컴 동작이 동시에 발생했을 경우 이를 제어하며, 우선 순위는 리프레쉬 사이클, 서브코드 저장, 마이컴 동작순으로 한다. 외부 메모리제어부(630)는 타이밍 제어부(620)에서 생성된 클락신호에 동기되어 메모리 제어용 신호를 생성하는 블록이다.
우선순위 제어부(610)는 외부에서 서브코드의 저장이나 마이컴 데이터의 메모리 억세스 주기가 매우 길기 때문에 현재 주어진 구간이 리프레쉬 사이클이면 먼저 다른 동작에 무관하게 리프레쉬 동작을 우선 수행될 수 있도록 제어하며, 다음으로 마이컴 제어와 서브코드 저장이 동시에 요구될 경우에는 서브코드를 먼저 저장한 다음 마이컴 동작을 수행하도록 우선순위를 제어한다.
상기와 같이 각 생성된 어드레스는 제5도에 도시된 타이밍도에서와 같이 각 동작 별로 주어진 구간에 따라 해당 어드레스는 멀티플렉서(640)에 의해 선택되어 외부 메모리(650)를 억세스한다.
상술한 바와 같이 본 발명에 따른 씨디롬 디코더의 외부 메모리 제어 방법은 매스터 사이클의 소정의 주기 구간에 할당된 리프레쉬와 서브코드 저장, 마이컴데이터 리드/라이트의 수행을 우선순위에 따라 할당하여 수행시킴으로써, 씨디롬의 버퍼링이나 에러정정, 호스트에 픽업 데이터를 전송시에 처리속도에 영향없이 다양한 기능을 추가시킬 수 있다.

Claims (2)

  1. 픽업된 씨디롬 데이터를 마이컴의 제어에 의해 호스트에 전송하며 외부 메모리를 갖는 씨디롬 장치에서 한 주기에 1 바이트 단위로 전송하는 바이트 클락과 상기 바이트 클락의 주기에 동기되어 각 명령의 수행구간이 할당된 매스터 클락을 형성하는 씨디롬 디코더의 외부 메모리 제어 방법에 있어서, 상기 바이트 클락 1주기 마다 상기 매스터 클락을 복수의 주기로 상응시켜 출력시키고 상기 매스터 클락의 한주기의 제1레벨의 구간에 버퍼링 수행을 할당하며, 상기 매스터 클락의 다른 주기의 각 제1레벨의 구간에 에러정정 수행을 할당하고, 상기 매스터 클락의 제1레벨과 상보적인 레벨의 구간에 상기 호스트에 픽업된 데이터의 전송을 위하여 할당하며, 상기 매스터 클락의 또 다른 한 주기의 제1레벨의 구간에 상기 외부 메모리의 리프레쉬 수행 및 서브코드 저장, 마이컴과의 리드/라이트를 위해 할당함을 특징으로 하는 씨디롬 디코더의 외부 메모리 제어 방법.
  2. 제1항에 있어서, 상기 매스터 클락의 상기 또 다른 한주기의 제1레벨의 구간에서 외부 메모리의 억세스가 동시에 요구될 때는 상기 매스터 클락의 해당 주기의 로우 레벨 마다 리프레쉬 사이클, 서브코드 저장, 마이컴 리드/라이트 순위로 순차적으로 수행함을 특징으로 하는 씨디롬 디코더의 외부 메모리 제어 방법.
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