JP3564910B2 - データ再生装置及びデータ再生方法 - Google Patents
データ再生装置及びデータ再生方法 Download PDFInfo
- Publication number
- JP3564910B2 JP3564910B2 JP34424096A JP34424096A JP3564910B2 JP 3564910 B2 JP3564910 B2 JP 3564910B2 JP 34424096 A JP34424096 A JP 34424096A JP 34424096 A JP34424096 A JP 34424096A JP 3564910 B2 JP3564910 B2 JP 3564910B2
- Authority
- JP
- Japan
- Prior art keywords
- data
- buffer memory
- error correction
- error
- ring buffer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【0001】
【発明の属する技術分野】
この発明は、例えば、DVD(Digital Video Disc)で可変レート再生を行うのに用いて好適なデータ再生装置及びデータ再生方法に関する。
【0002】
【従来の技術】
波長の短いレーザ光を使用するとともに開口数の大きい対物レンズを使用することにより大量のデータ記録を可能とした光ディスク(DVD)が開発されている。DVDには、例えばMPEG(Moving Picture Experts Group)2の規格で圧縮されたディジタルビデオ信号を記録するのに用いられる。また、DVDは、大容量のデータを記録するデータ記録媒体としても期待されている。
【0003】
DVDの記録データを再生する再生装置において、可変レート対応とされたものが提案されている。このような可変レート対応の再生装置では、リングバッファメモリが設けられている。リングバッファメモリは、基本的に、図16に示すように構成されている。
【0004】
図16に示すように、リングバッファメモリは、終端アドレスまで進むと先頭アドレスに戻るようなアドレス構成とされている。すなわち、図16のように、アドレスが「0」から「11」の場合には、アドレス「0」,「1」,「2」,・・・と進められ、アドレス「11」に達すると、次にアドレス「0」に戻り、再び、「1」,「2」,・・・と進められていく。このようなリングバッファメモリは、具体的には、FIFOで構成されている。
【0005】
書き込みポインタWPは、書き込みが終了したアドレスを示すものである。ECC終了ポインタは、エラー訂正処理が完了したアドレスを示すものである。読み出しポインタRPは、読み出しが終了したアドレスを示すものである。図示の場合、書き込みポインタWPがアドレス「11」の位置にあるので、アドレス「11」のところまで、データが書き込まれている。ECC終了ポインタEPがアドレス「9」の位置にあるので、アドレス「9」のところまでエラー訂正処理が終了している。読み出しポインタRPがアドレス「2」の位置にあるので、アドレス「2」のところまで書き込みが終了している。したがって、アドレス「3」〜「9」にエラー訂正処理が終了し、読み出し可能なデータが位置され、アドレス「0」〜「2」に、既に読み出されて不要となったデータが位置され、アドレス「10」,「11」に新しく書かれたデータが位置される。
【0006】
上述のリングバッファメモリでは、読み出しポインタRPがECC終了ポインタEPを追い越さないようにする必要がある。また、ECC終了ポインタEPが書き込みポインタWPを追い越さないようにする必要がある。なお、書き込みポインタWPが読み出しポインタRPに追いついたときには、復調データの書き込みが一時停止される(オーバーフロー制御)。
【0007】
このようなリングバッファメモリが設けられ、可変レート対応とされたデータ再生装置の構成としては、図17〜図19に示すようなものが考えられる。
【0008】
図17において、復調回路101からは、光ディスクの再生信号の復調データが出力される。この復調データは、先ず、リングバッファメモリ102に蓄えられる(アクセスe)。リングバッファメモリ102に1ECCブロック分のデータが蓄えられたら、図18に示すように、リングバッファメモリ102に蓄えられたデータは、エラー訂正処理回路103に転送され、エラー訂正処理が行われる。エラー訂正処理は、先ず、PI系列の処理が行われ(アクセスf1)、P0系列の処理が行われ(アクセスf2)、再度のPI系列の処理が行われる(アクセスf3)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、データの転送が可能になる。出力のリクエストに応じて、図19に示すように、エラー訂正処理の終了したデータがリングバッファメモリ102から読み出され、この読み出されたデータは、デスクランブル及びエラー検出回路104でデスクランブルされ、インターフェース106を介して、外部のホストコンピュータ105に転送される(アクセスg)。
【0009】
【発明が解決しようとする課題】
可変レート対応のディスク再生装置において、ホストコンピュータとの間を例えばATAPIインターフェースで結び、ATAPIインターフェースの転送レート(16.6MB/s)でデータを転送することが考えられている。更に、ディスクの読み出しを、通常の2倍速で読み出すことが考えられている。
【0010】
ところが、上述の従来のデータ再生装置では、リングバッファメモリ102が可変レート制御と、エラー訂正符号化処理とに用いられているため、リングバッファメモリ102に対するアクセスが多く発生し、このような要求に応えることが困難である。
【0011】
すなわち、上述の構成では、リングバッファメモリ102に対して、復調回路101のデータを書き込むためのアクセス(アクセスe)と、PI系列のエラー訂正処理のためのアクセス(アクセスf1)と、PO系列のエラー訂正処理のためのアクセス(アクセスf2)と、再度のPI系列のエラー訂正処理のためのアクセス(アクセスf3)と、出力のリクエストに応じてデータを出力するためのアクセス(アクセスg)が発生する。図20は、これらのアクセスのタイミングを示すものである。このように、リングバッファメモリ102に対して多数のアクセスが発生するため、ディスクの読み出しを2倍速にし、出力レートをATAPIインターフェースのレートに対応させることが困難である。
【0012】
なお、リングバッファメモリのデータ幅を大きくしたり、動作クロックの周波数を上げることで、このような要求に応えることが考えられるが、バッファメモリのデータ幅を大きくしたり、動作クロックの周波数を上げると、回路規模の増大や、コストアップにつながる。
【0013】
そこで、図21〜図24に示すように、リングバッファメモリ112とは別に、エラー訂正処理用のメモリ113を設けることが考えられる。図21において、復調回路111からは、光ディスクの再生信号の復調データが出力される。1ECCブロック分の復調データは、先ず、エラー訂正処理用のメモリ113に蓄えられる(アクセスH)。そして、図22に示すように、エラー訂正回路114により、PI系列の処理が行われ(アクセスI1)、PO系列の処理が行われ(アクセスI2)、再度のPI系列の処理が行われる(アクセスI3)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、図23に示すように、エラー訂正処理用のメモリ113のデータが読み出され(アクセスJ)、デスクランブル及びエラー検出回路115でデスクランブルされる。そして、このデータは、リングバッファメモリ112に転送される(アクセスh)。出力のリクエストに応じて、図24に示すように、エラー訂正処理の終了したデータがリングバッファメモリ112から読み出され、インターフェース117を介して、外部のホストコンピュータ116に転送される(アクセスi)。
【0014】
このように、リングバッファ112とは別に、エラー訂正用のメモリ113を設けると、エラー訂正処理の際にリングバッファメモリ112をアクセスする必要はなくなる。しかしながら、この例では、リングバッファメモリ112への入力データのアクセス(アクセスh)は、エラー訂正処理が完了してから起こるので、図25に示すようなタイミングとなり、やはり、ディスクの読み出しを2倍速、出力をATAPIインターフェースとするという要求に応えることが困難である。
【0015】
そこで、図26〜図29に示すように、エラー訂正用に、メモリ123とメモリ124の2つのメモリを用意し、一方のメモリで復調データの書き込みを行う間に、他方メモリでエラー訂正処理を行うようにすることが考えられる。図26において、復調回路121からは、光ディスクの再生信号の復調データが出力される。1ECCブロック分の復調データは、先ず、エラー訂正処理用のメモリ123に蓄えられる(アクセスK)。そして、図27に示すように、エラー訂正回路125により、PI系列の処理が行われ(アクセスL1)、P0系列の処理が行われ(アクセスL2)、再度のPI系列の処理が行われる(アクセスL3)。このとき、同時に、復調回路121からの次の1ECCブロック分の復調データが他方のエラー訂正処理用のメモリI24に蓄えられる(アクセスK)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、図28に示すように、エラー訂正処理用のメモリ123のデータが読み出され(アクセスM)、デスクランブル及びエラー検出回路116でデスクランブルされる。そして、このデータは、リングバッファメモリ122に転送される(アクセスk)。出力のリクエストに応じて、図29に示すように、エラー訂正処理の終了したデータがリングバッファメモリ122から読み出され、インターフェース128を介して、外部のホストコンピュータ27に転送される(アクセスl)。
【0016】
このようにすると、復調データの書き込み(アクセスK)とエラー訂正処理(アクセスL1、L2、L3)が同時に起こるので、図30に示すようなタイミングとなり、ディスクの読み出しからエラー訂正処理データの出力までの時間を短縮できる。これにより、ディスクの読み出しを2倍速、出力をATAPIインターフェースとするという要求に応えることができる。
【0017】
ところが、このような構成では、エラー訂正処理用のメモリとして、2つのメモリ123及び124Bが必要になり、回路規模が増大するという問題が生じる。
【0018】
したがって、この発明の目的は、回路規模を増大させたり、クロックの速度を速めることなく、ディスクの読み出しから復号データの出力までの時間を短縮できるようにしたデータ再生装置及びデータ再生方法を提供することにある。
【0019】
【課題を解決するための手段】
この発明に係るデータ再生装置は、記録媒体からデジタルデータを再生する再生手段と、上記再生手段により再生されたデータにエラー訂正処理を施すエラー訂正手段と、上記エラー訂正手段によりエラー訂正された再生データを可変レートで出力する可変レート制御用のリングバッファメモリと、上記再生手段から供給される再生データを少なくとも1フレーム分蓄積して上記エラー訂正手段とリングバッファメモリに送る第1のバッファメモリと、上記エラー訂正手段によりエラー訂正された再生データを少なくとも1フレーム分蓄積して上記リングバッファメモリに送る第2のバッファメモリと、上記再生手段及びリングバッファメモリの動作を制御する制御手段とを備え、上記第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込み、第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力することを特徴とする。
【0020】
この発明に係るデータ再生装置における上記第1及び第2のバッファメモリは、例えば、エラー訂正ブロックの2乃至3フレーム分の記憶容量をそれぞれ有する。
【0021】
この発明に係るデータ再生方法は、復調された再生データを第1のバッファメモリに書き込む第1の工程と、第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第2の工程と、上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第3の工程と、上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込む第4の工程と、第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第5の工程と、出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力する第6の工程とを有することを特徴とする。
【0022】
【発明の実施の形態】
以下、本発明の実施の形態について図面を参照して詳細に説明する。
【0023】
本発明を適用した光ディスク再生装置の構成を図1のブロック図に示す。この図1に示す光ディスク再生装置おいて、光ディスク1としては、波長の短いレーザ光を使用するとともに開口数の大きい対物レンズを使用することにより大量のデータ記録を可能とした光ディスク(DVD)が用いられる。
【0024】
光ディスク1に記録されたデータの1セクタは、図2に示すように、12行×172バイト)のデータからなる。1セクタの先頭には、物理的なアドレスを示す4バイトのIDと、このIDに2バイトのパリティIEDとが設けられる。そして、6バイトのリザーブデータRSVの後の、2048バイトがメインデータエリアとされる。1セクタの最後には、4バイトのエラー検出コードが付加されている。
【0025】
そして、図3に示すように、1セクタのデータ(12行×172バイト)が16セクタ分集められ、(192行×172バイト)に2次元配列されて、ECCブロックが構成される。(192行×172バイト)のデータに対して、行方向に10バイトの内符号のパリティPI((182,172,11)リード・ソロモン符号)が付加され、列方向に16列の外符号のパリティPO((208,192,17)リード・ソロモン符号)が付加されている。
【0026】
エラー訂正符号化されたデータは、16行あるパリティPOが1データセクタに1行ずつ配置されるようにインターリーブされる。そして、所定パターンのシンクが付加され、8−16変調(EFMプラスと呼ばれる)されて、記録される。したがって、ディクスに記録される1セクタのデータの物理的な構成は、図4に示すようになる。8−16変調しているので、1456ビットは、91バイト分に相当する。図4において、SY0,SY1,SY2,・・・はシンクパターンを示す。
【0027】
図1に示すように、光ディスク1と対向するようにピックアップ2が設けられている。ピックアップ2は、サーボ回路13により、ディスクの半径方向に移動可能とされている。ピックアップ2により、光ディスク1の記録信号が再生される。光ピックアップ2からの再生信号は、復調回路3に供給される。復調回路3で、EFMプラスによる復調処理がなされる。
【0028】
復調回路3の出力は、セクタ検出回路4に供給される。セクタ検出回路4で、再生データ中のシンクパターンSY0,SY1,SY2,・・・を検出することで、セクタが検出される。このセクタ検出回路4の出力がメモリコントローラ10に供給される。
【0029】
この光ディスク再生装置は、復調回路3の出力にエラー訂正処理を施すために再生データを一時記憶しておく第1及び第2のバッファメモリ5A,5Bを備える。第1及び第2のバッファメモリ5A,5Bは、それぞれ512バイトで2.5フレームの容量を有する。また、光ディスク1は、例えば、2倍速で再生される。そして、可変レート再生を可能とするために、リングバッファメモリ6が設けられる。リングバッファメモリ6は、例えば、FIFOで構成されている。リングバッファメモリ6は、バッファコントローラ10により制御される。
【0030】
ここで、この光ディスク再生装置におけるECCブロックタイミングを基にしたデータ処理動作のタイミングチャートを図5に示し、また、ECCフレームタイミングを基にしたPI/POエラー訂正動作のタイミングチャートを図6に示し、さらに、ECCフレームタイミングを基にしたPI/PI2エラー訂正動作のタイミングチャートを図7に示す。
【0031】
すなわち、この光ディスク再生装置では、図6に示すように、先ず、復調回路3の出力を第1のバッファメモリ5Aに書き込む。そして、第1のバッファメモリ5Aに1フレーム分の復調データが蓄えられると、第1のバッファメモリ5Aからエラー訂正回路7にECC転送(PI1データ転送)を実行すると同時に、リングバッファメモリ6にデータを書き込む。そして、エラー訂正回路7においてPIエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。さらに、PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)を実行する。リングバッファメモリ6に16ビット幅のメモリを用い、このリングバッファメモリ6をワードでPO2フレーム分のデータをアクセスし、その内の1フレームのECC転送(PO)を実行すると同時に、残りの1フレームを第2のバッファメモリ5Bに書き込み、1フレームのデータ転送終了後に、第2のバッファメモリ5Bからデータを読み出して、ECC転送(PO)を実行する。これにより、エラー訂正回路7においてPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。すなわち、PI/POエラー訂正は、リングバッファメモリ6に対してエラーデータをリード(R:READ)/ライト(W:WRITE) して行う。
【0032】
また、この光ディスク再生装置では、上記POエラー訂正が終わると、図7に示すように、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込む。そして、エラー訂正回路7においてPI2エラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0033】
このPI2エラー訂正は、第2のバッファメモリ5Bに対してエラーデータをリード(R:READ)/ライト(W:WRITE) して行う。すなわち、PI2エラーは、その系列のデータのECC転送(PI2データ転送)の次の次のフレームのECC転送を行っているところで出力されるので、エラー出力されたら、一時、ECC転送を停止して、第2のバッファメモリ5Bに対してエラーデータをリード(R:READ)/ライト(W:WRITE) することによりPI2エラー訂正を行う。
【0034】
そして、PI2エラー訂正後、そのフレームのデータに対して、デスクランブル及びエラー検出回路8によりデスクランブル処理を施すとともにエラー検出コードを計算してリングバッファメモリ6にデータを書き込む。なお、スクランブル処理は、物理アドレスの下位7〜4ビットにより選択される値を初期値として生成されるスクランブルデータとメインデータと排他的論理和をとるものである。PI2エラー訂正フレームのデータを全てリングバッファメモリ6に書き込み終わったら、一時停止させていたECC転送を再開する。
【0035】
このように、PI2エラー訂正まで終了したデータは、リングバッファメモリ6に格納されていき、ホストコンピュータ14から出力要求されたデータがデコード終了していたらリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に転送(ホスト転送)される。
【0036】
なお、ここで、リングバッファメモリ6の書き込みポインタが読み出しポインタに追いつくと、リングバッファメモリ6が溢れてしまう。そこで、図1に示したシステムコントローラ11により、バッファコントローラ10での読み出しポインタWPと、書き込みポインタRPが監視されている。書き込みポインタWPと読み出しポインタRPとにより、リングバッファメモリ6に現在記憶されているデータ量が算出される。このデータ量が予め設定された所定の記憶量を越えた場合には、リングバッファメモリ6がオーバフローする恐れがあると判断され、トラックジャンプ指令がトラックジャンプ制御回路12に送られる(オーバーフロー処理)。このトラックジャンプ制御回路12の出力がサーボ回路13に供給され、必要に応じて、トラックジャンプ制御が行われる。
【0037】
そして、この実施の形態における光ディスク再生装置では、ATAPIインターフェース15が設けられており、このATAPIインターフェース15を介して、リングバッファメモリ6からホストコンピュータ16にデータを転送することができる。また、ビデオデコーダ17及びオーディオデコーダ18が設けられており、光ディスク1にMPEG2で圧縮されたビデオ信号が記録されている場合には、このビデオ信号を再生させることができる。
【0038】
すなわち、ATAPIインターフェース15を介して、ホストコンピュータ16にデータを転送する場合には、ホストコンピュータ16からのリクエスト信号により、リングバッファメモリ6からデータが読み出される。このデータは、ATAPIインターフェース15を介して、ホストコンピュータ16に送られる。
【0039】
また、光ディスク1にMPEG2で圧縮されて記録されているビデオ信号を再生させる場合には、ビデオバッファ20及びオーディオバッファ21のバッファ残量に基づいてリクエスト信号が発生され、このリクエスト信号により、リングバッファメモリ6からデータが読み出される。リングバッファメモリ6の出力は、デマルチプレクサ19に供給される。デマルチプレクサ19により、パケットヘッダの情報に従って、ビデオデータとオーディオデータとが分離される。
【0040】
ビデオデータは、ビデオバッファ20を介して、ビデオバッファビデオデコーダ17に供給される。オーディオデータは、オーディオバッファ21を介して、オーディオデコーダ18に供給される。ビデオデコーダ17で、例えば、MPEG2に基づいて、ビデオデータがデコードされる。デコードされたビデオ信号は、出力端子22から出力される。オーディオデコーダ18で、オーディオデータがデコードされる。デコードされたオーディオデータは、出力端子23から出力される。
【0041】
このように、この実施の形態における光ディスク再生装置では、次のようの処理工程(1)〜(6)に従って、再生データの復号処理を行っている。
【0042】
(1) 復調された再生データを第1のバッファメモリ5Aに書き込む。
【0043】
(2) 第1のバッファメモリ5Aに1フレーム分のデータが蓄積されたら、第1のバッファメモリ5Aからエラー訂正回路7にECC転送(PI1データ転送)を実行すると同時に、リングバッファメモリ6にデータを書き込み、エラー訂正回路7によりPIエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0044】
(3) PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)を実行して、エラー訂正回路7によりPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0045】
(4) POエラー訂正が終わると、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込む。
【0046】
(5) エラー訂正回路7によりPI2エラー訂正を行い、デスクランブル及びエラー検出回路8を介してエラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0047】
(6) ホストコンピュータ14から出力要求に応じたデータをリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に転送(ホスト転送)する。
【0048】
そして、リングバッファメモリ6では、図8に示すように、ポインタが配置され、図9〜図11に示すように、ポインタが移動していく。
【0049】
すなわち、リングバッファメモリ6のアドレスは、終端アドレスが先頭アドレスに続いており、終端アドレスまで進むと先頭アドレスに戻るような構成とされている。WPは書き込みポインタで、この書き込みポインタWPは、書き込みが終了したアドレスを示すものである。EPはECC終了ポインタで、このECC終了ポインタは、エラー訂正処理が完了したアドレスを示すものである。RPは読み出しポインタで、この読み出しポインタRPは、読み出しが終了したアドレスを示すものである。
【0050】
書き込みポインタWPのところまで、エラー訂正前のデータが書き込まれている。そして、このエラー訂正前のデータは、エラー訂正回路7でエラー訂正処理され、第2のバッファメモリ5Bからリングバッファメモリ6に送られ、エラーポインタEPのところまでが、エラー訂正処理が済み、出力可能なデータである。そして、読み出しポインタRPのところまで読み出しが終了している。
【0051】
図9に示すように、先ず、復調データがリングバッファメモリ6に書き込まれる。復調データの書き込みが終了すると、書き込みポインタWPが1ECCブロック分進められ、リングバッファメモリ6から第2のバッファメモリ5Bにデータが転送されるとともに、エラー訂正回路7にデータが転送され、PI系列、PO系列、PI系列のエラー訂正処理が行われる。エラー訂正処理が終了すると、デスクランブル、エラー検出処理が実行されて、第2のバッファメモリ5Bからリングバッファメモリ6にエラー訂正処理されたデータが転送され、そのブロックのデータの転送が終了すると、エラーポインタEPが1ブロック分進められる。
【0052】
図10に示すように、エラー訂正処理後のデータは、出力可能データとなる。出力要求信号があると、リングバッファメモリ6がらデータが読み出され、読み出しポインタRPが進められる。このとき、出力可能データがあるかどうかが、読み出しポインタRPとエラーポインタEPから判断される。すなわち、エラーポインタEPと読み出しポインタRPとの関係が判断される。エラーポインタEPと読み出しポインタRPとの関係が、EP>RPであれば、出力可能データがあるので、後段にデータが出力され、読み出しポインタRPが進められる。EP=RPなら、出力可能データがないので、データは出力さない。
【0053】
図11に示すように、後段の回路からのデータ出力要求がない場合等では、書き込みポインタWPは進んでいくが、読み出しポインタRPは止まっているため、書き込みポインタWPが読み出しポインタRPに追いつく。書き込みポインタWPが読み出しポインタRPに追いつき、EP=RPになったら、書き込み動作が一時停止される。そして、トラックジャンプが必要なときには、トラックジャンプさせるようになっている。(オーバーフロー制御)。その後、読み出しポインタRPが進んで、入力可能領域が生じたら、復調データの書き込みが可能になる。
【0054】
図12は、この光ディスク再生装置に用いられるエラー訂正回路7の構成例を示すものである。
【0055】
図12において、エラー訂正回路7は、エラー訂正用集積回路51と、エラーバッファ52と、フラグメモリ53と、エラーカウンタ54とから構成される。エラー訂正用集積回路51は、リードソロモン符号のエラー訂正処理を行う集積回路である。エラー訂正用集積回路51には、RAMインターフェース56を介して、データEDT〔7:0〕と、フラグメモリ53からのイレージャ訂正のためのフラグEFLGが入力される。このエラー訂正用集積回路51は、符号長及びパリティ数等のパラメータがプログラマブルに設定可能とされている。
【0056】
エラーバッファ52は、FIFOで構成されている。エラー訂正用集積回路51でのエラー訂正処理の結果、エラーパターンは、エラーバッファ52に蓄えられる。エラーバッファ52の出力は、EX−OR回路55に供給される。このEX−OR回路55には、RAMインターフェース56を介して、第2のバッファメモリ5Bからのデータが供給される。エラーパターンの場合には、エラーを修正するために、このエラーの位置のタイミングで、エラーバッファ52からのデータと、第2のバッファメモリ5Bからのデータとの排他的論理和がとられてエラーが修正され、再び第2のバッファメモリ5Bに戻される。
【0057】
フラグメモリ53は、エラーポジションを示すエラーフラグのポインタを蓄えるものである。そして、イレージャ訂正を行う際に、このエラーフラグが用いられる。
【0058】
エラーカウンタ54は、エラー訂正用集積回路51でのエラー訂正処理の結果、エラーの数をカウントしている。
【0059】
図13及び図14は、このエラー訂正回路の動作を示すタイミングチャートである。図13で、ESTTは、符号の先頭を示すコントロール信号、ECDEは符号の最後を示すコントロール信号、ECYEは符号サイクルの最後を示すコントロール信号である。図13に示すように、訂正結果は次式のようなサイクルで出力される。
【0060】
スループット=2×NCYC+3×PCYC+13
なお、NCYCは長い方の符号長を示し、PCYCは長い方のパリティ数を示すものである。
【0061】
図14に示すように、エラー訂正用集積回路51は、単一のクロックECCKで動作している。図14において、OSTTはコントロール信号ESTTの遅延出力であり、ある符号系列においてコントロール信号ESTTから477クロック(ECCKクロック)後に出力される。そして、エラーが検出され、そのエラーが訂正可能であれば、OSTT=1と同時にECOD=0となり、その後EC0R=1の位置に、エラーパターンECD〔7:0〕とエラーポジションECA〔7:0〕が出力される。
【0062】
なお、イレージャ訂正モードにおていは、エラーパターンECD〔7:0〕とエラーポジションECA〔7:0〕データは必ず出力されるが、その位置のデータが正しい場合には、エラーパターンはECD〔7:0〕=00(H)となる。
【0063】
エラー訂正結果、エラーパターンECD〔7:0〕及びエラーポジションECA〔7:0〕は、エラーバッファ52に書き込まれ、エラー訂正タイミングで、第2のバッファメモリ5Bからエラーのある位置のデータを読み出し、バッファ52から読み出したエラーパターンとの排他的論理知をとった結果、再度第2のバッファメモリ5Bに書き戻される。
【0064】
ここで、イレージャ訂正時にエラーパターンECD〔7:0〕=00(H)となるデータは、実際には正しいので、訂正動作しても無意味なため、エラーバッファ52への書き込みを行わない。
【0065】
以上のように、この実施の形態における光ディスク再生装置では、復調された再生データが第1のバッファメモリ5Aに1フレーム分蓄積されたら、リングバッファメモリ6とエラー訂正回路7に送りPI系列のエラー訂正処理を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込み、PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)して、エラー訂正回路7によりPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。また、PIエラー訂正が終わると、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込み、エラー訂正回路7によりPI2エラー訂正を行い、デスクランブル及びエラー検出回路8を介してエラー訂正済みのデータをリングバッファメモリ6に書き込む。そして、ホストコンピュータ14から出力要求に応じたデータをリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に必要とされる転送レートで転送(ホスト転送)する。この光ディスク再生装置では、リングバッファメモリ6から第2のバッファメモリ5Bへのデータの書き込みと、エラー訂正回路7でのPI系列のエラー訂正処理が同時に起こるので、データ処理速度が短縮され、例えば、ディスクを2倍速で読み出し、ATAPIインターフェースで16.6Mビット/sでデータを転送することが可能となる。このことについて、以下に検証する。
【0066】
ディスクを1倍速で再生した場合の復調データのレートは、26.16MB/sである。ATAPIインターフェースで要求される転送レートは、16.6MB/sである。
【0067】
リングバッファメモリ6は、ワードアクセス(16ビット)とし、nワードページアクセスのサイクル数を3+2×nサイクルとする。また、第2のバッファメモリ6Bは、バイトアクセス(8ビット)とし、nバイトページアクセスのサイクル数を3+2×nサイクルとする。さらに、マスタークロックの周波数は、40MHzとする。
【0068】
また、図4で示したように、1シンクフレームのビット数は、1456ビットであり、これに32ビットのシンクパターンが付加されている。したがって、1シンクフレームの総ビット数は、1456+32=1488ビットである。
【0069】
ディスクを1倍速で再生した場合の復調データのレートは26.16Mbit/sである。したがって、シンクフレーム周波数は、
となる。
【0070】
マスタークロックは40MHzであり、このマスタークロックの1クロック分を1サイクルとする。シンクフレーム周波数は、17.58065KHzであり、2シンクフレームがPI系列(182バイト)の1フレームに相当するので、PI系列の1フレームをサイクル数に換算すると、2×40MHz/17.58065KHz=4550サイクルとなる。したがって、1ECCブロックすなわち208フレームでは、4550サイクル×208=946400サイクルとなる。
【0071】
ここでは、図15に示すように、リングバッファメモリ6を16バイト/19サイクル毎にぺージアクセスして、ホスト転送のアクセスとそれ以外のアクセスが交互に行われるものとする(ECC以外のアクセス要求がなければ、ECCアクセスを繰り返せるが、その場合はえCCの16サイクル終了を待つことになる)。このときのホスト転送レートは、16.84MB/sなので、16.6MB/sを満足する。
【0072】
そして、復調データの書き込み及びPIデータの読み出し、訂正に要するサイクル数は、PI系列の182バイトが16バイト/19サイクル毎にぺージアクセスされると、182/16=11.3であるから、1ECCブロック208フレームでは、
12×19×208=47424サイクル (1)
となる。また、5バイト訂正であるから、
(5+5)×5×208=10400サイクル (2)
を必要とする。
【0073】
さらに、POデータの読み出し、訂正に要するサイクル数は、PO系列のフレームの208バイトが16バイト/19サイクル毎にぺージアクセスされると、208/16=26であるから、
26×19×172/2+15064(#) =57548サイクル (3)
となる。また、16バイト訂正であるから、
(16+16)×5×172=27520サイクル (4)
を必要とする。なお、15064(#) は、第2のバッファメモリ5BからのECC転送(POデータ転送)サイクルにおけるホスト以外の転送分を考慮したものである。
【0074】
また、PI2データの読み出しに要するサイクル数は、POパリティデータの16列を除いて計算し、PI系列の182バイトが16バイト/19サイクル毎にぺージアクセスされると、182/16=11.3であるから、1ECCブロック208フレームでは、
12×19×(208−16)=43776サイクル (5)
となる。
【0075】
EDC終了データの書き込みは、メインデータ192フレームのみを計算し、16バイト/19サイクル毎にぺージアクセスされるので、172バイト/16=10.75であるから、1ECCブロック208フレームでは、
11×19×192=40128サイクル (6)
必要となる。
【0076】
これら(1)〜(6)の合計は、226796サイクルとなる。
【0077】
さらにDRAMにはリフレッシュ動作が必要で、約16μ秒に1度CASビッフォアRASリフレッシュサイクルを入れるとすると、1ECCブロック期間では、23660/16=1478.75回となり、1回のリフレッシュサイクルを5サイクルとすると、
1479×5=7395サイクル
となる。
【0078】
したがって、全てのホスト転送を確保するときのデコード処理速度の限界は、(946400+7395)×(19/38)/(226796+7395)=2.02となり、2倍速が可能となる。
【0079】
なお、上述の例では、エラー訂正符号として、PI系列とPO系列とからなる積符号のものを用いているが、他の構成のエラー訂正符号を用いるようにしても良い。また、この例では、PI系列の復号をし、PO系列の復号をした後、更に、PI系列の復号を行っているか、PI系列の復号と、P0系列の復号とがエラー訂正処理を完了するようにしても良い。
【0080】
【発明の効果】
この発明によれば、復調された再生データを第1のバッファメモリに書き込み、この第1のバッファメモリに1フレーム分のデータが蓄積されると、1フレーム分のPIデータをエラー訂正回路に送るとともにリングバッファメモリに書き込み、エラー訂正回路によりPI系列のエラー訂正処理を行い、エラー訂正処理済みのデータをリングバッファメモリに書き込み、PIエラー訂正が終わるとリングバッファメモリからPOデータをエラー訂正回路に送るとともに第2のバッファメモリに書き込み、エラー訂正回路によりPO系列のエラー訂正処理を行い、エラー訂正処理済みのデータをリングバッファメモリに書き込む。さらに、POエラー訂正が終わるとリングバッファメモリからエラー訂正回路にPI2データを送るとともに第2のバッファメモリにデータを書き込み、この第2のバッファメモリに蓄えられたデータによりエラー訂正回路でPI2エラー訂正処理を行い、PI2エラー訂正処理を完了したら、第2のバッファメモリからリングバッファメモリにデータを転送し、必要とされる転送レートでリングバッファメモリからデータを出力する。これにより、リングバッファメモリから第2のバッファメモリへのデータの書き込みと、エラー訂正回路でのPI系列のエラー訂正処理が同時に起こるので、データ処理速度が短縮され、例えば、ディスクを2倍速で読み出し、ATAPIインターフェースで16.6Mビット/sでデータを転送することが可能となる。
【図面の簡単な説明】
【図1】この発明が適用された光ディスク再生装置の構成を示すブロック図である。
【図2】DVDのデータフォーマットを示す略線図である。
【図3】DVDのデータフォーマットを示す略線図である。
【図4】DVDのデータフォーマットを示す略線図である。
【図5】上記光ディスク再生装置におけるECCブロックタイミングを基にしたデータ処理動作のタイミングチャートである。
【図6】上記光ディスク再生装置におけるECCフレームタイミングを基にしたPI/POエラー訂正処理動作のタイミングチャートである。
【図7】上記光ディスク再生装置におけるECCフレームタイミングを基にしたPI/PI2エラー訂正処理動作のタイミングチャートである。
【図8】上記光ディスク再生装置におけるリングバッファの説明に用いる略線図である。
【図9】上記リングバッファの説明に用いる略線図である。
【図10】上記リングバッファの説明に用いる略線図である。
【図11】上記リングバッファの説明に用いる略線図である。
【図12】上記光ディスク再生装置におけるエラー訂正回路の構成例を示すブロック図である。
【図13】上記エラー訂正回路の説明に用いるタイミングチャートである。
【図14】上記エラー訂正回路の説明に用いるタイミングチャートである。
【図15】上記光ディスク再生装置の動作説明に用いるタイミングチャートである。
【図16】リングバッファメモリの基本構成の説明に用いる略線図である。
【図17】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図18】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図19】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図20】従来のディスク再生装置の一例の説明に用いるタイミングチャートである。
【図21】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図22】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図23】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図24】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図25】従来のディスク再生装置の他の例の説明に用いるタイミングチャートである。
【図26】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図27】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図28】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図29】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図30】従来のディスク再生装置の更に他の例の説明に用いるタイミングチャートである。
【符号の説明】
1 光ディスク、5A 第1のバッファメモリ、5B 第2のバッファメモリ、6 リングバッファメモリ、7 エラー訂正回路
【発明の属する技術分野】
この発明は、例えば、DVD(Digital Video Disc)で可変レート再生を行うのに用いて好適なデータ再生装置及びデータ再生方法に関する。
【0002】
【従来の技術】
波長の短いレーザ光を使用するとともに開口数の大きい対物レンズを使用することにより大量のデータ記録を可能とした光ディスク(DVD)が開発されている。DVDには、例えばMPEG(Moving Picture Experts Group)2の規格で圧縮されたディジタルビデオ信号を記録するのに用いられる。また、DVDは、大容量のデータを記録するデータ記録媒体としても期待されている。
【0003】
DVDの記録データを再生する再生装置において、可変レート対応とされたものが提案されている。このような可変レート対応の再生装置では、リングバッファメモリが設けられている。リングバッファメモリは、基本的に、図16に示すように構成されている。
【0004】
図16に示すように、リングバッファメモリは、終端アドレスまで進むと先頭アドレスに戻るようなアドレス構成とされている。すなわち、図16のように、アドレスが「0」から「11」の場合には、アドレス「0」,「1」,「2」,・・・と進められ、アドレス「11」に達すると、次にアドレス「0」に戻り、再び、「1」,「2」,・・・と進められていく。このようなリングバッファメモリは、具体的には、FIFOで構成されている。
【0005】
書き込みポインタWPは、書き込みが終了したアドレスを示すものである。ECC終了ポインタは、エラー訂正処理が完了したアドレスを示すものである。読み出しポインタRPは、読み出しが終了したアドレスを示すものである。図示の場合、書き込みポインタWPがアドレス「11」の位置にあるので、アドレス「11」のところまで、データが書き込まれている。ECC終了ポインタEPがアドレス「9」の位置にあるので、アドレス「9」のところまでエラー訂正処理が終了している。読み出しポインタRPがアドレス「2」の位置にあるので、アドレス「2」のところまで書き込みが終了している。したがって、アドレス「3」〜「9」にエラー訂正処理が終了し、読み出し可能なデータが位置され、アドレス「0」〜「2」に、既に読み出されて不要となったデータが位置され、アドレス「10」,「11」に新しく書かれたデータが位置される。
【0006】
上述のリングバッファメモリでは、読み出しポインタRPがECC終了ポインタEPを追い越さないようにする必要がある。また、ECC終了ポインタEPが書き込みポインタWPを追い越さないようにする必要がある。なお、書き込みポインタWPが読み出しポインタRPに追いついたときには、復調データの書き込みが一時停止される(オーバーフロー制御)。
【0007】
このようなリングバッファメモリが設けられ、可変レート対応とされたデータ再生装置の構成としては、図17〜図19に示すようなものが考えられる。
【0008】
図17において、復調回路101からは、光ディスクの再生信号の復調データが出力される。この復調データは、先ず、リングバッファメモリ102に蓄えられる(アクセスe)。リングバッファメモリ102に1ECCブロック分のデータが蓄えられたら、図18に示すように、リングバッファメモリ102に蓄えられたデータは、エラー訂正処理回路103に転送され、エラー訂正処理が行われる。エラー訂正処理は、先ず、PI系列の処理が行われ(アクセスf1)、P0系列の処理が行われ(アクセスf2)、再度のPI系列の処理が行われる(アクセスf3)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、データの転送が可能になる。出力のリクエストに応じて、図19に示すように、エラー訂正処理の終了したデータがリングバッファメモリ102から読み出され、この読み出されたデータは、デスクランブル及びエラー検出回路104でデスクランブルされ、インターフェース106を介して、外部のホストコンピュータ105に転送される(アクセスg)。
【0009】
【発明が解決しようとする課題】
可変レート対応のディスク再生装置において、ホストコンピュータとの間を例えばATAPIインターフェースで結び、ATAPIインターフェースの転送レート(16.6MB/s)でデータを転送することが考えられている。更に、ディスクの読み出しを、通常の2倍速で読み出すことが考えられている。
【0010】
ところが、上述の従来のデータ再生装置では、リングバッファメモリ102が可変レート制御と、エラー訂正符号化処理とに用いられているため、リングバッファメモリ102に対するアクセスが多く発生し、このような要求に応えることが困難である。
【0011】
すなわち、上述の構成では、リングバッファメモリ102に対して、復調回路101のデータを書き込むためのアクセス(アクセスe)と、PI系列のエラー訂正処理のためのアクセス(アクセスf1)と、PO系列のエラー訂正処理のためのアクセス(アクセスf2)と、再度のPI系列のエラー訂正処理のためのアクセス(アクセスf3)と、出力のリクエストに応じてデータを出力するためのアクセス(アクセスg)が発生する。図20は、これらのアクセスのタイミングを示すものである。このように、リングバッファメモリ102に対して多数のアクセスが発生するため、ディスクの読み出しを2倍速にし、出力レートをATAPIインターフェースのレートに対応させることが困難である。
【0012】
なお、リングバッファメモリのデータ幅を大きくしたり、動作クロックの周波数を上げることで、このような要求に応えることが考えられるが、バッファメモリのデータ幅を大きくしたり、動作クロックの周波数を上げると、回路規模の増大や、コストアップにつながる。
【0013】
そこで、図21〜図24に示すように、リングバッファメモリ112とは別に、エラー訂正処理用のメモリ113を設けることが考えられる。図21において、復調回路111からは、光ディスクの再生信号の復調データが出力される。1ECCブロック分の復調データは、先ず、エラー訂正処理用のメモリ113に蓄えられる(アクセスH)。そして、図22に示すように、エラー訂正回路114により、PI系列の処理が行われ(アクセスI1)、PO系列の処理が行われ(アクセスI2)、再度のPI系列の処理が行われる(アクセスI3)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、図23に示すように、エラー訂正処理用のメモリ113のデータが読み出され(アクセスJ)、デスクランブル及びエラー検出回路115でデスクランブルされる。そして、このデータは、リングバッファメモリ112に転送される(アクセスh)。出力のリクエストに応じて、図24に示すように、エラー訂正処理の終了したデータがリングバッファメモリ112から読み出され、インターフェース117を介して、外部のホストコンピュータ116に転送される(アクセスi)。
【0014】
このように、リングバッファ112とは別に、エラー訂正用のメモリ113を設けると、エラー訂正処理の際にリングバッファメモリ112をアクセスする必要はなくなる。しかしながら、この例では、リングバッファメモリ112への入力データのアクセス(アクセスh)は、エラー訂正処理が完了してから起こるので、図25に示すようなタイミングとなり、やはり、ディスクの読み出しを2倍速、出力をATAPIインターフェースとするという要求に応えることが困難である。
【0015】
そこで、図26〜図29に示すように、エラー訂正用に、メモリ123とメモリ124の2つのメモリを用意し、一方のメモリで復調データの書き込みを行う間に、他方メモリでエラー訂正処理を行うようにすることが考えられる。図26において、復調回路121からは、光ディスクの再生信号の復調データが出力される。1ECCブロック分の復調データは、先ず、エラー訂正処理用のメモリ123に蓄えられる(アクセスK)。そして、図27に示すように、エラー訂正回路125により、PI系列の処理が行われ(アクセスL1)、P0系列の処理が行われ(アクセスL2)、再度のPI系列の処理が行われる(アクセスL3)。このとき、同時に、復調回路121からの次の1ECCブロック分の復調データが他方のエラー訂正処理用のメモリI24に蓄えられる(アクセスK)。PI系列、PO系列、再度のPI系列のエラー訂正処理が終了したら、図28に示すように、エラー訂正処理用のメモリ123のデータが読み出され(アクセスM)、デスクランブル及びエラー検出回路116でデスクランブルされる。そして、このデータは、リングバッファメモリ122に転送される(アクセスk)。出力のリクエストに応じて、図29に示すように、エラー訂正処理の終了したデータがリングバッファメモリ122から読み出され、インターフェース128を介して、外部のホストコンピュータ27に転送される(アクセスl)。
【0016】
このようにすると、復調データの書き込み(アクセスK)とエラー訂正処理(アクセスL1、L2、L3)が同時に起こるので、図30に示すようなタイミングとなり、ディスクの読み出しからエラー訂正処理データの出力までの時間を短縮できる。これにより、ディスクの読み出しを2倍速、出力をATAPIインターフェースとするという要求に応えることができる。
【0017】
ところが、このような構成では、エラー訂正処理用のメモリとして、2つのメモリ123及び124Bが必要になり、回路規模が増大するという問題が生じる。
【0018】
したがって、この発明の目的は、回路規模を増大させたり、クロックの速度を速めることなく、ディスクの読み出しから復号データの出力までの時間を短縮できるようにしたデータ再生装置及びデータ再生方法を提供することにある。
【0019】
【課題を解決するための手段】
この発明に係るデータ再生装置は、記録媒体からデジタルデータを再生する再生手段と、上記再生手段により再生されたデータにエラー訂正処理を施すエラー訂正手段と、上記エラー訂正手段によりエラー訂正された再生データを可変レートで出力する可変レート制御用のリングバッファメモリと、上記再生手段から供給される再生データを少なくとも1フレーム分蓄積して上記エラー訂正手段とリングバッファメモリに送る第1のバッファメモリと、上記エラー訂正手段によりエラー訂正された再生データを少なくとも1フレーム分蓄積して上記リングバッファメモリに送る第2のバッファメモリと、上記再生手段及びリングバッファメモリの動作を制御する制御手段とを備え、上記第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込み、第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力することを特徴とする。
【0020】
この発明に係るデータ再生装置における上記第1及び第2のバッファメモリは、例えば、エラー訂正ブロックの2乃至3フレーム分の記憶容量をそれぞれ有する。
【0021】
この発明に係るデータ再生方法は、復調された再生データを第1のバッファメモリに書き込む第1の工程と、第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第2の工程と、上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第3の工程と、上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込む第4の工程と、第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第5の工程と、出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力する第6の工程とを有することを特徴とする。
【0022】
【発明の実施の形態】
以下、本発明の実施の形態について図面を参照して詳細に説明する。
【0023】
本発明を適用した光ディスク再生装置の構成を図1のブロック図に示す。この図1に示す光ディスク再生装置おいて、光ディスク1としては、波長の短いレーザ光を使用するとともに開口数の大きい対物レンズを使用することにより大量のデータ記録を可能とした光ディスク(DVD)が用いられる。
【0024】
光ディスク1に記録されたデータの1セクタは、図2に示すように、12行×172バイト)のデータからなる。1セクタの先頭には、物理的なアドレスを示す4バイトのIDと、このIDに2バイトのパリティIEDとが設けられる。そして、6バイトのリザーブデータRSVの後の、2048バイトがメインデータエリアとされる。1セクタの最後には、4バイトのエラー検出コードが付加されている。
【0025】
そして、図3に示すように、1セクタのデータ(12行×172バイト)が16セクタ分集められ、(192行×172バイト)に2次元配列されて、ECCブロックが構成される。(192行×172バイト)のデータに対して、行方向に10バイトの内符号のパリティPI((182,172,11)リード・ソロモン符号)が付加され、列方向に16列の外符号のパリティPO((208,192,17)リード・ソロモン符号)が付加されている。
【0026】
エラー訂正符号化されたデータは、16行あるパリティPOが1データセクタに1行ずつ配置されるようにインターリーブされる。そして、所定パターンのシンクが付加され、8−16変調(EFMプラスと呼ばれる)されて、記録される。したがって、ディクスに記録される1セクタのデータの物理的な構成は、図4に示すようになる。8−16変調しているので、1456ビットは、91バイト分に相当する。図4において、SY0,SY1,SY2,・・・はシンクパターンを示す。
【0027】
図1に示すように、光ディスク1と対向するようにピックアップ2が設けられている。ピックアップ2は、サーボ回路13により、ディスクの半径方向に移動可能とされている。ピックアップ2により、光ディスク1の記録信号が再生される。光ピックアップ2からの再生信号は、復調回路3に供給される。復調回路3で、EFMプラスによる復調処理がなされる。
【0028】
復調回路3の出力は、セクタ検出回路4に供給される。セクタ検出回路4で、再生データ中のシンクパターンSY0,SY1,SY2,・・・を検出することで、セクタが検出される。このセクタ検出回路4の出力がメモリコントローラ10に供給される。
【0029】
この光ディスク再生装置は、復調回路3の出力にエラー訂正処理を施すために再生データを一時記憶しておく第1及び第2のバッファメモリ5A,5Bを備える。第1及び第2のバッファメモリ5A,5Bは、それぞれ512バイトで2.5フレームの容量を有する。また、光ディスク1は、例えば、2倍速で再生される。そして、可変レート再生を可能とするために、リングバッファメモリ6が設けられる。リングバッファメモリ6は、例えば、FIFOで構成されている。リングバッファメモリ6は、バッファコントローラ10により制御される。
【0030】
ここで、この光ディスク再生装置におけるECCブロックタイミングを基にしたデータ処理動作のタイミングチャートを図5に示し、また、ECCフレームタイミングを基にしたPI/POエラー訂正動作のタイミングチャートを図6に示し、さらに、ECCフレームタイミングを基にしたPI/PI2エラー訂正動作のタイミングチャートを図7に示す。
【0031】
すなわち、この光ディスク再生装置では、図6に示すように、先ず、復調回路3の出力を第1のバッファメモリ5Aに書き込む。そして、第1のバッファメモリ5Aに1フレーム分の復調データが蓄えられると、第1のバッファメモリ5Aからエラー訂正回路7にECC転送(PI1データ転送)を実行すると同時に、リングバッファメモリ6にデータを書き込む。そして、エラー訂正回路7においてPIエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。さらに、PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)を実行する。リングバッファメモリ6に16ビット幅のメモリを用い、このリングバッファメモリ6をワードでPO2フレーム分のデータをアクセスし、その内の1フレームのECC転送(PO)を実行すると同時に、残りの1フレームを第2のバッファメモリ5Bに書き込み、1フレームのデータ転送終了後に、第2のバッファメモリ5Bからデータを読み出して、ECC転送(PO)を実行する。これにより、エラー訂正回路7においてPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。すなわち、PI/POエラー訂正は、リングバッファメモリ6に対してエラーデータをリード(R:READ)/ライト(W:WRITE) して行う。
【0032】
また、この光ディスク再生装置では、上記POエラー訂正が終わると、図7に示すように、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込む。そして、エラー訂正回路7においてPI2エラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0033】
このPI2エラー訂正は、第2のバッファメモリ5Bに対してエラーデータをリード(R:READ)/ライト(W:WRITE) して行う。すなわち、PI2エラーは、その系列のデータのECC転送(PI2データ転送)の次の次のフレームのECC転送を行っているところで出力されるので、エラー出力されたら、一時、ECC転送を停止して、第2のバッファメモリ5Bに対してエラーデータをリード(R:READ)/ライト(W:WRITE) することによりPI2エラー訂正を行う。
【0034】
そして、PI2エラー訂正後、そのフレームのデータに対して、デスクランブル及びエラー検出回路8によりデスクランブル処理を施すとともにエラー検出コードを計算してリングバッファメモリ6にデータを書き込む。なお、スクランブル処理は、物理アドレスの下位7〜4ビットにより選択される値を初期値として生成されるスクランブルデータとメインデータと排他的論理和をとるものである。PI2エラー訂正フレームのデータを全てリングバッファメモリ6に書き込み終わったら、一時停止させていたECC転送を再開する。
【0035】
このように、PI2エラー訂正まで終了したデータは、リングバッファメモリ6に格納されていき、ホストコンピュータ14から出力要求されたデータがデコード終了していたらリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に転送(ホスト転送)される。
【0036】
なお、ここで、リングバッファメモリ6の書き込みポインタが読み出しポインタに追いつくと、リングバッファメモリ6が溢れてしまう。そこで、図1に示したシステムコントローラ11により、バッファコントローラ10での読み出しポインタWPと、書き込みポインタRPが監視されている。書き込みポインタWPと読み出しポインタRPとにより、リングバッファメモリ6に現在記憶されているデータ量が算出される。このデータ量が予め設定された所定の記憶量を越えた場合には、リングバッファメモリ6がオーバフローする恐れがあると判断され、トラックジャンプ指令がトラックジャンプ制御回路12に送られる(オーバーフロー処理)。このトラックジャンプ制御回路12の出力がサーボ回路13に供給され、必要に応じて、トラックジャンプ制御が行われる。
【0037】
そして、この実施の形態における光ディスク再生装置では、ATAPIインターフェース15が設けられており、このATAPIインターフェース15を介して、リングバッファメモリ6からホストコンピュータ16にデータを転送することができる。また、ビデオデコーダ17及びオーディオデコーダ18が設けられており、光ディスク1にMPEG2で圧縮されたビデオ信号が記録されている場合には、このビデオ信号を再生させることができる。
【0038】
すなわち、ATAPIインターフェース15を介して、ホストコンピュータ16にデータを転送する場合には、ホストコンピュータ16からのリクエスト信号により、リングバッファメモリ6からデータが読み出される。このデータは、ATAPIインターフェース15を介して、ホストコンピュータ16に送られる。
【0039】
また、光ディスク1にMPEG2で圧縮されて記録されているビデオ信号を再生させる場合には、ビデオバッファ20及びオーディオバッファ21のバッファ残量に基づいてリクエスト信号が発生され、このリクエスト信号により、リングバッファメモリ6からデータが読み出される。リングバッファメモリ6の出力は、デマルチプレクサ19に供給される。デマルチプレクサ19により、パケットヘッダの情報に従って、ビデオデータとオーディオデータとが分離される。
【0040】
ビデオデータは、ビデオバッファ20を介して、ビデオバッファビデオデコーダ17に供給される。オーディオデータは、オーディオバッファ21を介して、オーディオデコーダ18に供給される。ビデオデコーダ17で、例えば、MPEG2に基づいて、ビデオデータがデコードされる。デコードされたビデオ信号は、出力端子22から出力される。オーディオデコーダ18で、オーディオデータがデコードされる。デコードされたオーディオデータは、出力端子23から出力される。
【0041】
このように、この実施の形態における光ディスク再生装置では、次のようの処理工程(1)〜(6)に従って、再生データの復号処理を行っている。
【0042】
(1) 復調された再生データを第1のバッファメモリ5Aに書き込む。
【0043】
(2) 第1のバッファメモリ5Aに1フレーム分のデータが蓄積されたら、第1のバッファメモリ5Aからエラー訂正回路7にECC転送(PI1データ転送)を実行すると同時に、リングバッファメモリ6にデータを書き込み、エラー訂正回路7によりPIエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0044】
(3) PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)を実行して、エラー訂正回路7によりPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0045】
(4) POエラー訂正が終わると、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込む。
【0046】
(5) エラー訂正回路7によりPI2エラー訂正を行い、デスクランブル及びエラー検出回路8を介してエラー訂正済みのデータをリングバッファメモリ6に書き込む。
【0047】
(6) ホストコンピュータ14から出力要求に応じたデータをリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に転送(ホスト転送)する。
【0048】
そして、リングバッファメモリ6では、図8に示すように、ポインタが配置され、図9〜図11に示すように、ポインタが移動していく。
【0049】
すなわち、リングバッファメモリ6のアドレスは、終端アドレスが先頭アドレスに続いており、終端アドレスまで進むと先頭アドレスに戻るような構成とされている。WPは書き込みポインタで、この書き込みポインタWPは、書き込みが終了したアドレスを示すものである。EPはECC終了ポインタで、このECC終了ポインタは、エラー訂正処理が完了したアドレスを示すものである。RPは読み出しポインタで、この読み出しポインタRPは、読み出しが終了したアドレスを示すものである。
【0050】
書き込みポインタWPのところまで、エラー訂正前のデータが書き込まれている。そして、このエラー訂正前のデータは、エラー訂正回路7でエラー訂正処理され、第2のバッファメモリ5Bからリングバッファメモリ6に送られ、エラーポインタEPのところまでが、エラー訂正処理が済み、出力可能なデータである。そして、読み出しポインタRPのところまで読み出しが終了している。
【0051】
図9に示すように、先ず、復調データがリングバッファメモリ6に書き込まれる。復調データの書き込みが終了すると、書き込みポインタWPが1ECCブロック分進められ、リングバッファメモリ6から第2のバッファメモリ5Bにデータが転送されるとともに、エラー訂正回路7にデータが転送され、PI系列、PO系列、PI系列のエラー訂正処理が行われる。エラー訂正処理が終了すると、デスクランブル、エラー検出処理が実行されて、第2のバッファメモリ5Bからリングバッファメモリ6にエラー訂正処理されたデータが転送され、そのブロックのデータの転送が終了すると、エラーポインタEPが1ブロック分進められる。
【0052】
図10に示すように、エラー訂正処理後のデータは、出力可能データとなる。出力要求信号があると、リングバッファメモリ6がらデータが読み出され、読み出しポインタRPが進められる。このとき、出力可能データがあるかどうかが、読み出しポインタRPとエラーポインタEPから判断される。すなわち、エラーポインタEPと読み出しポインタRPとの関係が判断される。エラーポインタEPと読み出しポインタRPとの関係が、EP>RPであれば、出力可能データがあるので、後段にデータが出力され、読み出しポインタRPが進められる。EP=RPなら、出力可能データがないので、データは出力さない。
【0053】
図11に示すように、後段の回路からのデータ出力要求がない場合等では、書き込みポインタWPは進んでいくが、読み出しポインタRPは止まっているため、書き込みポインタWPが読み出しポインタRPに追いつく。書き込みポインタWPが読み出しポインタRPに追いつき、EP=RPになったら、書き込み動作が一時停止される。そして、トラックジャンプが必要なときには、トラックジャンプさせるようになっている。(オーバーフロー制御)。その後、読み出しポインタRPが進んで、入力可能領域が生じたら、復調データの書き込みが可能になる。
【0054】
図12は、この光ディスク再生装置に用いられるエラー訂正回路7の構成例を示すものである。
【0055】
図12において、エラー訂正回路7は、エラー訂正用集積回路51と、エラーバッファ52と、フラグメモリ53と、エラーカウンタ54とから構成される。エラー訂正用集積回路51は、リードソロモン符号のエラー訂正処理を行う集積回路である。エラー訂正用集積回路51には、RAMインターフェース56を介して、データEDT〔7:0〕と、フラグメモリ53からのイレージャ訂正のためのフラグEFLGが入力される。このエラー訂正用集積回路51は、符号長及びパリティ数等のパラメータがプログラマブルに設定可能とされている。
【0056】
エラーバッファ52は、FIFOで構成されている。エラー訂正用集積回路51でのエラー訂正処理の結果、エラーパターンは、エラーバッファ52に蓄えられる。エラーバッファ52の出力は、EX−OR回路55に供給される。このEX−OR回路55には、RAMインターフェース56を介して、第2のバッファメモリ5Bからのデータが供給される。エラーパターンの場合には、エラーを修正するために、このエラーの位置のタイミングで、エラーバッファ52からのデータと、第2のバッファメモリ5Bからのデータとの排他的論理和がとられてエラーが修正され、再び第2のバッファメモリ5Bに戻される。
【0057】
フラグメモリ53は、エラーポジションを示すエラーフラグのポインタを蓄えるものである。そして、イレージャ訂正を行う際に、このエラーフラグが用いられる。
【0058】
エラーカウンタ54は、エラー訂正用集積回路51でのエラー訂正処理の結果、エラーの数をカウントしている。
【0059】
図13及び図14は、このエラー訂正回路の動作を示すタイミングチャートである。図13で、ESTTは、符号の先頭を示すコントロール信号、ECDEは符号の最後を示すコントロール信号、ECYEは符号サイクルの最後を示すコントロール信号である。図13に示すように、訂正結果は次式のようなサイクルで出力される。
【0060】
スループット=2×NCYC+3×PCYC+13
なお、NCYCは長い方の符号長を示し、PCYCは長い方のパリティ数を示すものである。
【0061】
図14に示すように、エラー訂正用集積回路51は、単一のクロックECCKで動作している。図14において、OSTTはコントロール信号ESTTの遅延出力であり、ある符号系列においてコントロール信号ESTTから477クロック(ECCKクロック)後に出力される。そして、エラーが検出され、そのエラーが訂正可能であれば、OSTT=1と同時にECOD=0となり、その後EC0R=1の位置に、エラーパターンECD〔7:0〕とエラーポジションECA〔7:0〕が出力される。
【0062】
なお、イレージャ訂正モードにおていは、エラーパターンECD〔7:0〕とエラーポジションECA〔7:0〕データは必ず出力されるが、その位置のデータが正しい場合には、エラーパターンはECD〔7:0〕=00(H)となる。
【0063】
エラー訂正結果、エラーパターンECD〔7:0〕及びエラーポジションECA〔7:0〕は、エラーバッファ52に書き込まれ、エラー訂正タイミングで、第2のバッファメモリ5Bからエラーのある位置のデータを読み出し、バッファ52から読み出したエラーパターンとの排他的論理知をとった結果、再度第2のバッファメモリ5Bに書き戻される。
【0064】
ここで、イレージャ訂正時にエラーパターンECD〔7:0〕=00(H)となるデータは、実際には正しいので、訂正動作しても無意味なため、エラーバッファ52への書き込みを行わない。
【0065】
以上のように、この実施の形態における光ディスク再生装置では、復調された再生データが第1のバッファメモリ5Aに1フレーム分蓄積されたら、リングバッファメモリ6とエラー訂正回路7に送りPI系列のエラー訂正処理を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込み、PIエラー訂正が終わると、リングバッファメモリ6からPOデータを読み出して第2のバッファメモリ5Bに書き込むとともに、第2のバッファメモリ5Bからエラー訂正回路7にECC転送(POデータ転送)して、エラー訂正回路7によりPOエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリ6に書き込む。また、PIエラー訂正が終わると、リングバッファメモリ6からエラー訂正回路7にECC転送(PI2データ転送)を実行すると同時に、第2のバッファメモリ5Bにデータを書き込み、エラー訂正回路7によりPI2エラー訂正を行い、デスクランブル及びエラー検出回路8を介してエラー訂正済みのデータをリングバッファメモリ6に書き込む。そして、ホストコンピュータ14から出力要求に応じたデータをリングバッファメモリ6からATAPIインターフェース15を介してホストコンピュータ14に必要とされる転送レートで転送(ホスト転送)する。この光ディスク再生装置では、リングバッファメモリ6から第2のバッファメモリ5Bへのデータの書き込みと、エラー訂正回路7でのPI系列のエラー訂正処理が同時に起こるので、データ処理速度が短縮され、例えば、ディスクを2倍速で読み出し、ATAPIインターフェースで16.6Mビット/sでデータを転送することが可能となる。このことについて、以下に検証する。
【0066】
ディスクを1倍速で再生した場合の復調データのレートは、26.16MB/sである。ATAPIインターフェースで要求される転送レートは、16.6MB/sである。
【0067】
リングバッファメモリ6は、ワードアクセス(16ビット)とし、nワードページアクセスのサイクル数を3+2×nサイクルとする。また、第2のバッファメモリ6Bは、バイトアクセス(8ビット)とし、nバイトページアクセスのサイクル数を3+2×nサイクルとする。さらに、マスタークロックの周波数は、40MHzとする。
【0068】
また、図4で示したように、1シンクフレームのビット数は、1456ビットであり、これに32ビットのシンクパターンが付加されている。したがって、1シンクフレームの総ビット数は、1456+32=1488ビットである。
【0069】
ディスクを1倍速で再生した場合の復調データのレートは26.16Mbit/sである。したがって、シンクフレーム周波数は、
となる。
【0070】
マスタークロックは40MHzであり、このマスタークロックの1クロック分を1サイクルとする。シンクフレーム周波数は、17.58065KHzであり、2シンクフレームがPI系列(182バイト)の1フレームに相当するので、PI系列の1フレームをサイクル数に換算すると、2×40MHz/17.58065KHz=4550サイクルとなる。したがって、1ECCブロックすなわち208フレームでは、4550サイクル×208=946400サイクルとなる。
【0071】
ここでは、図15に示すように、リングバッファメモリ6を16バイト/19サイクル毎にぺージアクセスして、ホスト転送のアクセスとそれ以外のアクセスが交互に行われるものとする(ECC以外のアクセス要求がなければ、ECCアクセスを繰り返せるが、その場合はえCCの16サイクル終了を待つことになる)。このときのホスト転送レートは、16.84MB/sなので、16.6MB/sを満足する。
【0072】
そして、復調データの書き込み及びPIデータの読み出し、訂正に要するサイクル数は、PI系列の182バイトが16バイト/19サイクル毎にぺージアクセスされると、182/16=11.3であるから、1ECCブロック208フレームでは、
12×19×208=47424サイクル (1)
となる。また、5バイト訂正であるから、
(5+5)×5×208=10400サイクル (2)
を必要とする。
【0073】
さらに、POデータの読み出し、訂正に要するサイクル数は、PO系列のフレームの208バイトが16バイト/19サイクル毎にぺージアクセスされると、208/16=26であるから、
26×19×172/2+15064(#) =57548サイクル (3)
となる。また、16バイト訂正であるから、
(16+16)×5×172=27520サイクル (4)
を必要とする。なお、15064(#) は、第2のバッファメモリ5BからのECC転送(POデータ転送)サイクルにおけるホスト以外の転送分を考慮したものである。
【0074】
また、PI2データの読み出しに要するサイクル数は、POパリティデータの16列を除いて計算し、PI系列の182バイトが16バイト/19サイクル毎にぺージアクセスされると、182/16=11.3であるから、1ECCブロック208フレームでは、
12×19×(208−16)=43776サイクル (5)
となる。
【0075】
EDC終了データの書き込みは、メインデータ192フレームのみを計算し、16バイト/19サイクル毎にぺージアクセスされるので、172バイト/16=10.75であるから、1ECCブロック208フレームでは、
11×19×192=40128サイクル (6)
必要となる。
【0076】
これら(1)〜(6)の合計は、226796サイクルとなる。
【0077】
さらにDRAMにはリフレッシュ動作が必要で、約16μ秒に1度CASビッフォアRASリフレッシュサイクルを入れるとすると、1ECCブロック期間では、23660/16=1478.75回となり、1回のリフレッシュサイクルを5サイクルとすると、
1479×5=7395サイクル
となる。
【0078】
したがって、全てのホスト転送を確保するときのデコード処理速度の限界は、(946400+7395)×(19/38)/(226796+7395)=2.02となり、2倍速が可能となる。
【0079】
なお、上述の例では、エラー訂正符号として、PI系列とPO系列とからなる積符号のものを用いているが、他の構成のエラー訂正符号を用いるようにしても良い。また、この例では、PI系列の復号をし、PO系列の復号をした後、更に、PI系列の復号を行っているか、PI系列の復号と、P0系列の復号とがエラー訂正処理を完了するようにしても良い。
【0080】
【発明の効果】
この発明によれば、復調された再生データを第1のバッファメモリに書き込み、この第1のバッファメモリに1フレーム分のデータが蓄積されると、1フレーム分のPIデータをエラー訂正回路に送るとともにリングバッファメモリに書き込み、エラー訂正回路によりPI系列のエラー訂正処理を行い、エラー訂正処理済みのデータをリングバッファメモリに書き込み、PIエラー訂正が終わるとリングバッファメモリからPOデータをエラー訂正回路に送るとともに第2のバッファメモリに書き込み、エラー訂正回路によりPO系列のエラー訂正処理を行い、エラー訂正処理済みのデータをリングバッファメモリに書き込む。さらに、POエラー訂正が終わるとリングバッファメモリからエラー訂正回路にPI2データを送るとともに第2のバッファメモリにデータを書き込み、この第2のバッファメモリに蓄えられたデータによりエラー訂正回路でPI2エラー訂正処理を行い、PI2エラー訂正処理を完了したら、第2のバッファメモリからリングバッファメモリにデータを転送し、必要とされる転送レートでリングバッファメモリからデータを出力する。これにより、リングバッファメモリから第2のバッファメモリへのデータの書き込みと、エラー訂正回路でのPI系列のエラー訂正処理が同時に起こるので、データ処理速度が短縮され、例えば、ディスクを2倍速で読み出し、ATAPIインターフェースで16.6Mビット/sでデータを転送することが可能となる。
【図面の簡単な説明】
【図1】この発明が適用された光ディスク再生装置の構成を示すブロック図である。
【図2】DVDのデータフォーマットを示す略線図である。
【図3】DVDのデータフォーマットを示す略線図である。
【図4】DVDのデータフォーマットを示す略線図である。
【図5】上記光ディスク再生装置におけるECCブロックタイミングを基にしたデータ処理動作のタイミングチャートである。
【図6】上記光ディスク再生装置におけるECCフレームタイミングを基にしたPI/POエラー訂正処理動作のタイミングチャートである。
【図7】上記光ディスク再生装置におけるECCフレームタイミングを基にしたPI/PI2エラー訂正処理動作のタイミングチャートである。
【図8】上記光ディスク再生装置におけるリングバッファの説明に用いる略線図である。
【図9】上記リングバッファの説明に用いる略線図である。
【図10】上記リングバッファの説明に用いる略線図である。
【図11】上記リングバッファの説明に用いる略線図である。
【図12】上記光ディスク再生装置におけるエラー訂正回路の構成例を示すブロック図である。
【図13】上記エラー訂正回路の説明に用いるタイミングチャートである。
【図14】上記エラー訂正回路の説明に用いるタイミングチャートである。
【図15】上記光ディスク再生装置の動作説明に用いるタイミングチャートである。
【図16】リングバッファメモリの基本構成の説明に用いる略線図である。
【図17】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図18】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図19】従来のディスク再生装置の一例の説明に用いるブロック図である。
【図20】従来のディスク再生装置の一例の説明に用いるタイミングチャートである。
【図21】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図22】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図23】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図24】従来のディスク再生装置の他の例の説明に用いるブロック図である。
【図25】従来のディスク再生装置の他の例の説明に用いるタイミングチャートである。
【図26】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図27】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図28】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図29】従来のディスク再生装置の更に他の例の説明に用いるブロック図である。
【図30】従来のディスク再生装置の更に他の例の説明に用いるタイミングチャートである。
【符号の説明】
1 光ディスク、5A 第1のバッファメモリ、5B 第2のバッファメモリ、6 リングバッファメモリ、7 エラー訂正回路
Claims (3)
- 記録媒体からデジタルデータを再生する再生手段と、
上記再生手段により再生されたデータにエラー訂正処理を施すエラー訂正手段と、
上記エラー訂正手段によりエラー訂正された再生データを可変レートで出力する可変レート制御用のリングバッファメモリと、
上記再生手段から供給される再生データを少なくとも1フレーム分蓄積して上記エラー訂正手段とリングバッファメモリに送る第1のバッファメモリと、
上記エラー訂正手段によりエラー訂正された再生データを少なくとも1フレーム分蓄積して上記リングバッファメモリに送る第2のバッファメモリと、
上記再生手段及びリングバッファメモリの動作を制御する制御手段とを備え、
上記第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込み、第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込み、出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力することを特徴とするデータ再生装置。 - 上記第1及び第2のバッファメモリは、エラー訂正ブロックの2乃至3フレーム分の記憶容量をそれぞれ有することを特徴とすることを特徴とする請求項1記載のデータ再生装置。
- 復調された再生データを第1のバッファメモリに書き込む第1の工程と、
第1のバッファメモリに1フレーム分のデータが蓄積されたら、第1のバッファメモリから1フレーム分のデータをエラー訂正手段に送るとともにリングバッファメモリに書き込み、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第1の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第2の工程と、
上記第1の系列のエラー訂正が終わると、リングバッファメモリから第2の系列のデータを読み出して第2のバッファメモリに書き込むとともに、第2のバッファメモリから第2の系列のデータをエラー訂正手段に送り、リングバッファメモリに書き込まれたデータに対してエラー訂正手段により第2の系列のエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第3の工程と、
上記第2の系列のエラー訂正が終わると、リングバッファメモリからエラー訂正手段に第1の系列のデータをエラー訂正手段に送るとともに第2のバッファメモリに書き込む第4の工程と、
第2のバッファメモリに書き込まれたデータに対してエラー訂正手段によりエラー訂正を行い、エラー訂正済みのデータをリングバッファメモリに書き込む第5の工程と、
出力要求に応じた転送速度でリングバッファメモリからエラー訂正済みのデータを出力する第6の工程とを有することを特徴とするデータ再生方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP34424096A JP3564910B2 (ja) | 1996-12-24 | 1996-12-24 | データ再生装置及びデータ再生方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP34424096A JP3564910B2 (ja) | 1996-12-24 | 1996-12-24 | データ再生装置及びデータ再生方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH10188471A JPH10188471A (ja) | 1998-07-21 |
JP3564910B2 true JP3564910B2 (ja) | 2004-09-15 |
Family
ID=18367719
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP34424096A Expired - Fee Related JP3564910B2 (ja) | 1996-12-24 | 1996-12-24 | データ再生装置及びデータ再生方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3564910B2 (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001210013A (ja) | 1999-11-15 | 2001-08-03 | Hitachi Ltd | データ再生装置 |
KR100685360B1 (ko) | 2000-01-31 | 2007-02-22 | 산요덴키가부시키가이샤 | 회로 규모를 억제하며 고속의 오류 정정을 행하는 것이 가능한 오류 정정 장치 및 복호 장치 |
JP4551635B2 (ja) | 2003-07-31 | 2010-09-29 | ソニー株式会社 | パイプライン処理システムおよび情報処理装置 |
JP4082300B2 (ja) | 2003-08-29 | 2008-04-30 | ソニー株式会社 | パイプライン処理システムおよび情報処理装置 |
JP2008204544A (ja) * | 2007-02-20 | 2008-09-04 | Fujitsu Ltd | 誤り訂正装置及びデータ読み出し装置 |
-
1996
- 1996-12-24 JP JP34424096A patent/JP3564910B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH10188471A (ja) | 1998-07-21 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP2569478B2 (ja) | デ−タ記録装置 | |
US5901159A (en) | Apparatus and method for decoding a coded digital signal | |
CN1205612C (zh) | 数字视盘重现装置中的存贮器控制装置及其方法 | |
KR100223634B1 (ko) | 고속 데이타 처리 및 전송을 위한 에러정정용 메모리를 구비하는 시스템 디코더 및 에러정정용 메모리 제어방법 | |
JP3562544B2 (ja) | 復号化装置および復号化方法 | |
US6282367B1 (en) | System decoder for high-speed data transmission and method for controlling track buffering | |
JP3564910B2 (ja) | データ再生装置及びデータ再生方法 | |
KR19990060321A (ko) | 디지털 비디오 디스크-램 시스템에서 디펙트 섹터 데이터의처리방법 | |
JPH09265730A (ja) | データ再生装置、再生方法 | |
JP4140344B2 (ja) | 復号化装置及びコンピュータプログラム | |
KR20030089430A (ko) | 데이터 재생 제어 장치 | |
US20010038584A1 (en) | Optical disc reproducing apparatus and semiconductor integrated circuit used therefor | |
JP3759992B2 (ja) | 記録情報再生装置 | |
JPH1186465A (ja) | 信号処理装置 | |
KR0176586B1 (ko) | 씨디롬 디코더의 외부 메모리 제어 방법 | |
JP3672139B2 (ja) | データ復号装置及びその方法並びにデータ再生装置 | |
JPH07272415A (ja) | 記録媒体およびその再生装置 | |
JPH04255187A (ja) | 情報記録装置 | |
US6687871B2 (en) | Digital signal processing apparatus for reproducing optical disc data and optical disc player having the same | |
KR100315768B1 (ko) | 고속의 데이타재생을 위한 메모리액세스방법 및 이를 채용한dvd시스템 | |
KR100216026B1 (ko) | 디지탈 비디오 디스크 시스템의 디코딩 장치 | |
JP2000057712A (ja) | データ再生装置およびこれを具備した電子機器 | |
KR100194044B1 (ko) | 메모리 억세스를 위한 인터페이스 장치 및 방법 | |
KR100200096B1 (ko) | 메모리의 전송데이타 인터페이스 장치 및 방법 | |
JP2000090595A (ja) | デ・スクランブル装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20040518 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040531 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080618 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090618 Year of fee payment: 5 |
|
LAPS | Cancellation because of no payment of annual fees |