KR0132407Y1 - Power source voltage reduction detection circuit - Google Patents
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Abstract
본 고안은 전원 전압의 감소를 검출하는 회로에 관한 것으로써, 특히 충전지를 이용하거나 전원 전압이 감소되면 큰 영향을 받는 회로에 적당하도록 함과 아울러 고가의 집적회로를 이용하지 않고 트랜지스터 및 저항만을 이용하여 원가 절감의 측면에서도 유리한 전원 전압 감소 검출 회로에 관한 것으로, 종래에는 전원 전압의 강하에 의하여 다른 회로에 영향을 끼치게 되고, 고가의 집적 회로로 구성된 비교기나 오피앰프를 사용함으로써 원가 상승의 요인이 되는 문제점이 있었으나, 본 고안에서는 전원 전압(Vcc)과 접지 사이에 저항(R1)과 기준전위 설정부(100)가 직렬로 연결되고, 상기 저항(R1)과 상기 기준전위 설정부(100)의 접속점은 콜렉터에 전원 전압(Vcc)를 인가 받는 트랜지스터(Q1)의 베이스에 연결되어, 그의 에미터는 저항(R2)을 통하여 트랜지스터(Q2)의 에미터에 연결되고, 전원 전압(Vcc)과 접지 사이에 직렬로 연결된 저항(R4) (R5)의 접속점은 상기 트랜지스터(Q2)의 베이스에 연결되어, 그의 콜렉터는 접지의 저항(R3) 및 에미터가 접지된 트랜지스터(Q3)의 베이스에 연결되고, 상기 전원 전압(Vcc)은 저항(R6)을 통해 상기 트랜지스터(Q3)의 콜렉터에 인가되게 접속되어, 그 접속점에서 출력(OUT)을 내게 구성하여 전원 전압의 하강에 따라 타 회로에 끼치는 영향을 최소화함으로써 오동작의 유발을 방지하고, 충전지를 사용하는 회로에 대해서는 충전지의 교체시기를 알 수 있게 해주며, 또한 고가의 집적 회로 대신에 저가의 트랜지스터 및 저항을 사용함에 따라 원가 절감의 효과도 있게 된다.The present invention relates to a circuit for detecting a decrease in power supply voltage. Especially, it is suitable for a circuit that is significantly affected by using a rechargeable battery or when the power supply voltage is reduced, and only transistors and resistors are used without using expensive integrated circuits. Therefore, the present invention relates to a power supply voltage reduction detection circuit which is advantageous in terms of cost reduction. In the related art, a power supply voltage drop affects other circuits, and a cost increase factor is achieved by using a comparator or an op amp composed of expensive integrated circuits. However, in the present invention, the resistor R1 and the reference potential setting unit 100 are connected in series between the power supply voltage Vcc and the ground, and the resistance R1 and the reference potential setting unit 100 are connected to each other in series. The connection point is connected to the base of transistor Q1, which receives the supply voltage Vcc to the collector, the emitter of which is transistored through resistor R2. Is connected to the emitter of emitter Q2, and the connection point of resistor R4 (R5) connected in series between power supply voltage Vcc and ground is connected to the base of transistor Q2, and its collector is connected to the resistance of ground (R3) and the emitter are connected to the base of the grounded transistor (Q3), the power supply voltage (Vcc) is connected to be applied to the collector of the transistor (Q3) via a resistor (R6), and output at that connection point ( By configuring OUT), it minimizes the effect on other circuits as the power supply voltage falls, preventing malfunctions, and it is possible to know when to replace the rechargeable battery for the circuit using the rechargeable battery. Instead, the use of low cost transistors and resistors also reduces costs.
Description
제1도는 종래의 전원 전압 감소 검출 회로도1 is a conventional power supply voltage reduction detection circuit diagram
제2도는 본 고안 전원 전압 감소 검출 회로도2 is a circuit voltage detection detection circuit of the present invention
제3도는 본 고안의 동작 상태를 나타낸도3 is a view showing the operating state of the present invention
제4도는 본 고안의 다른 동작 상태를 나타낸도4 is a view showing another operating state of the present invention
제5도는 제2도 내지 제4도에 의거한 실험 결과를 나타낸 파형도5 is a waveform diagram showing the results of experiments based on FIGS.
*도면의 주요부분에 대한 부호의 설명* Explanation of symbols for main parts of the drawings
100 : 기준전위 설정부 Q1~Q7 : 트랜지스터100: reference potential setting unit Q1 to Q7: transistor
R1~R6 : 저항R1 ~ R6: resistance
본 고안은 전원 전압의 감소를 검출하는 회로에 관한 것으로, 특히 충전지를 이용하거나 전원 전압이 감소되면 큰 영향을 받는 회로에 적당하도록 함과 아울러 고가의 집적회로를 사용하지 않고 트랜지스터 및 저항만을 이용하여 원가 절감의 측면에서도 유리하게 한 전원 전압 감소 검출 회로에 관한 것이다.The present invention relates to a circuit for detecting a decrease in power supply voltage, and in particular, it is suitable for a circuit that is significantly affected by using a rechargeable battery or when the power supply voltage is reduced, and also using only transistors and resistors without using expensive integrated circuits. It also relates to a supply voltage reduction detection circuit which is advantageous in terms of cost reduction.
제1도는 종래의 전원 전압 감소 검출 회로도로서, 이에도시된 바와 같이 비교기(COM)의 반전 입력단(-)으로 입력되는 기준 전위(Vref)는 검출하려는 기준전압으로 설정하여 놓고, 비반전 입력단자(+)에 전원 전압(Vcc)이 저항(R1), (R2)을 통해 분압되어 입력되는데, 만일 A점의 전위가 기준 전위(Vref)보다 높게 되면, 상기 비교기(COM)의 출력(OUT)은 고전위로 출력된다.FIG. 1 is a conventional circuit diagram for detecting a decrease in power supply voltage. As shown in FIG. 1, the reference potential Vref input to the inverting input terminal (-) of the comparator COM is set to a reference voltage to be detected and the non-inverting input terminal ( The power supply voltage Vcc is divided into + through the resistors R1 and R2. If the potential at the point A is higher than the reference potential Vref, the output OUT of the comparator COM Output at high potential.
반면에, A점의 전위가 기준 전위(Vref)보다 낮게 되면, 상기 비교기(COM)의 출력(OUT)은 저전위로 출력되어 전원 전압(Vcc)의 감소를 검출해 내게 된다.On the other hand, when the potential at the point A becomes lower than the reference potential Vref, the output OUT of the comparator COM is output at a low potential to detect a decrease in the power supply voltage Vcc.
그런데, 이와 같은 경우에 전원 전압의 출력 자체를 제어할 수 없어 전원 전압의 강하에 의하여 다른 회로에 영향을 끼치게 되고, 고가의 집적 회로로 구성된 비교기나 오피앰프를 사용함으로써 원가 상승의 요인이 되는 문제점이 있었다.In this case, however, the output voltage of the power supply itself cannot be controlled, which causes other circuits to be affected by a drop in the power supply voltage, and a cost increase factor is achieved by using a comparator or an op amp composed of expensive integrated circuits. There was this.
따라서, 본 고안은 종래의 이러한 문제점을 감안하여, 전원 전압 강하에 의해 타 회로에 끼치는 영향을 제거함과 아울러 저가의 트랜지스터 및 저항을 사용하여 전원 전압 감소를 정확히 검출하고, 원가 절감을 이루도록 하는데 목적이 있는 것으로, 이와 같은 목적을 갖는 본 고안을 상세히 설명한다.Accordingly, the present invention has been made in view of the above-mentioned problems, and aims at eliminating the influence on other circuits due to power supply voltage drop and accurately detecting power supply voltage reduction and cost reduction by using low-cost transistors and resistors. It will be described in detail the present invention having such a purpose.
제2도는 본 고안 전원 전압 감소 검출 회로도로서, 이에도시한 바와 같이, 전원 전압(Vcc)과 접지 사이에 저항(R1)과 기준전위 설정부(100)가 직렬로 연결되고, 상기 저항(R1)과 상기 기준전위 설정부(100)의 접속점(A)에 트랜지스터(Q1)의 베이스가 연결됨과 아울러, 그의 콜렉터로는 전원 전압(Vcc)을 인가받고 에미터로는 저항(R2)을 통하여 트랜지스터(Q2)의 에미터에 연결되고, 상기 트랜지스터(Q2)의 콜렉터는 저항(R3)을 통하여 접지에 연결됨과 아울러 그의 베이스는 전원 전압(Vcc)과 접지 사이에 직렬로 연결된 저항(R4)(R5)의 접속점(B)에 연결되며, 트랜지스터(Q3)의 베이스는 상기 트랜지스터(Q2)의 콜렉터와 저항(R3)의 접속점에 연결됨과 아울러 그의 콜렉터로는 전원 전압(Vcc)을 저항(R6)을 통해 인가받으며, 에미터는 접지와 연결되고, 상기 트랜지스터(Q3)의 콜렉터에서 출력(OUT)을 내도록 구성한다.FIG. 2 is a circuit diagram of a power supply voltage detection circuit of the present invention. As shown in the drawing, a resistor R1 and a reference potential setting unit 100 are connected in series between a power supply voltage Vcc and a ground, and the resistor R1 The base of the transistor Q1 is connected to the connection point A of the reference potential setting unit 100 and the collector is supplied with a power supply voltage Vcc and the emitter is a resistor R2 through a resistor R2. Connected to the emitter of Q2), the collector of transistor Q2 is connected to ground via a resistor R3, and its base is connected in series between the supply voltage Vcc and ground (R4) (R5) The base of transistor Q3 is connected to the connection point of the collector of the transistor Q2 and the resistor R3, and the collector is connected to the supply voltage Vcc through the resistor R6. Applied, the emitter is connected to ground, and the call of the transistor Q3 It constitutes the emitter to pay a output (OUT).
이와 같이 구성한 본 고안의 작용 및 효과를 상세히 설명한다.The operation and effects of the present invention configured as described above will be described in detail.
먼저, 항상 트랜지스터(Q1)가 온되어 있도록 기준전위 설정부(100)에 의해 A점의 전위를 일정하게 유지시켜 놓게 된다.First, the potential at the point A is kept constant by the reference potential setting unit 100 so that the transistor Q1 is always on.
이후, 전원 전압(Vcc)이 설정 전압 이상이 되면, 전원 전압(Vcc)의 감소를 검출하기 위한 저항(R4)(R5)의 접속점인 B점의 전위 (Vcc × R5 / (R4 + R5))가 트랜지스터(Q2)를 오프시키도록 저항(R4)(R5)이 조정되어 있으므로 트랜지스터(Q2)는 오프되고, 이로 인해 트랜지스터(Q3)도 오프됨으로써 전원 전압(Vcc)은 저항(R6)을 통하여 출력(OUT)되게 된다.Subsequently, when the power supply voltage Vcc becomes equal to or higher than the set voltage, the potential of the point B (Vcc × R5 / (R4 + R5)), which is the connection point of the resistor R4 (R5), for detecting the decrease in the power supply voltage Vcc). Since resistor R4 and R5 are adjusted so that transistor Q2 is turned off, transistor Q2 is turned off, thereby turning off transistor Q3 so that power supply voltage Vcc is output through resistor R6. (OUT).
이 때, 트랜지스터(Q2)가 온이 될 수 있는 조건은 A 점의 전위보다 B 점의 전위가 (Q1 × VBE) + (Q2 × VBE) 이상 낮아져야만 한다.At this time, the condition at which the transistor Q2 can be turned on must be lower than the potential of the point A by more than (Q1 × V BE ) + (Q2 × V BE ).
반면에, 전원 전압(Vcc)이 설정 전압 이하가 되면 B 점의 전위도 마찬가지로 설정 전압보다 낮게 되어 상기의 트랜지스터(Q2)가 온이 될 수 있는 조건을 만족하게 되므로 트랜지스터(Q2)는 온되고, 이에 따라 트랜지스터(Q3)가 온됨으로써 전원 전압(Vcc)이 출력되는 것을 차단하게 되고 즉, 출력(OUT)은 저전위로 출력한다.On the other hand, when the power supply voltage Vcc is less than or equal to the set voltage, the potential at the point B is also lower than the set voltage to satisfy the condition that the transistor Q2 can be turned on, so that the transistor Q2 is turned on, As a result, the transistor Q3 is turned on to block the output of the power supply voltage Vcc, that is, the output OUT is output at a low potential.
제3도는 제2도에 의거하여 전원 전압이 3.5볼트의 설정 전압보다 낮게 공급될 경우에 각 단에 걸리는 전압을 나타낸 본 고안의 동작 상태로서, A 점의 전위보다 B 점의 전위가 낮게 되므로 트랜지스터(Q2)가 온되어 0.152 볼트의 전압이 출력(OUT)됨을 나타내고 있으며, 제4도는 제2도에 의거하여 전원 전압이 5 볼트로 되어 3.5 볼트의 설정 전압보다 높을 경우에 각 단에 걸리는 전압을 나타낸 본 고안의 다른 동작 상태도로서, A 점의 전위보다 B 점의 전위가 높게 되므로 트랜지스터(Q2)가 오프되어 5 볼트의 전압이 출력(OUT)됨을 나타내고 있다.3 is an operating state of the present invention showing the voltage applied to each stage when the power supply voltage is lower than the set voltage of 3.5 volts according to FIG. 2, and the potential at the point B is lower than the potential at the point A. (Q2) is turned on to indicate that the voltage of 0.152 volts is output (OUT), and FIG. 4 shows the voltage applied to each stage when the power supply voltage is 5 volts and higher than the set voltage of 3.5 volts according to FIG. As another operation state diagram of the present invention, the potential of the point B is higher than the potential of the point A, which indicates that the transistor Q2 is turned off to output a voltage of 5 volts.
또한, 제5도는 본 고안에 의거한 실험 결과를 나타낸도로서, B 점의 전위보다 A 점의 전위가 낮을 경우에는 트랜지스터(Q3)의 베이스에 전압이 인가되지 않으므로 출력(OUT)에는 전원 전압(Vcc)이 출력되고, B 점의 전위보다 A 점의 전위가 높을 경우에는 트랜지스터(Q3)의 베이스에 전압이 인가되어 전원 전압(Vcc)의 출력(OUT)이 차단됨을 보여준다.5 shows an experimental result based on the present invention. When the potential at the point A is lower than the potential at the point B, no voltage is applied to the base of the transistor Q3. When Vcc) is output and the potential of the point A is higher than the potential of the point B, a voltage is applied to the base of the transistor Q3 to show that the output OUT of the power supply voltage Vcc is cut off.
이로써, 전원 전압의 강하에 따라 타 회로에 끼치는 영향을 최소화함으로써 오동작의 유발을 방지하고, 충전지를 사용하는 회로에 대해서는 충전지의 교체시기를 알 수 있게 해주며, 또한 고가의 집적 회로 대신에 저가의 트랜지스터 및 저항을 사용함에 따라 원가 절감의 효과도 있게 된다.This minimizes the effects on other circuits due to a drop in power supply voltage, thereby preventing malfunctions. For circuits using rechargeable batteries, it is possible to know when to replace the rechargeable batteries. The use of transistors and resistors also provides cost savings.
Claims (1)
Priority Applications (1)
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|---|---|---|---|
| KR2019950019890U KR0132407Y1 (en) | 1995-08-01 | 1995-08-01 | Power source voltage reduction detection circuit |
Applications Claiming Priority (1)
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| KR2019950019890U KR0132407Y1 (en) | 1995-08-01 | 1995-08-01 | Power source voltage reduction detection circuit |
Publications (2)
| Publication Number | Publication Date |
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| KR970010716U KR970010716U (en) | 1997-03-29 |
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Family
ID=19420011
Family Applications (1)
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| KR2019950019890U KR0132407Y1 (en) | 1995-08-01 | 1995-08-01 | Power source voltage reduction detection circuit |
Country Status (1)
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| KR (1) | KR0132407Y1 (en) |
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1995
- 1995-08-01 KR KR2019950019890U patent/KR0132407Y1/en not_active IP Right Cessation
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| Publication number | Publication date |
|---|---|
| KR970010716U (en) | 1997-03-29 |
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