JPS6442623U - - Google Patents

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JPS6442623U
JPS6442623U JP13853687U JP13853687U JPS6442623U JP S6442623 U JPS6442623 U JP S6442623U JP 13853687 U JP13853687 U JP 13853687U JP 13853687 U JP13853687 U JP 13853687U JP S6442623 U JPS6442623 U JP S6442623U
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JP
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access memory
coefficients
input
data
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JP13853687U
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【図面の簡単な説明】
第１図は本考案のデジタルアイルタの構成を示
す図、第２図は非巡回形デジタルアイルタ基本的
な構成をを示す図、第３図は同、具体例を示す図
である。 ５……入出力装置、６……データ・ランダムア
クセスメモリ、７……係数・ランダムアクセスメ
モリ、８……加算器、９……マイクロコンピユー
タ、１０……アツプダウンカウンタ、１１……転
送バツフア・ランダムアクセスメモリ。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力データを入出力装置５を通してデータ・ラ
    ンダムアクセスメモリ６に入力し、このデータ・
    ランダムアクセスメモリ６内において、入力デー
    タを遅延し、各遅延出力Ｄ０，Ｄ１，Ｄ２………
    Ｄｎ―１、Ｄｎと係数・ランダムアクセスメモリ
    ７に記録されている係数ａ０，ａ１，ａ２………
    ａｎ―１、ａｎとを乗加算器８によつて時分割で
    それぞれ乗算し、加算して、入出力装置５を通し
    て出力するようにした構成において、 所定の係数ａ０，ａ１，ａ２……ａｎ―１，ａ
    ｎをつくるマイクロコンピユータ９と、 この係数ａ０，ａ１，ａ２……ａｎ―１、ａｎ
    をアツプダウンカウンタ１０のアツプカウント動
    作によつて指定されるアドレスに順次書き込み、
    この係数ａ０，ａ１，ａ２……ａｎ―１，ａｎを
    上記アツプダウンカウンタ１０のダウンカウント
    動作によつて順次読み出す転送バツフア・ランダ
    ムアクセスメモリ１１とからなり、 この転送バツフア・ランダムアクセスメモリ１
    １から読み出された係数ａ０，ａ１，ａ２……ａ
    ｎ―１，ａｎを上記係数・ランダムアクセスメモ
    リ７に順次書き込むようにした、ことを特徴とす
    るデジタルフイルタ。
JP13853687U 1987-09-09 1987-09-09 Pending JPS6442623U (ja)

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JP13853687U JPS6442623U (ja) 1987-09-09 1987-09-09

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JP13853687U JPS6442623U (ja) 1987-09-09 1987-09-09

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JPS6442623U true JPS6442623U (ja) 1989-03-14

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JP13853687U Pending JPS6442623U (ja) 1987-09-09 1987-09-09

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Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57178412A (en) * 1981-04-27 1982-11-02 Nippon Telegr & Teleph Corp <Ntt> Equalizer
JPS5853217A (ja) * 1981-09-25 1983-03-29 Nec Corp デジタルフイルタ回路
JPS60205671A (ja) * 1984-03-29 1985-10-17 Toshiba Corp たたみ込み演算回路
JPS61152115A (ja) * 1984-12-26 1986-07-10 Toshiba Corp デジタルフイルタ
JPS6259408A (ja) * 1985-09-09 1987-03-16 Victor Co Of Japan Ltd デジタル・グラフイツク・イコライザ
JPS6259410A (ja) * 1985-09-09 1987-03-16 Victor Co Of Japan Ltd デジタル・グラフイツク・イコライザ

Patent Citations (6)

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Publication number Priority date Publication date Assignee Title
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