JPS6376528A - スケルチ回路 - Google Patents
スケルチ回路Info
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- JPS6376528A JPS6376528A JP22102186A JP22102186A JPS6376528A JP S6376528 A JPS6376528 A JP S6376528A JP 22102186 A JP22102186 A JP 22102186A JP 22102186 A JP22102186 A JP 22102186A JP S6376528 A JPS6376528 A JP S6376528A
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- 206010011878 Deafness Diseases 0.000 abstract 2
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- 238000010586 diagram Methods 0.000 description 15
- 230000035945 sensitivity Effects 0.000 description 7
- 238000006243 chemical reaction Methods 0.000 description 5
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- 101100464782 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) CMP2 gene Proteins 0.000 description 1
- 101100464779 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) CNA1 gene Proteins 0.000 description 1
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Landscapes
- Noise Elimination (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＦＭ受信機におけるキャリア消失時の雑音を
、１９調出力を遅延させて除去するスケルチ回路に関す
る。
、１９調出力を遅延させて除去するスケルチ回路に関す
る。
ＦＭ受信機には無信号時に装置内部で発生する雑音を除
去するため、スケルチ回路（ミュート回路）を内蔵して
いるのが一般的である。しかし、高周波信号（キャリア
）が消失してからスケルチ回路によるミュート動作が行
われるまでには、通常数１０ｍ５の遅れ時間があり、こ
の間の雑音は除去できない。
去するため、スケルチ回路（ミュート回路）を内蔵して
いるのが一般的である。しかし、高周波信号（キャリア
）が消失してからスケルチ回路によるミュート動作が行
われるまでには、通常数１０ｍ５の遅れ時間があり、こ
の間の雑音は除去できない。
この点を解決するために、送信側から送信終了時に検知
用の信号（トーンやデータ）を送出し、受信側でそれを
検知してミュート動作を行なう方式がある。しかし、こ
の方式の受信機でも送信側が終了検知用信号の送出機能
がないものに代れば、やはり雑音が発生する欠点がある
。
用の信号（トーンやデータ）を送出し、受信側でそれを
検知してミュート動作を行なう方式がある。しかし、こ
の方式の受信機でも送信側が終了検知用信号の送出機能
がないものに代れば、やはり雑音が発生する欠点がある
。
本発明は、ミュート対象となる復調出力を、ミュート信
号発生の遅延量に見合って遅延させることにより、上述
した問題点を解決しようとするものである。
号発生の遅延量に見合って遅延させることにより、上述
した問題点を解決しようとするものである。
本発明は、ＦＭ受信機の復調回路の出力からノイズ成分
を抽出し、そのレベルが所定値を越えたときにミュート
回路を作動させ、該復調回路の出力が後段回路へ入力し
ないようにするスケルチ回路において、該復調回路とミ
ュート回路の間に、キャリア消失時に該ミュート回路が
作動するまでの動作遅れに見合う遅延時間の遅延回路を
介在させてなることを特徴とするものである。
を抽出し、そのレベルが所定値を越えたときにミュート
回路を作動させ、該復調回路の出力が後段回路へ入力し
ないようにするスケルチ回路において、該復調回路とミ
ュート回路の間に、キャリア消失時に該ミュート回路が
作動するまでの動作遅れに見合う遅延時間の遅延回路を
介在させてなることを特徴とするものである。
復調回路からミュート回路へ入力する復調出力を適度に
遅延させると、復調出力のキャリア消失時にミュート回
路が動作するまでの遅れ時間と一致させることができ、
キャリア消失時の確実なノイズ除去効果が期待できる。
遅延させると、復調出力のキャリア消失時にミュート回
路が動作するまでの遅れ時間と一致させることができ、
キャリア消失時の確実なノイズ除去効果が期待できる。
第１図は本発明の一実施例を示す構成図で、ＦＭ受信機
の一部を示したものである。図中、１はＦＭ復調回路、
２は遅延回路、３はノイズスケルチ回路、４はＡＦ（低
周波）アンプ、５はスピーカである。ノイズスケルチ回
路３はｆＪｊ ８ｍ出力すのうち例えば２０ＫＨｚ程度
のノイズ成分だけを選択増幅するノイズアンプ３１と、
その出力を直流に変換する直流変換回路３２と、該回路
３２の出力ｄ（ミュート信号）でオン、オフ制御される
ミュートスイッチ３３とを備える。遅延回路２は例えば
第３図に示すようにＮ段のＢ Ｂ Ｄ （Ｂｕｃｋｅｔ
Ｂｒｉｇａｄｅ Ｄｅｖｉｃｅ）と、それを駆動する周
波数ｆｐのクロック発生器２２と、ＢＢＤ２１で遅延し
た出力から音声帯域（３ＫＨｚ程度）だけを通過させる
ＬＰＦ （ローパスフィルタ）２３とで構成され、 なる遅延時間を与えることができる。Ｎは例えば１０２
４である。
の一部を示したものである。図中、１はＦＭ復調回路、
２は遅延回路、３はノイズスケルチ回路、４はＡＦ（低
周波）アンプ、５はスピーカである。ノイズスケルチ回
路３はｆＪｊ ８ｍ出力すのうち例えば２０ＫＨｚ程度
のノイズ成分だけを選択増幅するノイズアンプ３１と、
その出力を直流に変換する直流変換回路３２と、該回路
３２の出力ｄ（ミュート信号）でオン、オフ制御される
ミュートスイッチ３３とを備える。遅延回路２は例えば
第３図に示すようにＮ段のＢ Ｂ Ｄ （Ｂｕｃｋｅｔ
Ｂｒｉｇａｄｅ Ｄｅｖｉｃｅ）と、それを駆動する周
波数ｆｐのクロック発生器２２と、ＢＢＤ２１で遅延し
た出力から音声帯域（３ＫＨｚ程度）だけを通過させる
ＬＰＦ （ローパスフィルタ）２３とで構成され、 なる遅延時間を与えることができる。Ｎは例えば１０２
４である。
第２図は動作波形図で、（ｂ）〜ｔｅｌは第１図の各記
号に対応する。（ａ）の高周波信号は受信キャリアを示
し、ＯＮはキャリア有、ＯＦＦはキャリアなしを示す。
号に対応する。（ａ）の高周波信号は受信キャリアを示
し、ＯＮはキャリア有、ＯＦＦはキャリアなしを示す。
（ｂ）の復調出力はキャリアがＯＮであれば信号成分が
あり、キャリアがＯＦＦになるとノイズ成分となる。（
Ｃ）の遅延出力はｆｂ）の復調出力を遅延回路２によっ
てτＢだけ遅延させたものである。
あり、キャリアがＯＦＦになるとノイズ成分となる。（
Ｃ）の遅延出力はｆｂ）の復調出力を遅延回路２によっ
てτＢだけ遅延させたものである。
＋ｄ）のミュート信号はｔｂ＞の復調出力にノイズ成分
が現われてからτＮ経たないとＯＮＬない。この時間τ
Ｎ （数１０ｍ５程度）はノイズアンプ３１や直流変換
回路３２内の容量（特に後者の平滑用コンデンサ）によ
る動作遅れである。ここで、τＢ＝τＮに設定すればｔ
ｅｌのスピーカ入力からはノイズ成分が確実に除去され
、且つ信号成分も欠落しない。但し、τＢ〉τＮである
と信号成分が一部欠落し、τＢくτＮであるとノイズ成
分が一部残存する。このようなケースはτＮ一定であれ
ば起こりにくいが、スケルチ感度をボリュームで調整す
ることによりτＮが変化してしまうと、τＮ＝τＢなる
関係を維持できなくなる。以下にこの対策方法を示す。
が現われてからτＮ経たないとＯＮＬない。この時間τ
Ｎ （数１０ｍ５程度）はノイズアンプ３１や直流変換
回路３２内の容量（特に後者の平滑用コンデンサ）によ
る動作遅れである。ここで、τＢ＝τＮに設定すればｔ
ｅｌのスピーカ入力からはノイズ成分が確実に除去され
、且つ信号成分も欠落しない。但し、τＢ〉τＮである
と信号成分が一部欠落し、τＢくτＮであるとノイズ成
分が一部残存する。このようなケースはτＮ一定であれ
ば起こりにくいが、スケルチ感度をボリュームで調整す
ることによりτＮが変化してしまうと、τＮ＝τＢなる
関係を維持できなくなる。以下にこの対策方法を示す。
第４図は第１図の直流変換回路３２の詳細ブロック図で
、第５図はその回路図である。整流回路３２１はコンデ
ンサＣ１とダイオードＤＩ、’Ｄ２を用いた倍電圧整流
型で、その整流出力は積分回路３２２のコンデンサＣ２
で平滑化される。スケルチボリューム３２３は可変抵抗
ＶＲと固定抵抗Ｒの直列回路に発生する電圧Ｖを可変抵
抗ＶＲで変化させてスケルチ感度を調整する。つまり、
電圧Ｖは比較器３２４のしきい値、第５図ではトランジ
スタＴｒのベース・エミッタ間電圧０．６■と比較され
、Ｖ ＝ ０．６を境にトランジスタＴｒはオン、オフ
する。このトランジスタＴｒのコレクタ出力がミュート
信号ｄとして使用される。
、第５図はその回路図である。整流回路３２１はコンデ
ンサＣ１とダイオードＤＩ、’Ｄ２を用いた倍電圧整流
型で、その整流出力は積分回路３２２のコンデンサＣ２
で平滑化される。スケルチボリューム３２３は可変抵抗
ＶＲと固定抵抗Ｒの直列回路に発生する電圧Ｖを可変抵
抗ＶＲで変化させてスケルチ感度を調整する。つまり、
電圧Ｖは比較器３２４のしきい値、第５図ではトランジ
スタＴｒのベース・エミッタ間電圧０．６■と比較され
、Ｖ ＝ ０．６を境にトランジスタＴｒはオン、オフ
する。このトランジスタＴｒのコレクタ出力がミュート
信号ｄとして使用される。
上述した回路では可変抵抗ＶＲはコンデンサＣ２の放電
抵抗の一部となるので、その値がスケルチ動作点調整に
伴ない変化すると、前述した遅れ時間τＮも変化してし
まう。例えば、最高スケルチ感度点に設定するためにＶ
Ｒの値を増加させると遅れ時間τＮは最大値Ｔ１となり
、逆に最低スケルチ感度点に設定するためにＶＲＯ値を
低下させると遅れ時間τＮはＴ２となる。第６図はこの
特性を示している。但し、０．６Ｖ以上はトランジスタ
Ｔｒのない状態で示しである。そこで、例えば前者でτ
Ｎ＝τＢの関係を成立させると、後者にしたとき（ＴＩ
Ｔ２）時血だけ信号の欠落が生ずる。第７図はこれ
を示している。
抵抗の一部となるので、その値がスケルチ動作点調整に
伴ない変化すると、前述した遅れ時間τＮも変化してし
まう。例えば、最高スケルチ感度点に設定するためにＶ
Ｒの値を増加させると遅れ時間τＮは最大値Ｔ１となり
、逆に最低スケルチ感度点に設定するためにＶＲＯ値を
低下させると遅れ時間τＮはＴ２となる。第６図はこの
特性を示している。但し、０．６Ｖ以上はトランジスタ
Ｔｒのない状態で示しである。そこで、例えば前者でτ
Ｎ＝τＢの関係を成立させると、後者にしたとき（ＴＩ
Ｔ２）時血だけ信号の欠落が生ずる。第７図はこれ
を示している。
第８図は上述した不都合を避けるために、クロツク発振
器２２の周波数を調整できるようにすると共に、そのク
ロック周波数調整ボリューム２４とスケルチボリューム
３２３との間に連動関係を持たせた本発明の他の実施例
である。図中、遅延回路２０は第３図のＢＢＤ２１とＬ
ＰＦ２３を含み、ＢＢＤ２１を駆動するクロック発振器
２２は独立して図示しである。また、ミュート回路３０
は第４図の比較器３２４と第１図のミュートスイッチ３
３を含み、ノイズアンプ３１と直流変換回路３２は図示
していない。
器２２の周波数を調整できるようにすると共に、そのク
ロック周波数調整ボリューム２４とスケルチボリューム
３２３との間に連動関係を持たせた本発明の他の実施例
である。図中、遅延回路２０は第３図のＢＢＤ２１とＬ
ＰＦ２３を含み、ＢＢＤ２１を駆動するクロック発振器
２２は独立して図示しである。また、ミュート回路３０
は第４図の比較器３２４と第１図のミュートスイッチ３
３を含み、ノイズアンプ３１と直流変換回路３２は図示
していない。
実際には完全にτＮ−τＢとしなくとも、遅れ時間τＮ
を複数Ｘ（例えば３〜５）に分割し、遅延時間ｒＢをそ
の数だけ設定すれば充分である。
を複数Ｘ（例えば３〜５）に分割し、遅延時間ｒＢをそ
の数だけ設定すれば充分である。
具体的には遅れ時間τＮの変化幅をａとし、ａ／ｘ ＝
５ ｍｓ程度になるように設定する。第９図にＸ＝３
とした例を示す。同図（ａ）はスケルチボリュームＶＲ
の値が最低スケルチ感度点から最高スケルチ感度点へ変
化して、ミュート遅れ時間τＮがｔからｔ＋ａ／３．ｔ
＋２ａ／３．ｔ＋ａへと変化するものとしたとき、遅延
時間τＢをｔ ＋ ａ ／ ３ 。
５ ｍｓ程度になるように設定する。第９図にＸ＝３
とした例を示す。同図（ａ）はスケルチボリュームＶＲ
の値が最低スケルチ感度点から最高スケルチ感度点へ変
化して、ミュート遅れ時間τＮがｔからｔ＋ａ／３．ｔ
＋２ａ／３．ｔ＋ａへと変化するものとしたとき、遅延
時間τＢをｔ ＋ ａ ／ ３ 。
ｔ ＋ ２ａ ／ ３ 、 ｔ ＋ ａの各値に変化
させるようにしたものである。つまり、 ｒ Ｈ＝ ｔ 〜ｔ ＋ ａ ／ ３でｒＢ＝ｉ＋３／
３ｒ Ｎ ＝ ｔ ＋ ａ ／ ３〜ｔ＋ ２ ａ ／
３でτｓ＝ｔ＋２ａ／３ ｒｒ＋＝ｔ＋２ａ／３〜ｔ＋ａでｒＢ＝ｔ＋ａである。
させるようにしたものである。つまり、 ｒ Ｈ＝ ｔ 〜ｔ ＋ ａ ／ ３でｒＢ＝ｉ＋３／
３ｒ Ｎ ＝ ｔ ＋ ａ ／ ３〜ｔ＋ ２ ａ ／
３でτｓ＝ｔ＋２ａ／３ ｒｒ＋＝ｔ＋２ａ／３〜ｔ＋ａでｒＢ＝ｔ＋ａである。
第１０図は上述したτＢの各値を実現する回路で、ＶＲ
’ はクロック周波数調整ボリュームである。このボリ
ュームＶＲ′の各位置’ＶＲ３′、 ＶＲ２’ＶＲＩ
’ はスケルチボリュームＶＲの各位置ＶＲ３。
’ はクロック周波数調整ボリュームである。このボリ
ュームＶＲ′の各位置’ＶＲ３′、 ＶＲ２’ＶＲＩ
’ はスケルチボリュームＶＲの各位置ＶＲ３。
ｖＲ２，ｖＲ，に対応する。ＣＭＰ １．ＣＭＰ ２は
抵抗値表示したしきい値をそれぞれＶＲＩ’ ＋
ＶＲ２’とするコンパレータで、ＳＷｌ、ＳＷ２はアナ
ログスイッチである。ボリュームＶＲ’ がＶＲＩ’
以下であればコンパレータＣＭＰ ＋ 、ＣＭＰ ２
は作動しないので、スイッチＳＷ＋ 、ＳＷ２はオフで
ある。このためクロック発１辰器２２の端子Ｐ、 Ｑ間
には抵抗Ｒ・だけが接続され、τＢ＝ｔ＋ａとなる。次
にＶＲ′がＶＲＩ’ とＶＲ２’ の間にあるとコ
ンパレータＣＭＰ１が動作してスイッチＳ Ｗ ＋がオ
ンする。この結果、端子Ｐ、Ｑ間には抵抗Ｒ＋。
抵抗値表示したしきい値をそれぞれＶＲＩ’ ＋
ＶＲ２’とするコンパレータで、ＳＷｌ、ＳＷ２はアナ
ログスイッチである。ボリュームＶＲ’ がＶＲＩ’
以下であればコンパレータＣＭＰ ＋ 、ＣＭＰ ２
は作動しないので、スイッチＳＷ＋ 、ＳＷ２はオフで
ある。このためクロック発１辰器２２の端子Ｐ、 Ｑ間
には抵抗Ｒ・だけが接続され、τＢ＝ｔ＋ａとなる。次
にＶＲ′がＶＲＩ’ とＶＲ２’ の間にあるとコ
ンパレータＣＭＰ１が動作してスイッチＳ Ｗ ＋がオ
ンする。この結果、端子Ｐ、Ｑ間には抵抗Ｒ＋。
Ｒ２が並列接続されてτＢ ＝ ｔ ＋ ２ａ ／ ３
になる。
になる。
さらにＶＲ’がＶＲ２’ を越えるとコンパレータＣ
ＭＰ ＋、ＣＭＰ ２が動作してスイッチＳＷ１．ＳＷ
２がオンになり、端子Ｐ、Ｑ間には抵抗Ｒ１〜Ｒ３が並
列接続される。この結果、τＢ−ｔ ＋ ａ／３になる
。このようにしてスケルチボリュームＶＲの位置に応じ
た遅延時間τＢを設定することができる。
ＭＰ ＋、ＣＭＰ ２が動作してスイッチＳＷ１．ＳＷ
２がオンになり、端子Ｐ、Ｑ間には抵抗Ｒ１〜Ｒ３が並
列接続される。この結果、τＢ−ｔ ＋ ａ／３になる
。このようにしてスケルチボリュームＶＲの位置に応じ
た遅延時間τＢを設定することができる。
以上述べたように本発明によれば、復調回路とミュート
回路との間に遅延回路を介在させ、ミュート動作の遅れ
時間に見合って復調出力を遅延させるようにしたので、
受信キャリア消失直後の雑音も確実に除去できる利点が
ある。
回路との間に遅延回路を介在させ、ミュート動作の遅れ
時間に見合って復調出力を遅延させるようにしたので、
受信キャリア消失直後の雑音も確実に除去できる利点が
ある。
第１図は本発明の一実施例を示すブロック図、第２図は
その各部動作波形図、第３図は遅延回路の構成図、第４
図は直流変換回路の詳細図、第５図は第４図の主要回路
図、第６図はスケルチ感度とミュート動作時間の説明図
、第７図はミュート動作時間と信号欠落の説明図、第８
図は本発明の他の実施例を示す構成図、第９図は遅延時
間可変の説明図、第１０図は第８図の具体例を示す要部
回路図である。 図中、１は復調回路、２は遅延回路、３はスケルチ回路
、４はＡＦアンプ、５はスピーカである。 出 願 人 富士通テン株式会社 代理人弁理士 青 柳 稔 第１図 （ｅ）スピーカ入力
・ラヒ１図の各含ｐ會カイＦ禾（形に ＆′６ １
その各部動作波形図、第３図は遅延回路の構成図、第４
図は直流変換回路の詳細図、第５図は第４図の主要回路
図、第６図はスケルチ感度とミュート動作時間の説明図
、第７図はミュート動作時間と信号欠落の説明図、第８
図は本発明の他の実施例を示す構成図、第９図は遅延時
間可変の説明図、第１０図は第８図の具体例を示す要部
回路図である。 図中、１は復調回路、２は遅延回路、３はスケルチ回路
、４はＡＦアンプ、５はスピーカである。 出 願 人 富士通テン株式会社 代理人弁理士 青 柳 稔 第１図 （ｅ）スピーカ入力
・ラヒ１図の各含ｐ會カイＦ禾（形に ＆′６ １
Claims (1)
- ＦＭ受信機の復調回路の出力からノイズ成分を抽出し、
そのレベルが所定値を越えたときにミュート回路を作動
させ、該復調回路の出力が後段回路へ入力しないように
するスケルチ回路において、該復調回路とミュート回路
の間に、キャリア消失時に該ミュート回路が作動するま
での動作遅れに見合う遅延時間の遅延回路を介在させて
なることを特徴とするスケルチ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22102186A JPS6376528A (ja) | 1986-09-19 | 1986-09-19 | スケルチ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22102186A JPS6376528A (ja) | 1986-09-19 | 1986-09-19 | スケルチ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6376528A true JPS6376528A (ja) | 1988-04-06 |
Family
ID=16760242
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22102186A Pending JPS6376528A (ja) | 1986-09-19 | 1986-09-19 | スケルチ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6376528A (ja) |
-
1986
- 1986-09-19 JP JP22102186A patent/JPS6376528A/ja active Pending
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