JPS63161634A - 半導体集積回路装置 - Google Patents

半導体集積回路装置

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JPS63161634A
JPS63161634A JP61314311A JP31431186A JPS63161634A JP S63161634 A JPS63161634 A JP S63161634A JP 61314311 A JP61314311 A JP 61314311A JP 31431186 A JP31431186 A JP 31431186A JP S63161634 A JPS63161634 A JP S63161634A
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pad electrode
integrated circuit
semiconductor integrated
slit
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は半導体集積回路装置に関し、特にアルミ・パッ
ド電極の構造に関する。
(従来の技術) 従来、半導体集積回路装置のパッドRt極Kriアルご
材が多用され、また、半導体基板上では内部アルミ配線
群と隣接して設けられる。周知の通り、パヅド電極は半
導体集積回路装置の外部取出電極てらって半導体基板の
最上層に位置し組立ての際この面上にボンディング・ワ
イヤが熱圧着される。
この熱圧着の際、アルミ・パッドの電極面およびそのア
ルミ引出導体部はボンディング応力の伝ばん方向にそれ
ぞれ伸長するので内部アルミ配線との接触を回避する必
要上アルミ引出導体部rt隣接する内部アルミ配線と2
0〜30μm程度離間して形成される。また、ボンディ
ング応力により基板に形成された半導体素子の接合が破
壊される場合も生じるのでアルミ・パッド電極は接合上
を避けて設けられる。
(発明が解決しようとする問題点) しかしながら、微細加工技術が進み半導体装置の高密度
化および高速化が今日のように進展して来ると、能動素
子を含む電子回路の縮小化の達成度に比ベアルξ・パッ
ド電極周辺の遅れが目立つようになりその対策が望まれ
ている。すなわち、通常の内部アルき配線の相互間距船
が僅か3〜4μmにすぎないのにパッド電極との離間距
離がその10倍にも達していること、および、パッド電
極面縁膜上場所的制約のあることが注目され始めており
離間距離の縮小化および形成場所の制約開−の解決が強
く望まれている。
〔発明の目的〕
本発明の目的は、上記の情況に鑑み、隣接する内部アル
ミ配線との離間距離を縮小化し得ると共に形成場所に制
約を受けることなく構造のアルi・パッド電極を廟する
半導体集積回路装置を提供することである。
〔発明の構成〕
本発明によれば、半導体集積回路装置は、半導体基板と
、前記半導体基板のフィールド絶縁膜上に互いに隣接し
て形成されるアルミ−パッド−極および内部アルミ配線
群と、前記内部アルミ配線群の少なくとも一つと電気接
続されるアルミ・パッド電極のアルミ引出導体部と、前
記アルミ・パッド1極の面上に二次元配置されるスリッ
ト状の貫通孔とを備えることを含む。
(問題点を解決するための手段) すなわち、本発明によれば、アルミ・パッド電極の面上
にはスリット状の貫通孔が格子状または同心円状に二次
元配置される。この場合、スリット状の貫通孔はパッド
電極面の全面にわたって形成されていてもよいし中央部
だけに集中していてもよい。また、密匿分布が場所によ
り異なっていてもよい。
(作用) ここで、配設されたスリ、ト状の)1)孔はアルミ・パ
ッド電極にワイヤ・ボンディングが行なわれた際面上を
伝ばんするボンディング応力を受けてぎわば潰れるよう
に変形しこの応力を吸収するよう作用する。すなわち、
アルミ・パッド電極の伸長を緩和すると共に下部組織に
対してはスボンヂ・クヴシ1ンとしての効果を示す。従
って、アルミ引出導体部と隣接する内部アルミ配線との
離間距離を従来の172〜1/3に細小すると共に接合
上へのアルミ・パッド電極の形成を可能ならしめ得る。
以下図面を参照して本発明の詳細な説明する。
(実施例) 第1図Ca)および(b)は本発明の一実施例を示すア
ルク拳ハツト電極近傍の平囲図およびそのA−A’断面
図である。本実施例によれは、本発明の半導体集積回路
装置は、半導体基板lと、この基板に形成された不純物
拡散層2およびフィールド絶縁膜3と、不純物拡散層2
を含むフィールド絶縁膜3上に互いに隣接して形成され
たアルミ・パ雫ド″’IIE極4および内部アルミ配線
群5と、内部アルミ配線の一つと′電気接続されるアル
ミ・パッド・1極4のアルミ引出導体部6と、アルξ・
パッド4$J!、4の全国にわたつて配設されたスリッ
ト状の貫通孔7と、アルミ・バッド′電極の絶縁保護膜
8とを含む。すなわち、本実施例によれば、不純物拡散
層2の直上にアルミ・パッド電極4が配置された場合が
例示される。ここで、アルミ・パッド″Ft極4上にボ
ンディング作業が行なわれるとスリット状の貫通孔7は
この除虫じるボンディング応力の大半を吸収して押し潰
される。従ッて、ボンディング応力のほとんどはアルミ
eパ9ド亀他4の面上で消費されるのでアルミ引出導体
部6および直下の不純物拡散層2に向かう伝ばん勢力は
きわめて小さなものとなる。すなわち、アルミ引出導体
部6の横方向の伸長は著しく緩和されまた不純物拡散層
2が形成する接合はその破壊から保麹される。
第2図は本発明にかかるスリット状貫通孔のボンディン
グ応力吸収状況図で、ボンディング・ワイヤ9が熱圧着
された際スリット状の貫通孔7がボンディング応力を吸
収して変形する様子を示したものである。このようにス
リット状の貫通孔7の形成によりアルミ引出導体部6の
横方向の伸長を緩和し且つ下部組識の接合を破敞から保
護することができるので、アルミ引出導体部6と隣接す
る内部アルミ配線との離rlI′]m1iiLLを従来
の1/2〜1/3に縮小化すると共にアルξ・パッド電
極4の形成場所に関する制約を実質的に解決し得る。
以上は円形のスリ・ノド状貫通孔を格子配列した場合を
説明したが円形に限らず矩形、だ円形その他任意の形状
に設定することも可能であり、また、二次元配置であれ
ば格子に限らす同心円状とじてもよく、場合によっては
中央部にのみ配設してもよい。
第3図および第4図は本発明の他の実施例をそれぞれ示
すアルミ・パッド電極近傍の平面図である。これら2つ
の実施例図には絶縁膜!1la8が省略された以外は全
て前実施例と共通符号が付されている。すなわち、第3
図は円形のスリット状貫通孔7が同心円状に配置された
場合であり、また、第4図は同様に中央部に集中して格
子配列された場合をそれぞれ示したものである。以上の
配役の仕方は個々の半導体装置の構造に合わせ適宜選択
すればよいが、必要があれは形状の異なるスリット頁通
貫を混在せしめることも、また、異なる密度分布で配設
することもできる。
第5図は本発明のその他の実施例を示すアルミ・パッド
電極近傍の平面図で、同じく絶緘保a膜8が省略されて
示されている。このように形状を変え密度分布を異なら
せると下部組織に対するボンディング応力の19度を部
分的に微妙に変えることができる。
〔発明の効果〕
以上詳細に説明したように、本発明によれば、アルミ・
パッド電極のボンディング面の全面または中央部のみに
スリット状の貫通孔を二次元配置することによりボンテ
ィングの除虫じる機械的応力を吸収してアルミ・パッド
km全体の伸長を緩和し得る他、接合その他の下部組識
の破壊を有効に保護し得るので、アルミ・パッド1)L
4!1!、とこれに隣接配添される内部アルミ配線群と
の離間距離を従来の172〜1/3に短縮せしめ得るの
みでなくアルミ・パッド電極の形成場所の制約問題を実
質的に解決することができる。従って、電子回路の微細
化技術と相撲って半導体集積回路装置の集&度面上に顕
著なる効果を奏することが可能である。
【図面の簡単な説明】
第1図(a)および(b )d本発明の一実施例を示す
アルξ・パッド電極近傍の平面図およびそのA−A’断
面図、第2図は本発明にかかるスリット状貫通孔のボン
ディング応力吸収状況図、第3図および第4図は本発明
の他の実施例をそれぞれ示すアルi・パッド電極近傍の
平面図、第5図は本発明のその他の実施例を示すアルミ
・パッド′電極近傍の平面図である。 1・・・・・・半導体基板、2・・・・・・不純物拡散
層、3・・・・・・フィールド絶縁膜、4・・・・・・
アルミ・パッド電極、5・・・・・・内部アルミ配線群
、6・・・・・・アルミ引出導体部、7・・・・・・ス
リット状の貫通孔、8・・・・・・P2縁保誇膜、9・
・・・・・ボンディング・ワイヤ、L・・・・・・離間
距離。 代理人 弁理士  内 原   1′2・日 $ 1 図

Claims (5)

    【特許請求の範囲】
  1. (1)半導体基板と、前記半導体基板のフィールド絶縁
    膜上に互いに隣接して形成されるアルミ・パッド電極お
    よび内部アルミ配線群と、前記内部アルミ配線群の少な
    くとも一つと電気接続されるアルミ・パッド電極のアル
    ミ引出導体部と、前記アルミ・パッド電極の面上に二次
    元配置されるスリット状の貫通孔とを備えることを特徴
    とする半導体集積回路装置。
  2. (2)前記スリット状の貫通孔がアルミ・パッド電極の
    全面にわたり格子または同心円状に配設されることを特
    徴とする特許請求の範囲第(1)項記載の半導体集積回
    路装置。
  3. (3)前記スリット状の貫通孔がアルミ・パッド電極の
    中央部に集中して格子または同心円状に配設されること
    を特徴とする特許請求の範囲第(1)項記載の半導体集
    積回路装置。
  4. (4)前記スリット状の貫通孔がアルミ・パッド電極の
    全面にわたり異なる密度分布で格子または同心円状に配
    設されることを特徴とする特許請求の範囲第(1)項記
    載の半導体集積回路装置。
  5. (5)前記スリット状の貫通孔がアルミ・パッド電極の
    中央部に集中し異なる密度分布で格子または円心円状に
    配設されることを特徴とする特許請求の範囲第(1)項
    記載の半導体集積回路装置。
JP61314311A 1986-12-24 1986-12-24 半導体集積回路装置 Pending JPS63161634A (ja)

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5686762A (en) * 1995-12-21 1997-11-11 Micron Technology, Inc. Semiconductor device with improved bond pads
EP0897215A3 (en) * 1997-08-11 2000-08-09 Murata Manufacturing Co., Ltd. Surface acoustic wave device
US6879049B1 (en) * 1998-01-23 2005-04-12 Rohm Co., Ltd. Damascene interconnection and semiconductor device
US7420283B2 (en) 2004-11-11 2008-09-02 Denso Corporation Integration type semiconductor device and method for manufacturing the same
US7514790B2 (en) 2005-06-02 2009-04-07 Seiko Epson Corporation Semiconductor device and method of manufacturing a semiconductor device

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5686762A (en) * 1995-12-21 1997-11-11 Micron Technology, Inc. Semiconductor device with improved bond pads
USRE40819E1 (en) * 1995-12-21 2009-07-07 Micron Technology, Inc. Semiconductor device with improved bond pads
EP0897215A3 (en) * 1997-08-11 2000-08-09 Murata Manufacturing Co., Ltd. Surface acoustic wave device
US6879049B1 (en) * 1998-01-23 2005-04-12 Rohm Co., Ltd. Damascene interconnection and semiconductor device
US7042100B2 (en) 1998-01-23 2006-05-09 Rohm Co., Ltd Damascene interconnection and semiconductor device
US7420283B2 (en) 2004-11-11 2008-09-02 Denso Corporation Integration type semiconductor device and method for manufacturing the same
US7579695B2 (en) 2004-11-11 2009-08-25 Denso Corporation Integration type semiconductor device and method for manufacturing the same
US7514790B2 (en) 2005-06-02 2009-04-07 Seiko Epson Corporation Semiconductor device and method of manufacturing a semiconductor device

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