JPS63140735U - - Google Patents

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JPS63140735U
JPS63140735U JP3254087U JP3254087U JPS63140735U JP S63140735 U JPS63140735 U JP S63140735U JP 3254087 U JP3254087 U JP 3254087U JP 3254087 U JP3254087 U JP 3254087U JP S63140735 U JPS63140735 U JP S63140735U
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JP
Japan
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clock pulse
transistor
input signal
gate
logic circuit
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JP3254087U
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【図面の簡単な説明】
第1図はこの考案の論理回路の実施例を示す回
路図、第2図は第1図に示した論理回路の動作を
示すタイミングチヤート、第3図ないし第5図は
この考案の論理回路の他の実施例を示す回路図、
第6図は従来の論理回路を示す回路図である。 2……第1のトランジスタ、4,4A,4B…
…第2のトランジスタ、VIN……入力信号、φ
……クロツクパルス、……反転クロツクパルス

Claims (1)

  1. 【実用新案登録請求の範囲】 ゲートにクロツクパルスが加えられそのクロツ
    クパルスによつてスイツチングする第1のトラン
    ジスタとともに、ゲートに入力信号が加えられて
    その入力信号によつて論理動作を行う第2のトラ
    ンジスタを備えてダイナミツク動作をする論理回
    路において、 第2のトランジスタに対して接地電位または電
    源を反転クロツクパルスによつて設定した論理回
    路。
JP3254087U 1987-03-05 1987-03-05 Pending JPS63140735U (ja)

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JP3254087U JPS63140735U (ja) 1987-03-05 1987-03-05

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JP3254087U JPS63140735U (ja) 1987-03-05 1987-03-05

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JPS63140735U true JPS63140735U (ja) 1988-09-16

Family

ID=30839312

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3254087U Pending JPS63140735U (ja) 1987-03-05 1987-03-05

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JP (1) JPS63140735U (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5548592U (ja) * 1978-09-27 1980-03-29

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5548592U (ja) * 1978-09-27 1980-03-29

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