JPS6260473A - 直流出力電源回路 - Google Patents
直流出力電源回路Info
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- JPS6260473A JPS6260473A JP19911285A JP19911285A JPS6260473A JP S6260473 A JPS6260473 A JP S6260473A JP 19911285 A JP19911285 A JP 19911285A JP 19911285 A JP19911285 A JP 19911285A JP S6260473 A JPS6260473 A JP S6260473A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
本発明は、商用交流電圧を整流して、スイッチング電源
装置におけるインバータ部等ｆζ直流電圧を供給する直
流出力電源回路、特に前記商用交流電圧が大幅に変化し
ても故障を生じたり異常Ｉこ高い直流電圧を出力したり
することのない回路構成に関する。
装置におけるインバータ部等ｆζ直流電圧を供給する直
流出力電源回路、特に前記商用交流電圧が大幅に変化し
ても故障を生じたり異常Ｉこ高い直流電圧を出力したり
することのない回路構成に関する。
スイッチング電源装置等にお贋ては、電源としての商用
交流電圧が１００ボルトであっても２゜Ｏボルトであっ
ても使用できるようζこするために、通常倍電圧整流と
全波整流との両機能を有する蛋源回路が用いられており
、このような電源回路は従来第３図に示したように構成
されている。すなわち第３図において、１は入力端子２
ａ、２ｂに波高値Ｅ、瞬時値Ｅａの単相電圧を出力する
単相交流電源３が接続され、出力端子４ａ、４ｂ間に二
個のコンデンサ５，６が直列接続されたブリッジ整流回
路で、ｌａ、ｌｂ、ｌｃ、ｌｄは該整流回路１を構成す
るダイオードである。コンデンサ５と６との接続点７と
、入力端子２ｂとは、スイッチ８を介して接続されてい
る。第３図においては整流回路１とコンデンサ５，６と
スイッチ８とが上記のように接続されているので、スイ
ッチ８が閉状態であるとダイオードｌａ、ｌｂとコンデ
ンサ５，６とで全波形倍電圧整流回路が形成されている
ことになり、またスイッチ８が開状態であると整流回路
１は明らかに全波整流回路を形成している。９は、スイ
ッチ８の開閉（こ応じて交流電圧Ｅａを全波整流または
倍電圧整流した直流電圧Ｖｄを出力端子４ａ、４ｂから
出力する、上述の各部からなる直流出力電源回路である
。１０は電圧Ｖｄが入力され該電圧を高周波交流電圧に
変換するインバータ部、１１は結合トランス１２を介し
て入力されるインバータ部１０の出力交流゛電圧を直流
化する整流千渣部、ｌｌａ、ｌｌｂは直流電圧が出力さ
れる整流平滑部１１の出力端子である。１３は上記した
電源回路９とインバータ部１０とトランス１２と整流平
滑部１１とからなるスイッチング電源装置である。
交流電圧が１００ボルトであっても２゜Ｏボルトであっ
ても使用できるようζこするために、通常倍電圧整流と
全波整流との両機能を有する蛋源回路が用いられており
、このような電源回路は従来第３図に示したように構成
されている。すなわち第３図において、１は入力端子２
ａ、２ｂに波高値Ｅ、瞬時値Ｅａの単相電圧を出力する
単相交流電源３が接続され、出力端子４ａ、４ｂ間に二
個のコンデンサ５，６が直列接続されたブリッジ整流回
路で、ｌａ、ｌｂ、ｌｃ、ｌｄは該整流回路１を構成す
るダイオードである。コンデンサ５と６との接続点７と
、入力端子２ｂとは、スイッチ８を介して接続されてい
る。第３図においては整流回路１とコンデンサ５，６と
スイッチ８とが上記のように接続されているので、スイ
ッチ８が閉状態であるとダイオードｌａ、ｌｂとコンデ
ンサ５，６とで全波形倍電圧整流回路が形成されている
ことになり、またスイッチ８が開状態であると整流回路
１は明らかに全波整流回路を形成している。９は、スイ
ッチ８の開閉（こ応じて交流電圧Ｅａを全波整流または
倍電圧整流した直流電圧Ｖｄを出力端子４ａ、４ｂから
出力する、上述の各部からなる直流出力電源回路である
。１０は電圧Ｖｄが入力され該電圧を高周波交流電圧に
変換するインバータ部、１１は結合トランス１２を介し
て入力されるインバータ部１０の出力交流゛電圧を直流
化する整流千渣部、ｌｌａ、ｌｌｂは直流電圧が出力さ
れる整流平滑部１１の出力端子である。１３は上記した
電源回路９とインバータ部１０とトランス１２と整流平
滑部１１とからなるスイッチング電源装置である。
第３図においては電源回路９が上述のように４はぼ２Ｅ
に等しくなり、したがってこの状態でＥを逐次犬ぎくし
てＥ＝ １００ボルトにすると、第４図の特性線１４４
こ示したようにＶｄも次第に大きくなってＥ二１００ボ
ルトでは２００ボルトになる。Ｅが１００ボルトをこえ
るとＶｄは２００ボルトをこえることになるが、通常コ
ンデンサ５゜６やインバータ部１０は２００ボルトより
も異常に大きいｖｄの値に対しては損傷する可能性があ
るような特性（こ設定されているので、Ｅが１００ボル
トを僅かにこえた所でスイッチ８をＩＡ状態にする。す
ると電源回路９は全波整流回路になるのでやがてＶｄは
Ｅにほぼ等しくなり、この結果Ｅが１００ボルトを大幅
にこえてもコンデンサ５゜６やインバータ部１０が損傷
される恐れはなくなる。スイッチ８を開にすると、Ｅと
ｖｄとの関係は第４図の特性線１５に示したようになり
、Ｅが２００ボルト近傍まで大きくなってもコンデンサ
５．６やコンバータ部１０が損傷されることはない。第
３図のスイッチング電源装置１３は、ｖｄがほぼ１００
ボルトからほぼ２００ボルトに至る範囲内にあると正常
に動作するようにインバータ部１０等の要部が構成され
ているので、このように構成された電源袋［１３は、ス
イッチ８を開閉することによって、単相ヌ流電源３の波
高値Ｅがほぼ５０ボルトからほぼ２００Ｖボルトの範囲
内にあると正常に動作することになる。すなわちこのよ
うなスイッチング電源装置１３はほぼ５０ボルトからほ
ぼ２００ボルトにわたる広い電圧波高１Ｉｉｆｉ！囲の
供給電源電圧に対して使用可能であって、この結果第３
図においては交流電源３の波高値Ｅは当然１００ボルト
であっても２００ボルトであってもよいことになる。
に等しくなり、したがってこの状態でＥを逐次犬ぎくし
てＥ＝ １００ボルトにすると、第４図の特性線１４４
こ示したようにＶｄも次第に大きくなってＥ二１００ボ
ルトでは２００ボルトになる。Ｅが１００ボルトをこえ
るとＶｄは２００ボルトをこえることになるが、通常コ
ンデンサ５゜６やインバータ部１０は２００ボルトより
も異常に大きいｖｄの値に対しては損傷する可能性があ
るような特性（こ設定されているので、Ｅが１００ボル
トを僅かにこえた所でスイッチ８をＩＡ状態にする。す
ると電源回路９は全波整流回路になるのでやがてＶｄは
Ｅにほぼ等しくなり、この結果Ｅが１００ボルトを大幅
にこえてもコンデンサ５゜６やインバータ部１０が損傷
される恐れはなくなる。スイッチ８を開にすると、Ｅと
ｖｄとの関係は第４図の特性線１５に示したようになり
、Ｅが２００ボルト近傍まで大きくなってもコンデンサ
５．６やコンバータ部１０が損傷されることはない。第
３図のスイッチング電源装置１３は、ｖｄがほぼ１００
ボルトからほぼ２００ボルトに至る範囲内にあると正常
に動作するようにインバータ部１０等の要部が構成され
ているので、このように構成された電源袋［１３は、ス
イッチ８を開閉することによって、単相ヌ流電源３の波
高値Ｅがほぼ５０ボルトからほぼ２００Ｖボルトの範囲
内にあると正常に動作することになる。すなわちこのよ
うなスイッチング電源装置１３はほぼ５０ボルトからほ
ぼ２００ボルトにわたる広い電圧波高１Ｉｉｆｉ！囲の
供給電源電圧に対して使用可能であって、この結果第３
図においては交流電源３の波高値Ｅは当然１００ボルト
であっても２００ボルトであってもよいことになる。
第３図においでは電源回路９が上述のように動作するの
で、このような゛電源回路９を備えたスイッチング電源
装置１３は、供給電源としての交流電源３が１００ボル
トであっても２００ボルトであっても使用できて便利で
あるが、上述したように、この場合の電源回路９には、
Ｅが１００ボルト以上であった場合にスイッチ８を開状
態にしておくことを忘れると、コンデンサ５，６が損傷
したり、インバータ部１０に損傷を生じさせたりする等
の事故が発生するという問題がある。
で、このような゛電源回路９を備えたスイッチング電源
装置１３は、供給電源としての交流電源３が１００ボル
トであっても２００ボルトであっても使用できて便利で
あるが、上述したように、この場合の電源回路９には、
Ｅが１００ボルト以上であった場合にスイッチ８を開状
態にしておくことを忘れると、コンデンサ５，６が損傷
したり、インバータ部１０に損傷を生じさせたりする等
の事故が発生するという問題がある。
本発明は、上述したような従来の直流出力電源回路にお
ける問題を解消して、該電源回路に対する供給電源とし
ての単相交流電源の電圧が大幅に変化しても、故障を生
じたり異常に高い直流電圧を出力したりすることのない
′ぼ源回路を提供することを目的とする。
ける問題を解消して、該電源回路に対する供給電源とし
ての単相交流電源の電圧が大幅に変化しても、故障を生
じたり異常に高い直流電圧を出力したりすることのない
′ぼ源回路を提供することを目的とする。
本発明は、上記目的を達成するため、入力端子に単相又
流電圧が入力され、出力端子間に各組が少なくとも一個
のコンデンサで形成された電圧平滑用静電容量手段の二
組が直列に接続されたブリッジ整流回路と：単相交流電
圧の大きさを検出して検出信号を出力する電圧検出手段
と、；検出信号が入力され該信号ζζ応じて前記入力端
子の一方と両峰′成容量手段間の接女続点との間を開ま
たは閉状態（こする回路開閉手段と；で直流出力・電源
回路を構成し、回路開閉手段の開閉動作に応じて単相交
流′電圧を全波整流または倍電圧整流した直流電圧を前
記出力端子から出力させるようにしたもので、このよう
に構成することによって、単相交流電圧の大きざが大幅
に変化した場合、本′＃Ｊｔ源回路では単相交流電圧の
倍電圧整流動作と核交Ｒ′ｒ４Ｌ圧の全波整流動作とが
電圧検出手段と回路開閉手段とによって自動的に切りか
えられて実行されるようにして、この結果、スイッチの
開閉操作等の煩わしい手操作を行わなくても前記コンデ
ンサ等に故障を生じたり異常に高い直流電圧を出力した
りすることのない直流出力電源回路が得られるようにし
たものである。
流電圧が入力され、出力端子間に各組が少なくとも一個
のコンデンサで形成された電圧平滑用静電容量手段の二
組が直列に接続されたブリッジ整流回路と：単相交流電
圧の大きさを検出して検出信号を出力する電圧検出手段
と、；検出信号が入力され該信号ζζ応じて前記入力端
子の一方と両峰′成容量手段間の接女続点との間を開ま
たは閉状態（こする回路開閉手段と；で直流出力・電源
回路を構成し、回路開閉手段の開閉動作に応じて単相交
流′電圧を全波整流または倍電圧整流した直流電圧を前
記出力端子から出力させるようにしたもので、このよう
に構成することによって、単相交流電圧の大きざが大幅
に変化した場合、本′＃Ｊｔ源回路では単相交流電圧の
倍電圧整流動作と核交Ｒ′ｒ４Ｌ圧の全波整流動作とが
電圧検出手段と回路開閉手段とによって自動的に切りか
えられて実行されるようにして、この結果、スイッチの
開閉操作等の煩わしい手操作を行わなくても前記コンデ
ンサ等に故障を生じたり異常に高い直流電圧を出力した
りすることのない直流出力電源回路が得られるようにし
たものである。
〔発明の実施例〕−
第１図は本発明の一実施例の構成図で、図（ζは説明の
便宜上インバータ部１０が接続された状態が示しである
。＠１図において、１７．１８はダイオードｌｂ、ｌｄ
と共にブリッジ整流回路１６を形成するいずれもダイオ
ードで、１９，２０゜２１はブリッジ１６の出力電圧憂
こ対する平滑回路を構成するコンデンサ、抵抗器である
。２２は直列接続された抵抗器２０．２１間の接続点で
ある。
便宜上インバータ部１０が接続された状態が示しである
。＠１図において、１７．１８はダイオードｌｂ、ｌｄ
と共にブリッジ整流回路１６を形成するいずれもダイオ
ードで、１９，２０゜２１はブリッジ１６の出力電圧憂
こ対する平滑回路を構成するコンデンサ、抵抗器である
。２２は直列接続された抵抗器２０．２１間の接続点で
ある。
抵抗器−２１にはツェナダイオード２３と抵抗器２４と
からなる直列回路が並列に接続され、ツェナダイオード
２３のアノードはまたサイリスタ２５のゲートに接続さ
れている。ツェナダイオード２３のカソードは接続点２
２ｆこ接続されている。サイリスタ２５のカソードは抵
抗器２４と２１との接続点、すなわちブリッジ１また１
６の負側出力端子２６に接続され、該負側出力端子２６
と出力端子４ｂとの間にはダイオード２７が接続されて
いる。２８はサイリスタ２５のアノードと出力端子４ａ
との間に接続された抵抗器で、サイリスタ２５のアノー
ドはさらにトランジスタ２９のベースに接続されている
。３０は四個のダイオード３０ａ、３０ｂ、３０ｃ、３
０ｄで構成されたダイオードブリッジで、該ブリッジ３
０の入力端子の一方はブリッジ整流回路１の入力端子２
ｂに接続され、ブリッジ３０の入力端子の他方はコンデ
ンサ５，６間の接続点７に接続されている。またブリッ
ジ３０の出力端子の各々にはそれぞれトランジスタ２９
のコレクタ、エミッタが接続されている。３１はインバ
ータ部１０を除く図示の各部からなる直流出力電源回路
である。
からなる直列回路が並列に接続され、ツェナダイオード
２３のアノードはまたサイリスタ２５のゲートに接続さ
れている。ツェナダイオード２３のカソードは接続点２
２ｆこ接続されている。サイリスタ２５のカソードは抵
抗器２４と２１との接続点、すなわちブリッジ１また１
６の負側出力端子２６に接続され、該負側出力端子２６
と出力端子４ｂとの間にはダイオード２７が接続されて
いる。２８はサイリスタ２５のアノードと出力端子４ａ
との間に接続された抵抗器で、サイリスタ２５のアノー
ドはさらにトランジスタ２９のベースに接続されている
。３０は四個のダイオード３０ａ、３０ｂ、３０ｃ、３
０ｄで構成されたダイオードブリッジで、該ブリッジ３
０の入力端子の一方はブリッジ整流回路１の入力端子２
ｂに接続され、ブリッジ３０の入力端子の他方はコンデ
ンサ５，６間の接続点７に接続されている。またブリッ
ジ３０の出力端子の各々にはそれぞれトランジスタ２９
のコレクタ、エミッタが接続されている。３１はインバ
ータ部１０を除く図示の各部からなる直流出力電源回路
である。
次に上記゛電源回路３１の動作を第１図のほかに第２図
をも用いて説明する。まず第１図ｆこおいて、整流回路
］の入力端子２ａ 、２ｂに反流電源３が接続されると
該電源３の電圧ｇａがブリッジ１６によって全波整流さ
れ、平滑化された直流電圧がコンデンサ１９の両端に現
れる。この直流電圧の大きざは電源３の電圧Ｅａの波高
値ｇｔζはぼ等しい。第１図に示した■は抵抗器２１の
両端電圧で、コンデンサ１９の両端電圧が前述したよう
ζζＥにほぼ等しくなる力くら、電圧Ｖは波高直Ｅに対
応した電圧である。波高値Ｅが小さいとツェナダイオー
ド２３は非導通状態、俟言すればＯＦＦ状聾にある。さ
て、整流回路１の入力端子２ａ側が正（こなる、交流電
源３の瞬時電圧Ｅａの正の半波Ｃζおいては、抵抗器２
８とサイリスタ２５（！：からなる直列回路に電圧が印
加されるが、この場合波高値Ｅが小さくてツェナダイオ
ード２３がＯＦＦとなっているのでサイリスタ２５もＯ
ＦＦ状＠ｆこある。
をも用いて説明する。まず第１図ｆこおいて、整流回路
］の入力端子２ａ 、２ｂに反流電源３が接続されると
該電源３の電圧ｇａがブリッジ１６によって全波整流さ
れ、平滑化された直流電圧がコンデンサ１９の両端に現
れる。この直流電圧の大きざは電源３の電圧Ｅａの波高
値ｇｔζはぼ等しい。第１図に示した■は抵抗器２１の
両端電圧で、コンデンサ１９の両端電圧が前述したよう
ζζＥにほぼ等しくなる力くら、電圧Ｖは波高直Ｅに対
応した電圧である。波高値Ｅが小さいとツェナダイオー
ド２３は非導通状態、俟言すればＯＦＦ状聾にある。さ
て、整流回路１の入力端子２ａ側が正（こなる、交流電
源３の瞬時電圧Ｅａの正の半波Ｃζおいては、抵抗器２
８とサイリスタ２５（！：からなる直列回路に電圧が印
加されるが、この場合波高値Ｅが小さくてツェナダイオ
ード２３がＯＦＦとなっているのでサイリスタ２５もＯ
ＦＦ状＠ｆこある。
故にこの場合ダイオードｌａ、抵抗器２８、トランジス
タ２９、ダイオード３０ｂの順路でトランジスタ２９に
ベース電流が流れ、このため該トランジスタ２９はＯＮ
状態になるのでダイオード１ａ、コンデンサ５、ダイオ
ード３Ｑｃ、）ランジスタ２９、ダイオード３０ｂのｊ
ｔｌ路でコンデンサ５（ζ対する充電′ＩｉＬ流が流れ
る。やがて瞬時電圧Ｅ３が負の半波状態になった時、ト
ランジスタ２９には抵抗器２８、トランジスタ２９、ダ
イオード３０ｄの順路でコンデンサ５に充′１された電
荷が放電されてベース′１流が流れるので、トランジス
タ２９はＯＮ状態を継続し、この結果ダイオード３０ａ
、Ｉ−ランジスタ２９、ダイオード３０ ｄ。
タ２９、ダイオード３０ｂの順路でトランジスタ２９に
ベース電流が流れ、このため該トランジスタ２９はＯＮ
状態になるのでダイオード１ａ、コンデンサ５、ダイオ
ード３Ｑｃ、）ランジスタ２９、ダイオード３０ｂのｊ
ｔｌ路でコンデンサ５（ζ対する充電′ＩｉＬ流が流れ
る。やがて瞬時電圧Ｅ３が負の半波状態になった時、ト
ランジスタ２９には抵抗器２８、トランジスタ２９、ダ
イオード３０ｄの順路でコンデンサ５に充′１された電
荷が放電されてベース′１流が流れるので、トランジス
タ２９はＯＮ状態を継続し、この結果ダイオード３０ａ
、Ｉ−ランジスタ２９、ダイオード３０ ｄ。
コンデンサ６、ダイオード２７、ダイオード１ｂの順路
でコンデンサ６に対する充′直・α流が流れる。
でコンデンサ６に対する充′直・α流が流れる。
すなわち波高１直Ｅが小さくてサイリスタ２５がＯＦ
Ｆになっているとトランジスタ２９はＯＮになっていて
、この結果電源回路３１は、電源３の瞬時電圧Ｅａに対
して全波形の倍電圧整流を行って、この整流結果にもと
づくほぼ２Ｅに等しい大きさの直流電圧Ｖｄを出力する
。
Ｆになっているとトランジスタ２９はＯＮになっていて
、この結果電源回路３１は、電源３の瞬時電圧Ｅａに対
して全波形の倍電圧整流を行って、この整流結果にもと
づくほぼ２Ｅに等しい大きさの直流電圧Ｖｄを出力する
。
上述した所から明らかなように抵抗器２１の両くなって
、電圧Ｖの波形線がツェナ電圧Ｖ８を横切るようになっ
た場合の電源回路３１の動作を第２図を併用して説明す
る。すなわち、時刻ｔ１までは電圧ＶはｖＱよりも小さ
いのでツェナダイオード２３はＯＦＦ状態となっており
、この結果サイリスタ２５がＯＦＦ、 トランジスタ
ー２９がＯＮで１ａｃ源回路３１は倍電圧整流をしてい
るが、時刻ｔ。
、電圧Ｖの波形線がツェナ電圧Ｖ８を横切るようになっ
た場合の電源回路３１の動作を第２図を併用して説明す
る。すなわち、時刻ｔ１までは電圧ＶはｖＱよりも小さ
いのでツェナダイオード２３はＯＦＦ状態となっており
、この結果サイリスタ２５がＯＦＦ、 トランジスタ
ー２９がＯＮで１ａｃ源回路３１は倍電圧整流をしてい
るが、時刻ｔ。
で電圧Ｖが■うをこえるとツェナダイオード２３がＯＮ
となり、この時サイリスタ２５には抵抗器２８を介して
瞬時電圧Ｅａの正の半波が印加されているので該サイリ
スタ２５がＯＮになる。サイリスタ２５がＯＮになると
トランジスタ２９のベースの電位が該トランジスタのエ
ミッタの電位よりも低く引き下げられるのでトランジス
タ２９はＯＦＦ＋ζなり、この結果電源回路３１は全波
整流Ｅオに等しくなっており、このため時刻ｔ１で電源
回路３１が全波整流状態になってもコンデンサ５゜６を
こは充電電流は流れない。時刻ｔ２になって電圧Ｖがｖ
８を下まわるとツェナダイオード２３はＯＦＦとなるが
、サイリスタ２５は瞬時電圧Ｅａが零になる時刻ｔ、に
なってＯＦＦ状標になり、サクリスタ２５がＯＦ’Ｆ’
になるとコンデンサ５の充電′１荷のためにトランジス
タ２９にベースを流が流れるので、時刻ｔ、でトランジ
スタ２９は再び０Ｎ（Ｃなる。時刻ｔ、以降の瞬時電圧
Ｅａの負の半波においてもツェナダイオード２３、サイ
リスタ２５、トランジスタ２９は上記と同様に動作する
。したかって第２図の場合、ｔＳ回路３１は倍電圧整流
状態と全波整流状態とを交互に繰り返し、出力寛圧Ｖｄ
はほぼ２ Ｅ、に等しい値になる。
となり、この時サイリスタ２５には抵抗器２８を介して
瞬時電圧Ｅａの正の半波が印加されているので該サイリ
スタ２５がＯＮになる。サイリスタ２５がＯＮになると
トランジスタ２９のベースの電位が該トランジスタのエ
ミッタの電位よりも低く引き下げられるのでトランジス
タ２９はＯＦＦ＋ζなり、この結果電源回路３１は全波
整流Ｅオに等しくなっており、このため時刻ｔ１で電源
回路３１が全波整流状態になってもコンデンサ５゜６を
こは充電電流は流れない。時刻ｔ２になって電圧Ｖがｖ
８を下まわるとツェナダイオード２３はＯＦＦとなるが
、サイリスタ２５は瞬時電圧Ｅａが零になる時刻ｔ、に
なってＯＦＦ状標になり、サクリスタ２５がＯＦ’Ｆ’
になるとコンデンサ５の充電′１荷のためにトランジス
タ２９にベースを流が流れるので、時刻ｔ、でトランジ
スタ２９は再び０Ｎ（Ｃなる。時刻ｔ、以降の瞬時電圧
Ｅａの負の半波においてもツェナダイオード２３、サイ
リスタ２５、トランジスタ２９は上記と同様に動作する
。したかって第２図の場合、ｔＳ回路３１は倍電圧整流
状態と全波整流状態とを交互に繰り返し、出力寛圧Ｖｄ
はほぼ２ Ｅ、に等しい値になる。
次に瞬時電圧Ｒａの波高値Ｅがさら（ζ大きくなって、
遂に電圧Ｖが常に電圧Ｖカを上まわるようになったとす
る。するとサイリスタ２５はツェナダイオード２３の状
態を介して常にＯＮになるのでトランジスタ２９は常に
ＯＦＦになり、この結果電源回路３１は継続して全波整
？Ｍ＠作を行うことｆこなり、出力電圧Ｖｄの値はほぼ
Ｅに等しくなる。
遂に電圧Ｖが常に電圧Ｖカを上まわるようになったとす
る。するとサイリスタ２５はツェナダイオード２３の状
態を介して常にＯＮになるのでトランジスタ２９は常に
ＯＦＦになり、この結果電源回路３１は継続して全波整
？Ｍ＠作を行うことｆこなり、出力電圧Ｖｄの値はほぼ
Ｅに等しくなる。
１１を源回路３１は上述のように動作するので、Ｅ＝１
００ボルトである時に電圧Ｖの最大値がＶやにほぼ等し
くなるように要部が構成されていると、を上まわると、
電源回路３１は自動的に全波整流を行うようになる。こ
の時サイリスタ２５はＯＮになっているが、ダイオード
２７のためにコンデンサ５．６の充電電荷が抵抗器２８
、サイリスタ２５を介して放電されることはない。電源
回路３１が全波整流を行っている状態で波高値Ｅ力５小
さくなり、遂にツェナダイオードがｏｐＦ＋こなるとト
ランジスタ２９がＯＮになり、このため４ｉＱ回路３１
は自動的に倍電圧整流状態に切りかわる。
００ボルトである時に電圧Ｖの最大値がＶやにほぼ等し
くなるように要部が構成されていると、を上まわると、
電源回路３１は自動的に全波整流を行うようになる。こ
の時サイリスタ２５はＯＮになっているが、ダイオード
２７のためにコンデンサ５．６の充電電荷が抵抗器２８
、サイリスタ２５を介して放電されることはない。電源
回路３１が全波整流を行っている状態で波高値Ｅ力５小
さくなり、遂にツェナダイオードがｏｐＦ＋こなるとト
ランジスタ２９がＯＮになり、このため４ｉＱ回路３１
は自動的に倍電圧整流状態に切りかわる。
すなわち第１図において、３２は、単相交流電圧Ｅａの
波高値Ｂを検出し検出信号として電圧Ｖを出力する、ブ
リッジ１６とコンデンサ１９と抵抗器２０．２１とから
なる電圧検出手段、３３は、電圧Ｖが入力され該電圧の
大きさに応じて入力端子２ｂとコンデンサ５．６間の接
続点７との間の接続牟を開または閉状態にする、ツエナ
ダイオ一ド２３ｃ！：抵抗器２４．２８とサイリスタ２
５とトランジスタ２９とダイオードブリッジ３０とから
なる回路開閉手段であって、’ｉｉｔ源回路３１におい
ては、上述した所から明らかなように、単相交流電圧Ｅ
ａの波高値Ｅが大幅に変化すると、電圧検出手段３２と
回路開閉手段３３とによって前記交流電圧Ｅａζこ対す
る倍電圧整流動作と全波整流動作とが自動的に切り換え
られて実行される。したがってこのような電源回路３１
では、交流電源３の電圧波高値Ｅがたとえば５０〜２０
０ボルトのような広い範囲（こ変化した場合、従来の電
源回路ζζおけるようなスイッチの開閉操作等の煩わし
い手操作を行わなくても、コンデンサ５，６やインバー
タ部１０に過電圧印加にもとづく故障が生じるというこ
とはない。
波高値Ｂを検出し検出信号として電圧Ｖを出力する、ブ
リッジ１６とコンデンサ１９と抵抗器２０．２１とから
なる電圧検出手段、３３は、電圧Ｖが入力され該電圧の
大きさに応じて入力端子２ｂとコンデンサ５．６間の接
続点７との間の接続牟を開または閉状態にする、ツエナ
ダイオ一ド２３ｃ！：抵抗器２４．２８とサイリスタ２
５とトランジスタ２９とダイオードブリッジ３０とから
なる回路開閉手段であって、’ｉｉｔ源回路３１におい
ては、上述した所から明らかなように、単相交流電圧Ｅ
ａの波高値Ｅが大幅に変化すると、電圧検出手段３２と
回路開閉手段３３とによって前記交流電圧Ｅａζこ対す
る倍電圧整流動作と全波整流動作とが自動的に切り換え
られて実行される。したがってこのような電源回路３１
では、交流電源３の電圧波高値Ｅがたとえば５０〜２０
０ボルトのような広い範囲（こ変化した場合、従来の電
源回路ζζおけるようなスイッチの開閉操作等の煩わし
い手操作を行わなくても、コンデンサ５，６やインバー
タ部１０に過電圧印加にもとづく故障が生じるというこ
とはない。
上述したように、本発明においては、入力端子に単相交
流電圧が入力され、出力端子間に各組が少なくとも一個
のコンデンサで形成された電圧平滑用静電容量手段の二
組が直列に接続されたブリッジ整流回路と；単相交流電
圧の大きさを検出して検出信号を出力する電圧検出手段
と；検出信号が入力され該信号に応じて前記入力一端子
の一方と両静電容量手段間の接続点との間を開または閉
状態６ζする回路開閉手段と；で直流出力電源回路を構
成し、回路開閉手段の開閉動作に応じて単相交流電圧を
全波整流または倍電圧整流した直流電圧を前記出力端子
から出力させるようにしたので、このように構成するこ
とによって、単相交流電圧の大きさが大幅に変化しでも
、本電源回路では単相交流電圧の倍電圧整流動作と該交
流電圧の全波整流動作とが電圧検出手段と回路開閉手段
とによって自動的−に切りかえられて実行される結果、
スイッチの開閉操作等の煩わしい手操作を行わなくても
前記コンデンサ等に故障を生じたり異常に高い直流電圧
を出力したりすることのない直流出力電源回路が得られ
る効果がある。
流電圧が入力され、出力端子間に各組が少なくとも一個
のコンデンサで形成された電圧平滑用静電容量手段の二
組が直列に接続されたブリッジ整流回路と；単相交流電
圧の大きさを検出して検出信号を出力する電圧検出手段
と；検出信号が入力され該信号に応じて前記入力一端子
の一方と両静電容量手段間の接続点との間を開または閉
状態６ζする回路開閉手段と；で直流出力電源回路を構
成し、回路開閉手段の開閉動作に応じて単相交流電圧を
全波整流または倍電圧整流した直流電圧を前記出力端子
から出力させるようにしたので、このように構成するこ
とによって、単相交流電圧の大きさが大幅に変化しでも
、本電源回路では単相交流電圧の倍電圧整流動作と該交
流電圧の全波整流動作とが電圧検出手段と回路開閉手段
とによって自動的−に切りかえられて実行される結果、
スイッチの開閉操作等の煩わしい手操作を行わなくても
前記コンデンサ等に故障を生じたり異常に高い直流電圧
を出力したりすることのない直流出力電源回路が得られ
る効果がある。
第１図は本発明の一実施例の構成図、第２図は第１図に
示したｍ源回路の動作説明用波形図、第３図は従来の直
流出力・電源回路を用いたスイッチング電源装置の構成
図、第４図は第３図（ζ示した′電源回路の動作説明図
である。 １・・ブリッジ整流回路、２ａ、２ｂ・・入力端子、４
ａ、４ｂ ・出力端子、５，６・・コンデンサ、７・
・・接続点、９．３１・・直流出力・電源回路、３２・
・・電圧検出手段、３３ ・回路開閉手段、Ｅａ・・単
相交流電圧、ｖｄ・・直流電圧。 τに ′８ ２ 目 第 ３ 口 第 牛 口
示したｍ源回路の動作説明用波形図、第３図は従来の直
流出力・電源回路を用いたスイッチング電源装置の構成
図、第４図は第３図（ζ示した′電源回路の動作説明図
である。 １・・ブリッジ整流回路、２ａ、２ｂ・・入力端子、４
ａ、４ｂ ・出力端子、５，６・・コンデンサ、７・
・・接続点、９．３１・・直流出力・電源回路、３２・
・・電圧検出手段、３３ ・回路開閉手段、Ｅａ・・単
相交流電圧、ｖｄ・・直流電圧。 τに ′８ ２ 目 第 ３ 口 第 牛 口
Claims (1)
- 【特許請求の範囲】 １）入力端子に単相交流電圧が入力され、出力端子間に
各組が少なくとも一個のコンデンサで形成された電圧平
滑用静電容量手段の二組が直列に接続されたブリッジ整
流回路と；前記単相交流電圧の大きさを検出して検出信
号を出力する電圧検出手段と；前記検出信号が入力され
、該検出信号に応じて前記入力端子の一方と前記両静電
容量手段間の接続点との間を開または閉状態にする回路
開閉手段と；からなり、前記回路開閉手段の開閉動作に
応じて前記単相交流電圧を全波整流または倍電圧整流し
た直流電圧を前記出力端子から出力することを特徴とす
る直流出力電源回路。 ２）特許請求の範囲第１項に記載の電源装置において、
回路開閉手段は、検出信号が入力され該検出信号に応じ
た駆動信号を出力する第１手段と、前記駆動信号が入力
され該駆動信号によつてブリッジ整流回路の入力端子の
一方と両静電容量手段間の接続点との間を開または閉状
態にする第２手段とからなり；かつ前記第１手段は前記
ブリッジ整流回路の出力端子間に直列接続された抵抗器
と前記検出信号に応じて回路開閉動作をする開閉器とか
らなり；かつ前記駆動信号は前記抵抗器と前記開閉器と
の接続点における電位であることを特徴とする直流出力
電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19911285A JPS6260473A (ja) | 1985-09-09 | 1985-09-09 | 直流出力電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19911285A JPS6260473A (ja) | 1985-09-09 | 1985-09-09 | 直流出力電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6260473A true JPS6260473A (ja) | 1987-03-17 |
Family
ID=16402324
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19911285A Pending JPS6260473A (ja) | 1985-09-09 | 1985-09-09 | 直流出力電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6260473A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5162984A (en) * | 1990-03-05 | 1992-11-10 | Sgs-Thomson Microelectronics S.A. | Rectifier able to operate with at least two separate ranges of alternating current supply voltage |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5839273A (ja) * | 1981-08-31 | 1983-03-07 | Fujitsu Ltd | 電源回路 |
-
1985
- 1985-09-09 JP JP19911285A patent/JPS6260473A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5839273A (ja) * | 1981-08-31 | 1983-03-07 | Fujitsu Ltd | 電源回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5162984A (en) * | 1990-03-05 | 1992-11-10 | Sgs-Thomson Microelectronics S.A. | Rectifier able to operate with at least two separate ranges of alternating current supply voltage |
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