JPS6259492A - クロマインバ−タ−回路 - Google Patents
クロマインバ−タ−回路Info
- Publication number
- JPS6259492A JPS6259492A JP19984485A JP19984485A JPS6259492A JP S6259492 A JPS6259492 A JP S6259492A JP 19984485 A JP19984485 A JP 19984485A JP 19984485 A JP19984485 A JP 19984485A JP S6259492 A JPS6259492 A JP S6259492A
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- JP
- Japan
- Prior art keywords
- chroma
- signal
- output
- inverter
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はカラーテレビジョン受像機のビデオクロマ回路
においてクロマ信号の位相を一水平期間毎に反転するク
ロマインバータ−回路に関するものである。
においてクロマ信号の位相を一水平期間毎に反転するク
ロマインバータ−回路に関するものである。
従来の技術
近年、カラーテレビジョン受像機のビデオクロマ回路は
従来のアナログ回路方式からデジタル回路化されつつあ
る。これは部品数の削減や信頼性の向上という利点の他
に新しい機能を取込み易いという利点があるからである
。
従来のアナログ回路方式からデジタル回路化されつつあ
る。これは部品数の削減や信頼性の向上という利点の他
に新しい機能を取込み易いという利点があるからである
。
メモリーの応用技術としてはモニターインテレビといわ
れるような画面の中に別の番組を子画面として、同時に
映し出すものがある。従来このモニターインテレビでは
、チューナーをテレビジョン受像機としては1つしか持
っていないので、親画面と子画面で別の放送番組を同時
に受信することはできなかった。
れるような画面の中に別の番組を子画面として、同時に
映し出すものがある。従来このモニターインテレビでは
、チューナーをテレビジョン受像機としては1つしか持
っていないので、親画面と子画面で別の放送番組を同時
に受信することはできなかった。
以下図面を参照しながら従来のクロマインパ−ター回路
について説明を行なう。
について説明を行なう。
第2図は従来のモニターインテレビにおいて一水平期間
の複合ビデオ信号を記憶し、それを二水平期間同じ複合
ビデオ信号を出力することによシ、三水平期間全く同じ
複合ビデオ信号を出力する回路である。el)は切替器
で、−水平期間の間、複合ビデオ信号を入力する側に切
替わり、二水平期間の間、後述するメモリーの出力信号
側に切替わりこの動作を繰返す。に)は−水平期間分の
メモリーでちゃ、上記切替器0→の出力信号を一水平期
間遅延する。
の複合ビデオ信号を記憶し、それを二水平期間同じ複合
ビデオ信号を出力することによシ、三水平期間全く同じ
複合ビデオ信号を出力する回路である。el)は切替器
で、−水平期間の間、複合ビデオ信号を入力する側に切
替わり、二水平期間の間、後述するメモリーの出力信号
側に切替わりこの動作を繰返す。に)は−水平期間分の
メモリーでちゃ、上記切替器0→の出力信号を一水平期
間遅延する。
以上のように構成されたデジタル回路について、以下そ
の動作を説明する。
の動作を説明する。
まず、切替器Q0が下側にだおれている期間(−水平期
間)に入力した複合ビデオ信号は、メモ!J123で一
水平期間遅延する。次に切替器Q1)が二水平期間、上
側にだおれると、メモリーe→に記憶されていた複合ビ
デオ信号が同じメモリー(ロ)に記憶されることとなる
ため、二水平期間同じ複合ビデオ信号が出力される。以
上のような動作により、−水平期間だけチューナーであ
る放送番組を受信すると、それを三水平期間に伸ばすこ
とが可能となる。
間)に入力した複合ビデオ信号は、メモ!J123で一
水平期間遅延する。次に切替器Q1)が二水平期間、上
側にだおれると、メモリーe→に記憶されていた複合ビ
デオ信号が同じメモリー(ロ)に記憶されることとなる
ため、二水平期間同じ複合ビデオ信号が出力される。以
上のような動作により、−水平期間だけチューナーであ
る放送番組を受信すると、それを三水平期間に伸ばすこ
とが可能となる。
発明が解決しようとする問題点
しかしながら、上記のような方法では、クロマ位相が水
平期間毎に連続しないという問題点を有していた。すな
わち、第3図に示したバースト信号にのみ着目して説明
すると、30本1(nは整数)の期間、切替器Q1)は
下側にだおれ、メモリーHは入力する複合ビデオ信号を
記憶する。次に30+1本目は1メモリーに)に記憶さ
れたものが出力されるだめ、バーストの位相は3n本目
のものと同じになる。しかしながら本来のNTSC信号
ではこの期間のバースト信号の位相を反転しなければな
らない。さらに、3n+2本目になると、これは30本
1(同じ位相で出力されるので位相の問題は生じない。
平期間毎に連続しないという問題点を有していた。すな
わち、第3図に示したバースト信号にのみ着目して説明
すると、30本1(nは整数)の期間、切替器Q1)は
下側にだおれ、メモリーHは入力する複合ビデオ信号を
記憶する。次に30+1本目は1メモリーに)に記憶さ
れたものが出力されるだめ、バーストの位相は3n本目
のものと同じになる。しかしながら本来のNTSC信号
ではこの期間のバースト信号の位相を反転しなければな
らない。さらに、3n+2本目になると、これは30本
1(同じ位相で出力されるので位相の問題は生じない。
このようにして3n〜3n+2本目を経過し、次の3n
+3本目において新たに逆位相の複合ビデオ信号が入力
し、上と同様な循環記憶が行われる。
+3本目において新たに逆位相の複合ビデオ信号が入力
し、上と同様な循環記憶が行われる。
以上のように、従来のモニターインテレビにおけるデジ
タル回路では、3n千1本目で本来のNTSC信号とク
ロマ位相が反転するという問題が生じた。
タル回路では、3n千1本目で本来のNTSC信号とク
ロマ位相が反転するという問題が生じた。
本発明は上記問題点に鑑み、3n+1本目のクロマ位相
がNTSC信号とは反転している複合ビデオ信号のクロ
マ位相を、NTSC信号と合致した複合ビデオ信号に変
換するクロマインバータ−回路を提供しようとするもの
である。
がNTSC信号とは反転している複合ビデオ信号のクロ
マ位相を、NTSC信号と合致した複合ビデオ信号に変
換するクロマインバータ−回路を提供しようとするもの
である。
問題点を解決するだめの手段
この目的を達成するために本発明のクロマインバータ−
回路は、複合ビデオ信号を受け入れて輝度信号とクロマ
信号に分離するYC分離回路と、上記YC分離回路のク
ロマ信号出力をそのまま出力するバッファーと、上記Y
C分離回路のクロマ信号出力を反転するインバーターと
、上記バッファーと上記YC分離回路の輝度信号出力と
上記切替器の出力信号とを加える加算器とより構成され
ている。
回路は、複合ビデオ信号を受け入れて輝度信号とクロマ
信号に分離するYC分離回路と、上記YC分離回路のク
ロマ信号出力をそのまま出力するバッファーと、上記Y
C分離回路のクロマ信号出力を反転するインバーターと
、上記バッファーと上記YC分離回路の輝度信号出力と
上記切替器の出力信号とを加える加算器とより構成され
ている。
作 用
この構成によって、3n+1本目の複合ビデオ信号がこ
のクロマインバータ−回路に入力される期間だけ、切替
器をインバーター回路の出力側に切替えることにより、
クロマ位相を反転することが可能となる。
のクロマインバータ−回路に入力される期間だけ、切替
器をインバーター回路の出力側に切替えることにより、
クロマ位相を反転することが可能となる。
実施例
以下本発明の一実施例について、図面を参照しながら説
明する。第1図は本発明の一実施例におけるクロマイン
バータ−回路のブロック図を示すものである。第1図に
おいて、(11)は複合ビデオ信号からクロマ信号を通
過させるバンドパスフィルターであり、(12)ハ上記
りロマパンドバヌフィルター(1υと同じ遅延時間をも
つ遅延回路でアリ、(13)はクロマバンドパスフィル
ターC11)と遅延回路(ロ)との差を演算する減算器
であり、上記フィルター(11)及び遅延回路(12)
と共に、YC分離回路を構成している。04)は上記ク
ロマバンドパスフィルター(11)の出力信号をそのま
ま出力するバッファー、(15)は上記クロマパンドパ
スフイルター(11)の出力を反転するインバーター、
(16)は、上記バッファー04)と上記インバーター
α5)トの出力を切替え選択する切替器、(17)は上
記減算器α3)の出力と上記切替器06)の出力とを加
算する加算器である。
明する。第1図は本発明の一実施例におけるクロマイン
バータ−回路のブロック図を示すものである。第1図に
おいて、(11)は複合ビデオ信号からクロマ信号を通
過させるバンドパスフィルターであり、(12)ハ上記
りロマパンドバヌフィルター(1υと同じ遅延時間をも
つ遅延回路でアリ、(13)はクロマバンドパスフィル
ターC11)と遅延回路(ロ)との差を演算する減算器
であり、上記フィルター(11)及び遅延回路(12)
と共に、YC分離回路を構成している。04)は上記ク
ロマバンドパスフィルター(11)の出力信号をそのま
ま出力するバッファー、(15)は上記クロマパンドパ
スフイルター(11)の出力を反転するインバーター、
(16)は、上記バッファー04)と上記インバーター
α5)トの出力を切替え選択する切替器、(17)は上
記減算器α3)の出力と上記切替器06)の出力とを加
算する加算器である。
以上のように構成されたクロマインバータ−回路につい
て、以下その動作について説明する。
て、以下その動作について説明する。
まず入力した複合ビデオ信号はバンドパスフィルター(
11)を通過することによシクロマ信号だけが抽出され
る。この抽出されたクロマ信号は減算器において、遅延
回路■)を通過した同相の複合ビデオ信号から差し引か
れることにより、その減算器03)の出力に輝度信号を
発生させる。バンドパスフィルター(11)を通過した
クロマ信号は、バッファー04)及びインバーター05
)を通過しそれぞれ切替器(16)の一対の入力端子に
入力する。切替器(16)は3n千1本目の水平期間の
間はインバーター回路(15)の出力信号を選択し、残
りの期間はバッファー(1→の出力側を選択する。これ
により3n+1本目の水平期間のクロマ信号のみその位
相が反転する。切替器(16)を通過したクロマ信号と
、減算器(13)の出力の輝度信号は加算器(17)で
加算されNTSC複合ビデオ信号となる。
11)を通過することによシクロマ信号だけが抽出され
る。この抽出されたクロマ信号は減算器において、遅延
回路■)を通過した同相の複合ビデオ信号から差し引か
れることにより、その減算器03)の出力に輝度信号を
発生させる。バンドパスフィルター(11)を通過した
クロマ信号は、バッファー04)及びインバーター05
)を通過しそれぞれ切替器(16)の一対の入力端子に
入力する。切替器(16)は3n千1本目の水平期間の
間はインバーター回路(15)の出力信号を選択し、残
りの期間はバッファー(1→の出力側を選択する。これ
により3n+1本目の水平期間のクロマ信号のみその位
相が反転する。切替器(16)を通過したクロマ信号と
、減算器(13)の出力の輝度信号は加算器(17)で
加算されNTSC複合ビデオ信号となる。
なお、本発明の一実施例では、説明の都合上YC分m回
路を、クロマバンドパスフィルターと、遅延回路と、減
算器とで構成したが、コム形フィルターを用いてYC分
離を行なってもよいことはいうまでもない。
路を、クロマバンドパスフィルターと、遅延回路と、減
算器とで構成したが、コム形フィルターを用いてYC分
離を行なってもよいことはいうまでもない。
発明の効果
以上のように本発明によれば、デジタル符号化された複
合ビデオ信号を受け入れ、この複合ビデオ信号よシ輝度
信号とクロマ信号に分離するYC分離回路と、上記YC
分離回路のクロマ信号出力をそのまま通過させるバッフ
ァーと、上記YC分離回路のクロマ信号出力を反転する
インバーターと、上記バッファーと上記インバーターと
の出力信号を切替える切替器と、上記YC分離回路の輝
度信号出力と上記切替器の出力信号とを加える加算器と
を設け、上記切替器を30+1本目の水平期間にインバ
ーターの出力側に切替えることによりクロマ信号の位相
を 7反転し複合ビデオ信号のクロマ信号の位相を連続
的にすることができる。
合ビデオ信号を受け入れ、この複合ビデオ信号よシ輝度
信号とクロマ信号に分離するYC分離回路と、上記YC
分離回路のクロマ信号出力をそのまま通過させるバッフ
ァーと、上記YC分離回路のクロマ信号出力を反転する
インバーターと、上記バッファーと上記インバーターと
の出力信号を切替える切替器と、上記YC分離回路の輝
度信号出力と上記切替器の出力信号とを加える加算器と
を設け、上記切替器を30+1本目の水平期間にインバ
ーターの出力側に切替えることによりクロマ信号の位相
を 7反転し複合ビデオ信号のクロマ信号の位相を連続
的にすることができる。
第1図は本発明のクロマインバータ−回路の一実施例の
ブロック図、第2図は従来の一水平期間の複合ビデオ信
号を三水平期間出力する回路のブロック図、第3図は従
来の複合ビデオ信号のパーヌト信号の位相の反転を説明
する図である。 (11)・・・・・・・・・・・・・・・バンドパスフ
ィルター、□□□)・・・・・・・・・・・・・・・遅
延回路03)・・・・・・・・・・・・・・・減算器θ
→・・・・・・・・・・・・・・・バッファー(15)
・・・・・・・・・・・・・・・インバーター06)・
・・・・・・・・・・・・・切替器αη・・・・・・・
・・・・・・・・加算器特許出願人 松下電器産業株
式会社 代 理 人 新 実 健 部l外1名)
ブロック図、第2図は従来の一水平期間の複合ビデオ信
号を三水平期間出力する回路のブロック図、第3図は従
来の複合ビデオ信号のパーヌト信号の位相の反転を説明
する図である。 (11)・・・・・・・・・・・・・・・バンドパスフ
ィルター、□□□)・・・・・・・・・・・・・・・遅
延回路03)・・・・・・・・・・・・・・・減算器θ
→・・・・・・・・・・・・・・・バッファー(15)
・・・・・・・・・・・・・・・インバーター06)・
・・・・・・・・・・・・・切替器αη・・・・・・・
・・・・・・・・加算器特許出願人 松下電器産業株
式会社 代 理 人 新 実 健 部l外1名)
Claims (1)
- デジタル符号化された複合ビデオ信号を受け入れて輝度
信号とクロマ信号に分離するYC分離回路と、上記YC
分離回路のクロマ信号出力を受け入れてそのまま出力す
るバッファーと、上記YC分離回路のクロマ信号出力を
受け入れてクロマ信号を反転するインバーターと、上記
バッファーと上記インバーターとの出力信号を切替える
切替器と、上記YC分離回路の輝度信号出力と上記切替
器の出力信号とを加える加算器とよりなり、上記切替器
を三水平期間に一水平期間だけ切替えることによりクロ
マ信号の位相を反転することにより一水平期間の複合ビ
デオ信号を三水平期間の複合ビデオ信号に延長もしくは
補間するように構成したクロマインバーター回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19984485A JPS6259492A (ja) | 1985-09-09 | 1985-09-09 | クロマインバ−タ−回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19984485A JPS6259492A (ja) | 1985-09-09 | 1985-09-09 | クロマインバ−タ−回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6259492A true JPS6259492A (ja) | 1987-03-16 |
Family
ID=16414587
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19984485A Pending JPS6259492A (ja) | 1985-09-09 | 1985-09-09 | クロマインバ−タ−回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6259492A (ja) |
-
1985
- 1985-09-09 JP JP19984485A patent/JPS6259492A/ja active Pending
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