JPS62287335A - 領域検出回路 - Google Patents
領域検出回路Info
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- JPS62287335A JPS62287335A JP13161586A JP13161586A JPS62287335A JP S62287335 A JPS62287335 A JP S62287335A JP 13161586 A JP13161586 A JP 13161586A JP 13161586 A JP13161586 A JP 13161586A JP S62287335 A JPS62287335 A JP S62287335A
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- 238000001514 detection method Methods 0.000 title abstract description 9
- 230000008094 contradictory effect Effects 0.000 claims description 2
- 238000000034 method Methods 0.000 description 3
- 238000003491 array Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000001174 ascending effect Effects 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
Landscapes
- Devices For Executing Special Programs (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
3、発明の詳細な説明
〔概要〕
本発明はデータ処理装置における与えられた被検数の領
域を検出する回路であって、領域を区分する境界値を格
納した領域レジスタ配列と、被検数と境界値を順次比較
するコンパレータ配列と隣接コンパレータの異なる信号
端子を入力とする論理積回路配列とからなり、与えられ
る数が含まれる領域を効率良く検出する。
域を検出する回路であって、領域を区分する境界値を格
納した領域レジスタ配列と、被検数と境界値を順次比較
するコンパレータ配列と隣接コンパレータの異なる信号
端子を入力とする論理積回路配列とからなり、与えられ
る数が含まれる領域を効率良く検出する。
本発明はデータ処理装置における与えられた被検数を含
む領域を検出する回路に関するものである。
む領域を検出する回路に関するものである。
データ処理過程において、複数の順配列の整数値で区分
された領域にデータとして与えられた数値がどの領域内
にあるかを認識する必要がしばしば発生する。
された領域にデータとして与えられた数値がどの領域内
にあるかを認識する必要がしばしば発生する。
例えば、LIPS、PROLOG等の言語を使用して処
理する場合、多数のデータ型を用いるが、これを区別す
るために、データあるいはアドレスの値を用いることが
ある。
理する場合、多数のデータ型を用いるが、これを区別す
るために、データあるいはアドレスの値を用いることが
ある。
この場合、データ型を求めるために、与えられたデータ
の値が区分されたどの領域に存在するかを高速に識別す
ることが必要である。
の値が区分されたどの領域に存在するかを高速に識別す
ることが必要である。
従来、領域検出はソフトウェアによって実施されていた
。
。
即ち、領域の境界値順の配列を作成し、境界値配列から
順に境界値を読み出して、与えられた数と数値の大小比
較を行う手法を最初の境界値から繰り返し、大小判定が
逆転する境界値を検出して、与えられた数の領域を検出
していた。
順に境界値を読み出して、与えられた数と数値の大小比
較を行う手法を最初の境界値から繰り返し、大小判定が
逆転する境界値を検出して、与えられた数の領域を検出
していた。
この従来の方式では、境界値を読み出して与えられた数
と比較する手法が最小の境界値から順に逐一実施する。
と比較する手法が最小の境界値から順に逐一実施する。
即ち、境界値を読み出して比較レジスタに格納し、与え
られた数と比較して大小判定を行い、大小判定が変わら
なければ、次の境界値を比較レジスタに読み出して格納
し、比較することを繰り返す。
られた数と比較して大小判定を行い、大小判定が変わら
なければ、次の境界値を比較レジスタに読み出して格納
し、比較することを繰り返す。
即ち、この処理は直列に行われ、境界値のすべてを同時
に比較する並列処理を行うことができないために、処理
に時間がかかっていた。
に比較する並列処理を行うことができないために、処理
に時間がかかっていた。
上記問題点は 領域レジスタ配列と、与えられた被検数
を格納した被検数レジスタと、レジスタの値を比較する
コンパレータ配列と、隣接するコンパレータの互いに相
反する信号出力端子を入力とする論理積回路配列とから
なり、 論理積回路配列の出力論理値からその論理積回
路の入力となるコンパレータの比較入力に接続された領
域レジスタ配列の2個のレジスタに格納された値を前記
被検数を挟む領域とする本発明の領域検出回路によって
解決する。
を格納した被検数レジスタと、レジスタの値を比較する
コンパレータ配列と、隣接するコンパレータの互いに相
反する信号出力端子を入力とする論理積回路配列とから
なり、 論理積回路配列の出力論理値からその論理積回
路の入力となるコンパレータの比較入力に接続された領
域レジスタ配列の2個のレジスタに格納された値を前記
被検数を挟む領域とする本発明の領域検出回路によって
解決する。
領域レジスタ配列と同数のコンパレータを設けることに
よって、境界値との比較が同時に行うことができる。
よって、境界値との比較が同時に行うことができる。
そのコンパレータ配列の隣接するコンパレータ出力を論
理積回路で取り出す。
理積回路で取り出す。
被検数が領域レジスタ配列の1つの数より大きくて、次
の数より小さい時、即ち、この2つの数の領域にある時
には、前者のコンパレータの大の判定信号端子は「1」
となり、後者のコンパレータの小の判定信号端子は「1
」となる。
の数より小さい時、即ち、この2つの数の領域にある時
には、前者のコンパレータの大の判定信号端子は「1」
となり、後者のコンパレータの小の判定信号端子は「1
」となる。
従って、この両端子の論理積回路は成立し、その出力は
「1」となる。
「1」となる。
他の論理積回路は入力するコンパレータの大小判定の信
号はすべて反対信号になって論理積は成立しない。
号はすべて反対信号になって論理積は成立しない。
従って、論理積回路配列のうち論理積が成立する論理積
回路に入力する基準レジスタ配列の数が与えられた被検
数の領域の上限と下限を示していることになる。
回路に入力する基準レジスタ配列の数が与えられた被検
数の領域の上限と下限を示していることになる。
このようにハードウェアで回路構成することによって、
比較、検出が瞬時に行われる。
比較、検出が瞬時に行われる。
第1図は本発明の領域検出回路の一実施例の構成ブロッ
ク図である。
ク図である。
データ処理装置のデータバスlに領域境界値配列データ
が送出され、デマルチプレクサでデコードされN個のレ
ジスタR+ (i=o〜N−1)に境界値X、(i=
o−N−1)が格納される。
が送出され、デマルチプレクサでデコードされN個のレ
ジスタR+ (i=o〜N−1)に境界値X、(i=
o−N−1)が格納される。
境界値X、は降順に配置されて、Xo>X、>X2 >
・・・>XN−1とする。
・・・>XN−1とする。
同様に、被検数Cが被検数レジスタRCに格納されると
、レジスタR2の内容X、と被検数レジスタRCの内容
CがコンパレータCOM、 (i=0〜N−1)のそれ
ぞれ比較入力端子A、Bに入力する。
、レジスタR2の内容X、と被検数レジスタRCの内容
CがコンパレータCOM、 (i=0〜N−1)のそれ
ぞれ比較入力端子A、Bに入力する。
コンパレータは入力を比較して、C<X、のときは出力
端子Pに論理値rll、Qに「0」が出力される。
端子Pに論理値rll、Qに「0」が出力される。
また、C≧X8のときには出力端子Pに「0」、Qにr
lJが出力される。
lJが出力される。
論理積回路ANDL (i=1−N−1)はコンパレー
タCOM = −Iの端子QとCOM、の端子Pが入力
する。
タCOM = −Iの端子QとCOM、の端子Pが入力
する。
従って、c<x+−+ 、Xiのときは、論理積回路A
ND、の論理条件は成立せず、c>xi−+。
ND、の論理条件は成立せず、c>xi−+。
X、のときも成立しない。
X、<C<Xl−1のとき、AND、の論理条件は成立
し、rlJを出力する。
し、rlJを出力する。
論理積条件が成立したとき、i=にとすると、このrk
Jに対応する領域番号、例えばrkJが検出され、エン
コーダ3でコード化されてデータバスに送出される。
Jに対応する領域番号、例えばrkJが検出され、エン
コーダ3でコード化されてデータバスに送出される。
上記実施例では基準数配列はレジスタに降順に格納した
が、昇順に格納しても同様に処理できるのは云うまでも
ない。
が、昇順に格納しても同様に処理できるのは云うまでも
ない。
以上述べてきたように、本発明によれば、領域検出がハ
ードウェアで構成され、並列に処理が大行されるので、
領域検出処理が高速に行われ、実用的には極めてを用で
ある。
ードウェアで構成され、並列に処理が大行されるので、
領域検出処理が高速に行われ、実用的には極めてを用で
ある。
第1図は本発明の領域検出回路の一実施例の構成ブロッ
ク図である。 図において、 1はデータバス、2はデマルチプレクサ、3はエンコー
ダ、4はマルチプレクサ、RCは被検数レジスタ、Rは
令頁域レジスタ、COMはコンツマレータ、ANDは論
理積回路である。
ク図である。 図において、 1はデータバス、2はデマルチプレクサ、3はエンコー
ダ、4はマルチプレクサ、RCは被検数レジスタ、Rは
令頁域レジスタ、COMはコンツマレータ、ANDは論
理積回路である。
Claims (1)
- 【特許請求の範囲】 n個の領域境界値を大きさ順に1個ずつ格納したn個の
レジスタからなる領域レジスタ配列(R)と、 被検数を格納した被検数レジスタ(RC)と、前記領域
レジスタ配列(R)のそれぞれのレジスタの値と被検数
レジスタの値とを比較するコンパレータからなるコンパ
レータ配列(COM)と、該コンパレータは、互いに相
反する信号を出力する2個の信号端子をもち、前記コン
パレータ配列の隣接するコンパレータ出力の異なる信号
端子を入力とする論理積回路からなる論理積回路配列(
AND)とを備え、 該論理積回路配列(AND)の論理積回路の論理値から
前記被検数が挟まれる前記領域境界値を検出することを
特徴とする領域検出回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13161586A JPS62287335A (ja) | 1986-06-05 | 1986-06-05 | 領域検出回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13161586A JPS62287335A (ja) | 1986-06-05 | 1986-06-05 | 領域検出回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62287335A true JPS62287335A (ja) | 1987-12-14 |
Family
ID=15062204
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13161586A Pending JPS62287335A (ja) | 1986-06-05 | 1986-06-05 | 領域検出回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62287335A (ja) |
-
1986
- 1986-06-05 JP JP13161586A patent/JPS62287335A/ja active Pending
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