JPS62181680A - Inverter apparatus - Google Patents

Inverter apparatus

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JPS62181680A
JPS62181680A JP61021982A JP2198286A JPS62181680A JP S62181680 A JPS62181680 A JP S62181680A JP 61021982 A JP61021982 A JP 61021982A JP 2198286 A JP2198286 A JP 2198286A JP S62181680 A JPS62181680 A JP S62181680A
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JP
Japan
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circuit
current
transistors
switching
short
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JP61021982A
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Inventor
Mitsuhiro Shibata
光博 芝田
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Toshiba Corp
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Toshiba Corp
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Abstract

PURPOSE:To inhibit the rate-of-rise of accidental currents by inserting an inductor magnetically coupled with sections among arms, in which switching operation is paired, in series with switching elements for each arm. CONSTITUTION:Two pairs of inductors 5U, 5Y and 5V, 5X magnetically coupled with sections between transistors 4U and 4Y and with sections between 4V and 4X, in which switching operation is paired, differentially are each inserted in series with the transistors 4U, 4Y, 4V, 4X as the inhibiting means of the rate-of-rise of DC short-circuit currents. A current detector 7, an overcurrent detecting circuit 8 and a drive-signal blocking circuit 9 are mounted as overcurrent protective means.

Description

【発明の詳細な説明】 (発明の目的〕 (産業上の利用分野) 本発明は電圧源形インバータ装置の過電流保護に係わり
、特に磁気結合されたインダクタを用いて直流短絡電流
を抑制するインバータ装置に関する。。
Detailed Description of the Invention (Objective of the Invention) (Industrial Field of Application) The present invention relates to overcurrent protection for voltage source type inverter devices, and in particular to an inverter that suppresses DC short-circuit current using magnetically coupled inductors. Regarding equipment.

(従来の技術) 従来技術による電圧源形インバータ装置の回路構成例を
第5図に示す。同図において、1は直流電源、2(J、
負荷、3は配線のインダクタンス、4u、4v、4x、
4vはそれぞれUアーム、Vアーム、Xアーム、Yアー
ムのトランジスタ、7は直流部の電流を検出する電流検
出器、8は過電流検出回路、9は前記トランジスタ4u
〜4Yのベースドライブ信号の阻止指令を与えるベース
阻止信号、10はスイッチング制御回路、IIUY、 
IIVXはそれぞれU−Yアーム、v−Xアームのトラ
ンジスタをドライブするベースドライブ回路である。
(Prior Art) FIG. 5 shows an example of the circuit configuration of a voltage source type inverter device according to the prior art. In the figure, 1 is a DC power supply, 2 (J,
Load, 3 is wiring inductance, 4u, 4v, 4x,
4v are transistors for the U arm, V arm, X arm, and Y arm, respectively; 7 is a current detector that detects the current in the DC section; 8 is an overcurrent detection circuit; 9 is the transistor 4u.
A base blocking signal that gives a blocking command for the base drive signal of ~4Y, 10 is a switching control circuit, IIUY,
IIVX is a base drive circuit that drives the transistors of the U-Y arm and the V-X arm, respectively.

上述のインバータ回路例においてもスイッチング方式は
種々提案されているが、本発明の主題ではないので次の
例にJ:り説明を行う。まず、4uと4Yのトランジス
タが導通しているときの電流は、直流電源1からまとめ
て示した配線のインダクタンス3、トランジスタ4u、
負荷2、l−ランジスタ4Y、電流検出器7を通る経路
で流れる。
Various switching methods have been proposed for the above-mentioned inverter circuit example, but since they are not the subject of the present invention, the following example will be used for detailed explanation. First, when the transistors 4u and 4Y are conducting, the current flows from the DC power supply 1 to the inductance 3 of the wiring shown together, to the transistor 4u,
The current flows through a path passing through the load 2, the l-transistor 4Y, and the current detector 7.

次に、導通していた1〜ランジスタ4U、4Yを阻1F
状態としトランジスタのスイッチングA)時間を確保す
るための一定時間後にトランジスタ4vと4x@導通ざ
Uる。このときの電流は直流電源1から配線のインダク
タンス3、トランジスタ4ν、負荷2、トランジスタ4
x、電流検出器7を通る経路で流れる。以上の動作81
リ−イクルとして繰り返すことにより直流電源1から負
荷2へ交流電力を供給している。ここで重要なことは、
いかなるスイッチング方式であってちりアームとXアー
ムの1〜ランジスタ4u、’lxまたは、■アームとY
アームのトランジスタ4V、4Yが同+15に導通する
期間があってはならないことである。
Next, block the conductive transistors 1 to 4U and 4Y to 1F.
Switching of transistors A) Transistors 4v and 4x@ become conductive after a certain period of time to ensure time. At this time, the current flows from the DC power supply 1 to the wiring inductance 3, to the transistor 4ν, to the load 2, to the transistor 4.
x, flows along a path passing through the current detector 7. Above operation 81
AC power is supplied from the DC power supply 1 to the load 2 by repeating the cycle as a recycle. The important thing here is that
Any switching method, dust arm and X arm 1 to transistor 4u, 'lx or ■ arm and Y
There must be no period during which the arm transistors 4V and 4Y are conductive to +15.

万が一上述の導通期間があった場合には、配線のインダ
クタンス3とトランジスタ2個分のコレクターエミッタ
間インピーダンスを通して過大電流が流れ、負荷2へ電
力を供給できなくなる。上述のようなインバータ装置に
おいては、一般に配線のインダクタンスはスイッチング
オフ時のサージ電圧低減の要請からできる限り小さく工
夫されており、また1〜ランジスタのコレクターエミッ
タ間の飽和インピーダンスも非常に小さいことから上記
の過大電流(以1な、直流710絡電流という)は非常
に大きな上昇率でかつ大電流となり通常はトランジスタ
を破壊してしまう。
If the above-mentioned conduction period were to occur, an excessive current would flow through the wiring inductance 3 and the collector-emitter impedance of two transistors, making it impossible to supply power to the load 2. In the inverter device described above, the inductance of the wiring is generally designed to be as small as possible in order to reduce the surge voltage during switching off, and the saturation impedance between the collector emitter of 1 and the transistor is also very small. The excessive current (hereinafter referred to as DC 710 circuit current) has a very large rate of increase and becomes a large current, which usually destroys the transistor.

さて、従来技術による上述の直流短絡電流からの1〜ラ
ンシスタの保護方法としては、第5図1こし例示したJ
、うに直流短、惰の経路に電流検出器7を挿入しさらに
過電流検出回路8を護りで、所定値以上の電流か流れた
場合に(J、直らにベース阻止信号9を出力し前記1〜
ランジスタのベースを阻止するのか一般的でめった。
Now, as a method of protecting 1 to 1 to 2 Lancistors from the above-mentioned DC short circuit current according to the prior art, there is shown in FIG.
, a current detector 7 is inserted in the direct current short path, and the overcurrent detection circuit 8 is further protected, so that when a current exceeding a predetermined value flows (J), a base blocking signal 9 is immediately output and the ~
It is common and rare to block the base of a transistor.

(発明が解決しようとする問題点) しかし、インバータHVIに使用するスイッチング素子
は、前記トランジスタに限らず種々の複合素子か開発さ
れつつおり、そのスイッチング速度は非小゛に高速化さ
れてきている。これに供ない電流変化率の上571に供
なうサージ電圧の抑制から回路の配線のインダクタンス
3はにり一層小さく工夫され、また過電流検出回路8に
おいてら実際には電子回路の誤動作防電から最低限のフ
ィルタを右しており検出遅れ11)間を持っている。つ
まり、直流短絡電流上7il率は増々上臂するが、検出
遅れ口4間を小さくするに(j、限界があるため、直流
短絡電流に対するスイッチング素子の保護は単に過電流
検出回路8を段【ブてスイッチング素子のベースを阻止
するだけの方法では困難な場合があり、このことは高速
のスイッチング素子を使用していくうえで非常に重要な
問題となる。
(Problem to be Solved by the Invention) However, the switching elements used in the inverter HVI are not limited to the transistors mentioned above, but various composite elements are being developed, and their switching speeds have been significantly increased. . In order to suppress the surge voltage associated with the current change rate 571, the inductance 3 of the circuit wiring has been made even smaller, and the overcurrent detection circuit 8 is actually used to prevent electrical malfunction of electronic circuits. It has a detection delay of 11) with a minimum filter. In other words, although the DC short-circuit current rate increases more and more, there is a limit to reducing the detection delay gate 4 (j), so the protection of the switching elements against DC short-circuit current is simply to step up the overcurrent detection circuit 8. In some cases, it is difficult to simply block the base of the switching element by using a method of blocking the base of the switching element, and this becomes a very important problem when using high-speed switching elements.

本発明は直流短絡電流に対づる保護を容易に、かつ確実
に行うインバータ装置を提供することを目的とするもの
である。
An object of the present invention is to provide an inverter device that easily and reliably protects against DC short circuit current.

(発明の構成〕 (問題点を解決Jるための手段) 本発明は、その実施例図面第1図に示すにうに、直流短
I8電流上界捧−の抑制手段として、スイッチング動作
が対をなす1−ランジスタ4Uと4Y相互間、J3よび
/lvと4x相互間に差動的に磁気結合された2絹のイ
ンダクタ5U、5Yおよび5v。
(Structure of the Invention) (Means for Solving the Problems) As shown in FIG. 1-2 silk inductors 5U, 5Y and 5v differentially magnetically coupled between transistors 4U and 4Y and between J3 and /lv and 4x.

5xをそれぞれ前記1〜ランジスタに直列に挿入し、さ
らに過電流保護手段として、電流検出器7と過電流検出
回路8、ドライブ信号阻止回路9を設け、インバータ装
置におりる直流短絡電流に対する前記I・ランジスタ等
のスイッチング素子の保護方法を改良するものである。
A current detector 7, an overcurrent detection circuit 8, and a drive signal blocking circuit 9 are provided as overcurrent protection means, and the above I・It improves the protection method for switching elements such as transistors.

(作 用) 上述の(jへ成において、2絹のインダクタ5u。(for production) In the above (j), there are two silk inductors 5u.

5Yおよび5v、5xは、正常なスイッチング動作時に
お【)る11前電流に対しては、差動的な直列接続とな
るため、おのおのの自己インダクタンスに比べてはるか
に小さな舶として機能し、前記負荷電流には殆んど影響
をおよぼさない。
5Y, 5v, and 5x are differentially connected in series with respect to the current generated during normal switching operation, so they function as a much smaller vessel than their respective self-inductances, and the above-mentioned It has almost no effect on the load current.

これに対し、1〜ランジスタ4Uと4x、または4Vと
4Yが双方共導通する期間が発生した場合には、事故電
流は磁気結合されない2つのインダクタ5Uと5x、ま
たは5νと5Yを直列に通って流れるため前記事故電流
の上背率は前記の2つのインダクタおよび配線のインダ
クタンス3によって制限される。。
On the other hand, if a period occurs in which transistors 1 to 4U and 4x or 4V and 4Y are both conductive, the fault current will pass through the two inductors 5U and 5x, or 5ν and 5Y, which are not magnetically coupled, in series. Because of this, the fault current is limited by the inductance 3 of the two inductors and the wiring. .

(本発明の実施例) 以下図面に示した実施例に基づいて本発明の詳細な説明
する。
(Embodiments of the present invention) The present invention will be described in detail below based on embodiments shown in the drawings.

第1図は本発明の実施例を示づ電斤源形インパーク賃間
の構成図である。同図において、直流電源1はトランジ
スタ4u、 IAv、/′lX、4Yと、スイッチング
動作が対をな1ア一ム相互間で磁気結合されたインダク
タ5u、5v、5X、5Yと還流ダイオード6u、6v
、6X、6Yから主回路が構成される単相ブリッジイン
バータを介して交流電力に変換され負荷2へ供給される
。ここで、3は回路の配線のインダクタンスをまとめて
示したものである。トランジスタ駆動回路は、スイッチ
ング制御回路10からの信号をベースドライブ回路ti
uv、 11VXを通して増幅し前記の各トランジスタ
へ接続される。過電流保護回路は、電流検出器7により
検出される電流の信号を過電流検出回路8にて所定の設
定値と比較、判断し、過電流にはベース阻止信号9によ
りスイッチング制御回路10にベース阻止の指令を与え
る。
FIG. 1 is a block diagram showing an embodiment of the present invention. In the figure, a DC power supply 1 includes transistors 4u, IAv, /'lX, 4Y, inductors 5u, 5v, 5X, 5Y whose switching operations are magnetically coupled to each other in pairs, and a free-wheeling diode 6u. 6v
, 6X, and 6Y are converted into AC power via a single-phase bridge inverter, which constitutes a main circuit, and supplied to the load 2. Here, 3 collectively indicates the inductance of the circuit wiring. The transistor drive circuit transfers the signal from the switching control circuit 10 to the base drive circuit ti.
UV and 11VX are amplified and connected to each of the above transistors. The overcurrent protection circuit compares and judges the current signal detected by the current detector 7 with a predetermined setting value in the overcurrent detection circuit 8, and in the case of overcurrent, the base blocking signal 9 is sent to the switching control circuit 10. Give a command to stop.

つぎに、第2図および第3図を用いて作用を説明する。Next, the operation will be explained using FIGS. 2 and 3.

第2図は本発明の主回路動作の例を示す説明図であるが
、説明の簡略のために第1図と同様の作用をなす部分に
は同一符号を付【プて前述参照とする。同図において、
1uy−pはU、Yアームのトランジスタ4LJ、4N
を通って負荷に流れるカ行電流であり、iUY−gは前
記のU、Yアームのトランジスタ’lu、4Yが非導通
となった瞬間に、誘導性の負荷の場合にのみ負荷2から
還流ダイオード6x、6シを通って前記直流電源1へ流
れる回生電流である。J:た、181はトランジスタ4
Uと4xが同時に導通した場合に流れる直流)、0絡電
流である。第3図は、従来技術と本発明ににる場合の過
電流保護の違いを説明する電流波形図である。同図にお
いて181は本発明を用いた場合の直流短絡電流波形、
1B2は従来技術を用いた場合の直流短絡電流波形であ
る。locは過電流検出の設定値であり、過電流検出時
刻から前記トランジスタがスイッチングオフを開始する
までの遅れ時間to後に前記直流短絡電流はそれぞれ最
大値l8P2およびIarlに達する。
FIG. 2 is an explanatory diagram showing an example of the main circuit operation of the present invention, and for the sake of simplicity, parts having the same functions as those in FIG. 1 are given the same reference numerals and referred to above. In the same figure,
1uy-p is U, Y arm transistor 4LJ, 4N
iUY-g is the current that flows through the load to the load, and iUY-g is the current that flows from the freewheeling diode from load 2 only in the case of an inductive load, at the moment when the transistors 'lu and 4Y of the U and Y arms become non-conductive. This is a regenerative current that flows to the DC power supply 1 through 6x and 6shi. J: 181 is transistor 4
The direct current that flows when U and 4x conduct at the same time) is the 0-circuit current. FIG. 3 is a current waveform diagram illustrating the difference in overcurrent protection between the prior art and the present invention. In the same figure, 181 is a DC short circuit current waveform when using the present invention;
1B2 is a DC short circuit current waveform when using the conventional technique. loc is a set value for overcurrent detection, and after a delay time to from the overcurrent detection time until the transistor starts switching off, the DC short-circuit current reaches maximum values l8P2 and Iarl, respectively.

第2図に示したカ行電流1uv−p、回生電流1uv−
uの経路から明らかなにうに、スイッチング動作が対を
なすアーム相互間で差動的に磁気結合されたインダクタ
(同図の説明においては5υと5Y)には双方に等しい
電流が流れ、一つの開回路として見た場合の回路のイン
ダクタンスは非常に小さくなる。今、前記インダクタ5
υ、5vの自己インダクタンスを等しくし、相互インダ
クタンスをM、配線のインダクタンス@L慮とすれば上
述の閉回路で考えた場合の合成インダクタンスLoは Lo=21 2M十Lz で与えられ、理想的な結合度(結合係数が1のとぎ)が
得られればLo=Lzとなる。ところが、前)小の直流
yri絡電流ia1が流れた場合には、互いに磁気結合
していないインダクタ5Uと5xを通る閉回路となり、
この場合の閉回路のインダクタンスL6とすれば L6=21+l 1 となる。つまり、正規のスイッチング動作にてインバー
タ装置が運転されている場合には本発明によるところの
磁気結合インダクタは無いがごときにふるまい、直流短
絡時にのみ事故電流上背率を抑制御るように作用する。
The power current 1uv-p and the regenerative current 1uv-p shown in Fig. 2
As is clear from the path of u, the same current flows through the inductors (5υ and 5Y in the explanation of the same figure) whose switching operation is differentially magnetically coupled between the paired arms, and one The inductance of the circuit when viewed as an open circuit becomes very small. Now, the inductor 5
If the self-inductances of υ and 5V are made equal, the mutual inductance is M, and the wiring inductance @L is considered, the composite inductance Lo when considering the above closed circuit is given by Lo=21 2M + Lz, and the ideal If the degree of coupling (coupling coefficient is 1) is obtained, Lo=Lz. However, when a small DC yri circuit current ia1 flows, a closed circuit passes through the inductors 5U and 5x, which are not magnetically coupled to each other.
If the inductance of the closed circuit in this case is L6, then L6=21+l 1 . In other words, when the inverter device is operated with normal switching operation, the magnetically coupled inductor according to the present invention behaves as if it were not present, and acts to suppress the fault current increase rate only in the event of a DC short circuit. .

さて、第3図に示すように、同じ動作ばれ04間1.)
を有する過電流保護回路にて従来技術にJ、る場合と本
発明による場合を比較すれば、本発明による場合の事故
電流波高値の方がはるか低くおさえられる。このことは
、(υ 直流短絡電流の電流二乗時間積(通過12t)
が小さくなり、スイッチング素子の短時間領域における
熱エネルギ的な破壊から保護することが可能になる。
Now, as shown in FIG. 3, the same operation is performed between 04 and 1. )
Comparing the conventional overcurrent protection circuit with the present invention and the conventional overcurrent protection circuit, the fault current peak value in the present invention is much lower. This means that (υ current square time product of DC short circuit current (passing 12t)
becomes smaller, making it possible to protect the switching element from thermal energy damage in a short time range.

■ 直流短絡電流の上が率が抑制されることにより、過
電流検出回路の誤動作とスイッチング素子の保護とが協
調のとれるような適切なフィルタを過電流検出回路に挿
入することができ保護動作を確実かつ正確に行うことが
できる。
■ By suppressing the rate of increase in DC short-circuit current, it is possible to insert an appropriate filter into the overcurrent detection circuit so that the malfunction of the overcurrent detection circuit and the protection of the switching elements can be coordinated. Can be performed reliably and accurately.

という効果を生み、従来方式では保護不可能だったもの
が本発明により保護可能になったり、また保護回路が誤
動作したり不確実だったものが正確、かつ確実に行える
ようになる。
As a result, things that could not be protected by conventional methods can now be protected by the present invention, and things where the protection circuit malfunctioned or was uncertain can now be done accurately and reliably.

第4図は、本発明の他の実施例を示ず]1?J成図であ
る。この実施例にd3いては還流ダイオード6u。
FIG. 4 does not show other embodiments of the invention]1? This is a J composition diagram. In this embodiment, d3 is a free wheel diode 6u.

6v、6X、6Yの接続が第1図と51cなるのみで他
は同−子−1成である。前記還流ダイオード6u。
The connections of 6v, 6X, and 6Y are the same as in FIG. 1 and 51c, and the rest are the same configuration. The free wheel diode 6u.

6シ* 6 x 、6 Yは一端は磁気結合インダクタ
5 u 、J V T J x * J Yへ接続され
ているが、他端をそれぞれ配線のインダクタンス3おに
び電流検出器7を経由せずに直接直流電源1へ接続した
構成である。この構成にd3いても第一の実施例と全く
同様の効果を胃ることができ、さらにスイッチングオフ
時のり−−ジ電圧も軽減したインバータ装置とすること
が可能である。
6 * 6 x and 6 Y are connected at one end to the magnetically coupled inductor 5 u and J V T J x * J Y, but the other ends are connected through the wiring inductance 3 and current detector 7 respectively The configuration is such that it is directly connected to the DC power supply 1 without any need for a power source. Even with this configuration d3, it is possible to obtain exactly the same effects as in the first embodiment, and furthermore, it is possible to obtain an inverter device in which the surge voltage at the time of switching off is reduced.

以上二つの実施例はスイッチング素子を1〜ランジスタ
で説明してぎたが、1〜ランジスタに限らず自己消弧形
のスイッチング素子であればいずれにも適用されること
は言うまでもない。
In the above two embodiments, the switching elements have been described using transistors 1 to 1, but it goes without saying that the present invention is not limited to transistors 1 to 1 and is applicable to any self-extinguishing switching element.

〔発明の効果〕〔Effect of the invention〕

本発明によれば以上説明したにうに、正規のスイッチン
グ動作にてインバータ装置が運転されている場合には、
磁気結合インダクタは互いに打ら消し合って、回路中に
は無いがごときにふるまい、直流短絡が発生したとぎに
はその事故電流の上昇率を抑制して、スイッチング素子
の保護を容易にしかも確実に行うことができる。
According to the present invention, as explained above, when the inverter device is operated with normal switching operation,
Magnetically coupled inductors cancel each other out and behave as if they were not in the circuit, and when a DC short circuit occurs, the rate of increase in fault current is suppressed, making it easy and reliable to protect switching elements. It can be carried out.

スイッチング素子の高速化に伴ないその保護が増々難し
くなる中で、本発明は簡素な方法でありかつ非I;Sに
右動でおる。
As the speed of switching elements increases, it becomes more and more difficult to protect them, and the present invention is a simple method and is suitable for non-I;S.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例を示すインバータ装置の構成
図、第2図は本発明の作用をに1明暇“ろゴユ回路動作
説明図、第3図は従来技術による場合と本発明による場
合の効果を比較・説明づる直流短絡電流波形図、第4図
は本発明の他の実施例を示づ構成図、第5図は従来技術
によるインバータ装置群の構成図でおる。 1・・・直流電源、   2・・・負荷、3・・・配線
のインダクタンス、 4u、4v、4x、4y・=トランジスタ、5u、5y
・・・磁気結合インダクタ、5νt 5x・・・磁気結
合インダクタ、6U、6シー 6 x + 6 Y・・
・還流ダイオード、7・・・電流検出器、  8・・・
過電流検出回路、9・・・ベース阻止信号、 10・・・スイッチング制御回路、 11UY、 11νX・・・ベースドライブ回路、1u
y−p・・・U−Yアームを流れるカ行電流、1uv−
R・・・U−Yアームを流れる回生電流、is−+・・
・本発明による場合の直流短絡電流、l5r1・・・本
発明による場合の直流短絡電流最大値、182・・・従
来技術にJ:る場合の直流短絡電流、l3F2・・・従
来技術による場合の直流短絡電流最大値、 Ioc・・・過電流検出設定値、 tD・・・過電流検出時刻からトランジスタがスイッチ
ングオフを開始するまでの遅れ時間。 代理人 弁理士 則 近 憲 佑 同  三俣弘文 第1図 第3vlJ 第4図
Fig. 1 is a block diagram of an inverter device showing an embodiment of the present invention, Fig. 2 is an explanatory diagram of the operation of the inverter circuit, and Fig. 3 is a diagram illustrating the operation of the present invention. A DC short circuit current waveform diagram for comparing and explaining the effects of the invention, FIG. 4 is a configuration diagram showing another embodiment of the invention, and FIG. 5 is a configuration diagram of an inverter device group according to the prior art.1 ...DC power supply, 2...Load, 3...Wiring inductance, 4u, 4v, 4x, 4y = transistor, 5u, 5y
...Magnetic coupling inductor, 5νt 5x...Magnetic coupling inductor, 6U, 6 Sea 6 x + 6 Y...
・Freewheeling diode, 7...Current detector, 8...
Overcurrent detection circuit, 9...Base blocking signal, 10...Switching control circuit, 11UY, 11νX...Base drive circuit, 1u
y-p...Current flowing through U-Y arm, 1uv-
R...Regenerative current flowing through the U-Y arm, is-+...
・DC short-circuit current according to the present invention, l5r1... Maximum value of DC short-circuit current according to the present invention, 182... DC short-circuit current when according to the prior art, l3F2... When according to the prior art Maximum value of DC short circuit current, Ioc: Overcurrent detection setting value, tD: Delay time from overcurrent detection time until the transistor starts switching off. Agent Patent Attorney Noriyuki Chika Yudo Hirofumi MitsumataFigure 1Figure 3vlJ Figure 4

Claims (1)

【特許請求の範囲】[Claims] スイッチング動作が対をなすアーム相互間に対して磁気
結合させたインダクタを、各アームのスイッチング素子
と直列に挿入し、事故電流上昇率を抑制することを特徴
とするインバータ装置。
An inverter device characterized in that an inductor magnetically coupled between arms of which switching operation is a pair is inserted in series with a switching element of each arm to suppress a rate of increase in fault current.
JP61021982A 1986-02-05 1986-02-05 Inverter apparatus Pending JPS62181680A (en)

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JP61021982A JPS62181680A (en) 1986-02-05 1986-02-05 Inverter apparatus

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