JPS62166692A - 輝度信号分離回路 - Google Patents
輝度信号分離回路Info
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- JPS62166692A JPS62166692A JP916986A JP916986A JPS62166692A JP S62166692 A JPS62166692 A JP S62166692A JP 916986 A JP916986 A JP 916986A JP 916986 A JP916986 A JP 916986A JP S62166692 A JPS62166692 A JP S62166692A
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- JP
- Japan
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- circuit
- signal
- delay circuit
- input
- adder
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- Pending
Links
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- 239000002131 composite material Substances 0.000 abstract description 11
- 239000011521 glass Substances 0.000 abstract description 7
- 230000003287 optical effect Effects 0.000 abstract 1
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- 238000013459 approach Methods 0.000 description 1
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Landscapes
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は家庭用ビデオテープレコーダ（以下、ＶＴＲと
いうンなどに使用できる複合映像信号の輝度信号分離回
路に関するものである。
いうンなどに使用できる複合映像信号の輝度信号分離回
路に関するものである。
従来の技術
近年、家庭用ＶＴＲにおける高画質化のアプローチの１
つとして、−水子期間遅延素子（以下、１ＨＤＩ、とい
うンを使用したくし型フィルター回路により輝度信号分
離を行ない、輝度成分の広帯域化、高域の不要色成分の
除去、ノイズの低減などを達成し、画質の改良がはから
れている。
つとして、−水子期間遅延素子（以下、１ＨＤＩ、とい
うンを使用したくし型フィルター回路により輝度信号分
離を行ない、輝度成分の広帯域化、高域の不要色成分の
除去、ノイズの低減などを達成し、画質の改良がはから
れている。
以下図面を参照しながら、上述した従来の輝度信号分離
回路の１例について説明する。
回路の１例について説明する。
第３図はＮＴ３Ｇ信号用のＶＴＲの記録回路における従
来の輝度信号分離回路の１例を示すものであり、第４図
は、第３図に示した回路各部の周波数特性を示している
。第３図において、１は入力、２は１水平期間遅延を与
える電荷結合素子（以下Ｃ０Ｄ）を使用したＣＯＤ遅延
回路、３は加算器、４は出力、５はクロック入力、６は
クロック発生回路で、入力１はＣＯＤ遅延回路２と加算
器３の入力の１つに接続され、ＣＯＤ遅延回路２の出力
は加算器３の他方の入力に接続され、また加算器３の出
力は出力４に接続されている。なお、ＶＴＲの記録回路
において使用しているので、入力１と出力４はＶＴＲの
複合映像信号入力とＦＭ変調器の間に接続されている。
来の輝度信号分離回路の１例を示すものであり、第４図
は、第３図に示した回路各部の周波数特性を示している
。第３図において、１は入力、２は１水平期間遅延を与
える電荷結合素子（以下Ｃ０Ｄ）を使用したＣＯＤ遅延
回路、３は加算器、４は出力、５はクロック入力、６は
クロック発生回路で、入力１はＣＯＤ遅延回路２と加算
器３の入力の１つに接続され、ＣＯＤ遅延回路２の出力
は加算器３の他方の入力に接続され、また加算器３の出
力は出力４に接続されている。なお、ＶＴＲの記録回路
において使用しているので、入力１と出力４はＶＴＲの
複合映像信号入力とＦＭ変調器の間に接続されている。
以上のように構成された輝度信号分離回路について、以
下その動作について説明する。
下その動作について説明する。
まず、入力１に第４図乙に示す周波数特性を有した複合
映像信号を与えると、ｃａｎ遅延回路２の周波数特性を
第４図すに示す特性に設定しておけば、加算器３の作用
によって出力４には、第４図Ｃに示すような、くし形ｐ
波された輝度成分が分離出力される。上記した技術内容
は一般によく知られている。
映像信号を与えると、ｃａｎ遅延回路２の周波数特性を
第４図すに示す特性に設定しておけば、加算器３の作用
によって出力４には、第４図Ｃに示すような、くし形ｐ
波された輝度成分が分離出力される。上記した技術内容
は一般によく知られている。
発明が解決しようとする問題点
しかしながら上記のような構成では、ｃａｎ遅延素子を
使用するので、現状においては素子のコストはもちろん
クロック発生回路等も必要で、又。
使用するので、現状においては素子のコストはもちろん
クロック発生回路等も必要で、又。
一般にクロック周波数をできるだけ低くして、素子のコ
ストを最小限にとどめる場合が多いが、この場合高域の
周波数特性が一般に低下し、高域ゴースト回路も必要と
なり非常にコスト高となる現状である。
ストを最小限にとどめる場合が多いが、この場合高域の
周波数特性が一般に低下し、高域ゴースト回路も必要と
なり非常にコスト高となる現状である。
本発明は上記問題に鑑み、比較的低コストで従来と実用
上回等の性能が得られる輝度信号分離回路を提供するも
のである。
上回等の性能が得られる輝度信号分離回路を提供するも
のである。
問題点を解決するための手段
上記問題点を解決するために本発明の輝度信号分離回路
は、入力を共通にした色信号帯域を通過さす信号遅延回
路と、ディエンフアシス回路と、前記信号遅延回路と前
記ディエンファシス回路の夫々の出力を入力とする加算
器を具備するという構成を備えたものである。
は、入力を共通にした色信号帯域を通過さす信号遅延回
路と、ディエンフアシス回路と、前記信号遅延回路と前
記ディエンファシス回路の夫々の出力を入力とする加算
器を具備するという構成を備えたものである。
作用
本発明は上記した構成によって、信号遅延回路中に比較
的安価なりロマ帯超音波ガラス遅延線を使用して１Ｈ遅
延信号を得、主信号をディエンファシス回路によって適
当に振幅等化し、１Ｈ遅延信号とディエンファシス出力
を加算することにより、クロマ帯超音波ガラス遅延線の
通過帯域に相当する帯域において色信号をくし型炉波す
る輝度信号分離回路を得ることとなる。
的安価なりロマ帯超音波ガラス遅延線を使用して１Ｈ遅
延信号を得、主信号をディエンファシス回路によって適
当に振幅等化し、１Ｈ遅延信号とディエンファシス出力
を加算することにより、クロマ帯超音波ガラス遅延線の
通過帯域に相当する帯域において色信号をくし型炉波す
る輝度信号分離回路を得ることとなる。
実施例
以下、本発明のＮＴＳＣ用ＶＴＲの記録回路における一
実施例の輝度信号分離回路について、第１図、第２図を
用いて説明する。
実施例の輝度信号分離回路について、第１図、第２図を
用いて説明する。
まず、第１図は回路ブロックを示すものであって、まず
、入力端子１に第４図ａに示す周波数特性を有した複合
合成信号を与える０超音波ガラス遅延回路１ｏの周波数
特性は、一般にその中心周波数がカラーサブキャリア周
波数（３，５８ＭＨｚ ）である時、第２図ａの様な帯
域通帯特性を示す０ここに、ｌは３．６８ ＭＨｚと１
ＭＨｚにおけるレベル差でｂ ｆ ５ ＋ｆ ａは夫々
低域における振幅３ｄＢ［Ｉｉ下点と、２ｏｄＢ［ｉ下
点に対応する周波数である。
、入力端子１に第４図ａに示す周波数特性を有した複合
合成信号を与える０超音波ガラス遅延回路１ｏの周波数
特性は、一般にその中心周波数がカラーサブキャリア周
波数（３，５８ＭＨｚ ）である時、第２図ａの様な帯
域通帯特性を示す０ここに、ｌは３．６８ ＭＨｚと１
ＭＨｚにおけるレベル差でｂ ｆ ５ ＋ｆ ａは夫々
低域における振幅３ｄＢ［Ｉｉ下点と、２ｏｄＢ［ｉ下
点に対応する周波数である。
ディエンファシス回路１１の周波数特性は第２図すに示
すように、周波数ｆ３に等しいｆ、にて３ｄＢＩＩｊ下
点、周波数ｆ３に等しいｆ２にて２０ｄＢ［ｉ下点とな
り、かツ３．５８ ＭＨｚとＩ ＭＨｚのレベル差がｍ
となるように内部時定数を設定しである。入力端子１に
与えた複合映像信号を、上記した超音波ガラス遅延回路
１ｏとディエンファシス回路１１に分岐入力し、夫々の
出力を加算器３にて加え合わせれば、出力端子４には第
２図Ｃに示す周波数特性を有する色成分がくし形ｆ波さ
れかつ平坦な周波数特性を有する輝度信号が分離出力さ
れる。この時、一般に家庭用ＶＴＲで扱う色信号帯域は
３ ＭＨｚから４ ＭＨｚにそのスペクトルが集中して
いる事を考慮すれば、出力端子４に得た輝度信号に残留
している色信号成分は実用上支障ない水準に減衰しうる
事は容易に理解できる。なお、本回路は、ＶＴＲの記録
回路に使用しているので入力端子１の入力と出力端子４
の出力はＶＴＲの複合映像信号入力とＦＭ変調器の間に
接続されて、良好な輝度分離特性を発揮しうるものであ
る事を付記する。
すように、周波数ｆ３に等しいｆ、にて３ｄＢＩＩｊ下
点、周波数ｆ３に等しいｆ２にて２０ｄＢ［ｉ下点とな
り、かツ３．５８ ＭＨｚとＩ ＭＨｚのレベル差がｍ
となるように内部時定数を設定しである。入力端子１に
与えた複合映像信号を、上記した超音波ガラス遅延回路
１ｏとディエンファシス回路１１に分岐入力し、夫々の
出力を加算器３にて加え合わせれば、出力端子４には第
２図Ｃに示す周波数特性を有する色成分がくし形ｆ波さ
れかつ平坦な周波数特性を有する輝度信号が分離出力さ
れる。この時、一般に家庭用ＶＴＲで扱う色信号帯域は
３ ＭＨｚから４ ＭＨｚにそのスペクトルが集中して
いる事を考慮すれば、出力端子４に得た輝度信号に残留
している色信号成分は実用上支障ない水準に減衰しうる
事は容易に理解できる。なお、本回路は、ＶＴＲの記録
回路に使用しているので入力端子１の入力と出力端子４
の出力はＶＴＲの複合映像信号入力とＦＭ変調器の間に
接続されて、良好な輝度分離特性を発揮しうるものであ
る事を付記する。
以上のように本実施例によれば、ＶＴＲの複合映像信号
、を共通の入力とする比較的安価なりロマ帯超音波ガラ
ス１Ｈ遅延線を使用した信号遅延回路と信号遅延回路の
周波数特性を等化するディエンファシス回路と、該信号
遅延回路と該ディエンファシス回路夫々の出力を加算器
にて加算する事により、クロマ帯域において光分色信号
成分を減衰させた輝度成分が得られ、”ｌ／ＴＨのＦＭ
変調器に供給する事ができるので、従来のＣ０Ｄ−ＤＬ
方式に比して安価で、周波数特性が平坦な輝度分離回路
を実現することができる。
、を共通の入力とする比較的安価なりロマ帯超音波ガラ
ス１Ｈ遅延線を使用した信号遅延回路と信号遅延回路の
周波数特性を等化するディエンファシス回路と、該信号
遅延回路と該ディエンファシス回路夫々の出力を加算器
にて加算する事により、クロマ帯域において光分色信号
成分を減衰させた輝度成分が得られ、”ｌ／ＴＨのＦＭ
変調器に供給する事ができるので、従来のＣ０Ｄ−ＤＬ
方式に比して安価で、周波数特性が平坦な輝度分離回路
を実現することができる。
なお、上記した本発明の実施例はＮＴＳＣ用ＶＴＲの記
録回路に適用した例を説明したが、信号遅延回路１ｏの
１ＨＤＬを２ＨＤＬにする事によりＰムＬに対応できる
事、又ＶＴＨの記録回路以外においても広く複合映像信
号から輝度信号を分離する用途を有する事も付記する。
録回路に適用した例を説明したが、信号遅延回路１ｏの
１ＨＤＬを２ＨＤＬにする事によりＰムＬに対応できる
事、又ＶＴＨの記録回路以外においても広く複合映像信
号から輝度信号を分離する用途を有する事も付記する。
発明の効果
以上のように本発明によれば、入力を共通にした信号遅
延回路とディエンファシス回路と、該遅延信号回路の出
力とディエンファシス回路夫々の出力を入力とした加算
器を設けることにより、安価で周波数特性平坦な複合映
像信号の輝度信号分離回路を実現することができる。
延回路とディエンファシス回路と、該遅延信号回路の出
力とディエンファシス回路夫々の出力を入力とした加算
器を設けることにより、安価で周波数特性平坦な複合映
像信号の輝度信号分離回路を実現することができる。
第１図は本発明の実施例における複合映像信号の輝度信
号分離回路のブロック図、第２図は第１図の各部特性図
、第３図は従来例の複合映像信号の輝度信号分離回路の
ブロック図、第４図は第３図の各部特性図である。 １・・・・・・入力端子、２・・・・・・ＣＯＤ遅延回
路、３・・・・・・加算器、４・・・・・・出力端子、
１０・・・・・・超音波ガラス遅延回路、１１・・・・
・・ディエンファシス回路。
号分離回路のブロック図、第２図は第１図の各部特性図
、第３図は従来例の複合映像信号の輝度信号分離回路の
ブロック図、第４図は第３図の各部特性図である。 １・・・・・・入力端子、２・・・・・・ＣＯＤ遅延回
路、３・・・・・・加算器、４・・・・・・出力端子、
１０・・・・・・超音波ガラス遅延回路、１１・・・・
・・ディエンファシス回路。
Claims (1)
- 入力を共通にした色信号帯域を通過させる信号遅延回路
と、ディエンファシス回路と、前記信号遅延回路と前記
ディエンファシス回路の夫々の出力を入力とする加算器
を備えた事を特徴とする輝度信号分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP916986A JPS62166692A (ja) | 1986-01-20 | 1986-01-20 | 輝度信号分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP916986A JPS62166692A (ja) | 1986-01-20 | 1986-01-20 | 輝度信号分離回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62166692A true JPS62166692A (ja) | 1987-07-23 |
Family
ID=11713091
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP916986A Pending JPS62166692A (ja) | 1986-01-20 | 1986-01-20 | 輝度信号分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62166692A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6175494B1 (en) | 1998-03-12 | 2001-01-16 | Nec Corporation | Cooling apparatus and cooling method capable of cooling an encapsulated type housing in a high cooling efficiency |
-
1986
- 1986-01-20 JP JP916986A patent/JPS62166692A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6175494B1 (en) | 1998-03-12 | 2001-01-16 | Nec Corporation | Cooling apparatus and cooling method capable of cooling an encapsulated type housing in a high cooling efficiency |
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