JPS62118638A - 分周回路 - Google Patents
分周回路Info
- Publication number
- JPS62118638A JPS62118638A JP25758385A JP25758385A JPS62118638A JP S62118638 A JPS62118638 A JP S62118638A JP 25758385 A JP25758385 A JP 25758385A JP 25758385 A JP25758385 A JP 25758385A JP S62118638 A JPS62118638 A JP S62118638A
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- JP
- Japan
- Prior art keywords
- capacitor
- gate
- current source
- frequency division
- current
- Prior art date
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- Pending
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- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
分周回路において、電流源の電流値を制御することによ
ってコンデンサの充電時間を設定し任意の分周比を得る
ようにした分周回路であって、電流値の制御をソフトウ
ェア的に行うようにしたものである。
ってコンデンサの充電時間を設定し任意の分周比を得る
ようにした分周回路であって、電流値の制御をソフトウ
ェア的に行うようにしたものである。
本発明は分周回路に関し、特にハード構成の変更によら
ずソフトウェア的に分周比を設定、変更することができ
る分周回路に関する。
ずソフトウェア的に分周比を設定、変更することができ
る分周回路に関する。
従来、例えば、複数段のフリップ・フロップ回路を組み
合せたシフトレジスタによる分周回路あるいはプログラ
マブルカウンタによる分周回路等、ハード構成による分
周回路は既に知られている。
合せたシフトレジスタによる分周回路あるいはプログラ
マブルカウンタによる分周回路等、ハード構成による分
周回路は既に知られている。
このようなハード構成による分周回路では、分周圧を変
える場合、フリップフロップ回路の段数の増減あるいは
回路結線の増加等を伴い容易に実施することが困難であ
る。さらに回路の段数が増加する場合に、扱う周波数が
高ければ高いほど伝搬遅延時間の増大を来すという問題
も生じる。
える場合、フリップフロップ回路の段数の増減あるいは
回路結線の増加等を伴い容易に実施することが困難であ
る。さらに回路の段数が増加する場合に、扱う周波数が
高ければ高いほど伝搬遅延時間の増大を来すという問題
も生じる。
Ｃ問題点を解決するための手段及び作用〕本発明は上述
の問題点を解消した分周回路を提供することにあり、そ
の手段は、一方の入力端子に入力信号を供給し他方の入
力端子をコンデンサＣに接続したＡＮＤゲートと、該コ
ンデンサと電源間に接続され該コンデンサに充電電流を
供給する電流源Ｃ３と、該コンデンサと並列に接続され
かつ該他方の入力端子に接続される切換スイッチＳＷと
、該電流源の電流値をアナログ信号により所定の電流値
に制御するコントローラＣ０ＮＴと、該ＡＮＤゲートの
出力信号に基づいて該切換スイッチの開閉制御を行うス
イッチ駆動回路ＤＶとを備え、該電流源の電流値を該コ
ントローラにより制御することによって該コンデンサの
充電立上りを制御し、該コンデンサカ５所定の電圧値に
達したときに該Ａ’ＮＤゲートを開くことにより任意の
分周比を得るようにしたことを特徴とする。
の問題点を解消した分周回路を提供することにあり、そ
の手段は、一方の入力端子に入力信号を供給し他方の入
力端子をコンデンサＣに接続したＡＮＤゲートと、該コ
ンデンサと電源間に接続され該コンデンサに充電電流を
供給する電流源Ｃ３と、該コンデンサと並列に接続され
かつ該他方の入力端子に接続される切換スイッチＳＷと
、該電流源の電流値をアナログ信号により所定の電流値
に制御するコントローラＣ０ＮＴと、該ＡＮＤゲートの
出力信号に基づいて該切換スイッチの開閉制御を行うス
イッチ駆動回路ＤＶとを備え、該電流源の電流値を該コ
ントローラにより制御することによって該コンデンサの
充電立上りを制御し、該コンデンサカ５所定の電圧値に
達したときに該Ａ’ＮＤゲートを開くことにより任意の
分周比を得るようにしたことを特徴とする。
第１図は本発明に係る分周回路の一実施例回路図である
。第１図において、Ｃ８は電流源、ＡＮＤはＡＮＤゲー
ト、ＤＶはスイッチ駆動回路、Ｄ／Ａはデジタル／アナ
ログ変換器、Ｃ０ＮＴはコントローラ、Ｃはコンデンサ
、ＶＣＣは電源である。
。第１図において、Ｃ８は電流源、ＡＮＤはＡＮＤゲー
ト、ＤＶはスイッチ駆動回路、Ｄ／Ａはデジタル／アナ
ログ変換器、Ｃ０ＮＴはコントローラ、Ｃはコンデンサ
、ＶＣＣは電源である。
ＡＮＤゲートの一方の入力端子ａには分周前の信号が入
力される。また、ＡＮＤゲートの他方の入力端子すには
電流源Ｃ８が接続され、さらに並列に切換スイッチＳＷ
が接続される。コンデンサＣは電流源ＣＳにより充電さ
れ切換スイッチＳＷを閉じると放電される。
力される。また、ＡＮＤゲートの他方の入力端子すには
電流源Ｃ８が接続され、さらに並列に切換スイッチＳＷ
が接続される。コンデンサＣは電流源ＣＳにより充電さ
れ切換スイッチＳＷを閉じると放電される。
このような構成において、第１図回路の動作を第２図の
信号波形を参照しつつ説明する。第２図において（ａｌ
はａ点における分周前の入力（ＩＮ）信号波形、（１）
）はｂ点におけるコンデンサＣの充電波形、そしてｆｃ
）は０点におけるＡＮＤゲートの出力（ＯＵＴ）波形、
即ち、分周後の波形である。まず、切換スイッチＳＷを
一旦閉じてコンデンサＣを放電した後直ちに開放して充
電する。この場合、電流源Ｃ８はコントローラＣ０ＮＴ
からのデジタル信号をＤ／Ａによってアナログ変換した
信号によって所定の大きさの電流値に設定される。この
設定された電流値によってコンデンサＣは第２図山）の
如き所定の立上りを有する充電特性を示す。即ち、設定
電流値が大きければ大きいほど波形の立上りは早くなる
。
信号波形を参照しつつ説明する。第２図において（ａｌ
はａ点における分周前の入力（ＩＮ）信号波形、（１）
）はｂ点におけるコンデンサＣの充電波形、そしてｆｃ
）は０点におけるＡＮＤゲートの出力（ＯＵＴ）波形、
即ち、分周後の波形である。まず、切換スイッチＳＷを
一旦閉じてコンデンサＣを放電した後直ちに開放して充
電する。この場合、電流源Ｃ８はコントローラＣ０ＮＴ
からのデジタル信号をＤ／Ａによってアナログ変換した
信号によって所定の大きさの電流値に設定される。この
設定された電流値によってコンデンサＣは第２図山）の
如き所定の立上りを有する充電特性を示す。即ち、設定
電流値が大きければ大きいほど波形の立上りは早くなる
。
一方、充電終了タイミングに合せて切換スイッチＳＷを
閉じればコンデンサＣは放電し、これを繰り返すことに
より第２図（ｂ）に示すコンデンサＣの充放電波形を得
る。
閉じればコンデンサＣは放電し、これを繰り返すことに
より第２図（ｂ）に示すコンデンサＣの充放電波形を得
る。
ところで、ＡＮＤゲートは両方の入力信号がハイレベル
にあるときゲートを開く動作をするので、点すにおける
充電電圧が所定値即ち、ＡＮＤゲートを開くレベル、に
達したときＡＮＤゲートは開放し出力する。第２図（ａ
）〜（Ｃ）に示す如く、（ｂ）の波形が所定値に達する
と（ａ）と（′ｂ）とが所定のハイレベルとなるため、
ＡＮＤゲートは（Ｃ）の如き波形を出力する。図から明
らかな如く入力信号の周波数に対して３分の１に分周さ
れた出力信号を得名ことができる。
にあるときゲートを開く動作をするので、点すにおける
充電電圧が所定値即ち、ＡＮＤゲートを開くレベル、に
達したときＡＮＤゲートは開放し出力する。第２図（ａ
）〜（Ｃ）に示す如く、（ｂ）の波形が所定値に達する
と（ａ）と（′ｂ）とが所定のハイレベルとなるため、
ＡＮＤゲートは（Ｃ）の如き波形を出力する。図から明
らかな如く入力信号の周波数に対して３分の１に分周さ
れた出力信号を得名ことができる。
明らかな如く、コンデンサの立上りを変えることにより
任意の分周比を得ることができ、コンデンサの立上りを
変えるためには電流源の電流値をコントローラＣ０ＮＴ
の指示によるＤ／Ａ変換された信号により制御すればよ
い。従って所望の分周比を得るように電流源の電流値を
コントローラのソフトウェアにより制御すればよい。こ
こで駆動回路ＤＶは所定のタイミングで切換スイッチＳ
Ｗをオン／オフするためのスイッチ駆動回路であり、出
力波形に同期して切換スイッチＳＷをオン／オフする。
任意の分周比を得ることができ、コンデンサの立上りを
変えるためには電流源の電流値をコントローラＣ０ＮＴ
の指示によるＤ／Ａ変換された信号により制御すればよ
い。従って所望の分周比を得るように電流源の電流値を
コントローラのソフトウェアにより制御すればよい。こ
こで駆動回路ＤＶは所定のタイミングで切換スイッチＳ
Ｗをオン／オフするためのスイッチ駆動回路であり、出
力波形に同期して切換スイッチＳＷをオン／オフする。
本発明によれば、分周比がソフトウェアにより任意に設
定、変更できるので構成が簡素化され、従来の如きハー
ド構成の変更は不要となり、かつ段数の変更に伴う伝搬
遅延も除去することができる。
定、変更できるので構成が簡素化され、従来の如きハー
ド構成の変更は不要となり、かつ段数の変更に伴う伝搬
遅延も除去することができる。
第１図は本発明に係る分周回路の一実施例回路図、およ
び 第２図は第１図回路の各点における信号波形図である。 ＡＮＤ・・・ＡＮＤゲート１ 、 ＣＳ・・・電流源、 Ｃ・・・コンデンサ、 ＤＶ・・・スイッチ駆動回路、 ＳＷ・・・切換スイッチ、 Ｄ／Ａ・・・デジタル／アナログ変換器、Ｃ０ＮＴ・・
・コントローラ。 本発明の一実施例回路図 第１図 各点における信号波形図 第２図
び 第２図は第１図回路の各点における信号波形図である。 ＡＮＤ・・・ＡＮＤゲート１ 、 ＣＳ・・・電流源、 Ｃ・・・コンデンサ、 ＤＶ・・・スイッチ駆動回路、 ＳＷ・・・切換スイッチ、 Ｄ／Ａ・・・デジタル／アナログ変換器、Ｃ０ＮＴ・・
・コントローラ。 本発明の一実施例回路図 第１図 各点における信号波形図 第２図
Claims (1)
- １、一方の入力端子に入力信号を供給し他方の入力端子
をコンデンサに接続したＡＮＤゲートと、該コンデンサ
と電源間に接続され該コンデンサに充電電流を供給する
電流源と、該コンデンサと並列に接続されかつ該他方の
入力端子に接続される切換スイッチと、該電流源の電流
値をアナログ信号により所定の電流値に制御するコント
ローラと、該ＡＮＤゲートの出力信号に基づいて該切換
スイッチの開閉制御を行うスイッチ駆動回路とを備え、
該電流源の電流値を該コントローラにより制御すること
によつて該コンデンサの充電立上りを制御し、該コンデ
ンサが所定の電圧値に達したときに該ＡＮＤゲートを開
くことにより任意の分周比を得るようにしたことを特徴
とする分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25758385A JPS62118638A (ja) | 1985-11-19 | 1985-11-19 | 分周回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25758385A JPS62118638A (ja) | 1985-11-19 | 1985-11-19 | 分周回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62118638A true JPS62118638A (ja) | 1987-05-30 |
Family
ID=17308280
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25758385A Pending JPS62118638A (ja) | 1985-11-19 | 1985-11-19 | 分周回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62118638A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008264861A (ja) * | 2007-04-25 | 2008-11-06 | Murata Mach Ltd | 板材搬送装置 |
-
1985
- 1985-11-19 JP JP25758385A patent/JPS62118638A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008264861A (ja) * | 2007-04-25 | 2008-11-06 | Murata Mach Ltd | 板材搬送装置 |
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