JPS62114472A - Control circuit for power unit - Google Patents

Control circuit for power unit

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Publication number
JPS62114472A
JPS62114472A JP60250938A JP25093885A JPS62114472A JP S62114472 A JPS62114472 A JP S62114472A JP 60250938 A JP60250938 A JP 60250938A JP 25093885 A JP25093885 A JP 25093885A JP S62114472 A JPS62114472 A JP S62114472A
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JP
Japan
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voltage
pulse width
output
circuit
control circuit
Prior art date
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Pending
Application number
JP60250938A
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Japanese (ja)
Inventor
Mitsuhiro Shibata
光博 芝田
Sukeo Saitou
斎藤 涼夫
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Toshiba Corp
Original Assignee
Toshiba Corp
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Publication date
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Publication of JPS62114472A publication Critical patent/JPS62114472A/en
Pending legal-status Critical Current

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Abstract

PURPOSE:To reduce the ripples of DC voltage and currents by correcting the reference voltage value of the voltage control of an AC-DC conversion section so that the PWM pulse width of an AC output by DC-DC conversion is equalized to pulse width being set. CONSTITUTION:With a power unit containing AC-DC-AC conversion, a three- phase AC power supply 1 is rectified by a rectifier 2, desired DC voltage V is obtained by a chopper circuit consisting of a transistor (hereinafter called Tr) 4, etc., the DC voltage is changed into a square-wave AC output by a single- phase inverter circuit composed of a Tr 8, and load 13 is supplied with DC currents I through a rectifier 10 and a smoothing circuit 11. PWM pulse width is detected from an output from a PWM control circuit 22 at that time, and voltage correction circuits 31-44 correcting the reference voltage VREF of voltage control are added in response to the pulse width. Accordingly, a voltage set value VSET is corrected and transmitted over a voltage control circuit 23, and the waveform of AC output voltage approaches to a duty ratio 1 and the ripple of DC output currents I is reduced.

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明はAC−DC−AC変換を含む電源装置の出力波
形を改善した電源装置の制御回路に関するものである。
DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to a control circuit for a power supply device that improves the output waveform of the power supply device including AC-DC-AC conversion.

〔発明の技術的背景とその問題点〕[Technical background of the invention and its problems]

AC−DC−AC変換を含む電源装置の一例を第5図に
示す。
An example of a power supply device including AC-DC-AC conversion is shown in FIG.

第5図において商用の三相交流電源1は整流器2で整流
され、さらにトランジスタ4、ダイオード5、リアクト
ル6およびコンデンサ7から成るチミッパ回路で所要の
直流電圧Vを出力する。
In FIG. 5, a commercial three-phase AC power supply 1 is rectified by a rectifier 2, and further a timipper circuit comprising a transistor 4, a diode 5, a reactor 6, and a capacitor 7 outputs a required DC voltage V.

上記直流電圧Vは、電圧設定器45で設定された電圧基
準VILHFを上記直流電圧Vのフィードバック信号V
FBにと比較し、その偏差を電圧制御回路23で増幅し
、さらにベースドライブ回路27を介してトランジスタ
4のベースを制御することによって電圧基準VREFに
等しくなるように制御される。
The DC voltage V is determined by using the voltage reference VILHF set by the voltage setting device 45 as a feedback signal V of the DC voltage V.
By comparing it with FB and amplifying the deviation in the voltage control circuit 23, and further controlling the base of the transistor 4 via the base drive circuit 27, it is controlled to be equal to the voltage reference VREF.

上記チゴッパの出力電圧Vはトランジスタ80゜8V、
8X、8Yから成る単相インバータ回路に入力され、そ
の方形波交流出力は整流器10、平滑回路11を介して
負荷13に直流電流Iを供給する。
The output voltage V of the above chigoppa is transistor 80°8V,
It is input to a single-phase inverter circuit consisting of 8X and 8Y, and its square wave AC output supplies DC current I to a load 13 via a rectifier 10 and a smoothing circuit 11.

直流電流Iは電流検出器12を介して電流フィードバッ
ク信号IFBK シて検出され、電流基準信号111[
!Fと比較され、その偏差が電流制御回路21、PWM
制御回路22およびベースドライブ回路24a。
The direct current I is detected by the current feedback signal IFBK via the current detector 12, and the current reference signal 111[
! F, and the deviation is determined by the current control circuit 21, PWM
Control circuit 22 and base drive circuit 24a.

24b を介シテトランジスタ8U、 8V、8X、8
Yを駆動し、これによって単相インバータをPWM制御
し、出力電流工は電流基準IReFに制御される。
24b through the transistor 8U, 8V, 8X, 8
Y is driven, thereby performing PWM control on the single-phase inverter, and the output current is controlled to the current reference IReF.

この場合上記直流出力電圧Vと出力電流工とは独立して
制御されるので、ffi圧Vに比して電流工が小さい値
に制御されるときは、単相インバータの交流出力のパル
ス幅が狭くなり、このため直流出力電流工のリップルが
大きくなるという問題がある。
In this case, the DC output voltage V and the output current are controlled independently, so when the current is controlled to a smaller value than the ffi pressure V, the pulse width of the AC output of the single-phase inverter is This causes a problem in that the ripple of the DC output current becomes large.

〔発明の目的〕[Purpose of the invention]

本発明はPWM制御される交流出力のパルス幅が適正に
なるように直流電圧制御の電圧基準信号を自動的に補正
し、これによって交流出力電圧の波形をデユーティ比1
に近すけ、直流出力のリップルを低減させる電源装置の
制御回路を提供することを目的としている。
The present invention automatically corrects the voltage reference signal for DC voltage control so that the pulse width of the PWM-controlled AC output is appropriate, and thereby changes the waveform of the AC output voltage to a duty ratio of 1.
The object of the present invention is to provide a control circuit for a power supply device that reduces ripples in DC output.

〔発明の概要〕 本発明は、交流電源から電圧制御された直流出力を得る
AC−DC変換部と上記直流出力からパルス幅制御され
た交流出力を得るDC−AC変換部を有する電源装置の
制御回路において、上記交流出力のパルス幅を基準パル
ス幅と比較して極性を含むパルス幅偏差信号を算出する
パルス幅比較演算回路と、上記パルス幅偏差信号に応じ
て上記AC−DC変換部の電制御に対する電圧基準を補
正する電圧補正回路を備え、これによって上記交流出力
のパルス幅を所望のデユーティ比に制御できるようにす
ると共に、さらにこれを整流して得られる直流出力の電
圧または電流のリップルを低減できるようにしたもので
ある。
[Summary of the Invention] The present invention provides control of a power supply device having an AC-DC converter unit that obtains a voltage-controlled DC output from an AC power source, and a DC-AC converter unit that obtains a pulse-width-controlled AC output from the DC output. The circuit includes a pulse width comparison calculation circuit that compares the pulse width of the AC output with a reference pulse width to calculate a pulse width deviation signal including polarity, and a pulse width comparison calculation circuit that calculates a pulse width deviation signal including polarity; It is equipped with a voltage correction circuit that corrects the voltage reference for control, thereby making it possible to control the pulse width of the AC output to a desired duty ratio, and further reducing ripples in the voltage or current of the DC output obtained by rectifying the pulse width. It is designed to reduce the

〔発明の実施例〕[Embodiments of the invention]

本発明の一実施例を第1図に示す。 An embodiment of the present invention is shown in FIG.

第1図は従来の第5図に対して、PWM制御回路22の
出力するベースドライブ信号noUY、 BDVXがら
PWMのパルス幅を検出し、これに応じて電圧制御の電
圧基準VRIIFを補正する電圧補正回路が追加されて
おり、他は従来の第5図と同じである。
FIG. 1 shows a voltage correction system in which the PWM pulse width is detected from the base drive signals noUY and BDVX output from the PWM control circuit 22, and the voltage reference VRIIF for voltage control is corrected accordingly. A circuit is added, and the rest is the same as the conventional one shown in FIG.

以下第1図の動作を第2図に示すタイムチャートを参照
して説明する。
The operation shown in FIG. 1 will be explained below with reference to the time chart shown in FIG.

すなわち、上記ベースドライブ信号BD、J、およびB
DvxとはORゲート31を介して同期パルス信号BD
として取出され、排他ORゲート34、立下り順序判別
回路36を構成するDフリップフロップ35a、35b
およびシングルショット回路32へ入力される。
That is, the base drive signals BD, J, and B
Dvx is synchronized pulse signal BD via OR gate 31.
D flip-flops 35a and 35b forming the exclusive OR gate 34 and the falling order determining circuit 36
and is input to the single shot circuit 32.

シングルショット回路32は上記信号[10に同期する
と共にパルス幅設定器33の設定に対応した設定パルス
幅信号P’1sETをつくり、排他ORゲート34で上
記BD倍信号の排他ORを行い、BDとPI’!1iE
Tとのパルス幅差信号EXORをつくる。
The single shot circuit 32 synchronizes with the above signal [10 and generates a set pulse width signal P'1sET corresponding to the setting of the pulse width setter 33, and exclusive OR gate 34 performs exclusive OR of the above BD multiplied signal. PI'! 1iE
Create a pulse width difference signal EXOR with T.

一方、上記BDおよびHaI!r信号はDフリップフロ
ップ35a、 35bに入力され、上記パルス幅差信号
EXORに対する極性信号POLa、 POLbを出力
する。
On the other hand, the above BD and HaI! The r signal is input to D flip-flops 35a and 35b, which output polarity signals POLa and POLb for the pulse width difference signal EXOR.

上記各信号EXORおよびPOLa、 POLbはそれ
ぞれANDゲート37a、37bに入力され、第2図に
示すようにBDのパルス幅がP”SETのパルス幅より
大きい場合のパルス幅差信号Aおよび小さい場合のパル
ス幅差信号Bを出力し、それぞれアナログスイッチ38
aおよび38bをオンさせて+Vsまたは−Vsを積分
回路44に入力し、これを順次積分してBDのパルス幅
と設定パルス幅PWSETの大小に応じた補正信号Vl
:MPNを出力し、電圧設定値vsIllTをVCMP
Nだけ補正したVRI!Fを電圧制御回路23の電圧基
準としている。 これによって同期パルス信号BDが設
定パルス幅PI’!ml!?なるまで電圧補正が繰返し
行われ、交流出力電圧の波形がデユーティ比1に近ずい
て直流出力電流工のリップルが減少する。
The above signals EXOR, POLa, and POLb are input to AND gates 37a and 37b, respectively, and as shown in FIG. Outputs the pulse width difference signal B, and connects each analog switch 38
a and 38b are turned on to input +Vs or -Vs to the integrating circuit 44, which is sequentially integrated to generate a correction signal Vl according to the magnitude of the BD pulse width and the set pulse width PWSET.
:Output MPN and set voltage setting value vsIllT to VCMP
VRI corrected by N! F is used as a voltage reference for the voltage control circuit 23. This causes the synchronization pulse signal BD to change to the set pulse width PI'! ml! ? The voltage correction is repeated until the AC output voltage waveform approaches the duty ratio of 1, and the ripple of the DC output current decreases.

本発明の他の実施例を第3図に示す。第4図はその動作
を示すタイムチャートである。
Another embodiment of the invention is shown in FIG. FIG. 4 is a time chart showing the operation.

第3図は第1図における整流器2とトランジスタ4の代
りにサイリスタ整流器を用いた場合を示しており、第1
図におけるベースドライブ回路27の代りに位相制御回
路25とゲートドライブ回路26が用いられている。な
お9は変圧器である。
FIG. 3 shows a case where a thyristor rectifier is used in place of the rectifier 2 and transistor 4 in FIG.
A phase control circuit 25 and a gate drive circuit 26 are used in place of the base drive circuit 27 in the figure. Note that 9 is a transformer.

また信号A、Bの発生は、同期パルス信号BDのオン期
間をクロックパルスCLKをカウンタ41でカウントし
たカウント値Yとして求め、パルス幅設定器43で設定
した設定パルス幅データXと比較回路42で比較し、そ
の大小または一致の関係によってDフリップフロップ3
5a、35b、35cの何れがを動作させてBD倍信号
次回の立下りまで保持し、ANDゲート37a、 37
bに入力することによって行っておリ、他は第1図と同
じである。
The signals A and B are generated by determining the on-period of the synchronizing pulse signal BD as a count value Y obtained by counting the clock pulse CLK by the counter 41, and comparing it with the set pulse width data X set by the pulse width setting device 43 and the comparison circuit 42. D flip-flop 3 according to the relationship of magnitude or coincidence
Which of 5a, 35b, and 35c is activated to hold the BD double signal until the next falling edge, and AND gate 37a, 37
This is done by inputting the information to b, and the rest is the same as in FIG.

なお、パルス幅データの比較中にカウンタ41のデータ
がクリアされないように立下り遅延回路40を設け、遅
れ時間TD後にカウンタリセット信号R5Tを出してい
る。
Note that a fall delay circuit 40 is provided so that the data in the counter 41 is not cleared during the comparison of pulse width data, and a counter reset signal R5T is issued after a delay time TD.

〔発明の効果〕〔Effect of the invention〕

以上説明したように本発明によれば、AC−DC−AC
変換を含む電源装置の制御回路において、DC−AC変
換によるAC出力のPItMパルス幅が設定したパルス
幅に等しくなるようにAC−DC変換部の電圧制御の基
準電圧値を補正しているので、AC出力電圧の波形をデ
ユーディ比が1に近い波形にすることができ、従ってこ
れを整流した直流電圧または直流電流のリップルを小さ
くすることが可能となる。
As explained above, according to the present invention, AC-DC-AC
In the control circuit of the power supply device including the conversion, the reference voltage value for voltage control of the AC-DC converter is corrected so that the PItM pulse width of the AC output by DC-AC conversion is equal to the set pulse width. The waveform of the AC output voltage can be made into a waveform with a duty ratio close to 1, and therefore the ripple of the DC voltage or DC current obtained by rectifying the AC output voltage can be reduced.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の一実施例を示、す回路図、第2図は第
1図の動作を示すタイムチャート、第3図は本発明の他
の実施例を示す回路図、第4図は第3図の動作を示すタ
イムチャート、第5図は従来の電源装置の制御回路の一
例を示す回路図である。 l・・・交流電源    2,10・・・整流器3・・
・サイリスタ整流器 4−8U、 8V、8X、8Y トランジスタ5・・・
ダイオード   6・・・リアクトル7・・・コンデン
サ   9・・・変圧器11・・・平滑回路    1
2・・・電流検出器13・・・負 荷     21・
・・電流制御回路22・・・PWM制御回路 23・・
・電圧制御回路24a、24b、27・・・ベースドラ
イブ回路25・・・位相制御回路  26・・・ゲート
ドライブ回路(8733)  代理人 弁理士 猪 股
 祥 晃(ほか1名)m m−m m−ア −−−
Fig. 1 is a circuit diagram showing one embodiment of the present invention, Fig. 2 is a time chart showing the operation of Fig. 1, Fig. 3 is a circuit diagram showing another embodiment of the invention, Fig. 4 3 is a time chart showing the operation of FIG. 3, and FIG. 5 is a circuit diagram showing an example of a control circuit of a conventional power supply device. l... AC power supply 2, 10... Rectifier 3...
・Thyristor rectifier 4-8U, 8V, 8X, 8Y transistor 5...
Diode 6...Reactor 7...Capacitor 9...Transformer 11...Smoothing circuit 1
2...Current detector 13...Load 21.
...Current control circuit 22...PWM control circuit 23...
・Voltage control circuits 24a, 24b, 27...Base drive circuit 25...Phase control circuit 26...Gate drive circuit (8733) Agent Patent attorney Yoshiaki Inomata (and 1 other person) m m-m m −A −−−

Claims (1)

【特許請求の範囲】[Claims] 交流電源から電圧制御された直流出力を得るAC−DC
変換部と上記直流出力からパルス幅制御された交流出力
を得るDC−AC変換部を有する電源装置の制御回路に
おいて、上記交流力のパルス幅を基準パルス幅と比較し
て極性を含むパルス幅偏差信号を算出するパルス幅比較
演算回路と、上記パルス幅偏差信号に応じて上記AC−
DC変換部の電圧制御に対する電圧基準を補正する電圧
補正回路を備えたことを特徴とする電源装置の制御回路
AC-DC that obtains voltage-controlled DC output from an AC power supply
In a control circuit of a power supply device having a conversion unit and a DC-AC conversion unit that obtains an AC output whose pulse width is controlled from the DC output, the pulse width of the AC power is compared with a reference pulse width to determine a pulse width deviation including polarity. A pulse width comparison calculation circuit that calculates the signal, and a pulse width comparison calculation circuit that calculates the signal, and the AC-
A control circuit for a power supply device, comprising a voltage correction circuit that corrects a voltage reference for voltage control of a DC converter.
JP60250938A 1985-11-11 1985-11-11 Control circuit for power unit Pending JPS62114472A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007209109A (en) * 2006-02-01 2007-08-16 Fuji Electric Fa Components & Systems Co Ltd Control method of ac direct converter

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007209109A (en) * 2006-02-01 2007-08-16 Fuji Electric Fa Components & Systems Co Ltd Control method of ac direct converter

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