JPS62100626A - 赤外線式室内監視検知器用回路装置 - Google Patents
赤外線式室内監視検知器用回路装置Info
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- JPS62100626A JPS62100626A JP61247666A JP24766686A JPS62100626A JP S62100626 A JPS62100626 A JP S62100626A JP 61247666 A JP61247666 A JP 61247666A JP 24766686 A JP24766686 A JP 24766686A JP S62100626 A JPS62100626 A JP S62100626A
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Classifications
-
- G—PHYSICS
- G08—SIGNALLING
- G08B—SIGNALLING OR CALLING SYSTEMS; ORDER TELEGRAPHS; ALARM SYSTEMS
- G08B13/00—Burglar, theft or intruder alarms
- G08B13/18—Actuation by interference with heat, light, or radiation of shorter wavelength; Actuation by intruding sources of heat, light, or radiation of shorter wavelength
- G08B13/189—Actuation by interference with heat, light, or radiation of shorter wavelength; Actuation by intruding sources of heat, light, or radiation of shorter wavelength using passive radiation detection systems
- G08B13/19—Actuation by interference with heat, light, or radiation of shorter wavelength; Actuation by intruding sources of heat, light, or radiation of shorter wavelength using passive radiation detection systems using infrared-radiation detection systems
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はセンサおよびこのセンサに後置接続された電界
効果形トラン７７スタを有する赤外線式室内監視検知器
用回路装置に関す７．）。
効果形トラン７７スタを有する赤外線式室内監視検知器
用回路装置に関す７．）。
従来公知技術
第１ａ図はこの形式の公知の回路を示−Ｉｏこの回路に
おいては・ξイロ素子Ｐの端子の一方が接地されるか、
ないしはマイナス作動電圧端子に接続されており、他方
の端子は電界効果形トランジスタ（以下ではＦＥＴと略
称する）のゲート電極に接続されている。このＦＥＴの
ドレイン電極はプラス作動電圧端子ＬＩＢに接続されて
いる。このＦＥＴのソース電極は抵抗ＲＡを介して接地
されるか、ないしはマイナス作動電圧端子−ｕＢに接続
されている。この抵抗ＲＡを介して信号電圧ＵＡは取り
出されろ。そのため図示された回路はエミッタフォロワ
回路と類似に構成されている。
おいては・ξイロ素子Ｐの端子の一方が接地されるか、
ないしはマイナス作動電圧端子に接続されており、他方
の端子は電界効果形トランジスタ（以下ではＦＥＴと略
称する）のゲート電極に接続されている。このＦＥＴの
ドレイン電極はプラス作動電圧端子ＬＩＢに接続されて
いる。このＦＥＴのソース電極は抵抗ＲＡを介して接地
されるか、ないしはマイナス作動電圧端子−ｕＢに接続
されている。この抵抗ＲＡを介して信号電圧ＵＡは取り
出されろ。そのため図示された回路はエミッタフォロワ
回路と類似に構成されている。
信号電圧ＵＡはこの回路装置では、作動電圧に重畳され
ている障害電圧の影響を非常に受けやすし・。何故なら
ばこのような障害電圧はＦＥＴのｒレイン・ゲート反作
用のため、ゲート電圧にも作用し、したがってμ■の範
囲にある信号電圧ＵＡＩＬも作用するからである。ＦＥ
Ｔのドレイン電極に印加される作動電圧＋ＵＢはこのμ
■範囲にノイズ成分または障害成分を有し、したがって
センサ信号は信号送出について十分な信頼性で評価する
ことができないからである。
ている障害電圧の影響を非常に受けやすし・。何故なら
ばこのような障害電圧はＦＥＴのｒレイン・ゲート反作
用のため、ゲート電圧にも作用し、したがってμ■の範
囲にある信号電圧ＵＡＩＬも作用するからである。ＦＥ
Ｔのドレイン電極に印加される作動電圧＋ＵＢはこのμ
■範囲にノイズ成分または障害成分を有し、したがって
センサ信号は信号送出について十分な信頼性で評価する
ことができないからである。
それゆえ、作動電圧ＵＢを非常に良好にろ波することが
必要である。すなわち１００ ｄＢから１２０ｄＢまで
の高いろ波率を有する電源部が必要である。高いろ波率
な得るため２つの電源部を直列に接続する構成がしばし
ば用いられる。
必要である。すなわち１００ ｄＢから１２０ｄＢまで
の高いろ波率を有する電源部が必要である。高いろ波率
な得るため２つの電源部を直列に接続する構成がしばし
ば用いられる。
それゆえ作動電圧ＵＢをろ波するための回路費用は高く
なる。
なる。
さらに公知であるのは、有効−ないしは信号電圧ｔＪＡ
をＦＥＴのドレイン電極から取り出すことであり、それ
は第１ｂ図に示す略示的な回路装置に示されている。こ
の場合には作動電圧＋ＵＢはＦＥＴのドレイン電極に抵
抗ＲＬを介して供給される。ソース電極回路にはこの場
合、抵抗ＲＡおよびコンデンサＣの並列回路が挿入され
ている。
をＦＥＴのドレイン電極から取り出すことであり、それ
は第１ｂ図に示す略示的な回路装置に示されている。こ
の場合には作動電圧＋ＵＢはＦＥＴのドレイン電極に抵
抗ＲＬを介して供給される。ソース電極回路にはこの場
合、抵抗ＲＡおよびコンデンサＣの並列回路が挿入され
ている。
第１ａ図に示した回路装置に関連して起こる前記の欠点
に加えて、第１ｂ図に示すこの回路の場合にはさらに、
供給電圧ＵＢに重畳されるノイズ−および障害成分が有
効信号ないしは信号電圧ＵＡにも重畳され、この有効信
号ないしは信号電圧は抵抗ＲＬに現われここで取り出さ
れるということが起こる。ＦＥＴのｒレイン・ゲート遷
移領域の反作用コンダクタンスによって信号電圧ｕＡの
Ｓ／Ｎ比はさらに低化する。
に加えて、第１ｂ図に示すこの回路の場合にはさらに、
供給電圧ＵＢに重畳されるノイズ−および障害成分が有
効信号ないしは信号電圧ＵＡにも重畳され、この有効信
号ないしは信号電圧は抵抗ＲＬに現われここで取り出さ
れるということが起こる。ＦＥＴのｒレイン・ゲート遷
移領域の反作用コンダクタンスによって信号電圧ｕＡの
Ｓ／Ｎ比はさらに低化する。
発明の目的
それゆえ本発明の基礎をなす課題は、電源部で高いろ波
費用を必要とせず、センサ信号を高い値に増幅すること
が簡単に可能になる、冒頭に記載した形式の回路装置を
提供することである。
費用を必要とせず、センサ信号を高い値に増幅すること
が簡単に可能になる、冒頭に記載した形式の回路装置を
提供することである。
発明の構成
この課題は、本発明により、ＦＥＴのドレイン電極が演
算増幅器のマイナス入力側に接続されており、この演算
増幅器の出力信号が帰還抵抗を介して演算増幅器のマイ
ナス入力端に帰還されていることによって解決される。
算増幅器のマイナス入力側に接続されており、この演算
増幅器の出力信号が帰還抵抗を介して演算増幅器のマイ
ナス入力端に帰還されていることによって解決される。
演算増幅器の本発明による接続法ならびにＦＥＴと関連
づけた演算増幅器の前記の回路接続は、８０から１０Ｑ
ｄＢまでの減衰を生じる演算増幅器−安定化を十分て利
用することを可能にする。そのさいＦＥＴのドレイン電
圧は、ろ波用の付加的な回路費用なしに自動的に安定に
保持され、それゆえ実際にもまたＦＥＴのゲート電極へ
の反作用が生じない。それゆえ演算増幅器回路は自動的
に電流電圧のすべての変動を抑圧制御し、ＦＥＴのドレ
イン電圧は一定に保持され、その結果障害を受けない有
効信号ないしは障害を受けない信号電圧が得られる。言
い換えれば、本発明による回路装置では演算増幅器は電
圧増幅器としてではなく、電流増幅器として接続されて
おり、それによって演算増幅器のマイナス入力側におけ
る変動がしたがってＦＥＴのドレイン電極における変動
が抑圧され、その結果ＦＥＴのゲート電極に対する障害
反作用が生じなくなる。
づけた演算増幅器の前記の回路接続は、８０から１０Ｑ
ｄＢまでの減衰を生じる演算増幅器−安定化を十分て利
用することを可能にする。そのさいＦＥＴのドレイン電
圧は、ろ波用の付加的な回路費用なしに自動的に安定に
保持され、それゆえ実際にもまたＦＥＴのゲート電極へ
の反作用が生じない。それゆえ演算増幅器回路は自動的
に電流電圧のすべての変動を抑圧制御し、ＦＥＴのドレ
イン電圧は一定に保持され、その結果障害を受けない有
効信号ないしは障害を受けない信号電圧が得られる。言
い換えれば、本発明による回路装置では演算増幅器は電
圧増幅器としてではなく、電流増幅器として接続されて
おり、それによって演算増幅器のマイナス入力側におけ
る変動がしたがってＦＥＴのドレイン電極における変動
が抑圧され、その結果ＦＥＴのゲート電極に対する障害
反作用が生じなくなる。
とくに有利なのは、高い入力抵抗を有する演算増幅器を
選定することである。この目的のために例えばＣ−ＭＯ
３演算増幅器が挙げられる。
選定することである。この目的のために例えばＣ−ＭＯ
３演算増幅器が挙げられる。
しかしあまり高オームではない演算増幅器を使用するこ
とも、例えば作動電圧がたとえば前置接続された電源部
で付加的にさらに２０から３Ｑ ｄＢまでのろ波係数で
ろ波されるばおいて可能である。
とも、例えば作動電圧がたとえば前置接続された電源部
で付加的にさらに２０から３Ｑ ｄＢまでのろ波係数で
ろ波されるばおいて可能である。
本発明のとくに有利な実施例では、ＦＥＴのソース電極
に一定電流が定電流源によって供給される。ＦＥＴのソ
ース電極領域にＲＣの組合せを設けた従来の方法に代え
て、定電流源の使用によって出力信号の直流電流値をさ
らに一定に保持することができる。
に一定電流が定電流源によって供給される。ＦＥＴのソ
ース電極領域にＲＣの組合せを設けた従来の方法に代え
て、定電流源の使用によって出力信号の直流電流値をさ
らに一定に保持することができる。
本発明のもう１つの非常に有利な構成は、定電流源に演
算増幅器の出力信号を制御信号として供給する点にある
。つまり、演算増幅器の出力信号は定電流源を介して帰
還されるので、出力電圧ないしは出力電圧のスタティッ
ク電流値は安定に保持される。
算増幅器の出力信号を制御信号として供給する点にある
。つまり、演算増幅器の出力信号は定電流源を介して帰
還されるので、出力電圧ないしは出力電圧のスタティッ
ク電流値は安定に保持される。
・定
本発明のさらに別の実施例では、電電流源を帰還接続さ
れる４端子回路として構成する。そのさいとくに有利な
のは、この帰還接続される４一端子回路と関連づけて積
分素子を有効信号の減衰用定設けろことであく）１．そ
れによって回路全体を無負荷時増幅度で作動することが
ＬＩ］能となる。
れる４端子回路として構成する。そのさいとくに有利な
のは、この帰還接続される４一端子回路と関連づけて積
分素子を有効信号の減衰用定設けろことであく）１．そ
れによって回路全体を無負荷時増幅度で作動することが
ＬＩ］能となる。
さらに有利な実施例では、帰還接続された４端子回路が
減衰素子を有し、その減衰係数が検知器回路装置の全増
幅度に比例するようにして制御されろ。このようにして
有効信号の一定の増幅度が、製造−７部品−１温度−１
その他の偏差を除去のもとに、保証される。この増幅度
の制御される実施例によって、回路部［在はとくに原価
の面で有利に製造することができる。許容偏差の太きい
きわめて簡単な部品を使用することができ、しかも調整
が必要とされなし・からである。
減衰素子を有し、その減衰係数が検知器回路装置の全増
幅度に比例するようにして制御されろ。このようにして
有効信号の一定の増幅度が、製造−７部品−１温度−１
その他の偏差を除去のもとに、保証される。この増幅度
の制御される実施例によって、回路部［在はとくに原価
の面で有利に製造することができる。許容偏差の太きい
きわめて簡単な部品を使用することができ、しかも調整
が必要とされなし・からである。
実施例
本発明は以下に図面に基づいて実施例で詳細に説明する
。
。
第２図から第４図において、対応する回路部分および構
成部品定はそれぞれ同じ参照符号が付されている。
成部品定はそれぞれ同じ参照符号が付されている。
第２図が示すように、電界効果形トランジスタＦＥＴ２
のゲート電極は・？イロ素子１の端子に接続されて見・
る。このパイロ素子の他方の端子は接地されているかな
いしはマイナスの作動電圧源に接続されている。ＦＥＴ
２のソース電極は、抵抗Ｒ１およびこの抵抗Ｒ１に並列
接続したコンデンサＣ１を介して、同様に接地ないしは
マイナス作動電圧端子に接続されている。ＦＥＴ２のド
レイン電極は演算増幅器５のマイナス入力側と接続され
ている。演算増幅器のプラス入力側はコンデンサＣ２を
介してアースないしマイナス作動電圧源と接続されてい
る。演算増幅器３のプラス入力側に基準電圧ＵＲｅｆが
抵抗Ｒ５を介して供給される。演算増幅器３の出力信号
ＳＡは演算増幅器δのマイナス入力に抵抗Ｒ２を介して
帰還される。抵抗Ｒ２は例えばメガオーム範囲にあり、
たとえばＩＭＯｈｍ の抵抗値を有する。演算増幅器３
の作動電圧端子はプラスの作動電圧端子−１−ＵＢにな
いしはマイナス作動電圧端子−ＵＢまたはアースに接続
されている。
のゲート電極は・？イロ素子１の端子に接続されて見・
る。このパイロ素子の他方の端子は接地されているかな
いしはマイナスの作動電圧源に接続されている。ＦＥＴ
２のソース電極は、抵抗Ｒ１およびこの抵抗Ｒ１に並列
接続したコンデンサＣ１を介して、同様に接地ないしは
マイナス作動電圧端子に接続されている。ＦＥＴ２のド
レイン電極は演算増幅器５のマイナス入力側と接続され
ている。演算増幅器のプラス入力側はコンデンサＣ２を
介してアースないしマイナス作動電圧源と接続されてい
る。演算増幅器３のプラス入力側に基準電圧ＵＲｅｆが
抵抗Ｒ５を介して供給される。演算増幅器３の出力信号
ＳＡは演算増幅器δのマイナス入力に抵抗Ｒ２を介して
帰還される。抵抗Ｒ２は例えばメガオーム範囲にあり、
たとえばＩＭＯｈｍ の抵抗値を有する。演算増幅器３
の作動電圧端子はプラスの作動電圧端子−１−ＵＢにな
いしはマイナス作動電圧端子−ＵＢまたはアースに接続
されている。
ＦＥＴ２のドレイン電極に現われるパイロ素子１の出力
信号は演算増幅器３で増幅される。
信号は演算増幅器３で増幅される。
増幅された信号は、抵抗Ｒ２を了１する帰還回路を介し
て演算増幅器３のマイナス入力に帰還する。この演算増
幅器そのものは供給電工に対して約８０ないし１ｏｏｄ
Ｂの良好な７）数件用を有するので、演算増幅器のこの
特ヒＬは、ＦＥＴ２のドレイン電圧を安定に保持するた
めに、（１効信号に対する本来の増幅時性：テイツ加的
にｆｌｌ 、’１］される。それによってダート電電（
・メ１こ対する１ドレイン電極の不利な反作用が起こら
ず、その結果有効信号はその点に関しては不１１１な影
響を受けろことがない。つまり演算増幅器１ｍ路は叶−
べての変動を抑圧制御するので、Ｐ Ｌ／ イン電１−
Ｅは完全に一定に保持されろ。ｆ−］゛効効信そ、１）
さいもは−や電圧増幅されるのではなく、電流増幅され
る。それ：てよって有効信号は、作動電圧中：・、：上
する変動または障害成分が抑圧されζ）。
て演算増幅器３のマイナス入力に帰還する。この演算増
幅器そのものは供給電工に対して約８０ないし１ｏｏｄ
Ｂの良好な７）数件用を有するので、演算増幅器のこの
特ヒＬは、ＦＥＴ２のドレイン電圧を安定に保持するた
めに、（１効信号に対する本来の増幅時性：テイツ加的
にｆｌｌ 、’１］される。それによってダート電電（
・メ１こ対する１ドレイン電極の不利な反作用が起こら
ず、その結果有効信号はその点に関しては不１１１な影
響を受けろことがない。つまり演算増幅器１ｍ路は叶−
べての変動を抑圧制御するので、Ｐ Ｌ／ イン電１−
Ｅは完全に一定に保持されろ。ｆ−］゛効効信そ、１）
さいもは−や電圧増幅されるのではなく、電流増幅され
る。それ：てよって有効信号は、作動電圧中：・、：上
する変動または障害成分が抑圧されζ）。
第３図に示す実施例（第２図の回路装置と次の点だけが
異なる。すなわち抵抗Ｒ１およびＣＩからなりＦＥＴ２
のソース電極回路に接続された並列回路が、今度は定電
流源４に置き代えられている点だけである。このように
して有効信号ｓＡの直流電流値はさらに一層良好に一定
に保持することができる。
異なる。すなわち抵抗Ｒ１およびＣＩからなりＦＥＴ２
のソース電極回路に接続された並列回路が、今度は定電
流源４に置き代えられている点だけである。このように
して有効信号ｓＡの直流電流値はさらに一層良好に一定
に保持することができる。
第４図に示す実施例ではＦＥＴ２のソース電極回路に、
前述の接地した定電流源牛ないしは抵抗Ｒ１とコンデン
サＣ１からなる並列回路に代えて、定電流源ないしは帰
還接続用４端子回路５が設けられている。この４端子回
路に演算増幅器３の出力信号ＳＡが制御信号として供給
される。すなわち、定電流源は演算増幅器３の出力直流
電圧によって、出力信号の直流電圧値ないしはスタティ
ック電圧の値が安定を保つように帰還接続される。帰還
接続用４端子回路５ばたとえば演算増幅器、トランジス
タ回路またはカレントミラー回路として構成することが
できる。付加的に、帰還接続された定電流源ないしは帰
還接続用４端子回路５の出力信号は、ＦＥＴ２のソース
電極に供給する前に、増幅することができる。さらに、
この回路部分５に、回路全体を無負荷時増幅度で作動さ
せるために積分素子を信号の減衰のために設けることが
できる。そのため増幅度制御が行なわれる。積分素子は
たとえばコンデンサを介しての帰還接続を有する演算増
幅器として構成することができる。
前述の接地した定電流源牛ないしは抵抗Ｒ１とコンデン
サＣ１からなる並列回路に代えて、定電流源ないしは帰
還接続用４端子回路５が設けられている。この４端子回
路に演算増幅器３の出力信号ＳＡが制御信号として供給
される。すなわち、定電流源は演算増幅器３の出力直流
電圧によって、出力信号の直流電圧値ないしはスタティ
ック電圧の値が安定を保つように帰還接続される。帰還
接続用４端子回路５ばたとえば演算増幅器、トランジス
タ回路またはカレントミラー回路として構成することが
できる。付加的に、帰還接続された定電流源ないしは帰
還接続用４端子回路５の出力信号は、ＦＥＴ２のソース
電極に供給する前に、増幅することができる。さらに、
この回路部分５に、回路全体を無負荷時増幅度で作動さ
せるために積分素子を信号の減衰のために設けることが
できる。そのため増幅度制御が行なわれる。積分素子は
たとえばコンデンサを介しての帰還接続を有する演算増
幅器として構成することができる。
さらに、帰還接続用仝端子回路を減衰素子として構成し
、その減衰率を回路装置の全増幅度とちょうど同じ大き
さにすることが可能である。
、その減衰率を回路装置の全増幅度とちょうど同じ大き
さにすることが可能である。
本発明は図示の実施例に基づいて説明した。
その上さらに当業者には、本発明の思想が逸脱されるこ
となく、図示の実施例の多数の変型および改良が可能で
ある。
となく、図示の実施例の多数の変型および改良が可能で
ある。
発明の効果
本発明により、電源部に高価な濾波装置の必要とされな
い、センサ信号を高い値に増幅することのできる赤外線
式室内監視検知器用の回路装置が提供される。
い、センサ信号を高い値に増幅することのできる赤外線
式室内監視検知器用の回路装置が提供される。
第１ａ図および第１ｂ図は従来形式の回路装置の路線図
、第２図は本発明による回路装置の路線図、第３図は第
２図に示す回路装置の有利な変形実施例の路線図、第４
図は本発明のもう１つの実施例の路線図である。 １・・・・９イロ素子、２・・・ＦＥＴ、３・・・演算
増幅器、生０８．定電流源、５．１．帰還接続される４
端子回路、ＳＡ・・・出力信号、■ ・・・基準電圧
ｅｆ 一一〆′ 第１゜図 第１ｂ図
、第２図は本発明による回路装置の路線図、第３図は第
２図に示す回路装置の有利な変形実施例の路線図、第４
図は本発明のもう１つの実施例の路線図である。 １・・・・９イロ素子、２・・・ＦＥＴ、３・・・演算
増幅器、生０８．定電流源、５．１．帰還接続される４
端子回路、ＳＡ・・・出力信号、■ ・・・基準電圧
ｅｆ 一一〆′ 第１゜図 第１ｂ図
Claims (1)
- 【特許請求の範囲】 １、センサおよび該センサに後置接続されている電界効
果形トランジスタを有する赤外線式室内監視検知器用回
路装置において、電界効果形トランジスタ（２）のドレ
イン電極（Ｄ）が演算増幅器（３）のマイナス入力側に
接続されており、該演算増幅器の出力信号（Ｓ＿Ａ）が
帰還抵抗（Ｒ＿２）を介して演算増幅器（３）のマイナ
ス入力側に帰還されることを特徴とする赤外線式室内監
視検知器用回路装置。 ２、高い入力インピーダンスを有する演算増幅器が設け
られている、特許請求の範囲第１項記載の回路装置。 ３、電界効果形トランジスタ（２）のソース電極（Ｓ）
に定電流が定電流源（４）によつて供給される、特許請
求の範囲第１項または第２項に記載の回路装置。 ４、演算増幅器（３）の出力信号（Ｓ＿Ａ）が定電流源
（５）に制御信号として供給される、特許請求の範囲第
３項記載の回路装置。 ５、定電流源（５）が帰還接続される４端子回路である
、特許請求の範囲第３項または第４項記載の回路装置。 ６、帰還接続される４端子回路が有効信号を減衰するた
めの積分素子を有する、特許請求の範囲第５項記載の回
路装置。 ７、帰還接続される４端子回路が減衰素子を有し、該減
衰素子の減衰係数が検出回路装置の全増幅度に比例する
ように制御される、特許請求の範囲第５項記載の回路装
置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE3537316A DE3537316C1 (de) | 1985-10-19 | 1985-10-19 | Schaltungsanordnung fuer einen Infrarot-Raumueberwachungsdetektor |
| DE3537316.4 | 1985-10-19 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62100626A true JPS62100626A (ja) | 1987-05-11 |
| JPH054623B2 JPH054623B2 (ja) | 1993-01-20 |
Family
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