JPS6198296U - - Google Patents
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- Publication number
- JPS6198296U JPS6198296U JP18449384U JP18449384U JPS6198296U JP S6198296 U JPS6198296 U JP S6198296U JP 18449384 U JP18449384 U JP 18449384U JP 18449384 U JP18449384 U JP 18449384U JP S6198296 U JPS6198296 U JP S6198296U
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- JP
- Japan
- Prior art keywords
- register
- data
- cell array
- memory cell
- units
- Prior art date
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- Pending
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- 239000004065 semiconductor Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Static Random-Access Memory (AREA)
Description
第１図は本考案の一実施例を示すブロツク図、
第２図は第１図の実施例のタイミング図である。 １……アドレス入力信号、２……読み出し書き
込み制御信号、３……入出力データ信号、４，５
……転送制御信号、６……レジスタ入出力信号、
７，８……レジスタ入出力制御信号、９……メモ
リセルアレイ、１０，１１……各々２分割された
センスアンプ、１２，１３……各々２分割された
レジスタ、１４……レジスタ用デコーダ、１５…
……カウンタ、１６……Ｙデコーダ、１７……Ｘ
デコーダ。
第２図は第１図の実施例のタイミング図である。 １……アドレス入力信号、２……読み出し書き
込み制御信号、３……入出力データ信号、４，５
……転送制御信号、６……レジスタ入出力信号、
７，８……レジスタ入出力制御信号、９……メモ
リセルアレイ、１０，１１……各々２分割された
センスアンプ、１２，１３……各々２分割された
レジスタ、１４……レジスタ用デコーダ、１５…
……カウンタ、１６……Ｙデコーダ、１７……Ｘ
デコーダ。
Claims (1)
- メモリセルアレイと、このメモリセルアレイの
データを転送するためのレジスタと、このレジス
タの外部とのデータ入出力回路とを有し、前記メ
モリセルアレイと前記レジスタ間のデータ転送が
前記レジスタを複数個に分割した単位で行われる
ことを特徴とする半導体記憶装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18449384U JPS6198296U (ja) | 1984-12-05 | 1984-12-05 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18449384U JPS6198296U (ja) | 1984-12-05 | 1984-12-05 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6198296U true JPS6198296U (ja) | 1986-06-24 |
Family
ID=30741981
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18449384U Pending JPS6198296U (ja) | 1984-12-05 | 1984-12-05 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6198296U (ja) |
-
1984
- 1984-12-05 JP JP18449384U patent/JPS6198296U/ja active Pending
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