JPS6197871A - 電界効果トランジスタ - Google Patents
電界効果トランジスタInfo
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- JPS6197871A JPS6197871A JP22002784A JP22002784A JPS6197871A JP S6197871 A JPS6197871 A JP S6197871A JP 22002784 A JP22002784 A JP 22002784A JP 22002784 A JP22002784 A JP 22002784A JP S6197871 A JPS6197871 A JP S6197871A
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- transistor
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- 239000002184 metal Substances 0.000 claims description 6
- 230000005684 electric field Effects 0.000 claims 1
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- 239000000758 substrate Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
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- 238000005530 etching Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/80—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier
- H01L29/812—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier with a Schottky gate
- H01L29/8124—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier with a Schottky gate with multiple gate
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- Engineering & Computer Science (AREA)
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- Junction Field-Effect Transistors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
I業上の利用分野
本発明は、マイクロ波通信機器に用いられる電界効果ト
ランジスタに関するものである。
ランジスタに関するものである。
従来例の構成とその問題点
近年、SHF帯の通信機器用として、 G4AS を用
いた電界効果トランジスタの開発が進められている。こ
の電界効果トランジスタは、その用途から、低雑音増幅
用の品種と、発振用の品種とに態別に設計され製造され
ている。つまり、低雑音増幅用では、最小雑音指数が得
られる小ドレイン電流でも、十分な利得が得られるよう
、チャネルとなる活性層の厚さを薄く設計する。この結
果、ゲート、ソース間短絡時のドレイン電流(以下より
SSと呼ぶ)は3Q○μmゲート幅で、20〜50mA
程度となる。これに対し発振用では、高出力を得るため
に、ドレインバイアス電流を大きく流せるよう、活性層
の厚さを厚く設計する。従って、発振用のトランクそ夕
の工98.は80〜150mA程度になっている。この
ように、従来のマイクロ波用トランジスタは、その用途
に合わせ、活性層の厚さを変えて、製造する必要があり
、1品種では、それぞれの用途に十分対応することは出
来なかった。
いた電界効果トランジスタの開発が進められている。こ
の電界効果トランジスタは、その用途から、低雑音増幅
用の品種と、発振用の品種とに態別に設計され製造され
ている。つまり、低雑音増幅用では、最小雑音指数が得
られる小ドレイン電流でも、十分な利得が得られるよう
、チャネルとなる活性層の厚さを薄く設計する。この結
果、ゲート、ソース間短絡時のドレイン電流(以下より
SSと呼ぶ)は3Q○μmゲート幅で、20〜50mA
程度となる。これに対し発振用では、高出力を得るため
に、ドレインバイアス電流を大きく流せるよう、活性層
の厚さを厚く設計する。従って、発振用のトランクそ夕
の工98.は80〜150mA程度になっている。この
ように、従来のマイクロ波用トランジスタは、その用途
に合わせ、活性層の厚さを変えて、製造する必要があり
、1品種では、それぞれの用途に十分対応することは出
来なかった。
発明の目的
本発明は、上記欠点に鑑み、同じトランジスタで、低雑
音増幅用にも、発振用にも使える電界効果トランジスタ
を提供するものである。
音増幅用にも、発振用にも使える電界効果トランジスタ
を提供するものである。
発明の構成
この目的を達成するために、本発明の電界効果トランジ
スタは、活性層と基板の間に金属層を介在させ、この金
属層を第2ゲート電極とした構造によシ構成されている
。この構成により、第2ゲート電極への印加電圧を変え
て、よりS3を大きくしたシ、小さくしたり出来、同じ
トランジスタが発振用にも、低雑音増幅用にも使えると
いう、非常に用途の広い汎用的なマイクロ波用トランジ
スタが実現される。
スタは、活性層と基板の間に金属層を介在させ、この金
属層を第2ゲート電極とした構造によシ構成されている
。この構成により、第2ゲート電極への印加電圧を変え
て、よりS3を大きくしたシ、小さくしたり出来、同じ
トランジスタが発振用にも、低雑音増幅用にも使えると
いう、非常に用途の広い汎用的なマイクロ波用トランジ
スタが実現される。
実施例の説明
以下本発明の一実施例について図面を参照しながら説明
する。第1図は、本発明の実施例における電界効果トラ
ンジスタの断面概略を示す。半絶縁性G&ムS基板1の
上に、分子線エピタキシャル法で、単結晶のム1層2を
成長させる。厚さは500人である。ひきつづき、n−
GaムS活性層を分子線エピタキシャル法で成長させ、
エツチングにより、メサ状の活性層3を形成する。活性
層3のドーピングはSlを用い、3×1o cln と
し、厚さは、1600人である、活性層表面に第1のゲ
ート電極4.ソース電極5.ドレイン電極6を設け、そ
れぞれ第1ゲート端子V、4.ソース端子vs 、ドレ
イン端子VDに接続する。さらにム1層2を、第2ゲー
ト端子vG2に接続する。
する。第1図は、本発明の実施例における電界効果トラ
ンジスタの断面概略を示す。半絶縁性G&ムS基板1の
上に、分子線エピタキシャル法で、単結晶のム1層2を
成長させる。厚さは500人である。ひきつづき、n−
GaムS活性層を分子線エピタキシャル法で成長させ、
エツチングにより、メサ状の活性層3を形成する。活性
層3のドーピングはSlを用い、3×1o cln と
し、厚さは、1600人である、活性層表面に第1のゲ
ート電極4.ソース電極5.ドレイン電極6を設け、そ
れぞれ第1ゲート端子V、4.ソース端子vs 、ドレ
イン端子VDに接続する。さらにム1層2を、第2ゲー
ト端子vG2に接続する。
以上の様に構成された電界効果トランジスタについて、
以下その動作について説明する。
以下その動作について説明する。
本発明の電界効果トランジスタは、2個のゲート電極2
,4を持つため、空乏層7,8が活性層3の中に生じ、
2個のゲート端子v、1.vG2 の電圧を変えるこ
とにより、空乏層7,8の大きさを変え、ドレイン電流
を制御出来る。例えば、第2図に示すように、ソース接
地で、第2ゲート端子v、2も接地すると、空乏層7の
広がりは小さく、従って工、8.は1oO〜15Qm人
となり、発振用のトランジスタとして使用可能になる。
,4を持つため、空乏層7,8が活性層3の中に生じ、
2個のゲート端子v、1.vG2 の電圧を変えるこ
とにより、空乏層7,8の大きさを変え、ドレイン電流
を制御出来る。例えば、第2図に示すように、ソース接
地で、第2ゲート端子v、2も接地すると、空乏層7の
広がりは小さく、従って工、8.は1oO〜15Qm人
となり、発振用のトランジスタとして使用可能になる。
また第3図に示すように、ソース接地で、第2ゲート端
子vG2に負電圧、例えば−1vを印加すると、空乏層
7が大きく広がり、工。、Bは3o〜son人となり、
低雑音増幅用として、適当なトランジスタとなる。
子vG2に負電圧、例えば−1vを印加すると、空乏層
7が大きく広がり、工。、Bは3o〜son人となり、
低雑音増幅用として、適当なトランジスタとなる。
以上のように本実施例によれば、活性層の上。
下両面に、金属層からなるゲート電極を設け、第1のゲ
ート端子v、1には信号を加え、第2のゲート端子vG
2には、零または負のバイアス電圧を印加することによ
り、工。、Sを自在に変えることが出来、同じトランジ
スタを発振用にも、低雑音増幅用にも使用することが出
来る。
ート端子v、1には信号を加え、第2のゲート端子vG
2には、零または負のバイアス電圧を印加することによ
り、工。、Sを自在に変えることが出来、同じトランジ
スタを発振用にも、低雑音増幅用にも使用することが出
来る。
発明の効果
以上の様に本発明は、活性層の上下両面に金属層からな
るゲート電極を設け、第1のゲート端子には信号を加え
、第2のゲート端子には零または負のバイアス電圧を印
加することにより、工0,8を自在に変え、同じトラン
ジスタで、マイクロ波発振用にも、低雑音増幅用にも使
用可能な電界効果トランジスタを実現するものであり、
その実用的効果は大なるものがある。
るゲート電極を設け、第1のゲート端子には信号を加え
、第2のゲート端子には零または負のバイアス電圧を印
加することにより、工0,8を自在に変え、同じトラン
ジスタで、マイクロ波発振用にも、低雑音増幅用にも使
用可能な電界効果トランジスタを実現するものであり、
その実用的効果は大なるものがある。
第1図は本発明実施例の電界効果トランジスタの断面概
略図、第2図は第2ゲート端子を接地した時の動作説明
図、第3図は第2ゲート端子を負にバイアスした時の動
作説明図である。 1・・・・・・基板、2・・・・・・金属層、3・・・
・・・活性層、4・・・・・・ゲート電極、5・・・・
・・ソース電極、6・・・・・・ドレイン電極、7,8
・・・・・・空乏層。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 V&。 第2図 第3図
略図、第2図は第2ゲート端子を接地した時の動作説明
図、第3図は第2ゲート端子を負にバイアスした時の動
作説明図である。 1・・・・・・基板、2・・・・・・金属層、3・・・
・・・活性層、4・・・・・・ゲート電極、5・・・・
・・ソース電極、6・・・・・・ドレイン電極、7,8
・・・・・・空乏層。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 V&。 第2図 第3図
Claims (1)
- 活性層の上下両面に金属層からなるゲート電極を設け
、一方の前記ゲート電極には信号電圧を加え、他方の前
記ゲート電極には、零または負のバイアス電圧を印加す
ることを特徴とする電界効果トランジスタ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22002784A JPS6197871A (ja) | 1984-10-18 | 1984-10-18 | 電界効果トランジスタ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22002784A JPS6197871A (ja) | 1984-10-18 | 1984-10-18 | 電界効果トランジスタ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6197871A true JPS6197871A (ja) | 1986-05-16 |
Family
ID=16744785
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22002784A Pending JPS6197871A (ja) | 1984-10-18 | 1984-10-18 | 電界効果トランジスタ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6197871A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4775878A (en) * | 1986-09-30 | 1988-10-04 | Kabushiki Kaisha Toshiba | Semiconductor device formed in semi-insulative substrate |
US6221699B1 (en) | 1996-12-10 | 2001-04-24 | Yean-Kuen Fang | Method of fabricating an infrared optical bulk channel field effect transistor |
-
1984
- 1984-10-18 JP JP22002784A patent/JPS6197871A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4775878A (en) * | 1986-09-30 | 1988-10-04 | Kabushiki Kaisha Toshiba | Semiconductor device formed in semi-insulative substrate |
US6221699B1 (en) | 1996-12-10 | 2001-04-24 | Yean-Kuen Fang | Method of fabricating an infrared optical bulk channel field effect transistor |
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