JPS616716A - 可変出力安定化電源回路 - Google Patents
可変出力安定化電源回路Info
- Publication number
- JPS616716A JPS616716A JP12698184A JP12698184A JPS616716A JP S616716 A JPS616716 A JP S616716A JP 12698184 A JP12698184 A JP 12698184A JP 12698184 A JP12698184 A JP 12698184A JP S616716 A JPS616716 A JP S616716A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- power supply
- supply circuit
- fet
- stabilized power
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05F—SYSTEMS FOR REGULATING ELECTRIC OR MAGNETIC VARIABLES
- G05F3/00—Non-retroactive systems for regulating electric variables by using an uncontrolled element, or an uncontrolled combination of elements, such element or such combination having self-regulating properties
- G05F3/02—Regulating voltage or current
- G05F3/08—Regulating voltage or current wherein the variable is dc
- G05F3/10—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics
- G05F3/16—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices
- G05F3/18—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices using Zener diodes
- G05F3/185—Regulating voltage or current wherein the variable is dc using uncontrolled devices with non-linear characteristics being semiconductor devices using Zener diodes and field-effect transistors
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、出力電圧の可変可能な安定化電源回路に関す
る。
る。
従来、定電圧回路の基準電圧を得るために第１図に示す
ツェナーダイオードが多く用いられている。ツェナーダ
イオードを用いて基準電圧を得るには第２図に示すよう
に抵抗（１）とツェナーダイオード（２）を直列に接続
し、前記抵抗（１）とツェナーダイオード（２）の接続
部から出力を得るようにしたものがある。このようにし
て得られた基準電圧を第３図に示すようにさらに抵抗（
３）と抵抗（４）により分圧すれば出力電圧は前記抵抗
（３）と抵抗（４）の抵抗値の比によって任意に設定可
能である。
ツェナーダイオードが多く用いられている。ツェナーダ
イオードを用いて基準電圧を得るには第２図に示すよう
に抵抗（１）とツェナーダイオード（２）を直列に接続
し、前記抵抗（１）とツェナーダイオード（２）の接続
部から出力を得るようにしたものがある。このようにし
て得られた基準電圧を第３図に示すようにさらに抵抗（
３）と抵抗（４）により分圧すれば出力電圧は前記抵抗
（３）と抵抗（４）の抵抗値の比によって任意に設定可
能である。
第４図はツェナーダイオード（２）へ流れる電流が抵抗
（３）と抵抗（４）によって影響されないようにトラン
ジスタ（５）を介して出力を得るようにしたものである
。
（３）と抵抗（４）によって影響されないようにトラン
ジスタ（５）を介して出力を得るようにしたものである
。
以上説明したものは基準電圧を得るための回路であって
実際に安定化電源回路として使用する場合には前記第２
図〜第４図に示した回路にて得られた出力をさらに増幅
する。しかしながら、通常増幅回路に使用されるバイポ
ーラトランジスタでは入力インピーダンスが低く、入力
に高抵抗を使用すれば数段階の増幅を要する。このため
高入力インピーダンスを有するオペアンプを用いた例も
見られるが回路はやや複雑になっている。できればより
安い部品を使用し、より簡単な構成としたいものである
。
実際に安定化電源回路として使用する場合には前記第２
図〜第４図に示した回路にて得られた出力をさらに増幅
する。しかしながら、通常増幅回路に使用されるバイポ
ーラトランジスタでは入力インピーダンスが低く、入力
に高抵抗を使用すれば数段階の増幅を要する。このため
高入力インピーダンスを有するオペアンプを用いた例も
見られるが回路はやや複雑になっている。できればより
安い部品を使用し、より簡単な構成としたいものである
。
本発明は上記にかんがみて為されたものであり電界効果
トランジスタすなわちＦＥＴと用いてインピーダンス交
換を行うものである。
トランジスタすなわちＦＥＴと用いてインピーダンス交
換を行うものである。
第５図に本発明の一実施例を示す。本実施例では抵抗（
３）と抵抗（４）によって分圧された電圧が接合型ＦＥ
Ｔ（６）のゲートへ加わり、この電圧よりもやや低い電
圧であるが安定化された電圧が該ＦＥＴのソースから得
られる。該ＦＥＴのゲート電位とソース電位の差は該Ｆ
ＥＴの相互コンダクタンスｇｍが大きいほど小さい。さ
らに該ＦＥＴのソースとパワトランジスタ（７）のベー
スが接続されており該トランジスタ（７）のエミッタか
ら出力を得るようにされている。トランジスタ（７）の
ベース・エミッタ間の電圧は約０．７Ｖであり一定とな
るため前記ＦＥＴのソース側の電圧が安定化されていれ
ば出力電圧も安定化される。出力電圧は抵抗（３）また
は抵抗（４）の抵抗値を変化させることによって変化す
る。
３）と抵抗（４）によって分圧された電圧が接合型ＦＥ
Ｔ（６）のゲートへ加わり、この電圧よりもやや低い電
圧であるが安定化された電圧が該ＦＥＴのソースから得
られる。該ＦＥＴのゲート電位とソース電位の差は該Ｆ
ＥＴの相互コンダクタンスｇｍが大きいほど小さい。さ
らに該ＦＥＴのソースとパワトランジスタ（７）のベー
スが接続されており該トランジスタ（７）のエミッタか
ら出力を得るようにされている。トランジスタ（７）の
ベース・エミッタ間の電圧は約０．７Ｖであり一定とな
るため前記ＦＥＴのソース側の電圧が安定化されていれ
ば出力電圧も安定化される。出力電圧は抵抗（３）また
は抵抗（４）の抵抗値を変化させることによって変化す
る。
第６図は負荷電流を多く取り出せるようにした実施例で
ある。本実施例において、出力可変範囲０Ｖ〜９．５Ｖ
、最大負荷電流３２０ｍＡ。
ある。本実施例において、出力可変範囲０Ｖ〜９．５Ｖ
、最大負荷電流３２０ｍＡ。
第７図は第６図実施例をもう少し改良した実施例である
。
。
第８図は本発明をプラス・マイナス２電源回路に用いた
例である。
例である。
以上詳術した本発明の可変出力安定化電源回路は簡単な
構成で出力電圧を０Ｖから変化させることができる。
構成で出力電圧を０Ｖから変化させることができる。
第１図はツェナーダイオードを図示したものである。
第２図〜第４図は基準電圧発生回路の従来例を示すもの
である。 第５図〜第８図は本発明の可変出力安定化電源回路の実
施例である。 １．抵抗２．ツェナーダイオード３．４．抵抗５．トラ
ンジスタ６．ＦＥＴ ７．パワトランジス■
である。 第５図〜第８図は本発明の可変出力安定化電源回路の実
施例である。 １．抵抗２．ツェナーダイオード３．４．抵抗５．トラ
ンジスタ６．ＦＥＴ ７．パワトランジス■
Claims (1)
- １）基準電圧を分圧し、この分圧された電圧を接合型Ｆ
ＥＴのゲートへ加え、該接合型ＦＥＴのソースから定電
圧を得るようにしたことを特徴とする可変出力安定化電
源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12698184A JPS616716A (ja) | 1984-06-20 | 1984-06-20 | 可変出力安定化電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12698184A JPS616716A (ja) | 1984-06-20 | 1984-06-20 | 可変出力安定化電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS616716A true JPS616716A (ja) | 1986-01-13 |
Family
ID=14948689
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12698184A Pending JPS616716A (ja) | 1984-06-20 | 1984-06-20 | 可変出力安定化電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS616716A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100681641B1 (ko) | 2005-06-02 | 2007-02-09 | 주식회사 대우일렉트로닉스 | Ｓｍｐｓ에서의 가변형 정전압 장치 |
| JP2014042394A (ja) * | 2012-08-22 | 2014-03-06 | Denso Corp | スイッチング素子の駆動装置 |
-
1984
- 1984-06-20 JP JP12698184A patent/JPS616716A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100681641B1 (ko) | 2005-06-02 | 2007-02-09 | 주식회사 대우일렉트로닉스 | Ｓｍｐｓ에서의 가변형 정전압 장치 |
| JP2014042394A (ja) * | 2012-08-22 | 2014-03-06 | Denso Corp | スイッチング素子の駆動装置 |
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