JPS6148723B2 - - Google Patents
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- JPS6148723B2 JPS6148723B2 JP6196979A JP6196979A JPS6148723B2 JP S6148723 B2 JPS6148723 B2 JP S6148723B2 JP 6196979 A JP6196979 A JP 6196979A JP 6196979 A JP6196979 A JP 6196979A JP S6148723 B2 JPS6148723 B2 JP S6148723B2
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- 238000006243 chemical reaction Methods 0.000 claims description 16
- 238000001514 detection method Methods 0.000 claims description 7
- 238000010586 diagram Methods 0.000 description 10
- 239000003990 capacitor Substances 0.000 description 5
- 230000000694 effects Effects 0.000 description 2
- 239000000284 extract Substances 0.000 description 1
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- Rectifiers (AREA)
- Control Of Electrical Variables (AREA)
Description
【発明の詳細な説明】
この発明は、サイリスタ変換装置など、ある基
準入力信号に依存して負荷に電圧を印加し、電力
を供給する直流電源装置の内、複数台の電源装置
を直流側で共通に並列接続し、しかる後、負荷に
電力を供給する直流電源装置の制御回路に関する
ものである。
準入力信号に依存して負荷に電圧を印加し、電力
を供給する直流電源装置の内、複数台の電源装置
を直流側で共通に並列接続し、しかる後、負荷に
電力を供給する直流電源装置の制御回路に関する
ものである。
第１図は従来の複数台の直流電源装置（サイリ
スタ変換装置）の直列接続運転の回路の一例を示
す図であり、図において、１，２はサイリスタ変
換装置、３は電源変圧器、４，５はDCCT（直流
変換器）、６は負荷となる直流電動機、７は直流
電動機６の回転速度を電圧信号に変換する指速発
電機である。
スタ変換装置）の直列接続運転の回路の一例を示
す図であり、図において、１，２はサイリスタ変
換装置、３は電源変圧器、４，５はDCCT（直流
変換器）、６は負荷となる直流電動機、７は直流
電動機６の回転速度を電圧信号に変換する指速発
電機である。
指速発電機７により得られる速度帰還信号２１
は速度制御回路１９に送られるようになつてお
り、速度制御回路１９には速度基準信号２０（電
圧信号）も加えられている。速度制御回路１９は
例えば第６図ａの如く構成されて比例積分特性と
出力信号制限回路を有しており、速度基準信号２
０と速度帰還信号２１との偏差をとり、その偏差
信号の比例積分特性出力を電流基準信号１８とし
て電流制御回路１２，１３に送出するよう構成さ
れている。なお、第６図ａにおいて、Ａは直流増
幅器、Ｒ1sc，Ｒ2sc，Ｒfscは抵抗、Ｃfscはコンデ
ンサである。
は速度制御回路１９に送られるようになつてお
り、速度制御回路１９には速度基準信号２０（電
圧信号）も加えられている。速度制御回路１９は
例えば第６図ａの如く構成されて比例積分特性と
出力信号制限回路を有しており、速度基準信号２
０と速度帰還信号２１との偏差をとり、その偏差
信号の比例積分特性出力を電流基準信号１８とし
て電流制御回路１２，１３に送出するよう構成さ
れている。なお、第６図ａにおいて、Ａは直流増
幅器、Ｒ1sc，Ｒ2sc，Ｒfscは抵抗、Ｃfscはコンデ
ンサである。
電流制御回路１２，１３はそれぞれ例えば第６
図ｂ、第６図ｃに示すよう構成され、電流帰還信
号１６，１７が電流検出回路１４，１５から入力
されるようになつている。また第６図ｂ，ｃにお
いて、Ａは直流増幅器、Ｒ2cc1，Ｒ1cc1，Ｒfcc1お
よびＲ2cc2，Ｒ1cc2，Ｒfcc2は第６図ａと同様に抵
抗、Ｃfcc1およびＣfcc2はコンデンサである。電流
検出回路１４，１５はDCCT４，５でそれぞれ検
出した直流電流を電圧信号に変え、これを電流帰
還信号１６，１７とするものである。
図ｂ、第６図ｃに示すよう構成され、電流帰還信
号１６，１７が電流検出回路１４，１５から入力
されるようになつている。また第６図ｂ，ｃにお
いて、Ａは直流増幅器、Ｒ2cc1，Ｒ1cc1，Ｒfcc1お
よびＲ2cc2，Ｒ1cc2，Ｒfcc2は第６図ａと同様に抵
抗、Ｃfcc1およびＣfcc2はコンデンサである。電流
検出回路１４，１５はDCCT４，５でそれぞれ検
出した直流電流を電圧信号に変え、これを電流帰
還信号１６，１７とするものである。
電流制御回路１２，１３はそれぞれ電流基準信
号１８を基準にして、電流帰還信号１６，１７を
ゲートパルス位相基準１０，１１とし、これをゲ
ートパルス発生器８，９に出力するようになつて
いる。ゲートパルス発生器８，９はこの出力１
０，１１を受けて上記サイリスタ変換装置１，２
にゲートパルスを送出するものである。
号１８を基準にして、電流帰還信号１６，１７を
ゲートパルス位相基準１０，１１とし、これをゲ
ートパルス発生器８，９に出力するようになつて
いる。ゲートパルス発生器８，９はこの出力１
０，１１を受けて上記サイリスタ変換装置１，２
にゲートパルスを送出するものである。
次に、この第１図の直流電源装置の動作につい
て説明する。速度制御回路１９の出力としての電
流基準信号１８が、速度基準信号２０と速度帰還
信号２１の差の比例積分出力として与えられ、こ
の同一レベルの電流基準信号によつて、２つのサ
イリスタ変換装置１，２が電流制御される。これ
により、２つのサイリスタ変換装置１，２には同
じ電流が流れる。
て説明する。速度制御回路１９の出力としての電
流基準信号１８が、速度基準信号２０と速度帰還
信号２１の差の比例積分出力として与えられ、こ
の同一レベルの電流基準信号によつて、２つのサ
イリスタ変換装置１，２が電流制御される。これ
により、２つのサイリスタ変換装置１，２には同
じ電流が流れる。
したがつて、サイリスタ変換装置１，２の出力
電流定格をそれぞれ負荷の定格の1/2に選定して
おき、電流基準信号１８が速度制御回路１９の出
力信号制限回路で制限されるとき、この制限値を
電流基準信号値としてサイリスタ変換装置１，２
の出力電流定格の最大値となるように電流制御回
路１２，１３を設定すれば、それぞれのサイリス
タ変換装置１，２には常に同じ値の電流が流さ
れ、電流基準信号１８が最大値のときサイリスタ
変換装置１，２は２台とも最大定格電流が流れ、
負荷にはその和の電流が供給される。
電流定格をそれぞれ負荷の定格の1/2に選定して
おき、電流基準信号１８が速度制御回路１９の出
力信号制限回路で制限されるとき、この制限値を
電流基準信号値としてサイリスタ変換装置１，２
の出力電流定格の最大値となるように電流制御回
路１２，１３を設定すれば、それぞれのサイリス
タ変換装置１，２には常に同じ値の電流が流さ
れ、電流基準信号１８が最大値のときサイリスタ
変換装置１，２は２台とも最大定格電流が流れ、
負荷にはその和の電流が供給される。
このように、第１図は、２台以上のサイリスタ
変換装置１，２の並列運転において、個々のサイ
リスタ変換装置１，２の電流最大定格まで同時に
流すことが可能であり、負荷にそれらの総和の電
流を流し得るため、通常よく採用されるシステム
である。
変換装置１，２の並列運転において、個々のサイ
リスタ変換装置１，２の電流最大定格まで同時に
流すことが可能であり、負荷にそれらの総和の電
流を流し得るため、通常よく採用されるシステム
である。
しかし、この回路は個々のサイリスタ変換装置
１，２にそれぞれ電流制御回路１２，１３を持つ
ため、回路構成が複雑になる。そこでこの電流制
御回路を１個として使用することが考えられる。
第２図はこの点を勘案して第１図の直流変換装置
を改良したものである。この第２図において符号
１〜２１は第１図と同じであるが、第１図におけ
る２個の電流制御回路１２，１３は第２図では電
流制御回路１２１個のみとしたものである。
１，２にそれぞれ電流制御回路１２，１３を持つ
ため、回路構成が複雑になる。そこでこの電流制
御回路を１個として使用することが考えられる。
第２図はこの点を勘案して第１図の直流変換装置
を改良したものである。この第２図において符号
１〜２１は第１図と同じであるが、第１図におけ
る２個の電流制御回路１２，１３は第２図では電
流制御回路１２１個のみとしたものである。
このため２個のゲートパルス発生器８，９には
電流制御回路１２の出力１０が供給されている。
この場合同一出力１０がゲートパルス発生器８，
９に入力するため、サイリスタ変換装置１，２の
出力電圧は回路定数、特性などが同じであれば、
同一となり、サイリスタ変換装置１，２の出力電
流もまた同じであるはずである。この電流が
DCCT４，５で検出され、電流検出回路１４，１
５で電流帰還信号１６，１７に変換され、前述の
電流制御回路１２に帰還される。
電流制御回路１２の出力１０が供給されている。
この場合同一出力１０がゲートパルス発生器８，
９に入力するため、サイリスタ変換装置１，２の
出力電圧は回路定数、特性などが同じであれば、
同一となり、サイリスタ変換装置１，２の出力電
流もまた同じであるはずである。この電流が
DCCT４，５で検出され、電流検出回路１４，１
５で電流帰還信号１６，１７に変換され、前述の
電流制御回路１２に帰還される。
この電流制御回路１２の詳細な構成の一例が第
３図に示されている。
３図に示されている。
この第３図にて、R1は電流基準信号１８（ia*
と表わす）の入力抵抗、R2は電流帰還信号１
６，１７（それぞれia1，ia2と表わす）の入力抵
抗、Ｃf，Ｒfは電流制御回路１２の帰還コンデン
サおよび抵抗、Ａは直流増幅器である。
と表わす）の入力抵抗、R2は電流帰還信号１
６，１７（それぞれia1，ia2と表わす）の入力抵
抗、Ｃf，Ｒfは電流制御回路１２の帰還コンデン
サおよび抵抗、Ａは直流増幅器である。
サイリスタ変換装置の電流、電圧が一定の値を
保つ状態においてはゲートパルス位相基準１０が
一定状態にあることからこのゲートパルス位相基
準１０の電圧がすべてＣfに印加され、Ｒfに流れ
る電流が０の状態であるためｉａ＊／Ｒ１＋ｉａ１／Ｒ
２＋ｉａ２／Ｒ２＝０ の関係が成立つことによりia*＝−Ｒ１／Ｒ２（ia1＋ ia2）が成立つ。サイリスタ変換装置が定格最大電
流を流すとき電流基準信号１８（＝ia*）は最大
制限値になるが、電流帰還信号の和ia＝ia1＋ia2
は個々のサイリスタ変換装置１，２の最大電流定
格の和であるため、回路インピーダンス等のばら
つきによりサイリスタ変換装置出力電流が等しく
なくなつた場合（Ia1≠ia2）いずれかのサイリスタ
変換装置がその最大電流定格以上の電流を流すこ
とになるので、ついにはサイリスタ変換装置の損
傷または過電流検出により運転不能に至ることが
充分考えられる。
保つ状態においてはゲートパルス位相基準１０が
一定状態にあることからこのゲートパルス位相基
準１０の電圧がすべてＣfに印加され、Ｒfに流れ
る電流が０の状態であるためｉａ＊／Ｒ１＋ｉａ１／Ｒ
２＋ｉａ２／Ｒ２＝０ の関係が成立つことによりia*＝−Ｒ１／Ｒ２（ia1＋ ia2）が成立つ。サイリスタ変換装置が定格最大電
流を流すとき電流基準信号１８（＝ia*）は最大
制限値になるが、電流帰還信号の和ia＝ia1＋ia2
は個々のサイリスタ変換装置１，２の最大電流定
格の和であるため、回路インピーダンス等のばら
つきによりサイリスタ変換装置出力電流が等しく
なくなつた場合（Ia1≠ia2）いずれかのサイリスタ
変換装置がその最大電流定格以上の電流を流すこ
とになるので、ついにはサイリスタ変換装置の損
傷または過電流検出により運転不能に至ることが
充分考えられる。
この発明は上記従来の欠点を除去するためにな
されたもので、複数台のサイリスタ変換装置など
の直流電源から共通の負荷に電流を供給する場
合、１つの電流制御回路で負荷電流を制御し、か
つ電流不平衡により、ある電源がその電源のもつ
ている最大電流定格を越えて電流が流れるのを防
止することのできる直流電源装置の制御回路を提
供することを目的とするものである。
されたもので、複数台のサイリスタ変換装置など
の直流電源から共通の負荷に電流を供給する場
合、１つの電流制御回路で負荷電流を制御し、か
つ電流不平衡により、ある電源がその電源のもつ
ている最大電流定格を越えて電流が流れるのを防
止することのできる直流電源装置の制御回路を提
供することを目的とするものである。
以下、この発明の直流電源装置の制御回路の実
施例について図面に基づき説明する。この発明は
たとえば第２図にて示した直流電源装置における
電流制御回路１２の部分を改良したものであり、
第２図における電流制御回路１２以外の部分の説
明は省略する。
施例について図面に基づき説明する。この発明は
たとえば第２図にて示した直流電源装置における
電流制御回路１２の部分を改良したものであり、
第２図における電流制御回路１２以外の部分の説
明は省略する。
第４図は、この発明の一実施例を示す回路図で
あつて、第２図における電流制御回路１２の部分
に使用されるものである。この第４図において、
Ａ，R1，Ｒf，Ｃf，ia*，ia1，ia2，１６，１７，
１８，１０は第２図、第３図と同じである。
あつて、第２図における電流制御回路１２の部分
に使用されるものである。この第４図において、
Ａ，R1，Ｒf，Ｃf，ia*，ia1，ia2，１６，１７，
１８，１０は第２図、第３図と同じである。
また、R2，R3は電流帰還信号ia1，ia2の入力抵
抗であり、Ｄはダイオードで電流帰還信号ia1，
ia2が負極性の場合、図の向きとなる。（ia1，ia2
が正のときダイオードＤの向きは図と逆になる）
電流基準信号ia*は入力抵抗R1を通して直流増幅
器Ａに入力されるようになつており、この直流増
幅器Ａの入力端と出力端間には帰還コンデンサＣ
fと帰還抵抗Ｒfを直列にした帰還回路が接続され
ている。
抗であり、Ｄはダイオードで電流帰還信号ia1，
ia2が負極性の場合、図の向きとなる。（ia1，ia2
が正のときダイオードＤの向きは図と逆になる）
電流基準信号ia*は入力抵抗R1を通して直流増幅
器Ａに入力されるようになつており、この直流増
幅器Ａの入力端と出力端間には帰還コンデンサＣ
fと帰還抵抗Ｒfを直列にした帰還回路が接続され
ている。
また、電流帰還信号ia1，ia2はそれぞれ入力抵
抗R3とダイオードＤの並列回路を通し、さらに
点ｃより入力抵抗R2を通して直流増幅器Ａの入
力端に供給されるようになつている。
抗R3とダイオードＤの並列回路を通し、さらに
点ｃより入力抵抗R2を通して直流増幅器Ａの入
力端に供給されるようになつている。
いま、この第４図において、ダイオードＤがな
いものと仮定すれば となり第２図と特性はかわらない。入力抵抗R3
をR2に比べて無視出来るぐらい小さいものとす
れば、２つの入力抵抗R3の中点ｃの電位は
ｉａ１＋ｉａ２／２となり、入力抵抗R3の両端の電圧は ｉａ１−ｉａ２／２およびｉａ２−ｉａ１／２となる。
いものと仮定すれば となり第２図と特性はかわらない。入力抵抗R3
をR2に比べて無視出来るぐらい小さいものとす
れば、２つの入力抵抗R3の中点ｃの電位は
ｉａ１＋ｉａ２／２となり、入力抵抗R3の両端の電圧は ｉａ１−ｉａ２／２およびｉａ２−ｉａ１／２となる。
ここで、第４図のダイオードＤを入れた図で考
えると、ダイオードＤのスレツシヨールド電圧Ｅ
Dよりｉａ１−ｉａ２／２またはｉａ２−ｉａ１／２の
電圧が大きくなつ たとき、電流帰還信号ia1とia2の負に大きい方の
信号入力側のダイオードが導通する。
えると、ダイオードＤのスレツシヨールド電圧Ｅ
Dよりｉａ１−ｉａ２／２またはｉａ２−ｉａ１／２の
電圧が大きくなつ たとき、電流帰還信号ia1とia2の負に大きい方の
信号入力側のダイオードが導通する。
第４図の点ｃの電圧ＥCは電流帰還信号ia1がia2
より負に大きいと仮定すれば、ＥC＝ia1＋ＥDと
なる。したがつて、ia*＝−Ｒ１／Ｒ２（ia1＋ＥD）が
成 立すれば、ＥDは常に一定であるので電流基準信
号ia*が制限値のとき電流帰還信号ia1がサイリス
タ変換装置の最大電流定格となるようＲ１／Ｒ２を決め れば、サイリスタ変換装置にはこの値以上の電流
は流れ得ない。
より負に大きいと仮定すれば、ＥC＝ia1＋ＥDと
なる。したがつて、ia*＝−Ｒ１／Ｒ２（ia1＋ＥD）が
成 立すれば、ＥDは常に一定であるので電流基準信
号ia*が制限値のとき電流帰還信号ia1がサイリス
タ変換装置の最大電流定格となるようＲ１／Ｒ２を決め れば、サイリスタ変換装置にはこの値以上の電流
は流れ得ない。
なお、電流帰還信号ia1とia2が等しくかつ電流
基準信号ia*が制限値まで出た場合はia*＝−Ｒ１／Ｒ２ ia1（R2≫R3）であり先に決めたようにia*＝−Ｒ１／Ｒ
２ （ＩL＋ＥD） （ＩLは定格最大電流値の時のia1の
信号値を示す）であるので、ia1＝ＩL＋ＥDとな
る。
基準信号ia*が制限値まで出た場合はia*＝−Ｒ１／Ｒ２ ia1（R2≫R3）であり先に決めたようにia*＝−Ｒ１／Ｒ
２ （ＩL＋ＥD） （ＩLは定格最大電流値の時のia1の
信号値を示す）であるので、ia1＝ＩL＋ＥDとな
る。
この式でＩLは負、ＥDは正であるので電流が平
衡しているときのサイリスタ変換装置の出力電流
最大値はＩLより小さくなり、第１図の直流電源
装置に比べると、最大電流定格まで出力電流が出
ない欠点はあるが通常ＩL≫ＥDに選ぶことにより
実用上ほとんど差しつかえない。
衡しているときのサイリスタ変換装置の出力電流
最大値はＩLより小さくなり、第１図の直流電源
装置に比べると、最大電流定格まで出力電流が出
ない欠点はあるが通常ＩL≫ＥDに選ぶことにより
実用上ほとんど差しつかえない。
この欠点がなくしかも簡単な回路として、第５
図の回路を使用してもよい。この第５図は第４図
における電流帰還信号ia1，ia2に対する入力抵抗
R3を省略したものである。この回路は理想ダイ
オード（ＥD＝０）では非常によい回路である
が、ダイオードは必ずＥD≠０であるので電流帰
還信号ia1，ia2がＥDより絶対値が小さいとき、帰
還して帰つて来ないため、制御上不都合なことが
多く、用途が限定される。
図の回路を使用してもよい。この第５図は第４図
における電流帰還信号ia1，ia2に対する入力抵抗
R3を省略したものである。この回路は理想ダイ
オード（ＥD＝０）では非常によい回路である
が、ダイオードは必ずＥD≠０であるので電流帰
還信号ia1，ia2がＥDより絶対値が小さいとき、帰
還して帰つて来ないため、制御上不都合なことが
多く、用途が限定される。
なお、前述の実施例では、サイリスタ変換装置
を電源としたが、ある基準入力信号に依存して電
圧を発生する電源装置を使用した場合も同様の効
果が期待できる。
を電源としたが、ある基準入力信号に依存して電
圧を発生する電源装置を使用した場合も同様の効
果が期待できる。
また、上記実施例では２台のサイリスタ変換装
置に限つたが、３台以上の電源に対しても台数分
だけ第４図の入力抵抗R3とダイオードＤの部分
を用意することにより同様の効果が期待できる。
置に限つたが、３台以上の電源に対しても台数分
だけ第４図の入力抵抗R3とダイオードＤの部分
を用意することにより同様の効果が期待できる。
以上のように、この発明の直流電源装置の制御
回路によれば、複数台の直流電源装置により駆動
される電動機からの速度帰還信号と速度基準信号
との偏差を速度制御回路によりとり出し、この速
度制御回路の出力を電流基準信号として電流制御
回路に入力するとともに、各直流電源装置の出力
電流を検出して得られた各電流帰還信号をそれぞ
れ抵抗とダイオードとの並列回路を通した後に共
通の接続点を経て上記電流制御回路に入力させ、
直流電源装置間の電流に大きな不平衡があつた場
合にその最大の電流帰還信号を上記ダイオードを
通して帰還させ、電流基準信号の最大制限値と平
衡するように、電流制御回路の定数を設定するよ
うにしたので、直流電源装置の最大電流値を最大
定格以内に制限することができる。
回路によれば、複数台の直流電源装置により駆動
される電動機からの速度帰還信号と速度基準信号
との偏差を速度制御回路によりとり出し、この速
度制御回路の出力を電流基準信号として電流制御
回路に入力するとともに、各直流電源装置の出力
電流を検出して得られた各電流帰還信号をそれぞ
れ抵抗とダイオードとの並列回路を通した後に共
通の接続点を経て上記電流制御回路に入力させ、
直流電源装置間の電流に大きな不平衡があつた場
合にその最大の電流帰還信号を上記ダイオードを
通して帰還させ、電流基準信号の最大制限値と平
衡するように、電流制御回路の定数を設定するよ
うにしたので、直流電源装置の最大電流値を最大
定格以内に制限することができる。
第１図は、従来の２台のサイリスタ変換装置の
並列接続運転の回路の一例を示すブロツク図、第
２図は従来およびこの発明の直流電源装置の制御
回路を有するサイリスタ変換装置の並列接続運転
の回路を示すブロツク図、第３図は第２図の従来
の直流電源装置の制御回路の詳細な回路図、第４
図はこの発明の直流電源装置の制御回路の一実施
例の詳細な回路図、第５図はこの発明の直流電源
装置の制御回路の他の実施例を示す回路図、第６
図ａは速度制御回路の一例を示す回路図、第６図
ｂ，ｃはそれぞれ電流制御回路の一例を示す回路
図である。 １，２……サイリスタ変換装置、３……電源変
圧器、４，５……DCCT、６……直流電動機、７
……指速発電機、８，９……ゲートパルス発生
器、１２……電流制御回路、１４，１５……電流
検出回路、１９……速度制御回路、R1〜R3……
入力抵抗、Ｒf……帰還抵抗、Ｃf……帰還コンデ
ンサ、Ａ……直流増幅器、Ｄ……ダイオード。な
お、図中同一符号は同一部分または相当部分を示
す。
並列接続運転の回路の一例を示すブロツク図、第
２図は従来およびこの発明の直流電源装置の制御
回路を有するサイリスタ変換装置の並列接続運転
の回路を示すブロツク図、第３図は第２図の従来
の直流電源装置の制御回路の詳細な回路図、第４
図はこの発明の直流電源装置の制御回路の一実施
例の詳細な回路図、第５図はこの発明の直流電源
装置の制御回路の他の実施例を示す回路図、第６
図ａは速度制御回路の一例を示す回路図、第６図
ｂ，ｃはそれぞれ電流制御回路の一例を示す回路
図である。 １，２……サイリスタ変換装置、３……電源変
圧器、４，５……DCCT、６……直流電動機、７
……指速発電機、８，９……ゲートパルス発生
器、１２……電流制御回路、１４，１５……電流
検出回路、１９……速度制御回路、R1〜R3……
入力抵抗、Ｒf……帰還抵抗、Ｃf……帰還コンデ
ンサ、Ａ……直流増幅器、Ｄ……ダイオード。な
お、図中同一符号は同一部分または相当部分を示
す。
Claims (1)
- 【特許請求の範囲】 １ 複数台の直流側で並列に接続され、所定の基
準入力信号に依存して負荷に電圧を印加し電力を
供給する直流電源装置、この直流電源装置のそれ
ぞれの出力電流を検出する電流検出器、所定の基
準入力信号と上記直流電源装置より電力が供給さ
れた負荷からの帰還信号との偏差に応じて電流基
準信号を得る制御手段、上記各電流検出器で検出
された電流検出信号をそれぞれダイオードを通し
て同一入力抵抗に入力するとともに上記電流基準
信号を上記抵抗とは別の抵抗を通して入力するよ
うに構成され上記直流電源装置間の電流に所定以
上の不平衡が生じた場合にその最大の電流検出信
号が上記ダイオードを通じて帰還され上記電流基
準信号の最大制限値に制御されるように設定され
た１個の電流制御回路、この電流制御回路の出力
により上記直流電源装置の最大電流値を最大定格
以内に制限するようにこの直流電源装置を制御す
る手段を備えてなる直流電源装置の制御回路。 ２ 電流制限回路における各ダイオードは並列に
抵抗が接続されることを特徴とする特許請求の範
囲第１項記載の直流電源装置の制御回路。 ３ 直流電源装置はサイリスタ変換装置であるこ
とを特徴とする特許請求の範囲第１項または第２
項記載の直流電源装置の制御回路。 ４ 直流電源装置は電流基準信号により電流制御
されることを特徴とする特許請求の範囲第１項ま
たは第２項記載の直流電源装置の制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6196979A JPS55154617A (en) | 1979-05-18 | 1979-05-18 | Control circuit for direct current power supply unit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6196979A JPS55154617A (en) | 1979-05-18 | 1979-05-18 | Control circuit for direct current power supply unit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55154617A JPS55154617A (en) | 1980-12-02 |
| JPS6148723B2 true JPS6148723B2 (ja) | 1986-10-25 |
Family
ID=13186506
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6196979A Granted JPS55154617A (en) | 1979-05-18 | 1979-05-18 | Control circuit for direct current power supply unit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55154617A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01138415U (ja) * | 1988-03-16 | 1989-09-21 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AT398865B (de) * | 1990-09-19 | 1995-02-27 | E Z I Entwicklungszentrum Fuer | Strombegrenzungsschaltung |
| US6157555A (en) * | 1999-11-09 | 2000-12-05 | International Business Machines Corporation | Current limiter responsive to changing parallel power supply capacity |
-
1979
- 1979-05-18 JP JP6196979A patent/JPS55154617A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01138415U (ja) * | 1988-03-16 | 1989-09-21 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55154617A (en) | 1980-12-02 |
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