JPS6148308B2 - - Google Patents
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- JPS6148308B2 JPS6148308B2 JP59157492A JP15749284A JPS6148308B2 JP S6148308 B2 JPS6148308 B2 JP S6148308B2 JP 59157492 A JP59157492 A JP 59157492A JP 15749284 A JP15749284 A JP 15749284A JP S6148308 B2 JPS6148308 B2 JP S6148308B2
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- switch
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- scanning circuit
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Links
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Landscapes
- Solid State Image Pick-Up Elements (AREA)
- Transforming Light Signals Into Electric Signals (AREA)
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、半導体基板上に、光情報に応じた信
号電荷を蓄積する多数の光電変換素子および各素
子から信号電荷を取り出す走査回路素子を集積化
した固体撮像装置に関するものである。
号電荷を蓄積する多数の光電変換素子および各素
子から信号電荷を取り出す走査回路素子を集積化
した固体撮像装置に関するものである。
固体撮像装置は空間的2次元の光情報を時系列
化電気信号に変換するもので、この装置の一形式
は高い解像度を得るため500×500個程度の光電変
換素子マトリツクスとそれらの光電変換素子から
信号電荷を取り出すスイツチ素子及びスイツチ素
子を開閉する走査パルスを出力するX(水平)走
査回路、Y(垂直)走査回路をそなえている。固
体撮像装置の一例を原理的な構成を図示すると第
1図のようになる。以下図面を用いて説明する
が、同一符号のものは同一または均等部分を示す
ものとする。第1図において1は水平走査回路
で、水平方向に配列される画素(光電変換素子)
の数(例えば500)に対応した段数の単位回路か
らなり、走査回路を駆動するクロツクパルスによ
り1水平走査期間に一定のタイミング時間ずつシ
フトした走査パルスを単位回路の各段に順次出力
する。2は垂直走査回路で、光電変換素子マトリ
ツクスの行数(例えば500)に対応した段数の単
位回路からなり、走査回路を駆動するクロツクパ
ルスにより1フイールドの間に1水平走査期間に
対応して一定のタイミング時間ずつシフトした走
査パルスを単位回路の各段に順次出力する。垂直
走査回路2から出力される走査パルスにより垂直
転送スイツチ素子を順次開閉し、2次元状に配列
した個々の光電変換素子からの信号を垂直出力線
5に転送し、水平走査回路1から出力される走査
パルスにより水平転送スイツチ素子6を順次開閉
し、垂直出力線5から信号を水平転送スイツチ素
子6を通して水平出力線7に転送する。光電変換
素子4からの信号はその上に投影された光学像に
対応するので、上記動作により映像信号を取り出
すことができる。
化電気信号に変換するもので、この装置の一形式
は高い解像度を得るため500×500個程度の光電変
換素子マトリツクスとそれらの光電変換素子から
信号電荷を取り出すスイツチ素子及びスイツチ素
子を開閉する走査パルスを出力するX(水平)走
査回路、Y(垂直)走査回路をそなえている。固
体撮像装置の一例を原理的な構成を図示すると第
1図のようになる。以下図面を用いて説明する
が、同一符号のものは同一または均等部分を示す
ものとする。第1図において1は水平走査回路
で、水平方向に配列される画素(光電変換素子)
の数(例えば500)に対応した段数の単位回路か
らなり、走査回路を駆動するクロツクパルスによ
り1水平走査期間に一定のタイミング時間ずつシ
フトした走査パルスを単位回路の各段に順次出力
する。2は垂直走査回路で、光電変換素子マトリ
ツクスの行数(例えば500)に対応した段数の単
位回路からなり、走査回路を駆動するクロツクパ
ルスにより1フイールドの間に1水平走査期間に
対応して一定のタイミング時間ずつシフトした走
査パルスを単位回路の各段に順次出力する。垂直
走査回路2から出力される走査パルスにより垂直
転送スイツチ素子を順次開閉し、2次元状に配列
した個々の光電変換素子からの信号を垂直出力線
5に転送し、水平走査回路1から出力される走査
パルスにより水平転送スイツチ素子6を順次開閉
し、垂直出力線5から信号を水平転送スイツチ素
子6を通して水平出力線7に転送する。光電変換
素子4からの信号はその上に投影された光学像に
対応するので、上記動作により映像信号を取り出
すことができる。
上記固体撮像装置は通常高集積化が比較的容易
で、第2図に構造断面を示したように感光素子と
スイツチング素子が一体化構造で製作できる
MOS―LSI技術を用いて作られる。図から分かる
ように垂直スイツチ3は垂直走査パルスによつて
開閉するゲート8を備えたMOS電界効果トラン
ジスタ(以下MOSTと略記する)で構成され、
光電変換素子4はそのソース接合を利用したpn
(またはnp)接合光ダイオード、垂直出力線5は
MOST3のドレインにつながつた配線(通常Al
が使用される)で構成されている。水平スイツチ
6は水平走査パルスによつて開閉するゲート9を
備えたMOSTで構成され、水平出力線7は
MOST6のドレインにつながつた配線(通常Al
が使用される)で構成されている。また、10は
これらの素子を集積化する半導体(例えばシリコ
ン)基板で、上記のソースおよびドレインがp型
の不純物で作られる場合はn型(ソースおよびド
レインがn型で作られる場合はp型)となる。ま
た、11は絶縁用の酸化膜(一般にシリコン酸化
膜が使用される)である。このように構成された
固体撮像装置は光電変換素子としてMOSTのソ
ース接合が利用できる、また走査回路にもMOS
シフトレジスタが利用でき前記半導体基板上に一
体化構成できる等優れた利点を有している。
で、第2図に構造断面を示したように感光素子と
スイツチング素子が一体化構造で製作できる
MOS―LSI技術を用いて作られる。図から分かる
ように垂直スイツチ3は垂直走査パルスによつて
開閉するゲート8を備えたMOS電界効果トラン
ジスタ(以下MOSTと略記する)で構成され、
光電変換素子4はそのソース接合を利用したpn
(またはnp)接合光ダイオード、垂直出力線5は
MOST3のドレインにつながつた配線(通常Al
が使用される)で構成されている。水平スイツチ
6は水平走査パルスによつて開閉するゲート9を
備えたMOSTで構成され、水平出力線7は
MOST6のドレインにつながつた配線(通常Al
が使用される)で構成されている。また、10は
これらの素子を集積化する半導体(例えばシリコ
ン)基板で、上記のソースおよびドレインがp型
の不純物で作られる場合はn型(ソースおよびド
レインがn型で作られる場合はp型)となる。ま
た、11は絶縁用の酸化膜(一般にシリコン酸化
膜が使用される)である。このように構成された
固体撮像装置は光電変換素子としてMOSTのソ
ース接合が利用できる、また走査回路にもMOS
シフトレジスタが利用でき前記半導体基板上に一
体化構成できる等優れた利点を有している。
しかしながら、この種固体撮像装置はその構成
上、以下に述べるような問題点を抱えている。
上、以下に述べるような問題点を抱えている。
1 走査回路
走査回路はX方向の走査を行う水平走査回路と
Y方向の走査を行う垂直走査回路で構成される
が、水平走査回路は垂直走査回路の走査パルス出
力期間(標準テレビ放送方式では64μs、周波数
で表現すれば15.73kHz)にX方向に並ぶ全光電変
換素子を走査する必要があり、水平走査回路に要
求される走査速度は垂直走査回路よりX方向の画
素数倍(例えば500(X方向)×500(Y方向)の
素子では500倍。)だけ高いものとなる。しかし、
一般には走査回路は水平および垂直とも同じ構成
の回路でよく(勿論、互に異なる回路であつても
よい。)、同一の製造工程で作られることが望まし
い。
Y方向の走査を行う垂直走査回路で構成される
が、水平走査回路は垂直走査回路の走査パルス出
力期間(標準テレビ放送方式では64μs、周波数
で表現すれば15.73kHz)にX方向に並ぶ全光電変
換素子を走査する必要があり、水平走査回路に要
求される走査速度は垂直走査回路よりX方向の画
素数倍(例えば500(X方向)×500(Y方向)の
素子では500倍。)だけ高いものとなる。しかし、
一般には走査回路は水平および垂直とも同じ構成
の回路でよく(勿論、互に異なる回路であつても
よい。)、同一の製造工程で作られることが望まし
い。
従来用いられている代表的な走査回路(電子通
信学会半導体・トランジスタ研究会資料SSD72―
36参照)の各段単位回路は第3図に示く如く1組
の極性反転回路および1組のトランスフアーゲー
トで構成されたシフトレジスタ型回路である。図
においてはシフトレジスタ型走査回路の構成単位
となる初めの1段と、その駆動回路部分を合わせ
て示してある。12および13は180゜位相のず
れたクロツクパルス発生器、14は単位回路15
の出力端子16にシフトパルスを得るたもの入力
パルスV1Nを発生する入力パルス発生回路、また
17は駆動用電源である。18はクロツクパルスφ
1によつて開閉するトランスフアーMOST、1
9はクロツクパルスφ2によつて開閉するトラン
スフアーMOSTである。20は極性反転回路で
あり、ゲートおよびドレインが同一電源17につ
ながつた飽和型の負荷MOST21および駆動
MOST22の直列接続で構成されている。
信学会半導体・トランジスタ研究会資料SSD72―
36参照)の各段単位回路は第3図に示く如く1組
の極性反転回路および1組のトランスフアーゲー
トで構成されたシフトレジスタ型回路である。図
においてはシフトレジスタ型走査回路の構成単位
となる初めの1段と、その駆動回路部分を合わせ
て示してある。12および13は180゜位相のず
れたクロツクパルス発生器、14は単位回路15
の出力端子16にシフトパルスを得るたもの入力
パルスV1Nを発生する入力パルス発生回路、また
17は駆動用電源である。18はクロツクパルスφ
1によつて開閉するトランスフアーMOST、1
9はクロツクパルスφ2によつて開閉するトラン
スフアーMOSTである。20は極性反転回路で
あり、ゲートおよびドレインが同一電源17につ
ながつた飽和型の負荷MOST21および駆動
MOST22の直列接続で構成されている。
同図bは本回路で得られる入出力パルスのタイ
ミングを示したもので、クロツクパルスφ2に同
期した入力パルスV1Nは、クロツクパルスの周期
時間T〓だけ遅延し、出力端子16からは入力パ
ルスV1Nと同極性の出力パルスV01が得られる。
この出力パルスV01は次段(図示せず)の入力と
なり、その出力からはやはり時間T〓だけ遅延し
た出力パルスV02が得られ、以下同様にしてT〓
ずつ遅延した出力パルス列V03……を得ることが
できる。上記の出力パルスにおいて、立上り時間
tr(“0”→“1”)は負荷MOSTにより出力端
子16に寄生した容量Csを充電する時間であ
り、また立下り時間tf(“1”→“0”)は駆動
MOST22を通して寄生容量Csに蓄積された
“1”電圧が放電するのに要する時間である。極
性反転動作をさせるために、一般に負荷MOST
21のコンダクタンスは駆動MOST22のコン
ダクタンスの約1/10に選ばれる。このため、立上
り時間は立下り時間より一桁大きく、本走査回路
で得られる速度の上限を決めるのは、この立上り
時間すなわち負荷MOST21のコンダクタンス
である。ここで負荷MOSTコンダクタンスgmlお
よび“1”レベル電圧V0(“1")は、電源17の
電圧をVdd、しきい電圧をVTとすれば次式で与
えられる。
ミングを示したもので、クロツクパルスφ2に同
期した入力パルスV1Nは、クロツクパルスの周期
時間T〓だけ遅延し、出力端子16からは入力パ
ルスV1Nと同極性の出力パルスV01が得られる。
この出力パルスV01は次段(図示せず)の入力と
なり、その出力からはやはり時間T〓だけ遅延し
た出力パルスV02が得られ、以下同様にしてT〓
ずつ遅延した出力パルス列V03……を得ることが
できる。上記の出力パルスにおいて、立上り時間
tr(“0”→“1”)は負荷MOSTにより出力端
子16に寄生した容量Csを充電する時間であ
り、また立下り時間tf(“1”→“0”)は駆動
MOST22を通して寄生容量Csに蓄積された
“1”電圧が放電するのに要する時間である。極
性反転動作をさせるために、一般に負荷MOST
21のコンダクタンスは駆動MOST22のコン
ダクタンスの約1/10に選ばれる。このため、立上
り時間は立下り時間より一桁大きく、本走査回路
で得られる速度の上限を決めるのは、この立上り
時間すなわち負荷MOST21のコンダクタンス
である。ここで負荷MOSTコンダクタンスgmlお
よび“1”レベル電圧V0(“1")は、電源17の
電圧をVdd、しきい電圧をVTとすれば次式で与
えられる。
gml=β(Vdd−VT) (1)
V0(“1")=Vdd−VT (2)
但し、βはMOSTのデバイス定数によつて決
まるチヤンネル・コンダクタンスである。本式か
らわかるようにしきい値電圧を小さくするとコン
ダクタンスは大きくなり、さらに“1”レベル電
圧も高くなる。すなわち第3図cに見られるよう
に、しきい値電圧VTの低下とともにV0(“1")
が高くなり、trは小さくなるので走査回路の速
度は高くなる。このことから、高速で動作する水
平走査回路を構成するMOSTのしきい値電圧V
H T(sc)は低速で動作する垂直走査回路を構成する
MOSTのしきい値電圧VV T(sc)より低く選ぶこと
が必要となる。
まるチヤンネル・コンダクタンスである。本式か
らわかるようにしきい値電圧を小さくするとコン
ダクタンスは大きくなり、さらに“1”レベル電
圧も高くなる。すなわち第3図cに見られるよう
に、しきい値電圧VTの低下とともにV0(“1")
が高くなり、trは小さくなるので走査回路の速
度は高くなる。このことから、高速で動作する水
平走査回路を構成するMOSTのしきい値電圧V
H T(sc)は低速で動作する垂直走査回路を構成する
MOSTのしきい値電圧VV T(sc)より低く選ぶこと
が必要となる。
VV T(sc)>VH T(sc) (3)
しかるに前述の如く両走査回路を同一の製作工
程で作ることが望ましい、またそうすれば当然に
その両走査回路を構成するMOSTのしきい値電
圧は同じものになつてしまう。従つて水平走査回
路を構成するMOSTの設計値(チヤンネル幅、
チヤンネル長など)を変えてコンダクタンスを向
上させる必要があるが、単に設計値を変えただけ
で2桁以上の差を持たせることは、水平走査回路
の占めるレイアウト面積が極端に大きくなる等の
弊害が生じ好ましくない。
程で作ることが望ましい、またそうすれば当然に
その両走査回路を構成するMOSTのしきい値電
圧は同じものになつてしまう。従つて水平走査回
路を構成するMOSTの設計値(チヤンネル幅、
チヤンネル長など)を変えてコンダクタンスを向
上させる必要があるが、単に設計値を変えただけ
で2桁以上の差を持たせることは、水平走査回路
の占めるレイアウト面積が極端に大きくなる等の
弊害が生じ好ましくない。
2 転送スイツチ
水平スイツチ6は高速の水平走査回路1により
標準テレビ放送方式では64μs毎に選択され、垂
直出力線は64μs毎にビデオ電圧まで充電される
のに対し、垂直スイツチ3は約17ms(フイール
ド周波数は60Hzである)毎に選択を受ける。これ
により、光ダイオード4は17msの間光の照射を
受け、その間に発生した光信号電荷をダイオード
に蓄積する、いわゆる蓄積モードで動作するので
光感度が高くなるのである。MOSTの非導通時
の抵抗はバイポーラトランジスタ等の他素子に較
べると比較的大きいが、ゲートに加わる電圧がし
きい値電圧以下であつても完全にはカツトオフで
はなく微小電流(一般にテーリング電流と称され
ている)が流れ、光ダイオード4には垂直スイツ
チ用のMOST3を通して電流が充電されること
になる。このため、光学情報を正確に反映した信
号を続出すことができないことになる。
標準テレビ放送方式では64μs毎に選択され、垂
直出力線は64μs毎にビデオ電圧まで充電される
のに対し、垂直スイツチ3は約17ms(フイール
ド周波数は60Hzである)毎に選択を受ける。これ
により、光ダイオード4は17msの間光の照射を
受け、その間に発生した光信号電荷をダイオード
に蓄積する、いわゆる蓄積モードで動作するので
光感度が高くなるのである。MOSTの非導通時
の抵抗はバイポーラトランジスタ等の他素子に較
べると比較的大きいが、ゲートに加わる電圧がし
きい値電圧以下であつても完全にはカツトオフで
はなく微小電流(一般にテーリング電流と称され
ている)が流れ、光ダイオード4には垂直スイツ
チ用のMOST3を通して電流が充電されること
になる。このため、光学情報を正確に反映した信
号を続出すことができないことになる。
3 雑 音
水平信号出力線7には水平走査回路1を駆動す
る前述のクロツクパルスあるいは回路各段の出力
する走査パルスの立上り、立下り時に基づく誘導
性雑音が基板半導体体内あるいは体外の寄生容量
を通して漏洩する(垂直走査回路を駆動するクロ
ツクパルスあるいは走査パルスにより発生する雑
音は、クロツクパルスを1水平走査期間毎に設け
られる水平ブランキイング期間内に納めること等
により、本雑音を事実上映像信号から除去するこ
とができるので問題にはならない。)。特に、体内
を通して飛び込む雑音は寄生容量のほかに半導体
基板の抵抗が加わり複雑な経路を経て混入するの
で雑音処理回路(一般に低域フイルターが使用さ
れる)による雑音の除去が極めて難かしい。この
ため、固体撮像装置の信号対雑音比は電子管に較
べて低く、画質が悪いため、装置の応用分野を制
限もしくは実用化をはばんでいる。
る前述のクロツクパルスあるいは回路各段の出力
する走査パルスの立上り、立下り時に基づく誘導
性雑音が基板半導体体内あるいは体外の寄生容量
を通して漏洩する(垂直走査回路を駆動するクロ
ツクパルスあるいは走査パルスにより発生する雑
音は、クロツクパルスを1水平走査期間毎に設け
られる水平ブランキイング期間内に納めること等
により、本雑音を事実上映像信号から除去するこ
とができるので問題にはならない。)。特に、体内
を通して飛び込む雑音は寄生容量のほかに半導体
基板の抵抗が加わり複雑な経路を経て混入するの
で雑音処理回路(一般に低域フイルターが使用さ
れる)による雑音の除去が極めて難かしい。この
ため、固体撮像装置の信号対雑音比は電子管に較
べて低く、画質が悪いため、装置の応用分野を制
限もしくは実用化をはばんでいる。
本発明は上記の問題を解消することを目的とす
る。
る。
上述した問題を解決する手段として、走査回路
については水平走査回路のMOSTのしきい値電
圧をより低くすることが考えられる。また、スイ
ツチのテーリング電流はしきい値電圧が高い程小
さくなるので、正しい光学情報を得るための解決
策として垂直スイツチ用MOST3のしきい値電
圧をより高くすることが考えられる。さらに飛込
み雑音に関しては走査回路とスイツチを異なる基
板領域に集積化することが考えられる。
については水平走査回路のMOSTのしきい値電
圧をより低くすることが考えられる。また、スイ
ツチのテーリング電流はしきい値電圧が高い程小
さくなるので、正しい光学情報を得るための解決
策として垂直スイツチ用MOST3のしきい値電
圧をより高くすることが考えられる。さらに飛込
み雑音に関しては走査回路とスイツチを異なる基
板領域に集積化することが考えられる。
この考えの下に、本発明においては、水平スイ
ツチ用MOSTと垂直スイツチ用MOSTとが、異
なるしきい値電圧をとり得るようにした。具体的
には固体撮像装置を形成する半導体基板の主表面
に基板と同じ導電型であるが基板よりも不純物濃
度の高い領域を形成し、この領域に垂直スイツチ
用MOSTを集積化した。
ツチ用MOSTと垂直スイツチ用MOSTとが、異
なるしきい値電圧をとり得るようにした。具体的
には固体撮像装置を形成する半導体基板の主表面
に基板と同じ導電型であるが基板よりも不純物濃
度の高い領域を形成し、この領域に垂直スイツチ
用MOSTを集積化した。
以下、本発明を実施例を参照して詳細に説明す
る。
る。
第4図は本発明による固体撮像装置の骨子とな
る概念を示す平面構成図である。23は水平走査
回路1を含む領域、24は水平スイツチ用
MOST6を含む領域、25は垂直走査回路2を
含む領域、また、26は垂直スイツチ用MOST
3およ光ダイオード4を2次元状に配列した光電
変換部を含む領域である。
る概念を示す平面構成図である。23は水平走査
回路1を含む領域、24は水平スイツチ用
MOST6を含む領域、25は垂直走査回路2を
含む領域、また、26は垂直スイツチ用MOST
3およ光ダイオード4を2次元状に配列した光電
変換部を含む領域である。
最初に走査回路について説明する。領域23に
含まれる水平走査回路1のMOSTのしきい値電
圧VH T(sc)が前記第(3)式の関係を満足するよう
領
域25に含まれる垂直走査回路2のMOSTのし
きい値電圧VV T(sc)より低く設定する。
含まれる水平走査回路1のMOSTのしきい値電
圧VH T(sc)が前記第(3)式の関係を満足するよう
領
域25に含まれる垂直走査回路2のMOSTのし
きい値電圧VV T(sc)より低く設定する。
次にスイツチ用MOSTのしきい値電圧につい
て説明する。水平スイツチ用MOST6は前述の
ように64μs毎に導通するのに対し、垂直スイツ
チ用MOST3は17msという遅い周期で導通す
る。さらに、詳細に言うと水平スイツチにつなが
る垂直信号出力線5の情報蓄積時間は64μsであ
るのに対し、垂直スイツチにつながる光ダイオー
ド4の情報蓄積時間は500倍長い。したがつて、
光ダイオードの情報リークを抑えるためには垂直
スイツチ用MOST3の非導通時におけるカツト
オフ抵抗は出来得る限り大きくするのが望まし
い。本願発明者らの測定では、しきい値電圧を
0.1V上げることにより非導通時のテーリング電
流は1/10に減少する。垂直スイツチ用MOST3
の光学情報のリークを水平スイツチ用MOSTの
リークと同時にするには、垂直スイツチ用
MOSTのしきい値電圧VV T(sw)を水平スイツチ用
MOSTのしきい値電圧VH T(sw)に比較して0.25V高
くする必要があり、一般に、領域26に含まれる
MOSTのしきい値電圧は領域24に含まれる
MOSTのしきい値電圧より高くするのが望まし
い。
て説明する。水平スイツチ用MOST6は前述の
ように64μs毎に導通するのに対し、垂直スイツ
チ用MOST3は17msという遅い周期で導通す
る。さらに、詳細に言うと水平スイツチにつなが
る垂直信号出力線5の情報蓄積時間は64μsであ
るのに対し、垂直スイツチにつながる光ダイオー
ド4の情報蓄積時間は500倍長い。したがつて、
光ダイオードの情報リークを抑えるためには垂直
スイツチ用MOST3の非導通時におけるカツト
オフ抵抗は出来得る限り大きくするのが望まし
い。本願発明者らの測定では、しきい値電圧を
0.1V上げることにより非導通時のテーリング電
流は1/10に減少する。垂直スイツチ用MOST3
の光学情報のリークを水平スイツチ用MOSTの
リークと同時にするには、垂直スイツチ用
MOSTのしきい値電圧VV T(sw)を水平スイツチ用
MOSTのしきい値電圧VH T(sw)に比較して0.25V高
くする必要があり、一般に、領域26に含まれる
MOSTのしきい値電圧は領域24に含まれる
MOSTのしきい値電圧より高くするのが望まし
い。
VV T(sw)>VH T(sw) (4)
走査回路およびスイツチを構成するMOST間
のしきい値電圧については、必要とする特性によ
り変わるので、大小関係を上記のように一義的に
定めることはできない。
のしきい値電圧については、必要とする特性によ
り変わるので、大小関係を上記のように一義的に
定めることはできない。
前述のように本発明においては撮像装置を構成
するMOSTのしきい値電圧を部分的に異なる値
に設定する。しきい値電圧を部分的に異なる値に
設定する方法として、上述の4つの領域(第4
図)、あるいは2つの領域を構成するMOSTのチ
ヤンネル領域の基板濃度を変えることによりしき
い値電圧を変えることができる。
するMOSTのしきい値電圧を部分的に異なる値
に設定する。しきい値電圧を部分的に異なる値に
設定する方法として、上述の4つの領域(第4
図)、あるいは2つの領域を構成するMOSTのチ
ヤンネル領域の基板濃度を変えることによりしき
い値電圧を変えることができる。
簡便のため、第5図に2つの領域のしきい値電
圧を基板濃度により変える実施例を示し、その断
面構造を第6図に示す。10は第1導電型の基
板、57―1は領域46を納める基板と同型の不
純物層、57―2は領域47を納める基板と同型の
不純物層である。58,59は水平走査回路1、
水平スイツチ用MOST6を構成する任意の
MOST51のドレイン、またはソースであり第
2導電型の不純物で作られる。60,61は垂直
走査回路2、垂直スイツチ3を構成する任意の
MOST5のドレイン、またはソースであり第2
導電型不純物で作られる。56はゲート電極であ
る。本構造の場合しきい値電圧は不純物層57の
第1導電型不純物の濃度に依存し、濃度の増加と
共にしきい値電圧は高くなる。したがつて、不純
物層57―2の濃度N1 Vは不純物層57−1の濃
度N1 Hより高くすればよい。
圧を基板濃度により変える実施例を示し、その断
面構造を第6図に示す。10は第1導電型の基
板、57―1は領域46を納める基板と同型の不
純物層、57―2は領域47を納める基板と同型の
不純物層である。58,59は水平走査回路1、
水平スイツチ用MOST6を構成する任意の
MOST51のドレイン、またはソースであり第
2導電型の不純物で作られる。60,61は垂直
走査回路2、垂直スイツチ3を構成する任意の
MOST5のドレイン、またはソースであり第2
導電型不純物で作られる。56はゲート電極であ
る。本構造の場合しきい値電圧は不純物層57の
第1導電型不純物の濃度に依存し、濃度の増加と
共にしきい値電圧は高くなる。したがつて、不純
物層57―2の濃度N1 Vは不純物層57−1の濃
度N1 Hより高くすればよい。
N1 V>N1 H
基板濃度を最も一般的な1015個/cm3に選んだ場
合、N1 Hは1015〜1016、N1 Vは5×1015〜1017程度
に選べばよい。また特殊な例として、領域46を
集積化する領域の不純物濃度は基板と同じでもよ
く、この場合、不純物層57―1を設ける必要は
なく基板の上に直接MOST51のドレイン、ソ
ースを製作すればよい。本不純物層は通常のイオ
ン打込み法により簡単に製作することができる。
合、N1 Hは1015〜1016、N1 Vは5×1015〜1017程度
に選べばよい。また特殊な例として、領域46を
集積化する領域の不純物濃度は基板と同じでもよ
く、この場合、不純物層57―1を設ける必要は
なく基板の上に直接MOST51のドレイン、ソ
ースを製作すればよい。本不純物層は通常のイオ
ン打込み法により簡単に製作することができる。
第6図の実施例では該当する領域全体に基板よ
り濃度の高い不純物層を設けることを考えたが、
構成MOSTのチヤンネル領域だけ高濃度にして
も勿論同様の効果を得ることができる。第6図の
実施例に同じく2つの領域のしきい値電圧をチヤ
ンネル濃度により変える実施例の断面構造を第7
図に示す。図において58,59は領域46を構
成する任意のMOST51のドレイン、またはソ
ースであり第2導電型の不純物で作られる。62
―1はゲート電極52の下に位置する領域、すな
わちチヤンネル部分に設けた基板と同型不純物か
つ基板より不純物濃度の高い不純物層である。こ
の不純物層は本領域を構成するMOSTの1つ1
つに設けられる。60,61は領域47を構成す
る任意のMOST55のドレイン、またはソース
であり、第2導電型の不純物で作られる。56は
ゲート電極である。62―2はチヤンネル部分に
設けた不純物層であり、やはり本領域を構成する
MOSTの1つ1つに設けられる。第6図の実施
例の場合と同様、不純物層62―2の不純物濃度
NV 1(CH)は不純物層62―1の濃度NH 1(CH
)より高
く設定される。
り濃度の高い不純物層を設けることを考えたが、
構成MOSTのチヤンネル領域だけ高濃度にして
も勿論同様の効果を得ることができる。第6図の
実施例に同じく2つの領域のしきい値電圧をチヤ
ンネル濃度により変える実施例の断面構造を第7
図に示す。図において58,59は領域46を構
成する任意のMOST51のドレイン、またはソ
ースであり第2導電型の不純物で作られる。62
―1はゲート電極52の下に位置する領域、すな
わちチヤンネル部分に設けた基板と同型不純物か
つ基板より不純物濃度の高い不純物層である。こ
の不純物層は本領域を構成するMOSTの1つ1
つに設けられる。60,61は領域47を構成す
る任意のMOST55のドレイン、またはソース
であり、第2導電型の不純物で作られる。56は
ゲート電極である。62―2はチヤンネル部分に
設けた不純物層であり、やはり本領域を構成する
MOSTの1つ1つに設けられる。第6図の実施
例の場合と同様、不純物層62―2の不純物濃度
NV 1(CH)は不純物層62―1の濃度NH 1(CH
)より高
く設定される。
NV 1(CH)>NH 1(CH)
以上、実施例を用いて詳細に説明したように、
水平走査回路の素子と垂直走査回路の素子のしき
い値電圧を異なる値にすることにより、高速、低
速の走査速度を得ることができ、また水平スイツ
チ素子と垂直スイツチ素子のしきい値電圧を異な
る値にすることにより、スイツチのリーク電流を
低減することができる。さらに、垂直スイツチ素
子のしきい値を高くしたことにより、ブルーミン
グ(強烈光による電荷の溢れ)を防ぐことができ
る。
水平走査回路の素子と垂直走査回路の素子のしき
い値電圧を異なる値にすることにより、高速、低
速の走査速度を得ることができ、また水平スイツ
チ素子と垂直スイツチ素子のしきい値電圧を異な
る値にすることにより、スイツチのリーク電流を
低減することができる。さらに、垂直スイツチ素
子のしきい値を高くしたことにより、ブルーミン
グ(強烈光による電荷の溢れ)を防ぐことができ
る。
なお、上記の説明では固体撮像装置の構成素子
として光ダイオードとMOS形走査回路の組み合
せを例にとつてのべたが、光ダイオードと電荷移
送形走査素子の組み合せからなる固体撮像装置に
おいても本発明を実施することができる。
として光ダイオードとMOS形走査回路の組み合
せを例にとつてのべたが、光ダイオードと電荷移
送形走査素子の組み合せからなる固体撮像装置に
おいても本発明を実施することができる。
第1図は従来の固体撮像装置の原理的構成を示
す図、第2図は第1図に示した固体撮像装置の構
造を示す断面図、第3図は固体撮像装置で使用す
る走査回路および動作特性を示す図、第4図およ
び第5図は本発明の固体撮像装置の平面構成を示
す図、第6図、第7図は本発明の固体撮像装置の
断面構造を示す図である。 1…水平走査回路、2…垂直走査回路、3…垂
直スイツチ(素子)、4…光電変換素子(光ダイ
オード)、5…垂直出力線、6…水平スイツチ
(素子)、7…水平出力線、10…半導体基板(第
1導電型基板)、11…絶縁用酸化膜、23,2
4,25,26,46,47…領域、51,55
…MOST(MOSトランジスタ)、57…第1導電
型不純物層、62…第1導電型不純物層。
す図、第2図は第1図に示した固体撮像装置の構
造を示す断面図、第3図は固体撮像装置で使用す
る走査回路および動作特性を示す図、第4図およ
び第5図は本発明の固体撮像装置の平面構成を示
す図、第6図、第7図は本発明の固体撮像装置の
断面構造を示す図である。 1…水平走査回路、2…垂直走査回路、3…垂
直スイツチ(素子)、4…光電変換素子(光ダイ
オード)、5…垂直出力線、6…水平スイツチ
(素子)、7…水平出力線、10…半導体基板(第
1導電型基板)、11…絶縁用酸化膜、23,2
4,25,26,46,47…領域、51,55
…MOST(MOSトランジスタ)、57…第1導電
型不純物層、62…第1導電型不純物層。
Claims (1)
- 1 同一半導体基板の一主表面上に2次元状に配
列され光情報に応じた信号電荷を蓄積する複数個
の光電変換素子と、垂直列の光電変換素子の信号
電荷を伝送するための垂直伝送手段と、この光電
変換素子の信号電荷をこの垂直伝送手段に取り出
すためのスイツチ手段と、この垂直伝送手段から
の信号電荷を所定の順序で出力端に伝送するため
の水平伝送手段とをそなえる固体撮像装置におい
て、上記スイツチ手段の少なくともチヤンネル部
分を基板と同じ導電型で基板よりも高い濃度の不
純物領域で形成し、このスイツチ手段のしきい値
を水平伝送手段を構成する素子のしきい値よりも
高くしたことを特徴とする固体撮像装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59157492A JPS60149271A (ja) | 1984-07-30 | 1984-07-30 | 固体撮像装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59157492A JPS60149271A (ja) | 1984-07-30 | 1984-07-30 | 固体撮像装置 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP52091362A Division JPS605108B2 (ja) | 1977-08-01 | 1977-08-01 | 固体擦像装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60149271A JPS60149271A (ja) | 1985-08-06 |
JPS6148308B2 true JPS6148308B2 (ja) | 1986-10-23 |
Family
ID=15650868
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59157492A Granted JPS60149271A (ja) | 1984-07-30 | 1984-07-30 | 固体撮像装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60149271A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0265110U (ja) * | 1988-11-02 | 1990-05-16 | ||
US10841892B2 (en) | 2003-06-27 | 2020-11-17 | Qualcomm Incorporated | Local area network assisted positioning |
US10895648B2 (en) | 2003-06-27 | 2021-01-19 | Qualcomm Incorporated | Method and apparatus for wireless network hybrid positioning |
-
1984
- 1984-07-30 JP JP59157492A patent/JPS60149271A/ja active Granted
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0265110U (ja) * | 1988-11-02 | 1990-05-16 | ||
US10841892B2 (en) | 2003-06-27 | 2020-11-17 | Qualcomm Incorporated | Local area network assisted positioning |
US10849092B2 (en) | 2003-06-27 | 2020-11-24 | Qualcomm Incorporated | Local area network assisted positioning |
US10895648B2 (en) | 2003-06-27 | 2021-01-19 | Qualcomm Incorporated | Method and apparatus for wireless network hybrid positioning |
Also Published As
Publication number | Publication date |
---|---|
JPS60149271A (ja) | 1985-08-06 |
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