JPS6130176A - 表示装置 - Google Patents
表示装置Info
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- JPS6130176A JPS6130176A JP15164484A JP15164484A JPS6130176A JP S6130176 A JPS6130176 A JP S6130176A JP 15164484 A JP15164484 A JP 15164484A JP 15164484 A JP15164484 A JP 15164484A JP S6130176 A JPS6130176 A JP S6130176A
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- Japan
- Prior art keywords
- crt
- capacitor
- bias voltage
- cathode
- reverse bias
- Prior art date
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- Pending
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- Transforming Electric Information Into Light Information (AREA)
- Details Of Television Scanning (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、陰極線管（以下ＣＲＴと呼ぶ）を使用するテ
レビジョン受像機やＣＲＴディスプレイ装置等の表示装
置に関するものである。
レビジョン受像機やＣＲＴディスプレイ装置等の表示装
置に関するものである。
従来例の構成とその問題点
第１図に従来例の表示装置を示す。
第１図に於いて、１はＣＲＴ、２はＦＢＴ（フライバッ
クトランス）、３はＣＲＴ用の陽極電圧出力端子、４は
ＣＲＴ用のフォーカス電圧出力端子、６はＣＲＴ用のス
クリーンＧ２電圧出力端子、−ド、８は高圧コンデンサ
、９は高圧プリーダ抵′抗、１０は水平用カドランシス
ター、１１は水平ダンパーダイオード、１２は水平共振
容量である。
クトランス）、３はＣＲＴ用の陽極電圧出力端子、４は
ＣＲＴ用のフォーカス電圧出力端子、６はＣＲＴ用のス
クリーンＧ２電圧出力端子、−ド、８は高圧コンデンサ
、９は高圧プリーダ抵′抗、１０は水平用カドランシス
ター、１１は水平ダンパーダイオード、１２は水平共振
容量である。
１６はＣＲＴの第１グリッドＧ１の電源用巻線であシ、
負極性の水平パルスを出力する。１６は水平パルス整流
用ダイオード、１７は平滑コンデンサー、１８．１９は
ＣＲＴの第１グリッドＧ１の電位−Ｂ２を決定する分圧
用抵抗である。
負極性の水平パルスを出力する。１６は水平パルス整流
用ダイオード、１７は平滑コンデンサー、１８．１９は
ＣＲＴの第１グリッドＧ１の電位−Ｂ２を決定する分圧
用抵抗である。
次に、第１図に従い、その動作を説明する。水平出力ト
ランジスタ１ｏのスイッチング動作により、ＦＢＴ２の
１次側（水平出力トランジスタ１Ｑのコレクター）にパ
ルスが発生する。２次側にはＦＢＴ２の１次と２次間の
巻数比に従う高電圧のパルスが発生し、整流ダイオード
７によシ整流されてＣＲＴ １の陽極に印加される。Ｃ
ＲＴｌの陽極電圧出力端子３とＦＢＴ２のグラウンド端
子６０間には静的高圧安定性を実現する為に高圧ブリー
ダ抵抗９が、また、動的高圧安定性を実現する為に高圧
コンデンサー８が接続されている。又、同じく２次側に
は、ＣＲＴｌの第１グリッドＧ１゜の電源用巻線１６が
設けられ、整流ダイオード１６、平滑用コンデンサー１
７により、負の電圧が得られる。この得られた負電圧は
分圧抵抗１８゜１９により分圧され、ＣＲＴｌの第１グ
リッドＧ１の負電位−Ｂ２が得られる。
ランジスタ１ｏのスイッチング動作により、ＦＢＴ２の
１次側（水平出力トランジスタ１Ｑのコレクター）にパ
ルスが発生する。２次側にはＦＢＴ２の１次と２次間の
巻数比に従う高電圧のパルスが発生し、整流ダイオード
７によシ整流されてＣＲＴ １の陽極に印加される。Ｃ
ＲＴｌの陽極電圧出力端子３とＦＢＴ２のグラウンド端
子６０間には静的高圧安定性を実現する為に高圧ブリー
ダ抵抗９が、また、動的高圧安定性を実現する為に高圧
コンデンサー８が接続されている。又、同じく２次側に
は、ＣＲＴｌの第１グリッドＧ１゜の電源用巻線１６が
設けられ、整流ダイオード１６、平滑用コンデンサー１
７により、負の電圧が得られる。この得られた負電圧は
分圧抵抗１８゜１９により分圧され、ＣＲＴｌの第１グ
リッドＧ１の負電位−Ｂ２が得られる。
ＣＲＴ表示装置の電源がオンからオフに切換えられると
、抵抗１９を高インピーダンスとし、−Ｂ２を保持した
としても、カソードに側の時定数が小さく、オフ後、す
ぐカソードＫ”ｌＪｌ電位が０となる為、ＣＲＴ １の
第１グリッドＧ１〜カソードに間は順バイアスとなる。
、抵抗１９を高インピーダンスとし、−Ｂ２を保持した
としても、カソードに側の時定数が小さく、オフ後、す
ぐカソードＫ”ｌＪｌ電位が０となる為、ＣＲＴ １の
第１グリッドＧ１〜カソードに間は順バイアスとなる。
ＣＲＴｌの陽極電圧及び、スクリーンＧ２電圧も高イン
ピーダンスで大容量の為、放電時定数が大きく、長時間
ＣＲＴ １への印加バイアスとして保持され、前記第１
グリッドＧ１ とカソードに間の順バイアスとあいま
って、ＣＲＴ表示装置の電源オフ後、ＣＲＴｌの中央付
近にスポットが残シ（この時、偏向系は時定４数が小さ
い為、先に偏向を停止している）、このスポットにはビ
ーム電流が集中する為、スポット焼けとなる問題がある
。
ピーダンスで大容量の為、放電時定数が大きく、長時間
ＣＲＴ １への印加バイアスとして保持され、前記第１
グリッドＧ１ とカソードに間の順バイアスとあいま
って、ＣＲＴ表示装置の電源オフ後、ＣＲＴｌの中央付
近にスポットが残シ（この時、偏向系は時定４数が小さ
い為、先に偏向を停止している）、このスポットにはビ
ーム電流が集中する為、スポット焼けとなる問題がある
。
このように、近年、ＣＲＴ表示装置はテレビジョン受像
機としてだけでなく、コンピュータのマンーマシーンイ
ンターフェーストシて広く活用すれるようになってきた
。それに伴い、高度の画像安定性が強く、望まれるよう
になってきた。特に、グラフィクディスプレイ装置では
、画像の動的な歪が目立つ為、ＣＲＴ陽極電圧の動的安
定性を改善するべく、高圧コンデンサ８の容量値を大き
くする必要がある。例えば、従来は１ｏｏｏｐＦ〜６０
００ｐＦが用いられている。高圧コンデンサ８の容量値
を１０００ｐＦ〜５ｏｏｏｐＦ とした場合には、ＣＲ
Ｔ表示装置の電源をオフにしてから高圧が放電する放電
時定数が６倍となる為、ＣＲＴ表示装置の電源をオフに
した時、ＣＲＴｌの中央部にビームスポットが残り、ス
ポット焼けを生じ易くなる。例として、ＣＲＴ表示装置
の電源オフ後のＣＲＴの陽極電圧の放電時定数Ｔを計算
するとＴ＝ＣＲ＝３秒 但し、 ｒＴ：放電時定数 前記放電時定数はＣＲＴ表示装置の電源オフ後に陽極電
圧が６３％放電するのに必要な時間であり、実際にスポ
ット残シが発生する恐れのある時間、すなわち、陽極電
圧が完全に放電を完了するまでには、時定数Ｘ５＝１５
秒という長い時間を必要とする。
機としてだけでなく、コンピュータのマンーマシーンイ
ンターフェーストシて広く活用すれるようになってきた
。それに伴い、高度の画像安定性が強く、望まれるよう
になってきた。特に、グラフィクディスプレイ装置では
、画像の動的な歪が目立つ為、ＣＲＴ陽極電圧の動的安
定性を改善するべく、高圧コンデンサ８の容量値を大き
くする必要がある。例えば、従来は１ｏｏｏｐＦ〜６０
００ｐＦが用いられている。高圧コンデンサ８の容量値
を１０００ｐＦ〜５ｏｏｏｐＦ とした場合には、ＣＲ
Ｔ表示装置の電源をオフにしてから高圧が放電する放電
時定数が６倍となる為、ＣＲＴ表示装置の電源をオフに
した時、ＣＲＴｌの中央部にビームスポットが残り、ス
ポット焼けを生じ易くなる。例として、ＣＲＴ表示装置
の電源オフ後のＣＲＴの陽極電圧の放電時定数Ｔを計算
するとＴ＝ＣＲ＝３秒 但し、 ｒＴ：放電時定数 前記放電時定数はＣＲＴ表示装置の電源オフ後に陽極電
圧が６３％放電するのに必要な時間であり、実際にスポ
ット残シが発生する恐れのある時間、すなわち、陽極電
圧が完全に放電を完了するまでには、時定数Ｘ５＝１５
秒という長い時間を必要とする。
また、従来のＣＲＴ １のスクリーンＧ２の電源回路は
、フライバックトランス２とは別に低インピーダンスで
構成する例が多かったが、コストダウンの観点より、第
１図に示す如く、高圧プリーダ抵抗９よシ分圧する例が
増えてきており、スクリーンＧ２電源回路は従来の低イ
ンピーダンス構成より高インピーダンス構成になってき
ている。
、フライバックトランス２とは別に低インピーダンスで
構成する例が多かったが、コストダウンの観点より、第
１図に示す如く、高圧プリーダ抵抗９よシ分圧する例が
増えてきており、スクリーンＧ２電源回路は従来の低イ
ンピーダンス構成より高インピーダンス構成になってき
ている。
この為、ＣＲＴ表示装置の電源をオフにしてから、長時
間、スクリーンＧ２電位が保持されることになり、前記
の場合と共にＣＲＴ表示装置の電源をオフにした時にス
ポット焼けが生じる確率を高めている。
間、スクリーンＧ２電位が保持されることになり、前記
の場合と共にＣＲＴ表示装置の電源をオフにした時にス
ポット焼けが生じる確率を高めている。
このようなスポット焼けが発生した場合には、表示装置
として最も重要なＣＲＴ １のスクリーンの中央部が使
用不可能になる為、多大の費用をかけてＣＲＴｌを交換
する必要が発生する。
として最も重要なＣＲＴ １のスクリーンの中央部が使
用不可能になる為、多大の費用をかけてＣＲＴｌを交換
する必要が発生する。
発明の目的
本発明は、かかる従来の欠点を解消して、ＣＲＴ表示装
置の電源をオフにした時に発生するスポット残りを完全
に防止し、高価なＣＲＴをＳ ＰＯＴ焼けから保護する
ことのできる表示装置を提供することを目的とする。
置の電源をオフにした時に発生するスポット残りを完全
に防止し、高価なＣＲＴをＳ ＰＯＴ焼けから保護する
ことのできる表示装置を提供することを目的とする。
発明の構成
本発明においては、ＣＲＴの第１“グリッド用の電源回
路中に、電源オフ後に第１グリッドとカソード間に逆バ
イアス電圧を印加するコンデンサと、その逆バイアス電
圧を長時間保持する放電防止用のダイオードとを設ける
ようにしたことを特徴としている。
路中に、電源オフ後に第１グリッドとカソード間に逆バ
イアス電圧を印加するコンデンサと、その逆バイアス電
圧を長時間保持する放電防止用のダイオードとを設ける
ようにしたことを特徴としている。
これによシ、電源オフ後にＣＲＴを長時間カットオフに
し、スポット焼けを防止することができるようにしたも
のである。
し、スポット焼けを防止することができるようにしたも
のである。
実施例の説明
第２図に本発明の一実施例の構成を示す。第２図では第
１図に対して点線で囲まれた２ｏの部分が追加されてお
り、この部分２ｏが本発明の基本的構成を成すものであ
る。第２図中、１〜１９は第１図と同一である為、説明
を省略する。
１図に対して点線で囲まれた２ｏの部分が追加されてお
り、この部分２ｏが本発明の基本的構成を成すものであ
る。第２図中、１〜１９は第１図と同一である為、説明
を省略する。
第２図中、２１は放電防止用ダイオード、２２はＣＲＴ
表示装置の電源オフ後にＣＲＴ １の第１グリッドＧ１
とカソードに間に逆バイアス電圧を与える為のコン
デンサ、２３はＣＲＴ表示装置の電源オン時にＣＲＴ
１の第１グリッドＧ１ とカソードに間に過度の順バイ
アスが印加されるのを防止する為の保護用ダイオードで
ある。
表示装置の電源オフ後にＣＲＴ １の第１グリッドＧ１
とカソードに間に逆バイアス電圧を与える為のコン
デンサ、２３はＣＲＴ表示装置の電源オン時にＣＲＴ
１の第１グリッドＧ１ とカソードに間に過度の順バイ
アスが印加されるのを防止する為の保護用ダイオードで
ある。
次に、第２図に従い本装置の動作を詳細に説明する。第
２図に於いて、ＣＲＴ表示装置の電源が通電状態からオ
フにされると、十Ｂラインの時定数が小さい為に逆バイ
アス電圧印加用コンデンサ２２の陽極側が先に０電位と
なる。従って、コンデンサ２２の陰極側すなわち第１グ
リッドＧ１の電位は第１表の如くなる。
２図に於いて、ＣＲＴ表示装置の電源が通電状態からオ
フにされると、十Ｂラインの時定数が小さい為に逆バイ
アス電圧印加用コンデンサ２２の陽極側が先に０電位と
なる。従って、コンデンサ２２の陰極側すなわち第１グ
リッドＧ１の電位は第１表の如くなる。
このように（−Ｂ２） −−（Ｂ１＋Ｂ２）と変化し、
第１グリッドＧ１の電位をマイナスに引き込む為、ＣＲ
Ｔ １のカソードにと第１グリッド０１ 間に逆バイア
ス電圧を与えることになる。
第１グリッドＧ１の電位をマイナスに引き込む為、ＣＲ
Ｔ １のカソードにと第１グリッド０１ 間に逆バイア
ス電圧を与えることになる。
又、ＣＲＴｌをカットオフさせる前記逆バイアス電圧は
放電防止用ダイオード２１により放電ルートが切断され
る為、（この時、ダイオード２１の陰極側電位は（−Ｂ
２） 、ダイオード２１の陽極側電位は−（Ｂ １＋Ｂ
２ ）の為、第２表のようにダイオード２１がカット
オフしている、長時間保持される。
放電防止用ダイオード２１により放電ルートが切断され
る為、（この時、ダイオード２１の陰極側電位は（−Ｂ
２） 、ダイオード２１の陽極側電位は−（Ｂ １＋Ｂ
２ ）の為、第２表のようにダイオード２１がカット
オフしている、長時間保持される。
以下余白
前記逆バイアス電圧が保持されている間にＣＲＴｌの陽
極電圧は放電を完了し、ＣＲＴ表示装置の電源オフ時に
発生するスポット焼けを完全に防止することができる。
極電圧は放電を完了し、ＣＲＴ表示装置の電源オフ時に
発生するスポット焼けを完全に防止することができる。
次に、ＣＲＴ表示装置の電源をオフからオンにした時に
は、十Ｂラインの時定数が小さい為、逆バイアス印加用
コンデンサー２２の陽極側が先に＋ Ｂ１ に充電され
る。従って、第１グリッドＧ１に高いプラス電位が与え
られ、ＣＲＴｌのカソードにと第１グリッド０１ 間は
過度の順バイアスとなるがこの時、保護用ダイオード２
３がオンし、第１グリッドＧ１ の電位をＯｖにクラン
プする為、第１グリッドＧ１〜カソードに間の過度の順
バイアスは阻止される。
は、十Ｂラインの時定数が小さい為、逆バイアス印加用
コンデンサー２２の陽極側が先に＋ Ｂ１ に充電され
る。従って、第１グリッドＧ１に高いプラス電位が与え
られ、ＣＲＴｌのカソードにと第１グリッド０１ 間は
過度の順バイアスとなるがこの時、保護用ダイオード２
３がオンし、第１グリッドＧ１ の電位をＯｖにクラン
プする為、第１グリッドＧ１〜カソードに間の過度の順
バイアスは阻止される。
第３図に他の実施例として、よシ安価な構成にしたもの
を示す。この実施例では、第２図と異って整流用ダイオ
ード１６と平滑用コンデンサー１７を省略している。第
３図の場合は、フライバックトランス２の巻線１５より
得られる水子ノくルスは抵抗１８．１９によシ必要なレ
ベルに分圧された後、放電防止用ダイオード２１により
ピーク整流され、逆バイアス印加用コンデンサー２２に
より平滑される。その他動作は第２図と同一である。
を示す。この実施例では、第２図と異って整流用ダイオ
ード１６と平滑用コンデンサー１７を省略している。第
３図の場合は、フライバックトランス２の巻線１５より
得られる水子ノくルスは抵抗１８．１９によシ必要なレ
ベルに分圧された後、放電防止用ダイオード２１により
ピーク整流され、逆バイアス印加用コンデンサー２２に
より平滑される。その他動作は第２図と同一である。
発明の効果
このように、本発明によれば、ＣＲＴ表示装置の電源を
オフにした時に発生するスポット残シを完全に防止し、
高価なＣＲＴをスポット焼けから完全に保護することが
できる。
オフにした時に発生するスポット残シを完全に防止し、
高価なＣＲＴをスポット焼けから完全に保護することが
できる。
また、本発明では、高インピーダンス回路であるＣＲＴ
第１グリッドＧ１ の電源回路で処理している為、極め
てコンパクトにかつ安価にスポット焼けの防止を実現で
きている。
第１グリッドＧ１ の電源回路で処理している為、極め
てコンパクトにかつ安価にスポット焼けの防止を実現で
きている。
第１図は従来例の表示装置の回路図、第２図は本発明の
一実施例の表示装置の回路図、第３図は本発明の他の実
施例の表示装置の回路図である。 １・・・・・・陰極線管（ＣＲＴ）、２・・・・・・フ
ライバックトランス（ＦＢＴ）、３・・・・・・陽極電
圧の出力端子、４・・・・・フォーカス電圧の出力端子
、５・・・・・・スクリーンＧ２電圧の出力端子、６・
・・・・・ＦＢＴのグラウンド端子、７・・・・・高圧
整流ダイオード、８・・・°゛°高圧コンデンサ、９・
・・・・・高圧プリーダ抵抗、１゜・・・・・・水平吊
カドランシスター、１１・・・・・・ダンパーダイオー
ド、１２・・・・・・水平共振容量、１６・・・・・・
第１グリッドＧ１電源用巻線、１６．１７・・・・・・
整流回路、１８．１９・・・・・分圧抵抗、２１・・・
・・放電防止用ダイオード、２２・・・・逆バイアス印
加用のコンデンサー、２３・・・・・・順バイアス防止
用のダイオード。
一実施例の表示装置の回路図、第３図は本発明の他の実
施例の表示装置の回路図である。 １・・・・・・陰極線管（ＣＲＴ）、２・・・・・・フ
ライバックトランス（ＦＢＴ）、３・・・・・・陽極電
圧の出力端子、４・・・・・フォーカス電圧の出力端子
、５・・・・・・スクリーンＧ２電圧の出力端子、６・
・・・・・ＦＢＴのグラウンド端子、７・・・・・高圧
整流ダイオード、８・・・°゛°高圧コンデンサ、９・
・・・・・高圧プリーダ抵抗、１゜・・・・・・水平吊
カドランシスター、１１・・・・・・ダンパーダイオー
ド、１２・・・・・・水平共振容量、１６・・・・・・
第１グリッドＧ１電源用巻線、１６．１７・・・・・・
整流回路、１８．１９・・・・・分圧抵抗、２１・・・
・・放電防止用ダイオード、２２・・・・逆バイアス印
加用のコンデンサー、２３・・・・・・順バイアス防止
用のダイオード。
Claims (1)
- 表示用の陰極線管の第１グリッド用の電源回路中に、電
源オフ後に上記第１グリッドとカソード間に逆バイアス
電圧を与えるコンデンサと、前記逆バイアス電圧を長時
間保持する放電防止用のダイオードとを設けたことを特
徴とする表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15164484A JPS6130176A (ja) | 1984-07-20 | 1984-07-20 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15164484A JPS6130176A (ja) | 1984-07-20 | 1984-07-20 | 表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6130176A true JPS6130176A (ja) | 1986-02-12 |
Family
ID=15523062
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15164484A Pending JPS6130176A (ja) | 1984-07-20 | 1984-07-20 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6130176A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62135260U (ja) * | 1986-02-20 | 1987-08-26 | ||
| EP0453162A2 (en) * | 1990-04-20 | 1991-10-23 | Matsushita Electric Industrial Co., Ltd. | Spot killer circuit having blanking function |
-
1984
- 1984-07-20 JP JP15164484A patent/JPS6130176A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62135260U (ja) * | 1986-02-20 | 1987-08-26 | ||
| EP0453162A2 (en) * | 1990-04-20 | 1991-10-23 | Matsushita Electric Industrial Co., Ltd. | Spot killer circuit having blanking function |
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