JPS61247130A - 符号化・複号化装置 - Google Patents
符号化・複号化装置Info
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- JPS61247130A JPS61247130A JP60089583A JP8958385A JPS61247130A JP S61247130 A JPS61247130 A JP S61247130A JP 60089583 A JP60089583 A JP 60089583A JP 8958385 A JP8958385 A JP 8958385A JP S61247130 A JPS61247130 A JP S61247130A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は符号化・複合化装置に関するものである。
従来、送信側に符号化装置を設けることにより送信すべ
き信号を符号化し、一方、受信側に複合化装置を設ける
ことにより、上記信号を複合化して情報を再生すること
が知られている。
き信号を符号化し、一方、受信側に複合化装置を設ける
ことにより、上記信号を複合化して情報を再生すること
が知られている。
第６図及び第７図は従来技術による符号化複合化装置を
示す。第６図中、１は情報入力端子、２は情報出力端子
、３はＣＯ符号器、４はＣｒ、符号器、５はＱ符号器、
６はＲ符号器、７は通信路、８は受信語メモリー、９は
Ｃｒ複複層器１０はＣ８複号器、１１はＱ再生器、１２
はＱ復号器、１３はＲ再生器、１４はＲ復号器、Ｓｔ、
Ｓ２はスイッチ、Ｐｉ、Ｐ２．Ｐ３．ＴＩ、Ｔ２．Ｔ３
はスイッチ端子、ＡＩ、Ａ２．Ａ３．Ａ４は法２の加算
器である。
示す。第６図中、１は情報入力端子、２は情報出力端子
、３はＣＯ符号器、４はＣｒ、符号器、５はＱ符号器、
６はＲ符号器、７は通信路、８は受信語メモリー、９は
Ｃｒ複複層器１０はＣ８複号器、１１はＱ再生器、１２
はＱ復号器、１３はＲ再生器、１４はＲ復号器、Ｓｔ、
Ｓ２はスイッチ、Ｐｉ、Ｐ２．Ｐ３．ＴＩ、Ｔ２．Ｔ３
はスイッチ端子、ＡＩ、Ａ２．Ａ３．Ａ４は法２の加算
器である。
第７図は従来方式の符号化プロセスを示す図である。
第７図で１６はｋｘｋやシンボルの第１情報１１．１７
はｇ。ｘ ｋｘ−シンボルの第２情報■２．１８はｋ
ｘｇトシンボルの第３情報γ ■う、１９はＣ６符号のチェック部分、２０はＱ符号の
チェック部分、２１はＲ符号のチェック部分、２２はＣ
Ｉ−符号のチェック部分に重畳符号Ｑを重畳させた部分
、２３はＣｒ、符号のチェック部分、２４は行符号Ｃ２
のチェック部分に重畳符号Ｒを重畳された部分、２５は
ＣＱ符号化プロセス、２６はＱ符号化プロセス、２７は
Ｒ符号化プロセス、２８は符号Ｃｃに符号Ｑを重畳する
プロセス、２９はＣｊ符号化プロセス、３０は符号Ｃ２
に符号Ｒを重畳するプロセスである。
はｇ。ｘ ｋｘ−シンボルの第２情報■２．１８はｋ
ｘｇトシンボルの第３情報γ ■う、１９はＣ６符号のチェック部分、２０はＱ符号の
チェック部分、２１はＲ符号のチェック部分、２２はＣ
Ｉ−符号のチェック部分に重畳符号Ｑを重畳させた部分
、２３はＣｒ、符号のチェック部分、２４は行符号Ｃ２
のチェック部分に重畳符号Ｒを重畳された部分、２５は
ＣＱ符号化プロセス、２６はＱ符号化プロセス、２７は
Ｒ符号化プロセス、２８は符号Ｃｃに符号Ｑを重畳する
プロセス、２９はＣｊ符号化プロセス、３０は符号Ｃ２
に符号Ｒを重畳するプロセスである。
第６図で第１情報■１が端子１より入力されスイッチＳ
１．端子Ｐ１．を通過して、Ｃｏ符号器３へ入力される
。Ｃ，符号器３で符号化された情報■１は第７図（ｂ）
のようなｎＧｘ ｋｒシンボルの中間的な符号語呈とな
る。一方、ｇ ｏＸｋＸジオボルの情報Ｉ２が入力端子
１より入力される。この時スイッチＳ１は接続端子Ｐ２
．に切り換っており、第２情報■２は端子Ｐ２よりＱ符
号器５へ入力されＱ符号化される。第７図（ｄ）に示す
ようなｇ ｘ ｋ、シンボルに符号化されたＱ符号
語は第６図Ａ１の加算回路で重畳され第７図（ｅ）に示
すようなｎ。ｘｋｒシンボルの中間的ケ符号語且となり
、Ｃ１符号器４λ入力されてＣｙ−符号化が行われる（
第７図（ｆ））。一方、ｋ ｙ ｘ ｇ ｒシンボル
の第３情報Ｉ−５が入力端子１より入力される。この時
スイッチＳ１は接続端子Ｐ３へ切り換えられており情報
はＲ符号器６へ入力されてＲ符号語が加算器Ａ２で加算
されることによって重畳され第７図（１）のごとく最終
的にｎ Ｘ ｎｐシンボルの符号語を得る。
１．端子Ｐ１．を通過して、Ｃｏ符号器３へ入力される
。Ｃ，符号器３で符号化された情報■１は第７図（ｂ）
のようなｎＧｘ ｋｒシンボルの中間的な符号語呈とな
る。一方、ｇ ｏＸｋＸジオボルの情報Ｉ２が入力端子
１より入力される。この時スイッチＳ１は接続端子Ｐ２
．に切り換っており、第２情報■２は端子Ｐ２よりＱ符
号器５へ入力されＱ符号化される。第７図（ｄ）に示す
ようなｇ ｘ ｋ、シンボルに符号化されたＱ符号
語は第６図Ａ１の加算回路で重畳され第７図（ｅ）に示
すようなｎ。ｘｋｒシンボルの中間的ケ符号語且となり
、Ｃ１符号器４λ入力されてＣｙ−符号化が行われる（
第７図（ｆ））。一方、ｋ ｙ ｘ ｇ ｒシンボル
の第３情報Ｉ−５が入力端子１より入力される。この時
スイッチＳ１は接続端子Ｐ３へ切り換えられており情報
はＲ符号器６へ入力されてＲ符号語が加算器Ａ２で加算
されることによって重畳され第７図（１）のごとく最終
的にｎ Ｘ ｎｐシンボルの符号語を得る。
受信側では送信側の全く逆の操作を行えばよい。
通信路７上で雑音１５が加わった形で受信された受信ベ
クトルは受信語メモリー８へ蓄えられる。
クトルは受信語メモリー８へ蓄えられる。
受信ベクトルはＲ再生層１３へ入力されＣゎ符号の内部
符号化によって０１符号のチェック部分が受信ベクトル
から再生され受信ベクトルのチェック部分と法２加算す
ることによってＲ符号語を再生する。再生されたＲ符号
語はＲ復号器１４へ入力されて誤り訂正され、情報部分
ＩＢは端子Ｔ３、スイッチＳ２を通過して出力される。
符号化によって０１符号のチェック部分が受信ベクトル
から再生され受信ベクトルのチェック部分と法２加算す
ることによってＲ符号語を再生する。再生されたＲ符号
語はＲ復号器１４へ入力されて誤り訂正され、情報部分
ＩＢは端子Ｔ３、スイッチＳ２を通過して出力される。
再生されたＲ符号語は加算回路Ａ−３によって受信語と
加算され受信ベクトルからＲ符号語の影響完全に消しさ
る。次にデータはＣｒ複号器９へ入力されＣｒ、復号が
なされる。Ｃｒ複復号よって誤りを訂正し、中間的な受
信ベクトル基を得る。そしてデータはＱ再生層１１へ入
力され中間的な受信ベクトル基から符号Ｃｃのチェック
部分を再生する。再生されたチェック部分は中間的な受
信ベクトル基へ加算されてＱ符号語を再生する。Ｑ符号
語はＱ復号器１２で誤り訂正される。この時スイッチＳ
ｚは端子Ｔ２へ接続され第２情報■２は端子Ｔ２、スイ
ッチＳｚを通過して情報出力端子２より出力される。次
に復号されたＱ符号語を中間的な受信ベクトル基に加算
してＣＧ符号語を再生する。この時スイッチＳ２は端子
Ｔ１へ接続されており第１情報■１は端子Ｔ１．スイッ
チＳ２を通過して情報出力端子２より出力される。
加算され受信ベクトルからＲ符号語の影響完全に消しさ
る。次にデータはＣｒ複号器９へ入力されＣｒ、復号が
なされる。Ｃｒ複復号よって誤りを訂正し、中間的な受
信ベクトル基を得る。そしてデータはＱ再生層１１へ入
力され中間的な受信ベクトル基から符号Ｃｃのチェック
部分を再生する。再生されたチェック部分は中間的な受
信ベクトル基へ加算されてＱ符号語を再生する。Ｑ符号
語はＱ復号器１２で誤り訂正される。この時スイッチＳ
ｚは端子Ｔ２へ接続され第２情報■２は端子Ｔ２、スイ
ッチＳｚを通過して情報出力端子２より出力される。次
に復号されたＱ符号語を中間的な受信ベクトル基に加算
してＣＧ符号語を再生する。この時スイッチＳ２は端子
Ｔ１へ接続されており第１情報■１は端子Ｔ１．スイッ
チＳ２を通過して情報出力端子２より出力される。
従来方式はこのように符号化−重畳化一符号化一重畳化
の手順を踏んでいるので積符号のチェックオンチェック
部まで情報または検査シンボルを重畳することができる
ようになっている。
の手順を踏んでいるので積符号のチェックオンチェック
部まで情報または検査シンボルを重畳することができる
ようになっている。
上記のような符号化・複号化装置ではＣｐ符号化の方向
とＱ符号化の方向が同一方向であるため合成した時の距
離がＣ６符号、Ｑ符号の最小距離をｄｐ、ｄｇとすると
きｄｌ−ｘ ｄｚにはならずｍａｘ （ｄ、、ｄ、１
）にしかならなかった。即ち、このままでは積符号本来
の合成距離ｄＢ−ｘ ｄｔは保てず、その結果、Ｑ符
号に距離の大なる符号を用いなければならず、このため
、その分重畳される情報記号数が少くなるという問題点
があった。
とＱ符号化の方向が同一方向であるため合成した時の距
離がＣ６符号、Ｑ符号の最小距離をｄｐ、ｄｇとすると
きｄｌ−ｘ ｄｚにはならずｍａｘ （ｄ、、ｄ、１
）にしかならなかった。即ち、このままでは積符号本来
の合成距離ｄＢ−ｘ ｄｔは保てず、その結果、Ｑ符
号に距離の大なる符号を用いなければならず、このため
、その分重畳される情報記号数が少くなるという問題点
があった。
この発明はかかる問題点を解決するためになされたもの
で、Ｑ符号とＣｒ符号を直交させるよう両符号語で高々
１シンボルづつしか共有しないようインタリーブをかけ
合成距離をｄＩ−ｘ ｄｆとれるようにすることを目的
とする。
で、Ｑ符号とＣｒ符号を直交させるよう両符号語で高々
１シンボルづつしか共有しないようインタリーブをかけ
合成距離をｄＩ−ｘ ｄｆとれるようにすることを目的
とする。
〔問題点を解決するための手段〕
本発明は、メモリのアドレスを制御回路の指令により所
定の手順でアクセスするインタリーバ−を設けることに
より、重畳符号Ｕの符号語を行符号Ｃｒ１列符号Ｃ６の
いずれかに直交させたものである。
定の手順でアクセスするインタリーバ−を設けることに
より、重畳符号Ｕの符号語を行符号Ｃｒ１列符号Ｃ６の
いずれかに直交させたものである。
本発明においては、インタリーバーによってＣｒ符合語
とＱ符号語が直交化（１シンボルづつしか共有しない）
するから、最小距離が互いの符号語の積となり大きな訂
正能力を発揮できる。
とＱ符号語が直交化（１シンボルづつしか共有しない）
するから、最小距離が互いの符号語の積となり大きな訂
正能力を発揮できる。
第１図は本発明の実施例をしめずブロック接続図である
。１〜１５およびＡ（〜Ａ４．Ｓ１．ｓ２゜Ｐｌ、Ｒ２
，ｐ、、Ｔ（、Ｔｚ、Ｔ＠は第６図と同じものである。
。１〜１５およびＡ（〜Ａ４．Ｓ１．ｓ２゜Ｐｌ、Ｒ２
，ｐ、、Ｔ（、Ｔｚ、Ｔ＠は第６図と同じものである。
然るに、３１はインタリーバ−１３２はデ・インタリー
バである。
バである。
第２図は本方式の符号化過程を示す図、図中、番号１６
〜３０は第７図と同じものである。Ｗはインタリーブの
プロセスを示す。
〜３０は第７図と同じものである。Ｗはインタリーブの
プロセスを示す。
第３図は本発明によるインタリーブを示すＲＡＭメモリ
ーの内容とアドレス制御を示す図で、例として符号化装
置側の６３ｘ１６ビツトのメモリーマトリクスで説明し
ている。
ーの内容とアドレス制御を示す図で、例として符号化装
置側の６３ｘ１６ビツトのメモリーマトリクスで説明し
ている。
図中で、３３はＸデコーダー、３４はＹデコーダー、３
５は送信側でＣｒ符号器４に含まれるラム（ＲＡＭ）メ
モリーＲ％を示す。Ｘ ａ 、 Ｘｌ 。
５は送信側でＣｒ符号器４に含まれるラム（ＲＡＭ）メ
モリーＲ％を示す。Ｘ ａ 、 Ｘｌ 。
ｘ２．ｘ、はＸデコーダー３３の入力端子、Ｘ Ｏ＋Ｘ
、・・・、ｘ＋ｓはＸデコーダー３３の出力リード線
を示す。又、Ｙ Ｙ、・・・、Ｙ５はＹテコ−０・
１ ダ−３４（７）入力端子、１６ 、’１１． ・・”、
）’ＡｍはＹデコーダ３４の出力リード線を示す。又、
ｑｏ。
、・・・、ｘ＋ｓはＸデコーダー３３の出力リード線
を示す。又、Ｙ Ｙ、・・・、Ｙ５はＹテコ−０・
１ ダ−３４（７）入力端子、１６ 、’１１． ・・”、
）’ＡｍはＹデコーダ３４の出力リード線を示す。又、
ｑｏ。
ｑ 、・・・、ｑ８はＱ符号語の各シンボルを示す。
又、Ｃ〜、Ｃ，、・・・、ＣＦ、□はインタリーブされ
た各Ｃｒ符号語を示す。
た各Ｃｒ符号語を示す。
インタリーブ、ディンタリーブ以外は従来方式と全く同
じなのでインタリーブ、ディンタリーバを説明する。
じなのでインタリーブ、ディンタリーバを説明する。
Ｃｉ符号に（６３，５６，４）ＳＥＣ−ＤＢＤ符号から
短縮して（９，６，４）ＳＥＣ−ＤＥＤ符号をＣ６符号
に（６３，５６，４）ＳＥＣ−ＤＥＤ符号を選ぶ。
短縮して（９，６，４）ＳＥＣ−ＤＥＤ符号をＣ６符号
に（６３，５６，４）ＳＥＣ−ＤＥＤ符号を選ぶ。
第１情報■１は第２図（ａ）に示すように５６ｘ９ビツ
トのマトリクス状に配置される。ｃｏ符号化で各々７ビ
ツトの検査ビットが付加される。
トのマトリクス状に配置される。ｃｏ符号化で各々７ビ
ツトの検査ビットが付加される。
６３ｘ９ビツトのマトリクス状の配置が得られる（第２
図（ｂ））、７ｘ６ビツトの第２情報■ｚがＧＦ（２）
上の（９，６，４） Ｒ３（Ｒｅｅｄ−３ｏｌｏｍｏｎ
）符号Ｕｑによって符号化される（第２図（ｄ））。符
号ＵＱをＣ８の検査記号部に重畳する。
図（ｂ））、７ｘ６ビツトの第２情報■ｚがＧＦ（２）
上の（９，６，４） Ｒ３（Ｒｅｅｄ−３ｏｌｏｍｏｎ
）符号Ｕｑによって符号化される（第２図（ｄ））。符
号ＵＱをＣ８の検査記号部に重畳する。
６３ｘ９ビツトのマトリクス状の配置が得られる（第２
図（ｅ））。
図（ｅ））。
次にＣＩ−符号化がなされるが第３図に示すインタリー
ブがかけられ、各符号語Ｃ，，，Ｃ，，・・・。
ブがかけられ、各符号語Ｃ，，，Ｃ，，・・・。
Ｃｉ４□は第３図の各矢印の方向に符号化されＵｇ。
符号語とは１シンボルづつしか交わらないようになって
いる。
いる。
このようにしてＵα符号語とＣ２符号語の直交化がなさ
れた。復号側ではディンタリーバ３２によって受信語メ
モリー８から各Ｃ，，，Ｃ，，・・・。
れた。復号側ではディンタリーバ３２によって受信語メ
モリー８から各Ｃ，，，Ｃ，，・・・。
Ｃｒ Ｇ２．に対応するＣ 受信語を図３の矢印にとり
出しＣ１受信語を復号する。
出しＣ１受信語を復号する。
第４図は本発明の符号化ハードウェア構成図、第５図は
本発明の復号化ハードウェア構成図である。
本発明の復号化ハードウェア構成図である。
第４でＲ２はＣｉ−符号器４の中に内臓されているラム
（ＲＡＭ）メモリー、３７はアドレス／コントロール／
信号バス、３８は制御回路、３〜６は第６図のものと同
じである。
（ＲＡＭ）メモリー、３７はアドレス／コントロール／
信号バス、３８は制御回路、３〜６は第６図のものと同
じである。
第５図で３９はアドレス／データ／コントロール信号バ
ス、４０は制御回路、８〜１４は第６図に示したものと
同じである。
ス、４０は制御回路、８〜１４は第６図に示したものと
同じである。
符号化側では第４図で、制御回路３８は第３図のアドレ
スを各インタリーブの方向へ制御するためＸアドレスデ
コーダ３３．Ｙアドレスデコーダ３４ヘアドレス情報を
出力する。
スを各インタリーブの方向へ制御するためＸアドレスデ
コーダ３３．Ｙアドレスデコーダ３４ヘアドレス情報を
出力する。
復号化側では第５図で、制御回路４０は第３図の各アド
レスを各インクリープの方向へ制御するためＸアドレス
デコーダ３３、Ｙアドレスデコーダ３４へのアドレス情
報を出力する。
レスを各インクリープの方向へ制御するためＸアドレス
デコーダ３３、Ｙアドレスデコーダ３４へのアドレス情
報を出力する。
以上説明したように本発明によれば、メモリーのアドレ
スを制御回路の指令により所定の手順でアクセスするイ
ンタリーバーを設け、インタリーブを施すことによりＵ
Ｑ符号器とＣ，−符号語が直交するように配置するので
Ｕα符号語の最小距離が少くてすむ特徴があり、その分
Ｕ 符号語に多くの情報を重畳せしめることができる効
果がある。
スを制御回路の指令により所定の手順でアクセスするイ
ンタリーバーを設け、インタリーブを施すことによりＵ
Ｑ符号器とＣ，−符号語が直交するように配置するので
Ｕα符号語の最小距離が少くてすむ特徴があり、その分
Ｕ 符号語に多くの情報を重畳せしめることができる効
果がある。
即ち、インタリーブを施さないとＱ符号、Ｒ符号ともに
４ｘ４＝１６の距離が必要であるが、インタリーブを施
すとＱ符号は距離４の符号でよいことになる。
４ｘ４＝１６の距離が必要であるが、インタリーブを施
すとＱ符号は距離４の符号でよいことになる。
第１図は本発明による一実施例を示すブロック接続図、
第２図は本発明の符号化プロセスを説明する図、第３図
は本発明のインタリーブ方式を説明する図、第４図は本
発明の符号化側ハードウェア構成図、第５図は本発明の
復号化側ハードウェア構成図、第６図は従来方式のブロ
ック接続図、第７図は従来方式の符号化過定を示す図で
ある。 図において、３はＣ６符号器、４はＣｊ符号器、５はＱ
符号器、６はＲ符号器、８は受信語メモリー、９はＣＨ
複号器、１０はＣｃ複号器、１１はＱ再生器、１２はＱ
復号器、１３はＲ再生器、１４はＲ復号器、Ａ１．Ａ２
．Ａう、Ａ４は法２の加算回°路、Ｓ、Ｓ、はスイッチ
、３１はインタリーバー１３２はディンタリーバ−６ なお、図中、同一符号は同一または相当部分を示す。 代理人 大音 増雄（ほか２名） ＋１図 ＋２図 ｆ−５図 ＋６図
第２図は本発明の符号化プロセスを説明する図、第３図
は本発明のインタリーブ方式を説明する図、第４図は本
発明の符号化側ハードウェア構成図、第５図は本発明の
復号化側ハードウェア構成図、第６図は従来方式のブロ
ック接続図、第７図は従来方式の符号化過定を示す図で
ある。 図において、３はＣ６符号器、４はＣｊ符号器、５はＱ
符号器、６はＲ符号器、８は受信語メモリー、９はＣＨ
複号器、１０はＣｃ複号器、１１はＱ再生器、１２はＱ
復号器、１３はＲ再生器、１４はＲ復号器、Ａ１．Ａ２
．Ａう、Ａ４は法２の加算回°路、Ｓ、Ｓ、はスイッチ
、３１はインタリーバー１３２はディンタリーバ−６ なお、図中、同一符号は同一または相当部分を示す。 代理人 大音 増雄（ほか２名） ＋１図 ＋２図 ｆ−５図 ＋６図
Claims (1)
- 送信側で行（又は列）符号化→重畳符号化→列（又は行
符号化）と情報を符号化し、受信側でその逆変換を行っ
て情報を送受信する符号化、複号化装置において、メモ
リーのアドレスを制御回路の指令により所定の手順でア
クセスするインタリーバーを設けることにより、重畳符
号Ｕの符号語を行符号Ｃ＿ｒ、列符号Ｃ＿ｃのいずれか
に直交させたことを特徴とする符号化・複号化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60089583A JPS61247130A (ja) | 1985-04-25 | 1985-04-25 | 符号化・複号化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60089583A JPS61247130A (ja) | 1985-04-25 | 1985-04-25 | 符号化・複号化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61247130A true JPS61247130A (ja) | 1986-11-04 |
Family
ID=13974805
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60089583A Pending JPS61247130A (ja) | 1985-04-25 | 1985-04-25 | 符号化・複号化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61247130A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07105751B2 (ja) * | 1987-02-02 | 1995-11-13 | モトローラ・インコーポレーテツド | 適応等化器制御機能を具備する時分割多元接続（ｔｄｍａ）通信システム |
-
1985
- 1985-04-25 JP JP60089583A patent/JPS61247130A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07105751B2 (ja) * | 1987-02-02 | 1995-11-13 | モトローラ・インコーポレーテツド | 適応等化器制御機能を具備する時分割多元接続（ｔｄｍａ）通信システム |
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