JPS61162081U - - Google Patents
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- Publication number
- JPS61162081U JPS61162081U JP4573185U JP4573185U JPS61162081U JP S61162081 U JPS61162081 U JP S61162081U JP 4573185 U JP4573185 U JP 4573185U JP 4573185 U JP4573185 U JP 4573185U JP S61162081 U JPS61162081 U JP S61162081U
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- JP
- Japan
- Prior art keywords
- layer
- conductor layer
- conductor
- wiring
- wiring board
- Prior art date
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- Pending
Links
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Landscapes
- Electronic Switches (AREA)
Description
第1図は、本考案の多層配線基板の配線パター
ンの断面形状を示す説明図、第2図a乃至第2図
dは、本考案実施例の多層配線基板の製造工程を
示す図、第3図は従来の多層配線基板を示す図で
ある。 101……基板、102……第1の配線パター
ン、103……層間絶縁膜、104……第2の配
線パターン、105……スルーホール、E……エ
ツジ部分、1……基板、2……配線層、2a……
第1の導体層、2b……第2の導体層、10……
セラミツク基板、11……(第1の)配線層、1
1a……金薄膜、11b……銅薄膜、12……ポ
リイミド膜、13……スルーホール、14……第
2の配線層。
ンの断面形状を示す説明図、第2図a乃至第2図
dは、本考案実施例の多層配線基板の製造工程を
示す図、第3図は従来の多層配線基板を示す図で
ある。 101……基板、102……第1の配線パター
ン、103……層間絶縁膜、104……第2の配
線パターン、105……スルーホール、E……エ
ツジ部分、1……基板、2……配線層、2a……
第1の導体層、2b……第2の導体層、10……
セラミツク基板、11……(第1の)配線層、1
1a……金薄膜、11b……銅薄膜、12……ポ
リイミド膜、13……スルーホール、14……第
2の配線層。
Claims (1)
- 所定の素子領域の形成された基板上に層間絶縁
膜を介して2層以上の配線層の形成された多層配
線基板において、少なくとも下層側に配設される
配線層は第1の導体層および第2の導体層が順次
積層せしめられてなる2層構造を有しており、該
第2の導体層は配線パターン形成のためのエツチ
ング条件に対し、第1の導体層よりもエツチング
速度が大きい材料から構成されていることを特徴
とする多層配線基板。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4573185U JPS61162081U (ja) | 1985-03-28 | 1985-03-28 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4573185U JPS61162081U (ja) | 1985-03-28 | 1985-03-28 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61162081U true JPS61162081U (ja) | 1986-10-07 |
Family
ID=30559488
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4573185U Pending JPS61162081U (ja) | 1985-03-28 | 1985-03-28 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61162081U (ja) |
-
1985
- 1985-03-28 JP JP4573185U patent/JPS61162081U/ja active Pending