JPS61153728A - 磁気記憶装置の高速制御方式 - Google Patents

磁気記憶装置の高速制御方式

Info

Publication number
JPS61153728A
JPS61153728A JP59277391A JP27739184A JPS61153728A JP S61153728 A JPS61153728 A JP S61153728A JP 59277391 A JP59277391 A JP 59277391A JP 27739184 A JP27739184 A JP 27739184A JP S61153728 A JPS61153728 A JP S61153728A
Authority
JP
Japan
Prior art keywords
magnetic storage
storage device
host system
buffer memory
data
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59277391A
Other languages
English (en)
Inventor
Minoru Koyanagi
小柳 稔
Toshihiro Masumoto
増元 俊博
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP59277391A priority Critical patent/JPS61153728A/ja
Publication of JPS61153728A publication Critical patent/JPS61153728A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Memory System Of A Hierarchy Structure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (技術分野) 本発明は、磁気記憶装置の高速制御力式に関する0 (従来技術) 従来、磁気記憶装置の制一方式は、ホストシステムとの
データ処理のスピードの違いを解決する為に、ホストシ
ステムと磁気記憶装置間にデータパ、7アをもたせ、書
込み拳読み出しデータを一時データパ、7アに蓄えるこ
とによって、ホストシステムの介在をなくし磁気記憶装
置側の処jIKまかせていた0従って磁気記憶装置がデ
ータの処理を行っている場合、ホストシステムは、磁気
記憶装置側へのアクセスが禁止される為、tB磁気記憶
装置側処理が終了する迄待ち続けなければならなかつた
〇 この為大量のデータを磁気記憶装置にセーブしようとす
る場合ホストシステムは次のような動きを繰シ返し行わ
なければならなかりた0■ホストシステムはバックアメ
モリにデータをセットする。
■このバッフアメそりから磁気記憶装置にデータを転送
する。この時ホストシステムは、バッファメモリをアク
セスできない為、磁気記憶装置からの動作終了の割込み
をセンスしている。
■磁気記憶装置は、バッファメモリ分のデータのセーブ
を終了すると割込みをアクティブにする。
ホストシステムは割込み信号を確認後■の処理へ飛ぶ。
このようにホストシステムと磁気記憶装置とのデータの
処理方式はノ1ンド囃シェイク方式で動作しておシ、互
いに待ち時間が多くなシ粛続的にしかデータの転送を行
なえないと云う欠点があった。
(発明の目的) 本発明は従来の磁気記憶装置の為速制御方式におけるか
かる欠点を除去し、ホストシステムと磁気記憶装置との
データの受は渡し継続的に処理する磁気記憶装置の高速
制御方式を提供することにある0 (発明の構a) 本発明によればホストシステムに接続される磁気記憶装
置において、前記ホストシステムと磁気記憶装置間に少
なくとも2つのバッファメモリを有し、前船2つのバッ
ファメモリを交互に用いることKより、ホストシステム
と磁気記憶装置間のデータ転送を継続的に処理すること
を特徴とする磁気記憶装置の高速制御力式が得られる。
(5!施例) 久に本発明の実施例について図面を参照して詳細に説明
する。
図面は本発明の一実施例である磁気記憶装置の高速制御
方式を示す。図において、本実施例はホストシステム(
I(S ) 10に接続される磁気記憶装置(DISK
)20を制御する高速制御方式で、ホストシステム10
に直接接続されるマルチプレクサ(MPXI )31と
、磁気記憶装置20に直接接続されるマルチプレクサ(
MPX2 ) 32 、!:。
これらマルチプレクサ間に設けられるバッファメモリ(
BMI)33およびバッファメモリ(8M2)34と、
マルチプレクサ31に接続され、バッファメモリ33お
よびバッファメモリ34側のデータをそれぞれ制御する
ディスクコントローラ(DC)35と、工10命令によ
りこれらマルチプレクサ31および32を制御する7す
、グア0.グ(k゛/F)36とを含む。
本実施例では、ホストシステム10と磁気記憶装置20
間のバッファメモリ33.34を2つのプロ、りに分け
ることによシ、ホストシステムlOが磁気記憶装置20
を制御する際、−万をホストシステム用に、他方を磁気
記憶装置20用にと順次バッファメモリを交換しながら
使用することにより、磁気記憶装[2Gが、データの処
理中であっても、ホストシステムが1片方のバッファメ
モリをアクセスすることが可能になる。
従って本実施例は本ストシステムーバ、7アメモリ間と
バッファメモリー磁気記憶装置間のデータの転送や処理
が同時に並列に処理可能となる為ホストシステムと磁気
記憶装置間のデータの転送を継続的に行なえる。
次に本発明の一実施例について、磁気記憶装置にデータ
を書込む場合を説明する。
■ホストシステム10はバッファメモリ33をホストシ
ステム10に1バ、グアメモリ34を磁気記憶装置20
に@D当てるようにI10命令を送出する。
■ホスト7ステムioはバッファメモリ331C磁気記
憶装置20に書き込む為のデータをセ、卜する0 ■ホストシステム10はバッファメモIJ 33 ft
磁気記憶装置20に%バッファメモリ34をホスト7ス
テム10Kaり轟てるよ5KI10#令を送出する。
■ホスト7ステムlOがディスクコントローラ35にコ
マンドを与えることによりバッファメモリ33のデータ
を磁気記憶装置20に転送する。
この処理と並行してホストシステム10はバッファメモ
リ34に磁気記憶装[20に曹込む為のデータをセット
する。
■バッファメモリ33のデータを全て磁気記憶装置に転
送したならばホストシステムlOは再びバッファメモリ
33をホストシステムIOKバ。
7アメモリ34を磁気記憶装置20に割り当てるように
I10命令を送出する0 ■■ホストシステム10がディスクコントローラ35に
コマンドを与えることによシメモリパ。
7ア34のデータを磁気記憶装置20に転送する。
この処理と並行してホストシステム10はメモリバ、7
733にデータをセ、卜する0 このように■〜■のシーケンスを順次繰り返すことKよ
シ磁気記憶装置へのデータの書込みや読み出しは実行さ
れる。
仁の実施例においては磁気記憶装置側がデータを処理し
ている場合においてもホストシステムはパ、ファメモリ
忙対して常にアクセスすることができる為、ホストシス
テム及び磁気記憶装置を動車的に使用することができる
・ (発明の効果) 本発明は、以上説明したように1ホストシステムと磁気
記憶装置間のバッファメモリを2つのプロ、りに分割す
ることによ、少ホストシステムは。
常時バッファメモリへのアクセスが可能となり磁気記憶
装置をよシ効車的に使用できると云う効果がある。
【図面の簡単な説明】
図面は本発明の一実施例である磁気記憶装置の高速制御
方式を示す図である。 10・・・・・・ホストシステム、20 ・・・磁気記
憶装置ll、31.32・・・・・・マルチブレフサ、
33.34・・・・・・バッファメモIJ、35  ・
・・・ディスクコントローラ◇

Claims (1)

    【特許請求の範囲】
  1. ホストシステムに接続される磁気記憶装置に於いて、前
    記ホストシステムと磁気記憶装置間に少なくとも2つの
    バッファメモリを有し、前記2つのバッファメモリを交
    互に用いることにより、ホストシステムと磁気記憶装置
    間のデータ転送を継続的に処理することを特徴とする磁
    気記憶装置の高速制御方式。
JP59277391A 1984-12-27 1984-12-27 磁気記憶装置の高速制御方式 Pending JPS61153728A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59277391A JPS61153728A (ja) 1984-12-27 1984-12-27 磁気記憶装置の高速制御方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59277391A JPS61153728A (ja) 1984-12-27 1984-12-27 磁気記憶装置の高速制御方式

Publications (1)

Publication Number Publication Date
JPS61153728A true JPS61153728A (ja) 1986-07-12

Family

ID=17582880

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59277391A Pending JPS61153728A (ja) 1984-12-27 1984-12-27 磁気記憶装置の高速制御方式

Country Status (1)

Country Link
JP (1) JPS61153728A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01200444A (ja) * 1988-02-05 1989-08-11 Nec Corp ファイル間のデータ転送方法
JPH08234928A (ja) * 1995-02-22 1996-09-13 Matsushita Electric Ind Co Ltd 情報記憶制御装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01200444A (ja) * 1988-02-05 1989-08-11 Nec Corp ファイル間のデータ転送方法
JPH08234928A (ja) * 1995-02-22 1996-09-13 Matsushita Electric Ind Co Ltd 情報記憶制御装置

Similar Documents

Publication Publication Date Title
JPS60134953A (ja) デ−タ転送制御装置
JPS61153728A (ja) 磁気記憶装置の高速制御方式
JPS63178360A (ja) 入出力システム構成方式
JPS60201453A (ja) 記憶装置アクセス制御方式
JPH0222748A (ja) 不揮発生メモリ制御回路
JPH0246967B2 (ja)
JPS608965A (ja) 入出力バツフアメモリ方式
JPH07160655A (ja) メモリアクセス方式
JPS61250758A (ja) 通信制御装置
JPH0447350A (ja) 主記憶読み出し応答制御方式
JPH0380470A (ja) 記憶制御装置
JPH08137752A (ja) 情報処理装置
JPS63217460A (ja) バツフア制御回路
JPH04333950A (ja) 情報処理システム
JPS6343782B2 (ja)
JPS61131152A (ja) Dmaバツフア制御方式
JPS5847730B2 (ja) メモリアクセス制御方式
JPS6232551A (ja) メモリアクセス制御装置
JPS6243737A (ja) 割り込み制御方式
JPS62111337A (ja) メモリ制御回路
JPH0685154B2 (ja) 中間バッファ制御方式
JPH03204052A (ja) メモリアクセス制御方式
JPH0690711B2 (ja) メモリアクセス制御方式
JPS5983232A (ja) バスラインの使用方法
JPH01134649A (ja) I/oチャネル制御装置