JPS61153200U - - Google Patents

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JPS61153200U
JPS61153200U JP1934185U JP1934185U JPS61153200U JP S61153200 U JPS61153200 U JP S61153200U JP 1934185 U JP1934185 U JP 1934185U JP 1934185 U JP1934185 U JP 1934185U JP S61153200 U JPS61153200 U JP S61153200U
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mos
signal
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fet
circuit
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Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路図、第２
図はＣ―ＭＯＳの動作を説明する図で、第２図ａ
はＣ―ＭＯＳの構成図、第２図ｂは入出力特性を
示す図、第３図は従来の信号入力回路を示す回路
図、である。 図において、１０，２０はＣ―ＭＯＳ、１２，
２２はｐチヤネル、１３，２３はｎチヤネル、１
４，１５，２４，２５は入力端子、１６，２６は
出力端子、をそれぞれ表す。

Claims (1)

    【実用新案登録請求の範囲】
  1. １個の相補形ＭＯＳインバータからなる制御回
    路と、複数個の相補形ＭＯＳインバータからなる
    信号入力回路を有し、該制御回路のｐチヤネル形
    ＭＯＳ―ＦＥＴおよびｎチヤネル形ＭＯＳ…ＦＥ
    Ｔの両方に制御信号を入力し、且つ該信号入力回
    路のｐチヤネル形ＭＯＳ―ＦＥＴには該制御回路
    の出力信号を、ｎチヤネル形ＭＯＳ―ＦＥＴには
    データ信号を入力するように構成した、信号入力
    回路を具えてなることを特徴とする磁気バブルメ
    モリ装置。
JP1934185U 1985-02-14 1985-02-14 Pending JPS61153200U (ja)

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JP1934185U JPS61153200U (ja) 1985-02-14 1985-02-14

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JP1934185U JPS61153200U (ja) 1985-02-14 1985-02-14

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JPS61153200U true JPS61153200U (ja) 1986-09-22

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ID=30508829

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JP1934185U Pending JPS61153200U (ja) 1985-02-14 1985-02-14

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS589304U (ja) * 1981-07-07 1983-01-21 マルホ自動機株式会社 Ｐｔｐ製造機におけるスクラップ処理装置
JPS58215785A (ja) * 1982-06-09 1983-12-15 Fujitsu Ltd 磁気バブルメモリ装置
JPS59152579A (ja) * 1983-02-18 1984-08-31 Fujitsu Ltd 磁気バブル記憶装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS589304U (ja) * 1981-07-07 1983-01-21 マルホ自動機株式会社 Ｐｔｐ製造機におけるスクラップ処理装置
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JPS59152579A (ja) * 1983-02-18 1984-08-31 Fujitsu Ltd 磁気バブル記憶装置

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