JPS61152069A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS61152069A JPS61152069A JP27292584A JP27292584A JPS61152069A JP S61152069 A JPS61152069 A JP S61152069A JP 27292584 A JP27292584 A JP 27292584A JP 27292584 A JP27292584 A JP 27292584A JP S61152069 A JPS61152069 A JP S61152069A
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- Japan
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- ion
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- excimer laser
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- Pending
Links
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- 238000004519 manufacturing process Methods 0.000 title claims description 5
- 239000012535 impurity Substances 0.000 claims abstract description 19
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- 238000005468 ion implantation Methods 0.000 description 2
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/70—Bipolar devices
- H01L29/72—Transistor-type devices, i.e. able to continuously respond to applied control signals
- H01L29/73—Bipolar junction transistors
- H01L29/732—Vertical transistors
- H01L29/7322—Vertical transistors having emitter-base and base-collector junctions leaving at the same surface of the body, e.g. planar transistor
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は半導体装置、特にバイポーラトランジスタの製
造方法に関するものである。
造方法に関するものである。
高集積回路で重要なル−ナ型バイホーラド2ンジスタは
、シリコン基板に2度のイオン打込みとアニールを行な
って形成する〇 現在性なわnているバイポーラトランジスタの一般的な
製造は1例えij、NPN型トランジスタの場合、第1
図に示すように、N型半導体基板1KP型不純物をイオ
ン注入しt、気炉アニールすることによりペース領域2
を形成する。さらに表面の絶縁膜3に設けられた窓から
8塁不純物をイオン注入し電気炉アニールすることによ
フエミッタ領域4を形成する。しかしながらその時の電
気炉アニールによシベース不純物が再拡散し、バイホー
2トランジスタの特性に大きく影響するベース幅d(狭
いほど特性はよい)が広くなってしまう。
、シリコン基板に2度のイオン打込みとアニールを行な
って形成する〇 現在性なわnているバイポーラトランジスタの一般的な
製造は1例えij、NPN型トランジスタの場合、第1
図に示すように、N型半導体基板1KP型不純物をイオ
ン注入しt、気炉アニールすることによりペース領域2
を形成する。さらに表面の絶縁膜3に設けられた窓から
8塁不純物をイオン注入し電気炉アニールすることによ
フエミッタ領域4を形成する。しかしながらその時の電
気炉アニールによシベース不純物が再拡散し、バイホー
2トランジスタの特性に大きく影響するベース幅d(狭
いほど特性はよい)が広くなってしまう。
このような欠点を取シ除く方法として、特開昭55−1
65874号に記載のように1 エミッタ領域を形成す
る際電気炉アニールのかわシにレーザアニールを用いる
方法がある。この場合には第2図に示すように、ベース
不純物の再拡散は起こらずベース幅は広がらない。
65874号に記載のように1 エミッタ領域を形成す
る際電気炉アニールのかわシにレーザアニールを用いる
方法がある。この場合には第2図に示すように、ベース
不純物の再拡散は起こらずベース幅は広がらない。
しかし、現在、集積回路のよシ一層の高集積化。
高性能化が進行しておシ、バイポーラトランジスタにお
いても次の点が要求さnている。
いても次の点が要求さnている。
(1)ペース領域、エミッタ領域をよシ薄く形成する0
(2)エミッタ領域の不純物濃度7oフアイルカ急しゅ
んである。
んである。
(3)ベース幅がさらに狭い。
本発明は、上記した従来技術の欠点に監みなされ友もの
で、高集積化に適した高性能フ゛レーナ型バイホー2ト
ランジスタの裏造方法を提供することを目的としている
。
で、高集積化に適した高性能フ゛レーナ型バイホー2ト
ランジスタの裏造方法を提供することを目的としている
。
本発明では、バイボートランジスタのベース領域、エミ
ッタ領域ともK、不純物をイオン注入しエキシマレーザ
照射することにょル、形成することを特徴としている。
ッタ領域ともK、不純物をイオン注入しエキシマレーザ
照射することにょル、形成することを特徴としている。
以下、本発F!At−N P N型ト2ンジスタの製造
に適用し友場合の実施例に基づいて、本発明の詳細な説
明する。
に適用し友場合の実施例に基づいて、本発明の詳細な説
明する。
第3図(a)に示すように、N型半導体基板1に絶縁膜
3をCVD法等によ多形成する。リンクラフイ技術によ
シ、第5図(blのように孔部7をもうけP型不純物を
イオン注入(10”a坊ms/cm”程度)しエキシマ
レーザ光を表に示すエネルギー密度で照射する。第3図
(C) K示すようにベース領域2が形成さrした0そ
の後絶縁膜3をCVD法等によ多形成し、その絶縁膜3
に第3図(司に示すようにエミッタ窓8′f:リンクラ
フイ技術によ多形成する0エミツタ窓を通してN型不純
物をイオン注入(10”ILto国/ Cm”程度)シ
、エキシマレーザ光を表に示すエネルギー密度で照射す
る。第31N(8)に示すようにエミッタ領域4が形成
さf′Lり。その後第3図(f)に示すようにペースの
コンタクト窓を絶縁膜3にあけ、ペース及びエミッタの
引出し電、極5,6を形成してトランジスタを完成する
@ エミッタ領域、ベース領域の厚さ、およびベース幅15
Eに示す・ま友エミッタ領域の不純物濃度プロファイル
を第4図に示す0従来例よシも良好なものが得られた0 また本発明はPNP型トシト2ンジスタいても同様に実
施可能である0 〔発明の効果〕 本発明によnは、不純物濃度が急しゅんで浅いエミッタ
領域を持ち、ベース幅の狭いバイポーラトランジスタを
製作することができ、バイポーラトランジスタの高性能
化、高集積化に効果がある。
3をCVD法等によ多形成する。リンクラフイ技術によ
シ、第5図(blのように孔部7をもうけP型不純物を
イオン注入(10”a坊ms/cm”程度)しエキシマ
レーザ光を表に示すエネルギー密度で照射する。第3図
(C) K示すようにベース領域2が形成さrした0そ
の後絶縁膜3をCVD法等によ多形成し、その絶縁膜3
に第3図(司に示すようにエミッタ窓8′f:リンクラ
フイ技術によ多形成する0エミツタ窓を通してN型不純
物をイオン注入(10”ILto国/ Cm”程度)シ
、エキシマレーザ光を表に示すエネルギー密度で照射す
る。第31N(8)に示すようにエミッタ領域4が形成
さf′Lり。その後第3図(f)に示すようにペースの
コンタクト窓を絶縁膜3にあけ、ペース及びエミッタの
引出し電、極5,6を形成してトランジスタを完成する
@ エミッタ領域、ベース領域の厚さ、およびベース幅15
Eに示す・ま友エミッタ領域の不純物濃度プロファイル
を第4図に示す0従来例よシも良好なものが得られた0 また本発明はPNP型トシト2ンジスタいても同様に実
施可能である0 〔発明の効果〕 本発明によnは、不純物濃度が急しゅんで浅いエミッタ
領域を持ち、ベース幅の狭いバイポーラトランジスタを
製作することができ、バイポーラトランジスタの高性能
化、高集積化に効果がある。
第1図および第2図は従来例を示す図、第3図は本発明
の実施例を示す図、第4図は不純物分布を示す図である
。 1・・・N型半導体基板、2・・・ベース領域、3・・
・絶縁膜、4・・・エミッタ領域、5.6・・・エミッ
タの引出し電極、7・・・孔部、8・・・エミツタ窓%
d・・・ベース幅、a・・・本発明によるもの、b・・
・従来例。 ヤ / 図 ケ 2 図 才3yA (拘
の実施例を示す図、第4図は不純物分布を示す図である
。 1・・・N型半導体基板、2・・・ベース領域、3・・
・絶縁膜、4・・・エミッタ領域、5.6・・・エミッ
タの引出し電極、7・・・孔部、8・・・エミツタ窓%
d・・・ベース幅、a・・・本発明によるもの、b・・
・従来例。 ヤ / 図 ケ 2 図 才3yA (拘
Claims (1)
- 【特許請求の範囲】 1 一導電型の半導体基板に反対導電型の不純物をイオ
ン注入した後エキシマレーザ照射により不純物を活性化
することによりベースを形成し、さらに該ベース領域内
にそれより浅く前記基板と同一導電型の不純物をイオン
注入しエキシマレーザ照射により不純物を活性化してエ
ミッタを形成することを特徴とする半導体装置の製造方
法。 2 前記エキシマレーザ光のレーザエネルギ密度が0.
6J/cm^2から3.0J/cm^2の値であること
を特徴とする特許請求の範囲第1項記載の半導体装置の
製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27292584A JPS61152069A (ja) | 1984-12-26 | 1984-12-26 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27292584A JPS61152069A (ja) | 1984-12-26 | 1984-12-26 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61152069A true JPS61152069A (ja) | 1986-07-10 |
Family
ID=17520664
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27292584A Pending JPS61152069A (ja) | 1984-12-26 | 1984-12-26 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61152069A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02114521A (ja) * | 1988-10-24 | 1990-04-26 | Sony Corp | バイポーラ半導体装置の製造方法 |
US6440785B1 (en) | 1992-06-26 | 2002-08-27 | Semiconductor Energy Laboratory Co., Ltd | Method of manufacturing a semiconductor device utilizing a laser annealing process |
JP2016006882A (ja) * | 2009-04-07 | 2016-01-14 | レイザー システムズ アンド ソリューションズ オブ ヨーロッパLaser Systems And Solutions Of Europe | レーザエネルギによって半導体材料表面を照射する方法および装置 |
-
1984
- 1984-12-26 JP JP27292584A patent/JPS61152069A/ja active Pending
Cited By (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02114521A (ja) * | 1988-10-24 | 1990-04-26 | Sony Corp | バイポーラ半導体装置の製造方法 |
US6440785B1 (en) | 1992-06-26 | 2002-08-27 | Semiconductor Energy Laboratory Co., Ltd | Method of manufacturing a semiconductor device utilizing a laser annealing process |
US6991975B1 (en) | 1992-06-26 | 2006-01-31 | Semiconductor Energy Laboratory Co., Ltd. | Laser process |
JP2010045411A (ja) * | 1992-06-26 | 2010-02-25 | Semiconductor Energy Lab Co Ltd | 半導体膜の作製方法、レーザー処理方法及びレーザー照射装置 |
US7985635B2 (en) | 1992-06-26 | 2011-07-26 | Semiconductor Energy Laboratory Co., Ltd. | Laser process |
JP2011223027A (ja) * | 1992-06-26 | 2011-11-04 | Semiconductor Energy Lab Co Ltd | 半導体膜の作製方法及び電子機器 |
JP2016006882A (ja) * | 2009-04-07 | 2016-01-14 | レイザー システムズ アンド ソリューションズ オブ ヨーロッパLaser Systems And Solutions Of Europe | レーザエネルギによって半導体材料表面を照射する方法および装置 |
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