JPS61131935A - デ−タ伝送制御方式 - Google Patents
デ−タ伝送制御方式Info
- Publication number
- JPS61131935A JPS61131935A JP25283984A JP25283984A JPS61131935A JP S61131935 A JPS61131935 A JP S61131935A JP 25283984 A JP25283984 A JP 25283984A JP 25283984 A JP25283984 A JP 25283984A JP S61131935 A JPS61131935 A JP S61131935A
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- JP
- Japan
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- wire
- station
- line
- duplex
- communication
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Bidirectional Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はマルチドロップ方式の通信回路システムに於い
て、特に４線式全二重通信回線用の２次局と二線式半二
重通信回線用の２次局とを同一通信回線を介して共通の
１次局に分岐接続可能としたデータ伝送制御方式に関す
る。
て、特に４線式全二重通信回線用の２次局と二線式半二
重通信回線用の２次局とを同一通信回線を介して共通の
１次局に分岐接続可能としたデータ伝送制御方式に関す
る。
第３図に示すようなマルチドロップ方式の通信回線（分
岐回線）システムに於いては、伝送制御の主権を司る一
つの１次局と、従権を司る複数の２次局から構成される
、このような通信回線システムで用いられる通信路の種
類は、多種多様であるが、一般に全ての局（１次局、２
次局）は、同一の物理インタフェイス、電気的インタフ
ェイスおよび論理的インタフェイスを備える必要がある
。
岐回線）システムに於いては、伝送制御の主権を司る一
つの１次局と、従権を司る複数の２次局から構成される
、このような通信回線システムで用いられる通信路の種
類は、多種多様であるが、一般に全ての局（１次局、２
次局）は、同一の物理インタフェイス、電気的インタフ
ェイスおよび論理的インタフェイスを備える必要がある
。
従って第４図に示すような、４線式全二重通信方式の２
次局と、第５図に示すような２線式半二重通信方式の２
次局がある場合、それぞれ同種の２次局のみが同一の通
信路に接続可能であり、異種の２次局を同じ通信路に接
続することは不可能であった。とのため、従来では４線
式全二重通信方式の２次局と２線式半二重通信方式の２
次局とが存在する場合、ケーブルおよび１次局がそれぞ
れ２七ツト必要となり、経済的に不利な構成となる。
次局と、第５図に示すような２線式半二重通信方式の２
次局がある場合、それぞれ同種の２次局のみが同一の通
信路に接続可能であり、異種の２次局を同じ通信路に接
続することは不可能であった。とのため、従来では４線
式全二重通信方式の２次局と２線式半二重通信方式の２
次局とが存在する場合、ケーブルおよび１次局がそれぞ
れ２七ツト必要となり、経済的に不利な構成となる。
本発明は上記実情に鑑みなされたもので、４線式全二重
回線用２次局と、２線式半二重回線用２次局を同一の通
信路に分岐接続させることのできるデータ伝送制御方式
を提供することを目的とする。
回線用２次局と、２線式半二重回線用２次局を同一の通
信路に分岐接続させることのできるデータ伝送制御方式
を提供することを目的とする。
本発明は、１次局の受信端部に、４線式通信路の２つの
線路それぞれに別個に接続される第１、第２のレシーバ
と、このレシーバの何れか一方の出力端を選択的に前記
受信端部に接続するセレクタとを設けて、２線式半二重
通信用２次局、及び４線式全二重通信用２次局をそれぞ
れ同一の通信ケーブルに接続できる構成としたもので、
これにより２線式半二重通信用２次局と４線式全二重通
信用２次局とを同一の通信路を介して共通の１次局に接
続でき、ケーブル及びケーブル布設費と１次局とを大幅
に削減して経済的に有利なシステムを構築できる。
線路それぞれに別個に接続される第１、第２のレシーバ
と、このレシーバの何れか一方の出力端を選択的に前記
受信端部に接続するセレクタとを設けて、２線式半二重
通信用２次局、及び４線式全二重通信用２次局をそれぞ
れ同一の通信ケーブルに接続できる構成としたもので、
これにより２線式半二重通信用２次局と４線式全二重通
信用２次局とを同一の通信路を介して共通の１次局に接
続でき、ケーブル及びケーブル布設費と１次局とを大幅
に削減して経済的に有利なシステムを構築できる。
以下図面を参照して本発明の一実施例を説明する。
第１図は、本発明により実現した通信回線システムの一
実施例を示すブロック図である。図中、１１乃至１４は
それぞれ２次局であり、このうち、２次局Ａ１１および
Ｄ１４はそれぞれ４線式全二重回線用２次局であり、２
次局Ｂ１２およびＣ１３はそれぞれ２線式半二重回線用
２次局である。１次局ＰＩＯは後述する受信線選択機能
を有し、４線式全二重回線用２次局、および２線式半二
重回線用２次局の双方を制御可能な構成としている。こ
れら１次局ＰＩＯと２次局Ａ１１．Ｂ１２．Ｃ１３，Ｄ
１４とはそれぞれ共通の４線式ケーブルＬによって回線
接続される。
実施例を示すブロック図である。図中、１１乃至１４は
それぞれ２次局であり、このうち、２次局Ａ１１および
Ｄ１４はそれぞれ４線式全二重回線用２次局であり、２
次局Ｂ１２およびＣ１３はそれぞれ２線式半二重回線用
２次局である。１次局ＰＩＯは後述する受信線選択機能
を有し、４線式全二重回線用２次局、および２線式半二
重回線用２次局の双方を制御可能な構成としている。こ
れら１次局ＰＩＯと２次局Ａ１１．Ｂ１２．Ｃ１３，Ｄ
１４とはそれぞれ共通の４線式ケーブルＬによって回線
接続される。
第２図は、１次局ＰＩＯが有する受信線選択機能部の一
構成例を示すブロック図である。図中、１は送信データ
の並−直列変換機能、及び受信データの直−並列変換機
能をもつシリアルインタフェイスＬＳＩであり、以下Ｓ
ＩＯと称す。
構成例を示すブロック図である。図中、１は送信データ
の並−直列変換機能、及び受信データの直−並列変換機
能をもつシリアルインタフェイスＬＳＩであり、以下Ｓ
ＩＯと称す。
２はＳＩＯ１の送信端子ＴＸＤから出力される送信デー
タを駆動するドライバ（Ｄ）、３１はラインｔ□上の受
信データを受信するレジ−＜Ｒ）、３□はラインｔ、上
の受信データを受信するレシーバ（Ｒ）である。４はレ
シーバ３□ 、３．で受信したデータの何れをＳＩＯ１
の受信端子ＲＸＤに入力するかを決定するセレクタであ
る。
タを駆動するドライバ（Ｄ）、３１はラインｔ□上の受
信データを受信するレジ−＜Ｒ）、３□はラインｔ、上
の受信データを受信するレシーバ（Ｒ）である。４はレ
シーバ３□ 、３．で受信したデータの何れをＳＩＯ１
の受信端子ＲＸＤに入力するかを決定するセレクタであ
る。
ここで、第１図及び第２図を参照して一実施例の動作を
説明する。
説明する。
１次局ＰＩＯは、４線式全二重回線用２次局Ａ１１．Ｄ
１４と交信を行なう場合、セレクタ４をＢ入力選択モー
ドに設定する。これにより、レシーノぐ３．の出力端が
セレクタ４を介してＳＩＱ １の受信端子ＲＸＤに接続
され、４線式全二重の受信線となるラインｔ２上の受信
データがレシーバ３．で受信され、セレクタ４を介して
一８Ｉ０１の受信端子ＲＸＤに入力されてバッファされ
た後、バイト単位で内部に取込まれる。このようにして
１次局ＰＩＯと４線式全二重回線用２次局Ａ Ｊ ｉ
＊ Ｄ １４との間でデータ通信が実施される。
１４と交信を行なう場合、セレクタ４をＢ入力選択モー
ドに設定する。これにより、レシーノぐ３．の出力端が
セレクタ４を介してＳＩＱ １の受信端子ＲＸＤに接続
され、４線式全二重の受信線となるラインｔ２上の受信
データがレシーバ３．で受信され、セレクタ４を介して
一８Ｉ０１の受信端子ＲＸＤに入力されてバッファされ
た後、バイト単位で内部に取込まれる。このようにして
１次局ＰＩＯと４線式全二重回線用２次局Ａ Ｊ ｉ
＊ Ｄ １４との間でデータ通信が実施される。
又、１次局ＰＩＯは、２線式半二重回線用２次局Ｒ１２
，０１３と交信を行なう場合、セレクタ４をＡ入力選択
モードに設定する。これにより、レシーバ３１の出力端
がセレクタ４を介してＳＩＯ１の受信端子ＲＸＤに接続
され、ライン、Ｌｉ上の受信データがレシーバ３□で受
信され、セレクタ４を介してＳＩＯ１の受信端子ＲＸＤ
に入力されてバッファされた後、バイト単位で内部に取
込まれる。このようにして、１次局ＰＩＯと２線式半二
重回線用２次局Ｂ１２．Ｃ１３との間でデータ通信が実
施される。
，０１３と交信を行なう場合、セレクタ４をＡ入力選択
モードに設定する。これにより、レシーバ３１の出力端
がセレクタ４を介してＳＩＯ１の受信端子ＲＸＤに接続
され、ライン、Ｌｉ上の受信データがレシーバ３□で受
信され、セレクタ４を介してＳＩＯ１の受信端子ＲＸＤ
に入力されてバッファされた後、バイト単位で内部に取
込まれる。このようにして、１次局ＰＩＯと２線式半二
重回線用２次局Ｂ１２．Ｃ１３との間でデータ通信が実
施される。
上述したような構成を採ることによって、４線式のケー
ブル布設により、４線式回線用２次局は勿論のこと、２
線式回線用２次局をも同一のケーブルに接続でき、従っ
てケーブル及びケール布設費の大幅な削減が図れる。
ブル布設により、４線式回線用２次局は勿論のこと、２
線式回線用２次局をも同一のケーブルに接続でき、従っ
てケーブル及びケール布設費の大幅な削減が図れる。
〔発明の効果〕
以上詳記したように本発明のデータ伝送制御方式によれ
ば、１次局の受信端部に、４線式通信路の２つの線路そ
れぞれ別個に接続される第１．第２のレジ−・クト、こ
のレシーバの何れか一方の出力端を選択的に前記受信端
部に接続するセレクタとを設けて、２線式半二重通信用
２次局、及び４線式全二重通信用２次局をそれぞれ同一
の通信ケーブルに接続できる構成としたことにより、２
線式半二重通信用２次局と４線式全二重通信用２次局と
を同一の通信路を介して共通の１次局に接続でき、経済
的に有利なシステムを構築できる。
ば、１次局の受信端部に、４線式通信路の２つの線路そ
れぞれ別個に接続される第１．第２のレジ−・クト、こ
のレシーバの何れか一方の出力端を選択的に前記受信端
部に接続するセレクタとを設けて、２線式半二重通信用
２次局、及び４線式全二重通信用２次局をそれぞれ同一
の通信ケーブルに接続できる構成としたことにより、２
線式半二重通信用２次局と４線式全二重通信用２次局と
を同一の通信路を介して共通の１次局に接続でき、経済
的に有利なシステムを構築できる。
第１図は本発明の一実施例に於けるシステム構成を示す
ブロック図、第２図は上記実施例に於ける１次局の受信
部の構成を示すブロック図、第３図乃至第５図はそれぞ
れ従来のシステム構成を示すブロック図である。 １・・・シリアルインタフェイスＬＳＩ（ＳＩＯ）、２
・・・ドライバ（Ｄ）、３１．３．・・・レシーバ（Ｒ
）、４・・・セレクタ、１０・・・１次局（Ｐ）、１１
．１４・・・４Ｍ式全二重回線用２次局（Ａ、Ｄ）、１
２゜１３・・・２線式半二重回線用２次局（Ｂ 、Ｃ）
、Ｌ・・・４線式ケーブル。 出願人代理人 弁理士 鈴 江 武 彦第１図 第 ２図 内害乳くズ 第３ 図 第４図 第５図
ブロック図、第２図は上記実施例に於ける１次局の受信
部の構成を示すブロック図、第３図乃至第５図はそれぞ
れ従来のシステム構成を示すブロック図である。 １・・・シリアルインタフェイスＬＳＩ（ＳＩＯ）、２
・・・ドライバ（Ｄ）、３１．３．・・・レシーバ（Ｒ
）、４・・・セレクタ、１０・・・１次局（Ｐ）、１１
．１４・・・４Ｍ式全二重回線用２次局（Ａ、Ｄ）、１
２゜１３・・・２線式半二重回線用２次局（Ｂ 、Ｃ）
、Ｌ・・・４線式ケーブル。 出願人代理人 弁理士 鈴 江 武 彦第１図 第 ２図 内害乳くズ 第３ 図 第４図 第５図
Claims (1)
- マルチドロップ方式の通信回線システムに於いて、１次
局の受信端部に、４線式通信路の２つの線路にそれぞれ
別個に接続される第１、第２のレシーバと、このレシー
バの何れか一方の出力端を選択的に前記受信端部に接続
するセレクタとを設け、２線式半二重通信用２次局と４
線式全二重通信用２次局とを同一の通信路を介して共通
の１次局に接続するデータ伝送制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25283984A JPS61131935A (ja) | 1984-12-01 | 1984-12-01 | デ−タ伝送制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25283984A JPS61131935A (ja) | 1984-12-01 | 1984-12-01 | デ−タ伝送制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61131935A true JPS61131935A (ja) | 1986-06-19 |
Family
ID=17242901
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25283984A Pending JPS61131935A (ja) | 1984-12-01 | 1984-12-01 | デ−タ伝送制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61131935A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012027717A (ja) * | 2010-07-23 | 2012-02-09 | Idec Corp | プログラマブル表示器 |
-
1984
- 1984-12-01 JP JP25283984A patent/JPS61131935A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012027717A (ja) * | 2010-07-23 | 2012-02-09 | Idec Corp | プログラマブル表示器 |
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