JPS61129911A - デジタル周波数復調器 - Google Patents
デジタル周波数復調器Info
- Publication number
- JPS61129911A JPS61129911A JP25213284A JP25213284A JPS61129911A JP S61129911 A JPS61129911 A JP S61129911A JP 25213284 A JP25213284 A JP 25213284A JP 25213284 A JP25213284 A JP 25213284A JP S61129911 A JPS61129911 A JP S61129911A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- frequency
- output
- clock signal
- counter
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデジタル周波数復調器に関する。
従来の周波数復調器としては、フォスター・シーレー・
ディスクリミネータ、レシオ・ディテクタ等のアナログ
式のものがあった。
ディスクリミネータ、レシオ・ディテクタ等のアナログ
式のものがあった。
かかる従来のアナログ周波数復調器は、調整箇所が多く
、又、その調整が面倒であり、しかも長時間動作時には
安定性が良くないという欠点があった。
、又、その調整が面倒であり、しかも長時間動作時には
安定性が良くないという欠点があった。
かかる点に鑑み、本発明はかかる従来装置の欠点を除去
した周波数復調器を提案しようとするものである。
した周波数復調器を提案しようとするものである。
本発明によるデジタル周波数［１ｉ器は、アナログ被周
波数変調信号を所定周期期間毎にクロック信号で計数す
るカウンタ（５）を有し、このカウンタ（５）から周波
数復調されたデジタル信号を得るようにするものである
。
波数変調信号を所定周期期間毎にクロック信号で計数す
るカウンタ（５）を有し、このカウンタ（５）から周波
数復調されたデジタル信号を得るようにするものである
。
かかる本発明によれば、アナログ被周波数変調信号がカ
ウンタ（５）に供給されて、クロック信号に ″よ
り計数されることにより、周波数復調されたデジタル信
号が得られる。
ウンタ（５）に供給されて、クロック信号に ″よ
り計数されることにより、周波数復調されたデジタル信
号が得られる。
以下に、第１図を参照して、本発明の一実施例を詳細に
説明する。（２）はリミッタで、これに入力端子（１）
からの、例えば第２図に示す如く正弦波を搬送波ａとす
るアナログ被周波数変調信号が供給されて、例えばその
正（負も可）の半サイクルに対応した矩形波ｂ（第２図
）゛が出力される。この矩形波すはゲート回路（アンド
回路）（３）の一方の入力端子に供給される。ゲート回
路（３）の他方の入力端子に、クロック信号発生器（水
晶発振器）（４）からのクロック信号を供給する。ゲー
ト回路（３）の出力はカウンタ（例えば２８進カウンタ
）（５）に供給されて、矩形波すの期間のクロック信号
が計数される。（８）は制御回路で、リミッタ（２）よ
りの矩形波すを受けて、後述する制御パルスを発生する
。
説明する。（２）はリミッタで、これに入力端子（１）
からの、例えば第２図に示す如く正弦波を搬送波ａとす
るアナログ被周波数変調信号が供給されて、例えばその
正（負も可）の半サイクルに対応した矩形波ｂ（第２図
）゛が出力される。この矩形波すはゲート回路（アンド
回路）（３）の一方の入力端子に供給される。ゲート回
路（３）の他方の入力端子に、クロック信号発生器（水
晶発振器）（４）からのクロック信号を供給する。ゲー
ト回路（３）の出力はカウンタ（例えば２８進カウンタ
）（５）に供給されて、矩形波すの期間のクロック信号
が計数される。（８）は制御回路で、リミッタ（２）よ
りの矩形波すを受けて、後述する制御パルスを発生する
。
カウンタ（５）の並列８ビツトの計数出力はラッチ回路
（６）に供給されて、矩形波すの後縁の後に制御回路（
８）から発生するラッチパルスＣ（第２図）によりラッ
チされて、出力端子（７）に出力される。又、制御回路
（８）から、ラッチパルスＣの後に発生するクリアパル
スｄ （第２図）によって、カウンタ（５）はクリアさ
れる。尚、両パルスｃ、 ｄ共正弦波ａの負の半サイ
クル内の期間に発生する。
（６）に供給されて、矩形波すの後縁の後に制御回路（
８）から発生するラッチパルスＣ（第２図）によりラッ
チされて、出力端子（７）に出力される。又、制御回路
（８）から、ラッチパルスＣの後に発生するクリアパル
スｄ （第２図）によって、カウンタ（５）はクリアさ
れる。尚、両パルスｃ、 ｄ共正弦波ａの負の半サイ
クル内の期間に発生する。
入力端子（１）に供給されるアナログ信号が、変調信号
のレベルに比例した周波数を有する信号である場合は、
ラッチ回路（６）の次段に逆対数変換回路を接続するこ
とにより、その逆対数変換回路から、元の変調信号のデ
ジタル化信号を得ることができる。
のレベルに比例した周波数を有する信号である場合は、
ラッチ回路（６）の次段に逆対数変換回路を接続するこ
とにより、その逆対数変換回路から、元の変調信号のデ
ジタル化信号を得ることができる。
入力端子ｆｉｌに供給されるアナログ信号が、変調信号
のレベルに比例した周期を有する信号である場合は、ラ
ンチ回路（６）から元の変調信号のデジタル化信号が得
られる。
のレベルに比例した周期を有する信号である場合は、ラ
ンチ回路（６）から元の変調信号のデジタル化信号が得
られる。
尚、上述の実施例に於いて、カウンタ（５）として、例
えば２１０進カウンタを用い、その並列１０ビツトの出
力のうち下位２ビツトの出力は無視し、上位８ビツトの
出力をラッチ回路（６）に供給するようにすれば、周波
数復調されたデジタル信号のノイズが軽減される。
えば２１０進カウンタを用い、その並列１０ビツトの出
力のうち下位２ビツトの出力は無視し、上位８ビツトの
出力をラッチ回路（６）に供給するようにすれば、周波
数復調されたデジタル信号のノイズが軽減される。
次に、第３図を参照して、本発明の詳細な説明する。こ
の第３図は電話回線を用いて静止画信号を伝送する伝送
システムを示す。（１１）及び（１２）は夫々送信例お
らび受信例を示し、夫々ＣＰＵ （中央処理装置）
（１３Ｌ、これに接続された夫々メモリ （静止画信号
を２フレ一ム分記憶できる）、モニタ受信機（１５）及
び外部記憶装置（静止画信号を記憶する例えばフロッピ
ーディスク駆動装置＞ （１６）を備えている。
の第３図は電話回線を用いて静止画信号を伝送する伝送
システムを示す。（１１）及び（１２）は夫々送信例お
らび受信例を示し、夫々ＣＰＵ （中央処理装置）
（１３Ｌ、これに接続された夫々メモリ （静止画信号
を２フレ一ム分記憶できる）、モニタ受信機（１５）及
び外部記憶装置（静止画信号を記憶する例えばフロッピ
ーディスク駆動装置＞ （１６）を備えている。
送信０１１１（１１）では、光学系よりの被写体像を光
電変換素子に投影し、光電変換素子よりの撮像信号を磁
気ディスクに記録するようにした電子式スチルカメラ（
図示せず）の磁気ディスクよりの再生信号をメモリ （
１４）に書込み、これを読出して逆対数変換した後、デ
ジタル周波数変調器（１７）に供給して変調する。そし
て、そのアナログ被周波数変調信号を音響カプラ（図示
せず）を介して電話機（１９）に供給し、その送信信号
を電話線りを介して受信側（１２）の電話機（２０）に
伝送する。
電変換素子に投影し、光電変換素子よりの撮像信号を磁
気ディスクに記録するようにした電子式スチルカメラ（
図示せず）の磁気ディスクよりの再生信号をメモリ （
１４）に書込み、これを読出して逆対数変換した後、デ
ジタル周波数変調器（１７）に供給して変調する。そし
て、そのアナログ被周波数変調信号を音響カプラ（図示
せず）を介して電話機（１９）に供給し、その送信信号
を電話線りを介して受信側（１２）の電話機（２０）に
伝送する。
電話機（′２０）よりの受信信号は音響カプラ（図示せ
ず）を介して、本発明を適用したデジタル周波数復調器
（１８）に供給して、元の静止画デジタル信号を得、メ
モリ （１４）に書込む。そして、メモリ （１４）よ
り読出された信号をモニタ受信＃ｊ！Ａ（’１５）、外
部記憶装置（工６）等に供給して、モニタ及び記憶を行
なう。
ず）を介して、本発明を適用したデジタル周波数復調器
（１８）に供給して、元の静止画デジタル信号を得、メ
モリ （１４）に書込む。そして、メモリ （１４）よ
り読出された信号をモニタ受信＃ｊ！Ａ（’１５）、外
部記憶装置（工６）等に供給して、モニタ及び記憶を行
なう。
上述せる本発明によれば、調整箇所が少なく、その調整
も容易で、しかも長時間動作時にも動作が安定する、構
成の簡単なデジタル周波数復調器を得ることができる。
も容易で、しかも長時間動作時にも動作が安定する、構
成の簡単なデジタル周波数復調器を得ることができる。
第１図は本発明の一実施例を示すブロック線図、第２図
はその説明に供する波形図、第３図は本発明を適用して
好適な静止画信号伝送システムを示すブロック線図であ
る。 （１）は入力端子、（２）はリミッタ、（３）はゲート
回路、（４）はクロック信号発生器、（５）はカウンタ
、（６）はラッチ、（７）は出力端子、（８）は制御回
路である。
はその説明に供する波形図、第３図は本発明を適用して
好適な静止画信号伝送システムを示すブロック線図であ
る。 （１）は入力端子、（２）はリミッタ、（３）はゲート
回路、（４）はクロック信号発生器、（５）はカウンタ
、（６）はラッチ、（７）は出力端子、（８）は制御回
路である。
Claims (1)
- アナログ被周波数変調信号を所定周期期間毎にクロック
信号で計数するカウンタを有し、該カウンタから周波数
復調されたデジタル信号を得るようにしたことを特徴と
するデジタル周波数復調器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25213284A JPS61129911A (ja) | 1984-11-29 | 1984-11-29 | デジタル周波数復調器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP25213284A JPS61129911A (ja) | 1984-11-29 | 1984-11-29 | デジタル周波数復調器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61129911A true JPS61129911A (ja) | 1986-06-17 |
Family
ID=17232921
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP25213284A Pending JPS61129911A (ja) | 1984-11-29 | 1984-11-29 | デジタル周波数復調器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61129911A (ja) |
-
1984
- 1984-11-29 JP JP25213284A patent/JPS61129911A/ja active Pending
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