JPS61120523A - デイジタル入出力回路 - Google Patents
デイジタル入出力回路Info
- Publication number
- JPS61120523A JPS61120523A JP59240571A JP24057184A JPS61120523A JP S61120523 A JPS61120523 A JP S61120523A JP 59240571 A JP59240571 A JP 59240571A JP 24057184 A JP24057184 A JP 24057184A JP S61120523 A JPS61120523 A JP S61120523A
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- JP
- Japan
- Prior art keywords
- terminal
- input
- output
- circuit
- signal
- Prior art date
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- Pending
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/78—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled
- H03K17/795—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled controlling bipolar transistors
- H03K17/7955—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled controlling bipolar transistors using phototransistors
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/60—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being bipolar transistors
- H03K17/62—Switching arrangements with several input- output-terminals, e.g. multiplexers, distributors
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、ディジタル式のプロセス制御装置やシーケ
ンス制御装置等に対するディジタル（オン、オフ）信号
の入力およびこれらの装置からのディジタル信号の出力
を１つの回路で共用して行なうことが可能なディジタル
入出力回路に関する。
ンス制御装置等に対するディジタル（オン、オフ）信号
の入力およびこれらの装置からのディジタル信号の出力
を１つの回路で共用して行なうことが可能なディジタル
入出力回路に関する。
従来のディジタル制御装置における入、出力回路は、例
えば次の如く構成されている。
えば次の如く構成されている。
第２図は従来の入力回路の一例を示す回路図である。同
図において、１１は電源、２は入力用接点、５はフォト
カプラ５１．レシーバ５２．を源５３および抵抗Ｒ５，
Ｒ４等からなる入力回路である。すなわち、接点２のオ
ン、オフに応じた信号を７オトカプラ５１によって取り
出し、これをレシーバ５２．端子Ｔ５を介して図示され
ないディジタル制御機器に与えるものである。
図において、１１は電源、２は入力用接点、５はフォト
カプラ５１．レシーバ５２．を源５３および抵抗Ｒ５，
Ｒ４等からなる入力回路である。すなわち、接点２のオ
ン、オフに応じた信号を７オトカプラ５１によって取り
出し、これをレシーバ５２．端子Ｔ５を介して図示され
ないディジタル制御機器に与えるものである。
第５図は従来の出力回路の一例を示す回路図である。同
図において、６は電源６１．ドライバ６２およびフォト
カプラ６５等からなる出力回路、３は所定の負荷（出力
機器）、１２は電源である。
図において、６は電源６１．ドライバ６２およびフォト
カプラ６５等からなる出力回路、３は所定の負荷（出力
機器）、１２は電源である。
すなわち、端子Ｔ６を介して与えられる所定制御機器か
らのオン、オフ出力信号をドライバ６２゜７オトカプラ
６３を介して取り出し、負荷３に与えるものである。
らのオン、オフ出力信号をドライバ６２゜７オトカプラ
６３を介して取り出し、負荷３に与えるものである。
なお、第２，３図より明らかなよプに、制御機器と入力
回路、出力回路間はそれぞれフォトカブ？５１．６３に
よって絶縁されているが、これは制御機器の電位レベル
とオン、オフ接点信号、負荷間の電位レベルが互いに異
なることによって、いわゆるコモンモード電圧を生じ、
ノイズ耐性の点からも絶縁した方が何かと好都合である
ためである。もちろん、フォトカブ２にかえてトランス
を用いても良いことは云う迄もない。
回路、出力回路間はそれぞれフォトカブ？５１．６３に
よって絶縁されているが、これは制御機器の電位レベル
とオン、オフ接点信号、負荷間の電位レベルが互いに異
なることによって、いわゆるコモンモード電圧を生じ、
ノイズ耐性の点からも絶縁した方が何かと好都合である
ためである。もちろん、フォトカブ２にかえてトランス
を用いても良いことは云う迄もない。
〔この発明が解決しようとする問題点〕つまり、従来に
おいては、入力回路は飽く迄も入力回路であり、出力回
路は飽く迄も出力回路であるため、入力回路および出力
回路をそれぞれ多数必要とするシステムでは、そのシス
テム構成が大型化し、コスト高くなるという問題点があ
る。
おいては、入力回路は飽く迄も入力回路であり、出力回
路は飽く迄も出力回路であるため、入力回路および出力
回路をそれぞれ多数必要とするシステムでは、そのシス
テム構成が大型化し、コスト高くなるという問題点があ
る。
〔問題点を解決するための手段および作用〕この発明は
、ディジタル信号の入力および出力を１つの回路で共用
して行なうことができる双方向形のディジタル入出力回
路を構成することにより、装置の小型化およびコストの
低減化を図るものである。すなわち、共通端子と、電源
の一方側に接続される第１の端子と、電源の他方側に接
続される第２の端子と、該第２と共通端子間に挿入され
所定の制御機器へディジタル信号を絶縁して入力する信
号人力手段と、前記第１端子と共通端子間に挿入され所
定制御機器からのディジタル信号を絶縁して出力する信
号出力手段とを設け、前記共通端子および第１端子を介
して人力信号を与える一方、共通端子および第２端子を
介して出力信号を取り出すとともに、これら入、出力操
作を互いに切換えて行なうようにしたものでおる。
、ディジタル信号の入力および出力を１つの回路で共用
して行なうことができる双方向形のディジタル入出力回
路を構成することにより、装置の小型化およびコストの
低減化を図るものである。すなわち、共通端子と、電源
の一方側に接続される第１の端子と、電源の他方側に接
続される第２の端子と、該第２と共通端子間に挿入され
所定の制御機器へディジタル信号を絶縁して入力する信
号人力手段と、前記第１端子と共通端子間に挿入され所
定制御機器からのディジタル信号を絶縁して出力する信
号出力手段とを設け、前記共通端子および第１端子を介
して人力信号を与える一方、共通端子および第２端子を
介して出力信号を取り出すとともに、これら入、出力操
作を互いに切換えて行なうようにしたものでおる。
第１図はこの発明の実施例を示す回路図である。
同図において、１は電源、２は入力用接点、３は負荷、
４は７オトカグラ４１および４２．トランジスタ４３．
レシーバ４４．ドライバ４５．電源４６、抵抗ＦＬ１〜
Ｒ４等からなる入出力回路である。なお、Ｔｏ ””Ｔ
４は端子である。また、トランジスタ４３のかわりに、
フォトカプラ４２の出力に応動するリレー、スイッチ等
の接点を用いるようＫしてもよい。
４は７オトカグラ４１および４２．トランジスタ４３．
レシーバ４４．ドライバ４５．電源４６、抵抗ＦＬ１〜
Ｒ４等からなる入出力回路である。なお、Ｔｏ ””Ｔ
４は端子である。また、トランジスタ４３のかわりに、
フォトカプラ４２の出力に応動するリレー、スイッチ等
の接点を用いるようＫしてもよい。
端子Ｔｏは入、出力時において共用されるもので、入力
時には端子ＴＯｙＴＩ間に接点２が接続され、出力時に
は端子’ｒｏ 、 Ｔ２間に負荷（出力用機器ン３が接
続されるが、この切換えはハード的またはソフト的に適
宜に行なうこととする。
時には端子ＴＯｙＴＩ間に接点２が接続され、出力時に
は端子’ｒｏ 、 Ｔ２間に負荷（出力用機器ン３が接
続されるが、この切換えはハード的またはソフト的に適
宜に行なうこととする。
゛・いま、入出力回路４を入力回路として使用するとき
は、端子’ｒｏ 、 Ｔ、間に接点２が接続されるとと
もに、端子Ｔ４に所定の制御信号を与えてトランジスタ
４６がオンにならないよ５にされる。したがって、接点
２がオン、オフすると、フォトカプラ４１がこれに応動
し、レシーバ４４を介して端子Ｔｓに入力用信号が取り
出され、図示されない制御機器に入力される。
は、端子’ｒｏ 、 Ｔ、間に接点２が接続されるとと
もに、端子Ｔ４に所定の制御信号を与えてトランジスタ
４６がオンにならないよ５にされる。したがって、接点
２がオン、オフすると、フォトカプラ４１がこれに応動
し、レシーバ４４を介して端子Ｔｓに入力用信号が取り
出され、図示されない制御機器に入力される。
一方、入出力回路４を出力回路として使用するときは、
端子Ｔｏ、Ｔ２間に負荷６が接続され、端子Ｔ４を介し
て制御機器からのディジタル（オン。
端子Ｔｏ、Ｔ２間に負荷６が接続され、端子Ｔ４を介し
て制御機器からのディジタル（オン。
オフ）出力信号が与えられる。この信号は、ドライバ４
５を介してフォトカプラ４２１Ｃ与えられ、トランジス
タ４３゛をディジタル出力信号に応じてオン、オフさせ
るため、これにより負荷（出力用機器）５に対して所定
のディジタル信号を与えることができる。このとき、ト
ランジスタ４３０オン、オフ信号はフォトカプラ４１お
よびレシーバ４４等を介して端子ＴｓＫ読み出されるの
で、この端子Ｔ５から得られる信号と端子Ｔ４を介して
送出した信号とを比較することにより、この信号の伝達
に関与する各部分のチェックを行なうことが可能になる
利点が得られるものである。
５を介してフォトカプラ４２１Ｃ与えられ、トランジス
タ４３゛をディジタル出力信号に応じてオン、オフさせ
るため、これにより負荷（出力用機器）５に対して所定
のディジタル信号を与えることができる。このとき、ト
ランジスタ４３０オン、オフ信号はフォトカプラ４１お
よびレシーバ４４等を介して端子ＴｓＫ読み出されるの
で、この端子Ｔ５から得られる信号と端子Ｔ４を介して
送出した信号とを比較することにより、この信号の伝達
に関与する各部分のチェックを行なうことが可能になる
利点が得られるものである。
この発明によれば、１つの回路で入、出力操作を兼用し
得るので、使用する部品点数の削減によって装置の小型
化、コストの低減化を図ることが可能となる（この効果
は、入、出力回路数が多くなる程顕著となる。）ばかり
でな（、実施例の如き回路ではその各部の動作チェック
が可能となる利点がもたらされるものである。
得るので、使用する部品点数の削減によって装置の小型
化、コストの低減化を図ることが可能となる（この効果
は、入、出力回路数が多くなる程顕著となる。）ばかり
でな（、実施例の如き回路ではその各部の動作チェック
が可能となる利点がもたらされるものである。
第１図はこの発明の実施例を示す回路図、第２図は従来
の入力回路の一例を示す回路図、第３図は従来の出力回
路の一例を示す回路図である。 符号説明 １．１１，１２．４６，５５．５１・・・・−・電源、
２・・・・・・入力用接点、３・・・・・・負荷、４・
・・・・・入出力回路、５・・・・・・入力回路、６・
・・・・・出力回路、４１，４２゜５１．６３・・・・
・・フォトカプラ、４３・・・・・・トランジスタ、４
４，５２・・・・・・レシーバ、４５．６２・・・・・
・ドライバ、ｌＲｔ〜Ｒ６・・・・・・抵抗、Ｔ Ｏ”
” Ｔ ６・・・・・・端子。 代理メ、弁理士並木昭夫 代理人 弁理士 松 崎 清 Ｉｌｌ 図
の入力回路の一例を示す回路図、第３図は従来の出力回
路の一例を示す回路図である。 符号説明 １．１１，１２．４６，５５．５１・・・・−・電源、
２・・・・・・入力用接点、３・・・・・・負荷、４・
・・・・・入出力回路、５・・・・・・入力回路、６・
・・・・・出力回路、４１，４２゜５１．６３・・・・
・・フォトカプラ、４３・・・・・・トランジスタ、４
４，５２・・・・・・レシーバ、４５．６２・・・・・
・ドライバ、ｌＲｔ〜Ｒ６・・・・・・抵抗、Ｔ Ｏ”
” Ｔ ６・・・・・・端子。 代理メ、弁理士並木昭夫 代理人 弁理士 松 崎 清 Ｉｌｌ 図
Claims (1)
- 【特許請求の範囲】 １）共通端子と、電源の一方側に接続される第１の端子
と、電源の他方側に接続される第２の端子と、該第２端
子と共通端子間に挿入され所定の制御機器へディジタル
信号を絶縁して入力する信号入力手段と、前記第１端子
と共通端子間に挿入され所定制御機器からのディジタル
信号を絶縁して出力する信号出力手段とを備え、前記共
通端子および第１端子を介して入力信号を与える一方、
共通端子および第２端子を介して出力信号を取り出すと
ともに、これら入、出力操作を互いに切換えて行なうこ
とを特徴とするディジタル入出力回路。 ２）特許請求の範囲第１項に記載のディジタル入出力回
路において、前記ディジタル信号を絶縁するためにフォ
トカプラを用いたことを特徴とするディジタル入出力回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59240571A JPS61120523A (ja) | 1984-11-16 | 1984-11-16 | デイジタル入出力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59240571A JPS61120523A (ja) | 1984-11-16 | 1984-11-16 | デイジタル入出力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61120523A true JPS61120523A (ja) | 1986-06-07 |
Family
ID=17061500
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59240571A Pending JPS61120523A (ja) | 1984-11-16 | 1984-11-16 | デイジタル入出力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61120523A (ja) |
-
1984
- 1984-11-16 JP JP59240571A patent/JPS61120523A/ja active Pending
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