JPS6095737U - クロツク周波数てい倍回路 - Google Patents

クロツク周波数てい倍回路

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Publication number
JPS6095737U
JPS6095737U JP18765583U JP18765583U JPS6095737U JP S6095737 U JPS6095737 U JP S6095737U JP 18765583 U JP18765583 U JP 18765583U JP 18765583 U JP18765583 U JP 18765583U JP S6095737 U JPS6095737 U JP S6095737U
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JP
Japan
Prior art keywords
frequency multiplier
multiplier circuit
clock frequency
pulses
clock
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Pending
Application number
JP18765583U
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English (en)
Inventor
小野　愼二
Original Assignee
日本電気株式会社
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Publication date
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Publication of JPS6095737U publication Critical patent/JPS6095737U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示すブロック図、第２図は
Ｎ＝３とした例を示すブロック図、第３　−図はその動
作を示すタイムチャートである。 １１〜ＩＮ・・・遅延回路、１０１．・・・微分回路、
１０２・・・論理和回路、１０３・・・モフマルチバイ
ブレータ、２０１・・・基本クロック入力端子、２０２
・・・Ｎてい倍クロック出力端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. 基本クロックをＮ（てい倍数、Ｎ≧２の整数）分岐し、
    分岐した各基本クロックの変換点をそれぞれ（２ｎ−１
    ）Ｔ／２Ｎ時間（Ｔは入力クロックの周期、ｎ＝Ｌ　２
    ｔ・・・、Ｎ）遅延させる手段と、遅延させたＮ個のパ
    ルスの各変換点をそれぞれ微分して得られたパルスの論
    理和をとる手段と、論理和をとったパルスからＴ／２Ｎ
    時間幅のパルスを発生する手段とを含むクロック周波数
    てい倍回路。
JP18765583U 1983-12-05 1983-12-05 クロツク周波数てい倍回路 Pending JPS6095737U (ja)

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