JPS59129249U - 位相連続ｆｓ変調回路 - Google Patents

位相連続ｆｓ変調回路

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Publication number
JPS59129249U
JPS59129249U JP1444983U JP1444983U JPS59129249U JP S59129249 U JPS59129249 U JP S59129249U JP 1444983 U JP1444983 U JP 1444983U JP 1444983 U JP1444983 U JP 1444983U JP S59129249 U JPS59129249 U JP S59129249U
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JP
Japan
Prior art keywords
frequency divider
frequency
phase continuous
modulation circuit
output
Prior art date
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Pending
Application number
JP1444983U
Other languages
English (en)
Inventor
沢　豊太郎
Original Assignee
株式会社東芝
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Publication date
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  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のＭＳＫ変調回路の一例を示すブロック図
、第２図は本考案の一実施例の回路図、第３図は第２図
の回路のタイムチャートである。 １、　２．　４．　５・・・・・・分周器、３・・・・
・・スイッチ回路、６・・・・・・ラッチ回路、７・・
・・・・微分回路。

Claims (4)

    【実用新案登録請求の範囲】
  1. （１）所定のクロックを互いに異なる分周数で分周する
    第１の分周器および第２の分周器と、各分周器の分周数
    の公倍数で前記所定のクロックを分周したに相当するト
    リガ信号により送出すべきデータ信号をラッチするラッ
    チ回路と、ラッチ回路の出力信号にしたがっていずれか
    １の分周器の出力を選択的に送出するスイッチ回路とを
    有する位相連続ＦＳ変調回路において、前記トリガ信号
    若しくは各分周器の分周数の他の公倍数で前記所定のク
    ロックを分周したに相当する信号に基づくリセットパル
    スにより第１の分周器および第２の分周器のうち少なく
    ともいずれか一方を定常的にリセットするリセット手段
    を具備したことを特徴とする位相連続ＦＳ変調回路。
  2. （２）第１の分周器の分周数が第２の分周器のそれより
    大であり、トリガ信号が第１の分周器の出力をさらに分
    周する第３の分周器により得られ、リセット手段が第３
    の分周器の出力を微分する微分回路であることを特徴と
    する実用新案登録請求の範囲第（１）項記載の位相連続
    ＦＳ変調回路。
  3. （３）第１の分周器の分周数が第２の分周器のそれの整
    数倍であり、リセット手段が第１の分周器の出力を微分
    する微分回路であることを特徴とする実用新案登録請求
    の範囲第（１）項記載の位相連続ＦＳ変調回路。
  4. （４）　　リセットパルスによって第２の分周器のみを
    リセットするものであることを特徴とする実用新案登録
    請求の範囲第（２）項又は第（３）項に記載の位相連続
    ＦＳ変調回路。
JP1444983U 1983-02-04 1983-02-04 位相連続ｆｓ変調回路 Pending JPS59129249U (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61234152A (ja) * 1985-04-09 1986-10-18 Toshiba Corp Ｆｓｋ変復調器

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61234152A (ja) * 1985-04-09 1986-10-18 Toshiba Corp Ｆｓｋ変復調器

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