JPS6091242A - 信号処理装置 - Google Patents
信号処理装置Info
- Publication number
- JPS6091242A JPS6091242A JP19908983A JP19908983A JPS6091242A JP S6091242 A JPS6091242 A JP S6091242A JP 19908983 A JP19908983 A JP 19908983A JP 19908983 A JP19908983 A JP 19908983A JP S6091242 A JPS6091242 A JP S6091242A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- output
- amplifiers
- outputs
- decoder
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- Pending
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- Investigating, Analyzing Materials By Fluorescence Or Luminescence (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は検知器からなる広範囲なダイナミックレンジの
出力信号を高速でしかも高忠実度で信号処理を行う信号
処理装置に係ｐ、例えば多元素の金属を同時分析するプ
ラズマ発光分析装置に使用するに好適な信号処理装置に
関する。
出力信号を高速でしかも高忠実度で信号処理を行う信号
処理装置に係ｐ、例えば多元素の金属を同時分析するプ
ラズマ発光分析装置に使用するに好適な信号処理装置に
関する。
従来のプラズマ発光分析装置等に用いられるスペクトル
信号処理装置は第１図に示すようにホトマル検知器１か
らの出力信号を前置増幅器２で増幅し、その出力信号ｅ
を更に増幅度の異った４種類（１倍、８倍、６４倍、５
１２倍）の増幅器１２．１３，１４．１５で増幅し、各
々の出力端をアナログスイッチ１６．１７，１８．１９
で接続して、そのアナログスイッチ１６．１７，１８゜
１９で選択された１つの信号を極性変換器２０を通して
Ａ／Ｄ変換器２１でディジタル量に変換し、その出力を
パフアゲート２２を通してマイクロコンピュータ２３に
よシ演箕処理し記録装置２５に出力するように構成され
ている。更に前置増幅器２の出力信号Ｃはアナログ比較
器４，５．６に取シ込まれ、該比較器４，５．６とデコ
ーダ７で４つの信号領域のレベルに適合した判別信号が
作成され、７から４つの判別信号（スティタス信号）を
フリップフロップ８，９，１０．１１にアドレスデコー
ダ２４からのＩ１０命令で一時記憶し、判別ステイスタ
ス信号としてマイクロコンピュータ２３に読み込まして
いた。
信号処理装置は第１図に示すようにホトマル検知器１か
らの出力信号を前置増幅器２で増幅し、その出力信号ｅ
を更に増幅度の異った４種類（１倍、８倍、６４倍、５
１２倍）の増幅器１２．１３，１４．１５で増幅し、各
々の出力端をアナログスイッチ１６．１７，１８．１９
で接続して、そのアナログスイッチ１６．１７，１８゜
１９で選択された１つの信号を極性変換器２０を通して
Ａ／Ｄ変換器２１でディジタル量に変換し、その出力を
パフアゲート２２を通してマイクロコンピュータ２３に
よシ演箕処理し記録装置２５に出力するように構成され
ている。更に前置増幅器２の出力信号Ｃはアナログ比較
器４，５．６に取シ込まれ、該比較器４，５．６とデコ
ーダ７で４つの信号領域のレベルに適合した判別信号が
作成され、７から４つの判別信号（スティタス信号）を
フリップフロップ８，９，１０．１１にアドレスデコー
ダ２４からのＩ１０命令で一時記憶し、判別ステイスタ
ス信号としてマイクロコンピュータ２３に読み込まして
いた。
との従来方式ではアナログ比較器に入る信号が切換接点
でノイズと重なった場合にアドレスデコーダ２４からの
Ａ／Ｄスタート信号でフリップフロップ８，９，１０．
１１を同一時間で一時記憶を行った時、その系統の素子
の遅延時間のバラツキにより２つの領域を選択してしま
う場合が起る。
でノイズと重なった場合にアドレスデコーダ２４からの
Ａ／Ｄスタート信号でフリップフロップ８，９，１０．
１１を同一時間で一時記憶を行った時、その系統の素子
の遅延時間のバラツキにより２つの領域を選択してしま
う場合が起る。
これは２つの信号が同時に一時記憶されてしまうことに
なる。このために増幅器の出力端のアナログスイッチを
２つ選択してしまい増幅器の出力誤差が発生する。これ
と同時に７リツプフロツプ８．９，１０．１１の出力中
２つのスティタス信号がマイクロコンピュータ２３に読
み込まれるためマイクロコンピュータ２３は信号変化か
ら判断し１つのスティタス信号を選択する煩られしさが
あった。
なる。このために増幅器の出力端のアナログスイッチを
２つ選択してしまい増幅器の出力誤差が発生する。これ
と同時に７リツプフロツプ８．９，１０．１１の出力中
２つのスティタス信号がマイクロコンピュータ２３に読
み込まれるためマイクロコンピュータ２３は信号変化か
ら判断し１つのスティタス信号を選択する煩られしさが
あった。
本発明は上記のような従来技術の欠点を解消するために
なされたものである。
なされたものである。
本発明の目的は従来技術の欠点である増幅度切換時の２
重切換を解消し、円滑で直線性の優れたスペクトルを得
ることのできる高速でしかも高忠実度を有する信号処理
装置を提供することにある。
重切換を解消し、円滑で直線性の優れたスペクトルを得
ることのできる高速でしかも高忠実度を有する信号処理
装置を提供することにある。
本発明は、検知器からの検出信号の電圧レベル領域を判
別する複数の比較器と、該比較器出力を取り込み検出信
号の電圧レベルに応じた判別状態信号を出力するデコー
ダと、該デコーダ出力を一時的に記憶する記憶回路と、
スイッチ手段を介して並列接続され前記検出信号を増幅
する増幅度の異なる複数の増幅器と、前記記憶回路の出
力を取９込み検出信号の電圧レベル領域に適合する増幅
器を選択するための制御信号を前記スイッチ手段に出力
する優先回路とを有することを特徴とするものである。
別する複数の比較器と、該比較器出力を取り込み検出信
号の電圧レベルに応じた判別状態信号を出力するデコー
ダと、該デコーダ出力を一時的に記憶する記憶回路と、
スイッチ手段を介して並列接続され前記検出信号を増幅
する増幅度の異なる複数の増幅器と、前記記憶回路の出
力を取９込み検出信号の電圧レベル領域に適合する増幅
器を選択するための制御信号を前記スイッチ手段に出力
する優先回路とを有することを特徴とするものである。
第２図に本発明に係る信号処理装置の一実施例の構成を
示す。第１図と同じ回路部又は要素には同一符号を付し
である。第２図において、スペクトル先をホトマル検知
器１で検出し、この信号を前記増幅器２で増幅して、電
圧ｅとして出力される。この信号電圧ｅは３つのアナロ
グ比較器４゜５．６に同時に入力され各々、異った増幅
器をもつ増幅器１２，１３，１４．１５にも入力される
。
示す。第１図と同じ回路部又は要素には同一符号を付し
である。第２図において、スペクトル先をホトマル検知
器１で検出し、この信号を前記増幅器２で増幅して、電
圧ｅとして出力される。この信号電圧ｅは３つのアナロ
グ比較器４゜５．６に同時に入力され各々、異った増幅
器をもつ増幅器１２，１３，１４．１５にも入力される
。
本実施例では増幅器１２の増幅度′ｆｆ：、１倍、増幅
器１３の増幅度を８′倍、増幅器１４の増幅度を６４倍
、増幅器１５の増幅度を５１２倍となるように構成して
いる。
器１３の増幅度を８′倍、増幅器１４の増幅度を６４倍
、増幅器１５の増幅度を５１２倍となるように構成して
いる。
またアナログ比較器４，５．６の比較基準電圧ｅ・ｌ
ｅｂｌ ｅ、は一定電圧ｅ、をツェナーダイオード３に
よシ得、その電圧ｅ、を抵抗分圧することによって設定
しているう 更に４，５．’６の出力はデコーダ７０入力端子ＡＢＣ
に接続し、前置増幅器２の出力信号ｅがｅ。≧ｅ ＞
Ｏの範囲内ではデコーダの出力はＯの出力位置に、ｅｂ
≧ｅ）＞ｅ、の範囲内では１の位置に、ｅ１≧ｅ ）
ｅ 、の範囲内では３の位置に、ｅ ） ｅ 、の範囲
内では７の出力位置に判別状態信号として出力する。次
にアドレスデコーダ２４からのＡ／Ｄスクニト信号で各
フリップフロップ８゜９．１０．１１にデコーダ７から
の出力位置０゜１．３．７の判別状態信号が一時的に記
憶され、その出力端Ｑとｑとが各論理積素子２６，２７
゜２８に接続され、判別状態信号の優先回路を構成して
いる。この優先回路は２の出力電圧Ｃがアナログ比較器
４，５．６の比較電圧切換接点値り不安定な領域内でも
必ず１つしか状態信号を出さないように選択できる特徴
のある回路構成を備えている。更に７リツプフロツプ８
の出力Ｑ及び論理積素子２６，２７．２８の出力はアナ
ログスイッチ１６．１７，１８．１９の切換制御信号と
じてこれらのスイッチ１６．１７，１８．１９に供給さ
れ、各増幅器１２，１３，１４．１５の中の１つだけが
選択される。例えば切換接点ｅ、の入力電圧の判別でデ
コーダ７の出力が重複し誤って２つ選択されたとしても
優先回路によって論理積素子２７の出力だけが１″°と
なシ他の７リツプ７０ツブ８のＱ値、論理積素子２６．
２８の出力値は“０”となってアナログスイッチ１８を
ＯＮにし、他のスイッチはＯＦＦとなる。しかるに増幅
度６４倍の増幅器１４の出力電圧６４ｅが選択されて極
性変換器２０によって信号の極性が変換されてＡ／Ｄｉ
換器２１に入力される。
ｅｂｌ ｅ、は一定電圧ｅ、をツェナーダイオード３に
よシ得、その電圧ｅ、を抵抗分圧することによって設定
しているう 更に４，５．’６の出力はデコーダ７０入力端子ＡＢＣ
に接続し、前置増幅器２の出力信号ｅがｅ。≧ｅ ＞
Ｏの範囲内ではデコーダの出力はＯの出力位置に、ｅｂ
≧ｅ）＞ｅ、の範囲内では１の位置に、ｅ１≧ｅ ）
ｅ 、の範囲内では３の位置に、ｅ ） ｅ 、の範囲
内では７の出力位置に判別状態信号として出力する。次
にアドレスデコーダ２４からのＡ／Ｄスクニト信号で各
フリップフロップ８゜９．１０．１１にデコーダ７から
の出力位置０゜１．３．７の判別状態信号が一時的に記
憶され、その出力端Ｑとｑとが各論理積素子２６，２７
゜２８に接続され、判別状態信号の優先回路を構成して
いる。この優先回路は２の出力電圧Ｃがアナログ比較器
４，５．６の比較電圧切換接点値り不安定な領域内でも
必ず１つしか状態信号を出さないように選択できる特徴
のある回路構成を備えている。更に７リツプフロツプ８
の出力Ｑ及び論理積素子２６，２７．２８の出力はアナ
ログスイッチ１６．１７，１８．１９の切換制御信号と
じてこれらのスイッチ１６．１７，１８．１９に供給さ
れ、各増幅器１２，１３，１４．１５の中の１つだけが
選択される。例えば切換接点ｅ、の入力電圧の判別でデ
コーダ７の出力が重複し誤って２つ選択されたとしても
優先回路によって論理積素子２７の出力だけが１″°と
なシ他の７リツプ７０ツブ８のＱ値、論理積素子２６．
２８の出力値は“０”となってアナログスイッチ１８を
ＯＮにし、他のスイッチはＯＦＦとなる。しかるに増幅
度６４倍の増幅器１４の出力電圧６４ｅが選択されて極
性変換器２０によって信号の極性が変換されてＡ／Ｄｉ
換器２１に入力される。
−万、フリップ７０ツブ８の出力Ｑと論理槓系子２６，
２７．２８の出力信号はバッファゲート２２に増幅度切
換えスティタス便号として入る。
２７．２８の出力信号はバッファゲート２２に増幅度切
換えスティタス便号として入る。
このスティタス信号はマイクロコンピュータ２３に入力
され、その時点でのアナログ大刀のＡ／Ｄ変換値とステ
ィタスの倍率値とをコンピュータプログラムで換算し、
真の入力値をめているうＡ／Ｉ）ｆ換器２１はアドレス
デコーダ２４で発令するＡ／Ｄスタート信号によってＡ
／Ｄ変換動作を開始する。このＡ／Ｄスタート信号はマ
イクロコンピータ２３からアドレス信号を生じアドレス
デコーダ２４でＩ１０命令のコードに変換して発令する
ことになる。
され、その時点でのアナログ大刀のＡ／Ｄ変換値とステ
ィタスの倍率値とをコンピュータプログラムで換算し、
真の入力値をめているうＡ／Ｉ）ｆ換器２１はアドレス
デコーダ２４で発令するＡ／Ｄスタート信号によってＡ
／Ｄ変換動作を開始する。このＡ／Ｄスタート信号はマ
イクロコンピータ２３からアドレス信号を生じアドレス
デコーダ２４でＩ１０命令のコードに変換して発令する
ことになる。
本実施例ではマイクロコンピュータに読み込まれたデー
タは横軸を測定波長、縦軸を元素量として記録装置２５
に記録される。第３図は従来装置の入力電圧を４つの領
域（ｅ）ｅ、、ｅ、≧ｅ〉ｅ、、ｅｂ≧ｅ）ｅ、、ｅ。
タは横軸を測定波長、縦軸を元素量として記録装置２５
に記録される。第３図は従来装置の入力電圧を４つの領
域（ｅ）ｅ、、ｅ、≧ｅ〉ｅ、、ｅｂ≧ｅ）ｅ、、ｅ。
≧ｅ〉０）に分類し従来装置で得た波長とスペクトル電
圧ｅ。の出力線図である。この図のように従来技術では
アナログ比較器の電圧切換点のノイズ及び不確定な動作
領域ｅ、＝ｅ、／６４で頂度２つの切換スティタスが発
生し重複した接点切換となって８倍の増幅器１３と６４
倍の増幅器１４が二重に選択され、スペクトル電圧ｅ０
は切換接点で下降変動を発生してしまう。第４図は上記
不具合点？：解決した本実施例によるスペクトル電圧ｅ
、の波形図であシ、上記の如き不具合は解消されている
。このように論理積素子２６，２７．２８で構成される
優先回路を採用することによシ、必ず１つの信号選択し
かない回路構成にしたため出力電圧をとシ出すとき安定
した動作で行うことができ信頼性がち如しかもスペクト
ル波形誤差のない円滑な増幅度切換方式を用いることが
できる。
圧ｅ。の出力線図である。この図のように従来技術では
アナログ比較器の電圧切換点のノイズ及び不確定な動作
領域ｅ、＝ｅ、／６４で頂度２つの切換スティタスが発
生し重複した接点切換となって８倍の増幅器１３と６４
倍の増幅器１４が二重に選択され、スペクトル電圧ｅ０
は切換接点で下降変動を発生してしまう。第４図は上記
不具合点？：解決した本実施例によるスペクトル電圧ｅ
、の波形図であシ、上記の如き不具合は解消されている
。このように論理積素子２６，２７．２８で構成される
優先回路を採用することによシ、必ず１つの信号選択し
かない回路構成にしたため出力電圧をとシ出すとき安定
した動作で行うことができ信頼性がち如しかもスペクト
ル波形誤差のない円滑な増幅度切換方式を用いることが
できる。
更にダイナミックレンジの幅広Ａ／Ｄ変換値がまり、広
範囲な検出入力電圧に対して融通性の大きく、例えば多
元素のスペクトルを分析するような信号処理系に適用す
ることによシ優れた効果を発揮し、直線性が良好でしか
も滑かな出力波形がまる利点も備えている。
範囲な検出入力電圧に対して融通性の大きく、例えば多
元素のスペクトルを分析するような信号処理系に適用す
ることによシ優れた効果を発揮し、直線性が良好でしか
も滑かな出力波形がまる利点も備えている。
上記のように本実施例によれば増幅器切換接点での信号
変化の誤動作を解消し、円滑高精度なスペクトル出力電
圧波形を記録できるという効果がある。
変化の誤動作を解消し、円滑高精度なスペクトル出力電
圧波形を記録できるという効果がある。
第５図に本発明の他の実施例の構成を示す。この実施例
も上記実施例と同様に切換接点での二重選択の不具合点
を解消している。本実施例では上記実施例における優先
回路の機能をマイクロコンピュータの処理１０により実
現している。同図においてマイクロコンピュータ２３が
フリップフロップ８，９，１０．１１のＱ出力から出る
スティタス信号を読み取ってコンピュータプログラムで
優先順位を判断し、その優先する信号の１つを２３のデ
ータとして出力し、アドレスデコーダ２４からのＩ１０
命令で一時記憶回路２９に記憶し、２９からの記憶出力
信号はアナログスイッチ１６゜１７．１８．１９中の１
つをＯＮにする、この機能方式によシ増幅器を二重に選
択せずに従来の不具合点を解決することができる。
も上記実施例と同様に切換接点での二重選択の不具合点
を解消している。本実施例では上記実施例における優先
回路の機能をマイクロコンピュータの処理１０により実
現している。同図においてマイクロコンピュータ２３が
フリップフロップ８，９，１０．１１のＱ出力から出る
スティタス信号を読み取ってコンピュータプログラムで
優先順位を判断し、その優先する信号の１つを２３のデ
ータとして出力し、アドレスデコーダ２４からのＩ１０
命令で一時記憶回路２９に記憶し、２９からの記憶出力
信号はアナログスイッチ１６゜１７．１８．１９中の１
つをＯＮにする、この機能方式によシ増幅器を二重に選
択せずに従来の不具合点を解決することができる。
〔）６明の効果〕
本発明によればグイミンクレンジの広い出力信号を高速
で且つ高忠実度で以って処理することができる。
で且つ高忠実度で以って処理することができる。
第１図は従来の信号処理装置の構成を示す回路図、第２
図は本発明に係る信号処理装置の一実施例の構成を示す
回路図、第３図は第１図の従来装置で得た波長に対する
スペクトル強度を示す出力電圧波形図、第４図は本実施
例に係る信号処理装置から得ｆｃ波長に対するスペクト
ル強度を示す出力電圧波形図、第５図は本発明の他の実
施の構成を示す回路図である。 １・・・ホトマル検知器、２・・・前置増幅器−３・・
・ツェナーダイオード、４〜６・・・アナログ比較器、
７・・・デコーダ、８〜１１・・・フリップフロップ、
１２〜１５・・・増幅器、１６〜１９・・・アナログス
イッチ、２０・・・極性変換器、２１・・・Ａ／Ｄ変換
器、２２・・・パフアゲート、２３・・・マイクロコン
ピュータ、２４・・・アドレスデコーダ、２５・・・記
録装置、２６〜２８・・・論理積素子、２９・・・一時
記憶回路。 第２図 Ｅ 吊３０ 躬４図 波長入（吟Ｆ′Ｊ′Ｉ）
図は本発明に係る信号処理装置の一実施例の構成を示す
回路図、第３図は第１図の従来装置で得た波長に対する
スペクトル強度を示す出力電圧波形図、第４図は本実施
例に係る信号処理装置から得ｆｃ波長に対するスペクト
ル強度を示す出力電圧波形図、第５図は本発明の他の実
施の構成を示す回路図である。 １・・・ホトマル検知器、２・・・前置増幅器−３・・
・ツェナーダイオード、４〜６・・・アナログ比較器、
７・・・デコーダ、８〜１１・・・フリップフロップ、
１２〜１５・・・増幅器、１６〜１９・・・アナログス
イッチ、２０・・・極性変換器、２１・・・Ａ／Ｄ変換
器、２２・・・パフアゲート、２３・・・マイクロコン
ピュータ、２４・・・アドレスデコーダ、２５・・・記
録装置、２６〜２８・・・論理積素子、２９・・・一時
記憶回路。 第２図 Ｅ 吊３０ 躬４図 波長入（吟Ｆ′Ｊ′Ｉ）
Claims (1)
- 【特許請求の範囲】 １、検知器からの検出信号の電圧レベル領域を判別する
複数の比較器と、該比較器出力を取シ込み検出信号の電
圧レベルに応じた判別状態信号を出力するデコーダと、
該デコーダ出力を一時的に記憶する記憶回路と、スイッ
チ手段を介して並列接続されて前記検出信号を増幅する
増幅度の異なる複数の増幅器と、前記記憶回路の出力を
取シ込み検出信号の電圧レベル領域に適合する増幅器を
選択するための制御信号を前記スイッチ手段に出力する
優先回路とを有することを特徴とする信号処理回路。 ２、前記記憶回路によシ出力される検出信号の電圧レベ
ル領域の判別状態信号をマイクロコンピュータに取込み
、マイクロコンピュータはプログラムで優先順位を判断
し、優先するデータの１つを出力し、該データに基づい
て前記スイッチ手段を切り換えるように構成したことを
特徴とする特許請求の範囲第１項に記載の信号処理回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19908983A JPS6091242A (ja) | 1983-10-26 | 1983-10-26 | 信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19908983A JPS6091242A (ja) | 1983-10-26 | 1983-10-26 | 信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6091242A true JPS6091242A (ja) | 1985-05-22 |
Family
ID=16401919
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19908983A Pending JPS6091242A (ja) | 1983-10-26 | 1983-10-26 | 信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6091242A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0259647A (ja) * | 1988-08-26 | 1990-02-28 | Hitachi Ltd | 自動蛍光光度計を用いる分析方法 |
| US6870618B2 (en) * | 2001-04-27 | 2005-03-22 | Anritsu Corporation | Wavelength characteristic measuring device and method using light having wavelength thereof continuously changed |
-
1983
- 1983-10-26 JP JP19908983A patent/JPS6091242A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0259647A (ja) * | 1988-08-26 | 1990-02-28 | Hitachi Ltd | 自動蛍光光度計を用いる分析方法 |
| US6870618B2 (en) * | 2001-04-27 | 2005-03-22 | Anritsu Corporation | Wavelength characteristic measuring device and method using light having wavelength thereof continuously changed |
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