JPS6074525A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPS6074525A
JPS6074525A JP58180465A JP18046583A JPS6074525A JP S6074525 A JPS6074525 A JP S6074525A JP 58180465 A JP58180465 A JP 58180465A JP 18046583 A JP18046583 A JP 18046583A JP S6074525 A JPS6074525 A JP S6074525A
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JP
Japan
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pattern
mask
exposure
resist
patterns
Prior art date
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JP58180465A
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English (en)
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JPS6350852B2 (ja
Inventor
Hiroyuki Tanaka
裕之 田中
Takashi Nakagawa
孝 中川
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Publication of JPS6350852B2 publication Critical patent/JPS6350852B2/ja
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26

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  • Engineering & Computer Science (AREA)
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  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Preparing Plates And Mask In Photomechanical Process (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 l)発明の技術分野 本発明は半導体装置の製造方法に関し、更に詳しくは現
像レジストパターンの適正度を極めて容易に判別し、正
確に転写されたパターンを得るようC二した半導体装置
の製造方法に関する。
2)技術の背景 半導体装置の製造におけるホトエツチング工程において
は、ワーキングマスクを、ウェーハに塗布したホトレジ
ストに転写する。この転写はホトマスクの位置合わせ、
密着又は投影による紫外線露光お工び現像からなる。こ
の露光・現像において得られたレジスト画偉がワーキン
グマスクのパターンを正確i:反映しているかどうかが
問題となる0 3)従来技術と問題点 ホトエツチング工程において無光時間が適正であるか否
か全チェックすることは、ホトレジストにワーキングマ
スクが正確に転写されているか否かという点エフ極めて
重要なことである。すなわち、露光時間が適正時間↓り
も短い場合光の回折等の現象より所望レジスト画像より
も大きくなり、一方路光時間が適正時間よりも長い場合
所望レジスト画像エフも小さくなる。従って、露光時間
が適正でない場合、レジスト線幅離し再度位置合わせ、
露光お工び現像を行なわなければならず、このため多大
の時間的ロスが生じることとなる。
従来、j1光時間が適正であるか否かを判別するために
はホトマスク内のチップ形成パターン間のライン上にL
字形の測長パターン全般け、このパターンが転写された
現像レジストパターン金側長話および顕微鏡を用い実際
測長を行−てい7toこのような測定を伴なう顕微鏡検
査は相当の時間を強要するものである。従って、このよ
うな検査l二伴う時間を短縮しエフ簡便な方法で、得ら
れたレジストパターンの適正露光度を判定しより精度の
高いICパターンを得る方法が望まれていた。
(3) 4)発明の目的 本発明は、現像レジストノくターンの露光適正度を簡便
かつ瞬時に判定しプロセスの効率化を高めうる半導体装
置の製造方法を提供することをその目的とする0 5)発明の構成 かかる目的達成のため、本発明は少なくとも3個のパタ
ーンから構成される下記の寸法チェック用パターンを有
するマスクを使用してレジストに対し露光を行ない、露
光後レジストを現像し寸法チェック用レジストパターン
を得、このレジストパターンを顕微鏡を用いて観察し露
光の適正度を判断する工程を有することを特徴とするも
のであり、前記寸法チェック用パターンは(1)マスク
の一側からマスクの他1QIIl:、向って延びる第一
ノ(ターン、(2)該マスクの前記−側から前記他側1
:回って第一パターンと平行に延びる第二パターン、お
よび(3)該マスクの前記他側から前記第一ノ(ターン
と第二パターンとの間の間隙内に向って前記第一)くタ
ーン及び第二パターンと平行C:延びる第三ノくターン
(4) とからなり、前記第一パターンの先端辺部が第二パター
ンの先端辺部よシも一定距離αだけマスクの前記他側に
近接した位置C二あり、前記第三パタク、プロセスで予
め決められている値である)の位置だけマスクの一側に
あることを特徴とする0すなわち、本発明はホトマスク
の製品となるべき領域外の個所、例えばホトマスクの片
隅に前述の3個のパターンから構成される寸法チェック
パターンを形成し、このパターンを利用し露光秒数によ
ってレジスト線幅が許容範囲内に入−でいるか否かをチ
ェックせんとするものである。つまり、本発明は露光の
進行に従って得られるレジストノくターンはエツジ全体
を残しレジスト側に縮少する方向に進むのであるが、上
記寸法チェックパターンを利用したレジストパターンに
おけるピッチαが一足であることを利用したものである
以下、本発明の一実施例を図面に基づいて説明する〇 6)発明の実施例 ホトマスク1の必要パター7領域外、例えばホトマスク
の片隅に矩形の第一パターン2%矩形の第二パターン3
、お工び矩形の第三パターン4から構成される寸法制御
チェックパターンc以下、チェックパターンという)A
t−形成する。このチェックパターンAは、例えば電子
ビーム描画性1:エジレチクル作製時において同時に作
成することができる0 寸法チェックパターンを構成する第一パターン2と第二
パターン3は双方ともマスクの一側からマスクの他側に
向って平行a;延びており、該第−パターン2の先端辺
部2a扛第二パターン3の先端辺部3aよりも一定距離
αだけマスクの他側に近接して位置している0この一定
距離αの上限値はIC設計上必然的に定められる値であ
り、その下限値は顕微鏡によV第一パターン2の先端辺
部2aと第二パターン3の先端辺部3aの差が可視でき
る値である。従って、仁の上限値と下限値C二間にある
範囲が許容範囲となる。上記一定距離α、換言すれは許
容範囲αは露光時間に依存せず一定である。
第一パターン2と第二パターン3との間には、マスクの
前記他側から一方側に第一パターン及び第二パターンと
平行に(又は#1ぼ平行にト延びる第三パターン4が更
に前記マスクAに設けられてα いる。更に第三パターン4の先端辺部4aは−+2βC
βは露光シフトである)の位置だけマスクの一四にある
このような位置関係を有するマスクA(又はレチクル)
を用いてホトレジストに対し露光時間を3通り変化させ
紫外線露光を行い、次いで現像を行い現像レジストパタ
ーン(第3〜5図)を得る0すなわち、第一パターン2
に対応して第一レシストパターン5.5’、5”、第二
パターン3に対応して第ニレジストパターン6.6’、
6”、およヒ第三パターンに対応して第三レジストパタ
ーン7゜7′17” を得る。
今、露光時間が適正露光時間りりも短かい場合、すなわ
ち露光不足である場合第三レジスタパター(7) ン7の先端辺部7aは許容範囲αから外れ第ニレジスト
パターン6側に位置するC第3図)。これはg光時間が
短かく得られるレジストパターン5゜6.7の縮少値が
予じめ定められた縮少値β工9も少さいことに起因する
露光時間が適正な結党時間内にある場合、第三レジスト
パターン7′の先端辺部7’aは許容範囲α内に存在す
る。つまり必要な露光シフトが許容範囲内I:入ってい
ることを示している。
露光時間が適正露光時間エフも過剰である場合、第三レ
ジストパターン7”の先端辺部7“aは許容範囲α外に
あり第一レジストパターン5” お工び第ニレジストパ
ターン6″ エフ隔った位置にある07)発明の効果 本発明は以上の説明から明らかなようにマスク内に少な
くとも三個のパターンからなる寸法チェック用パターン
を形成し、該マスクを用いて露光・現像を行なうように
構成しkものであるから、顕微鏡観察だけで必要な露光
シフトが入−ているかどうか、つ′1り露光時間が適正
であったか否かを(8) 瞬時に判断し得る効果を奏する。従−て、ICプロセス
において全体の作業時間の短縮化・能率化を図ることが
可能となる。
【図面の簡単な説明】
第1図は本発明の一実施例を示す平面図、第2図は第1
図の部分拡大図、 第3図は露光不足の場合のレジストパターンを示す平面
図。 第4図は適正露光の場合のレジストパターンを示す平面
図、および 第5図は露光過剰の場合のレジストパターンを示す平面
図である。 1・・・・・・マスク、2,3.4・・・・・・パター
ン。 A・・・・・・寸法チェック用パターン。

Claims (1)

  1. 【特許請求の範囲】 1、少なくとも次の三個のパターン: (1)マスクの一側からマスクの他@l二向って延びる
    第一パターン、(2)該マスクの前記−関から前記他側
    に向って第一パターンと平行I:延びる第二パターン、
    および(3) #マスクの前記他側から前記第一パター
    ンと第二パターンとの間の間隙内に向って前記第一パタ
    ーン及び第二パターンと平行に延びる第三パターンとか
    らなり、前記第一パターンの先端辺部が第二パターンの
    先端辺部よりも一定距離αだけマスクの前記他側に近接
    した位置にあは露光シフトである)の位置だけマスクの
    一側書−ある。 からなる、寸法チェック用パターンを有するマスクを使
    用してレジストに対し露光を行ない、露光後レジストを
    現像し寸法チェック用レジストパターンを得、このレジ
    ストパターンを顕微鏡により観察し露光の適正度を判断
    する工程を有することを特徴とする、半導体装置の製造
    方法。
JP58180465A 1983-09-30 1983-09-30 半導体装置の製造方法 Granted JPS6074525A (ja)

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JPS6350852B2 JPS6350852B2 (ja) 1988-10-12

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Cited By (5)

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Publication number Priority date Publication date Assignee Title
JPS60145637A (ja) * 1984-01-09 1985-08-01 Mitsubishi Electric Corp 半導体装置のパタ−ン寸法測定方法
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JP2006154265A (ja) * 2004-11-29 2006-06-15 Fujitsu Ltd レチクル及び半導体装置の製造方法

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5427708A (en) * 1977-08-03 1979-03-02 Pioneer Electronic Corp Signal compander

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