JPS6055557A - ディジタル音響記録再生装置 - Google Patents
ディジタル音響記録再生装置Info
- Publication number
- JPS6055557A JPS6055557A JP16223983A JP16223983A JPS6055557A JP S6055557 A JPS6055557 A JP S6055557A JP 16223983 A JP16223983 A JP 16223983A JP 16223983 A JP16223983 A JP 16223983A JP S6055557 A JPS6055557 A JP S6055557A
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- JP
- Japan
- Prior art keywords
- circuit
- data
- recording
- logic
- control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/10527—Audio or video recording; Data buffering arrangements
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、高忠実ステレオ装置のうちで、磁気テープ・
カートリッジ等にディジタル化した信号を記録再生する
テープレコーダ装置、あるいは記録再生可能なディスク
装置等のディジタル音響記録再生装置に関するものであ
る。
カートリッジ等にディジタル化した信号を記録再生する
テープレコーダ装置、あるいは記録再生可能なディスク
装置等のディジタル音響記録再生装置に関するものであ
る。
従来例の構成とその問題点
従来、磁気テープ装置においてディジタル情報の記録再
生を行なうものは、主にコンビーータの外部記録装置で
あって一般に広く使用されてきて３ いる。
生を行なうものは、主にコンビーータの外部記録装置で
あって一般に広く使用されてきて３ いる。
上記のような磁気テープ装置における磁気テープ」二の
記録線密度は晶いものでも６２５０ＢＰＩ（ビット／イ
ンチ）動度が主流であり通常かなりの高速でテープを駆
動している。
記録線密度は晶いものでも６２５０ＢＰＩ（ビット／イ
ンチ）動度が主流であり通常かなりの高速でテープを駆
動している。
しかしながら音響信号を例えば５ｏｋＨｚ程度のサンプ
リング周波数、量子化１６Ｂｉｔ、冗長度１６０゛チ、
２チヤンネルの場合で記録、再生時を考えると、２ Ｍ
１３ ｉ ｔ／Ｓのピッ］・レートのデータを記録しな
ければならず、これを２０トランクで分割したとしても
１トラツクにつき約１００Ｋ Ｂｉ ｔ／Ｓとなる。例
えばオーディオコンパクトカセットのテープスピードを
４ 、７６ｔｙｎ／ Ｓで走行させた場合でも記録線密
度は５０ＫＢＰＩ（ビット／インチ）となり、この様な
高密度記録を行なうためには特殊チープツトレコーダが
各社より発表されているが全て高密度テープを使用して
おり、カセットテープの互換性という点では通常のオー
ディオカセットを使用することができないという大きな
欠点を有していた。
リング周波数、量子化１６Ｂｉｔ、冗長度１６０゛チ、
２チヤンネルの場合で記録、再生時を考えると、２ Ｍ
１３ ｉ ｔ／Ｓのピッ］・レートのデータを記録しな
ければならず、これを２０トランクで分割したとしても
１トラツクにつき約１００Ｋ Ｂｉ ｔ／Ｓとなる。例
えばオーディオコンパクトカセットのテープスピードを
４ 、７６ｔｙｎ／ Ｓで走行させた場合でも記録線密
度は５０ＫＢＰＩ（ビット／インチ）となり、この様な
高密度記録を行なうためには特殊チープツトレコーダが
各社より発表されているが全て高密度テープを使用して
おり、カセットテープの互換性という点では通常のオー
ディオカセットを使用することができないという大きな
欠点を有していた。
発明の目的
本発明は上記欠点に鑑み々されたもので、高密度記録媒
体と低密度記録媒体のような記録密度の異なる媒体を使
用する場合、ディジタル信号処理によって音響信号の情
報圧縮を行ない前記媒体を用いるシステムに対する互換
性を持つディジタル音響記録再生装置を提供することを
目的とする。
体と低密度記録媒体のような記録密度の異なる媒体を使
用する場合、ディジタル信号処理によって音響信号の情
報圧縮を行ない前記媒体を用いるシステムに対する互換
性を持つディジタル音響記録再生装置を提供することを
目的とする。
発明の構成
上記目的を達するため本発明のディジタル音響記録再生
装置は記録再生媒体の記録再生特性を識別する手段と、
アナログ−ディジタルコンバータ（以下Ａ／Ｄコンバー
タという。）と、ディジタル−アナログコンバータ（以
下Ｄ／Ａコンバータという。）と、論理制御回路と、前
記論理制御回路を制御するコントロールメモリー回路と
、前記コントロールメモリー回路にアドレスを与えて前
記論理制御回路の制御手順を決定する順序制御回路と、
前記論理制御回路により指定された演算を６ ′ 行なう算術論理演算回路と、前記算術論理演算回路に係
数値を−ｔ５える係数メモリー回路とを備え、前記記録
再生媒体の識別結果に従って前記順序制御回路の制御手
段を変更し、前記算術論理演算回路及び係数メモリー回
路は前記Ａ／Ｄコンバータによって２進化されたデータ
の誤り訂正符号を生成しかつ前記識別結果に応じて前記
データと前記係数メモリー回路又は前記コントロールメ
モリー回路にあらかじめ蓄えて才？いた２進情報とを前
記算術論理演算回路に入力して演算処理を行ない圧縮デ
ータを前記記録再生媒体へ記録し、あるいは前記記録再
生媒体から再生され加工されたデータと、前記係数メモ
リー回路又は前記コントロールメモリー回路にあらかじ
め蓄えおいた２進情報とを前記算術論理演算回路に入力
して演算処理を行ない伸張データを前記Ｄ／Ａコンバー
タに入力して音響信号を再生する構成となっている。
装置は記録再生媒体の記録再生特性を識別する手段と、
アナログ−ディジタルコンバータ（以下Ａ／Ｄコンバー
タという。）と、ディジタル−アナログコンバータ（以
下Ｄ／Ａコンバータという。）と、論理制御回路と、前
記論理制御回路を制御するコントロールメモリー回路と
、前記コントロールメモリー回路にアドレスを与えて前
記論理制御回路の制御手順を決定する順序制御回路と、
前記論理制御回路により指定された演算を６ ′ 行なう算術論理演算回路と、前記算術論理演算回路に係
数値を−ｔ５える係数メモリー回路とを備え、前記記録
再生媒体の識別結果に従って前記順序制御回路の制御手
段を変更し、前記算術論理演算回路及び係数メモリー回
路は前記Ａ／Ｄコンバータによって２進化されたデータ
の誤り訂正符号を生成しかつ前記識別結果に応じて前記
データと前記係数メモリー回路又は前記コントロールメ
モリー回路にあらかじめ蓄えて才？いた２進情報とを前
記算術論理演算回路に入力して演算処理を行ない圧縮デ
ータを前記記録再生媒体へ記録し、あるいは前記記録再
生媒体から再生され加工されたデータと、前記係数メモ
リー回路又は前記コントロールメモリー回路にあらかじ
め蓄えおいた２進情報とを前記算術論理演算回路に入力
して演算処理を行ない伸張データを前記Ｄ／Ａコンバー
タに入力して音響信号を再生する構成となっている。
この構成により記録密度の異なる媒体を使用する場合で
も互換性をもって記録再生を行なうこととなる。
も互換性をもって記録再生を行なうこととなる。
６ベ ７・
実施例の説明 □
以下本発明の一実施例について図面に基づき説明する。
図は本発明の一実施例のディジタル音響記録再生装置の
ブロック図である。
ブロック図である。
図において、１はアナログ信号を入力する入力端子、２
は入力端子１に接続しアナログ信号をディジタル信号に
変換するＡ／Ｄコンバータ、３はＡ／Ｄコンバータ２に
接続しディジタル信号等を伝送するパスライン、４はパ
スライン３に接続しディジタル信号をアナログ信号に変
換するＤ／Ａコンバータ、６はＤ／Ａコンバータ４によ
っテ変換されたアナログ信号を出力する出力端子、６は
パスライン３に接続され、また誤り訂正等の演算を行な
う算術論理演算回路７に接続し圧縮比較データを出力す
る係数メモリー回路、８は算術論理演算回路７に接続し
て設けられ２進データを格納するレジスタ、９は記録再
生媒体である磁気テープカセットの識別穴に連動してテ
ープの判定出力を出すスイッチ、１０はパスライン３に
接続され７ ： Ｄフリップフロップに」二って構成された論理制御回路
、１１は論理制御回路１０に接続され、論理制御回路１
０の制御順序を決定する順序制御回路、１２は順序制御
回路１１に接続され算術論理演算回路１ｏの演算を制御
する制御ビットを出す読み出し専用のコントロールメモ
リー回路、１３はパスライン３に接続され圧縮または伸
長されたデー゛りのインターリーブ又はディンターリー
ブを行なうデータメモリー回路、１４はパスライン３に
接続されディンターリーブされたデータの変調を行なう
変調器、１５はテープに記録する記録ヘッド１６を駆動
するドライバー回路、１７は再生ヘッド１８によって再
生されたデータの増幅等を行なう再生アンプを持つ等何
回路、１９ｉｌ：パスライン３に接続され等何回路１７
を通った再生データを復調する復調器である。
は入力端子１に接続しアナログ信号をディジタル信号に
変換するＡ／Ｄコンバータ、３はＡ／Ｄコンバータ２に
接続しディジタル信号等を伝送するパスライン、４はパ
スライン３に接続しディジタル信号をアナログ信号に変
換するＤ／Ａコンバータ、６はＤ／Ａコンバータ４によ
っテ変換されたアナログ信号を出力する出力端子、６は
パスライン３に接続され、また誤り訂正等の演算を行な
う算術論理演算回路７に接続し圧縮比較データを出力す
る係数メモリー回路、８は算術論理演算回路７に接続し
て設けられ２進データを格納するレジスタ、９は記録再
生媒体である磁気テープカセットの識別穴に連動してテ
ープの判定出力を出すスイッチ、１０はパスライン３に
接続され７ ： Ｄフリップフロップに」二って構成された論理制御回路
、１１は論理制御回路１０に接続され、論理制御回路１
０の制御順序を決定する順序制御回路、１２は順序制御
回路１１に接続され算術論理演算回路１ｏの演算を制御
する制御ビットを出す読み出し専用のコントロールメモ
リー回路、１３はパスライン３に接続され圧縮または伸
長されたデー゛りのインターリーブ又はディンターリー
ブを行なうデータメモリー回路、１４はパスライン３に
接続されディンターリーブされたデータの変調を行なう
変調器、１５はテープに記録する記録ヘッド１６を駆動
するドライバー回路、１７は再生ヘッド１８によって再
生されたデータの増幅等を行なう再生アンプを持つ等何
回路、１９ｉｌ：パスライン３に接続され等何回路１７
を通った再生データを復調する復調器である。
以上のように構成さノまた本実施例について以下その動
作について説明する。
作について説明する。
まず、入力端子１より入力されたアナログ信号はＡ／Ｄ
変換後、２進データとなりパスライン３を通じて算術論
理演算回路７に入力され第１番目のクロック時にはＡ／
Ｄ変換された２進データは論理制御回路１ｏと論理制御
回路１０の制御順序を決定する順序制御回路１１とコン
トロールメモリー回路１２による制御ビットによって算
術論理演算回路７に演算を行なわせずレジスタ８に格納
される。次のクロック時には磁気テープカセットの識別
穴に連動したスイッチ９による判定出力が正となってい
る時は係数メモリー回路６から圧縮比較データを論理制
御回路１ｏの制御下に読み出す。そして算術論理演算回
路７によって比較演算を行ない比較演算結果に従ったビ
ットを算術論理演算回路γ及び論理制御回路１０．コン
トロールメモリー回路１２．順序制御回路１１によって
設定し圧縮データを得る。もしスイッチ９による判定出
力が負の時はこれらの圧縮操作は行なわない。
変換後、２進データとなりパスライン３を通じて算術論
理演算回路７に入力され第１番目のクロック時にはＡ／
Ｄ変換された２進データは論理制御回路１ｏと論理制御
回路１０の制御順序を決定する順序制御回路１１とコン
トロールメモリー回路１２による制御ビットによって算
術論理演算回路７に演算を行なわせずレジスタ８に格納
される。次のクロック時には磁気テープカセットの識別
穴に連動したスイッチ９による判定出力が正となってい
る時は係数メモリー回路６から圧縮比較データを論理制
御回路１ｏの制御下に読み出す。そして算術論理演算回
路７によって比較演算を行ない比較演算結果に従ったビ
ットを算術論理演算回路γ及び論理制御回路１０．コン
トロールメモリー回路１２．順序制御回路１１によって
設定し圧縮データを得る。もしスイッチ９による判定出
力が負の時はこれらの圧縮操作は行なわない。
これらの圧縮データの結果は論理制御回路１００制御下
に算術論理演算回路７．係数メモリー回路６等によって
誤り訂正符号を付加、あるいはまたデータメモリー回路
１３によってインターリーブ９べ−７ 後、変調器１４によって変調され、ｌ−ライバー回路１
６を通じて記録ヘッド１６を駆動する。
に算術論理演算回路７．係数メモリー回路６等によって
誤り訂正符号を付加、あるいはまたデータメモリー回路
１３によってインターリーブ９べ−７ 後、変調器１４によって変調され、ｌ−ライバー回路１
６を通じて記録ヘッド１６を駆動する。
また、再生ヘッド１８に、１：って再生されたデータは
再生アンプを持つ等何回路１７を通ったのち復調器１９
を通じて復調した後、論理制御回路１゜の制御下に算術
論理演算回路７の係数メモリー回路６等によってｉｌＱ
り訂正を、またデータメモリー回路１３によってディン
ターリーブを行なう。その後、記録時とｉｄ：逆の手順
に従ってデータを伸長してＤ／Ａコンバータに入力し、
出力端子５１［アナログ出力を得ることになる。
再生アンプを持つ等何回路１７を通ったのち復調器１９
を通じて復調した後、論理制御回路１゜の制御下に算術
論理演算回路７の係数メモリー回路６等によってｉｌＱ
り訂正を、またデータメモリー回路１３によってディン
ターリーブを行なう。その後、記録時とｉｄ：逆の手順
に従ってデータを伸長してＤ／Ａコンバータに入力し、
出力端子５１［アナログ出力を得ることになる。
以上のように本実施例によれば、ビットを圧縮すること
によって誤り訂正符号の作成及び訂正は簡単になり、処
理時間に余裕ができ記録及び再生されたデータの圧縮及
びイ中長処理を行なうのに十分な時間を取ることができ
る。これらのことにより、通常のアナログテープとディ
ジタルテープといった記録密度の異なる媒体を用いた時
でも、同一のハードウェアで記録再生することができる
。
によって誤り訂正符号の作成及び訂正は簡単になり、処
理時間に余裕ができ記録及び再生されたデータの圧縮及
びイ中長処理を行なうのに十分な時間を取ることができ
る。これらのことにより、通常のアナログテープとディ
ジタルテープといった記録密度の異なる媒体を用いた時
でも、同一のハードウェアで記録再生することができる
。
また、スイッチ９の判定出力に従って等何回路１ｏ ＋
−一・ １７のイコライザ特性を変更させることができる。
−一・ １７のイコライザ特性を変更させることができる。
さらに上記と同様に、この判定出力に応じて記録フォー
マントを順序制御回路１１０手順を変えて変更すること
、Ａ／Ｄコンバータ２．Ｄ／Ａコンバータ４のサンプリ
ング周波数を変更することも可能である。
マントを順序制御回路１１０手順を変えて変更すること
、Ａ／Ｄコンバータ２．Ｄ／Ａコンバータ４のサンプリ
ング周波数を変更することも可能である。
発明の効果
以上のように本発明のディジタル音響記録再生装置によ
れば、ビットを圧縮することによって誤り訂正符号の作
成及び訂正は簡単になり、処理時間に余裕ができ、記録
及び再生されたデータの圧縮及び伸長処理を行なうのに
十分な時間を取ることができるので、通常のアナログテ
ープとディジタルテープといった記録密度の異なる媒体
を用いた場合でも同一のハードウェアで記録再生するこ
とができ、その効果は大なるものがある。
れば、ビットを圧縮することによって誤り訂正符号の作
成及び訂正は簡単になり、処理時間に余裕ができ、記録
及び再生されたデータの圧縮及び伸長処理を行なうのに
十分な時間を取ることができるので、通常のアナログテ
ープとディジタルテープといった記録密度の異なる媒体
を用いた場合でも同一のハードウェアで記録再生するこ
とができ、その効果は大なるものがある。
図は本発明の一実施例のディジタル音響記録再生装置の
ブロック図である。 ２・・・…Ａ／Ｄコンバータ、４・旧・・Ｄ／Ａコンパ
−タ、６・・・・・・係数メモリー回路、９・・・・・
・スイソ九１ｏ・・・・・・論理制御回路、１１・・・
・・順序制御回路、１２・・・・・・コントロールメモ
リー回路。
ブロック図である。 ２・・・…Ａ／Ｄコンバータ、４・旧・・Ｄ／Ａコンパ
−タ、６・・・・・・係数メモリー回路、９・・・・・
・スイソ九１ｏ・・・・・・論理制御回路、１１・・・
・・順序制御回路、１２・・・・・・コントロールメモ
リー回路。
Claims (1)
- 【特許請求の範囲】 記録再生媒体の記録再生特性を識別する手段と、アナロ
グ−ディジタルコンバータと、ディジタル−アナログコ
ンバータと、論理制御回路と、前記・論理制御回路を制
御するコントロールメモリー回路と、前記コントロール
メモリー回路にアドレスを与えて前記論理制御回路の制
御手順を決定する順序制御回路と、前記論理制御回路に
より指定された演算を行なう算術論理演算回路と、前記
算術論理演算回路に係数値を与える係数メモリー回路と
を備え、前記記録再生媒体の識別結果に従って前記順序
制御回路の制御手段を変更し、前記算術演算回路及び前
記係数メモリー回路は前記アナログ−ディジタルコンバ
ータによって２進化されたデータの誤り訂正符号を生成
しかつ前記識別結果に応じて前記データと前記係数メモ
リー回路又は前記コントロールメモリー回路にあらかじ
め蓄え２ベニ ておいた２進情報とを前記算術論理演算回路に入力して
演算処理を行ない圧縮データを前記記録再生媒体へ記録
し、あるいは前記記録再生媒体から再生され加工された
データと、前記係数メモリー回路又は前記コントロール
メモリー回路にあらかじめ蓄えておいた２進情報とを前
記算術論理演算回路に入力して演算処理を行ない伸張デ
ータを前記ディジタル−アナログコンバータに入力して
音響信号を再生するディジタル音響記録再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16223983A JPS6055557A (ja) | 1983-09-02 | 1983-09-02 | ディジタル音響記録再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16223983A JPS6055557A (ja) | 1983-09-02 | 1983-09-02 | ディジタル音響記録再生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6055557A true JPS6055557A (ja) | 1985-03-30 |
Family
ID=15750624
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16223983A Pending JPS6055557A (ja) | 1983-09-02 | 1983-09-02 | ディジタル音響記録再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6055557A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62118394A (ja) * | 1985-11-19 | 1987-05-29 | 松下電器産業株式会社 | 電子楽器 |
-
1983
- 1983-09-02 JP JP16223983A patent/JPS6055557A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62118394A (ja) * | 1985-11-19 | 1987-05-29 | 松下電器産業株式会社 | 電子楽器 |
| JPH0782338B2 (ja) * | 1985-11-19 | 1995-09-06 | 松下電器産業株式会社 | 電子楽器 |
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