JPS6039232B2 - シ−ケンス制御装置 - Google Patents
シ−ケンス制御装置Info
- Publication number
- JPS6039232B2 JPS6039232B2 JP50156671A JP15667175A JPS6039232B2 JP S6039232 B2 JPS6039232 B2 JP S6039232B2 JP 50156671 A JP50156671 A JP 50156671A JP 15667175 A JP15667175 A JP 15667175A JP S6039232 B2 JPS6039232 B2 JP S6039232B2
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- JP
- Japan
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- processing
- output section
- sequence control
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- Safety Devices In Control Systems (AREA)
- Control By Computers (AREA)
Description
【発明の詳細な説明】
本発明は複写機等のシーケンス制御装置に関する。
本発明が適用される複写機例を複写プロセスによってま
ず説明すると、第１図は複写型電子複写機の概略図であ
り、その動作は以下の如きものである。
ず説明すると、第１図は複写型電子複写機の概略図であ
り、その動作は以下の如きものである。
感光体２（導電層２−１，光導電層２一２，絶縁層２−
３からなる）を有する感光ドラムーの表面は、矢印方向
の回転に従ってまず一次帯電器３によって一様に前帯電
（例えばプラス帯電）され次に原稿台１８の移動開始と
ともに光像照射用ランプ１９，レンズ４により光像が走
査投影され同時に再帯電器５により交流もしくは前帯電
とは逆極性の直流で除電されて光像の明暗に応じた静霞
潜像が形成される。更に上記潜像はランプ６により全面
露光されてコントラストの高い静露潜像にされ現像器７
中のトナーを王とする現像剤により可視化される。その
後上記トナ−と同極性（例えば前帯電がプラスの場合は
マイナス）のコロナ放電等をなすポスト帯電器８により
上記可視像は転写され易くされ更に導電性ローラ９に転
写され搬送されつつヒータ１ １により複写材上に定着
される。一方複写済みの感光ドラム表面に残留する着色
粒子等の現像剤はクリーニング。−フ１２により、又残
留電荷はランプ１４とコロナ放電器１３とにより除去さ
れて感光体の繰り返しが可能となる。以上の様な複写プ
ロセスを繰り返すことにより所望枚数の複写物が得られ
る。従来この種の複写機においてシーケンス制御は感光
ドラムに設けたカムによるスイッチ信号で行なわれてい
た。
３からなる）を有する感光ドラムーの表面は、矢印方向
の回転に従ってまず一次帯電器３によって一様に前帯電
（例えばプラス帯電）され次に原稿台１８の移動開始と
ともに光像照射用ランプ１９，レンズ４により光像が走
査投影され同時に再帯電器５により交流もしくは前帯電
とは逆極性の直流で除電されて光像の明暗に応じた静霞
潜像が形成される。更に上記潜像はランプ６により全面
露光されてコントラストの高い静露潜像にされ現像器７
中のトナーを王とする現像剤により可視化される。その
後上記トナ−と同極性（例えば前帯電がプラスの場合は
マイナス）のコロナ放電等をなすポスト帯電器８により
上記可視像は転写され易くされ更に導電性ローラ９に転
写され搬送されつつヒータ１ １により複写材上に定着
される。一方複写済みの感光ドラム表面に残留する着色
粒子等の現像剤はクリーニング。−フ１２により、又残
留電荷はランプ１４とコロナ放電器１３とにより除去さ
れて感光体の繰り返しが可能となる。以上の様な複写プ
ロセスを繰り返すことにより所望枚数の複写物が得られ
る。従来この種の複写機においてシーケンス制御は感光
ドラムに設けたカムによるスイッチ信号で行なわれてい
た。
例えばドラム回転してカムＤによりリレーを作動すると
原稿台１８を移動開始させ、カムＦにより、給紙ローラ
１５を駆動して給紙開始させ、カムＪにより紙１０の排
出ミスを警告するものである。そのためカラー複写の如
くプロセス処理機器が多くなると、多数のカムとそれに
応じたスイッチが必要となり複数な機構故に保守点検が
困難となるものであり、そしてスイッチ，リレーのチヤ
タリングによる誤動作が増え信頼性が低下するものであ
った。
原稿台１８を移動開始させ、カムＦにより、給紙ローラ
１５を駆動して給紙開始させ、カムＪにより紙１０の排
出ミスを警告するものである。そのためカラー複写の如
くプロセス処理機器が多くなると、多数のカムとそれに
応じたスイッチが必要となり複数な機構故に保守点検が
困難となるものであり、そしてスイッチ，リレーのチヤ
タリングによる誤動作が増え信頼性が低下するものであ
った。
更に複雑な制御回路構成故に多くの素子が必要とされる
ので、コストが高くなるとともにシーケンス制御の変更
が簡単にできない欠点を有するものであった。
ので、コストが高くなるとともにシーケンス制御の変更
が簡単にできない欠点を有するものであった。
以上の欠点を除去すべくデータプロセサ、プログラムメ
モリを用いてデジタル的にシーケンス制御するものが考
えられる。
モリを用いてデジタル的にシーケンス制御するものが考
えられる。
しかしこの場合静電潜像を形成する複写機等においては
ノイズ等により出力部の信号レベルが反転することがあ
り、シーケンス上に不都合を生じることがある。
ノイズ等により出力部の信号レベルが反転することがあ
り、シーケンス上に不都合を生じることがある。
又装置の動きと独立にプログラム処理することはシーケ
ンス制御が不正確となる恐れがある。本発明はデータプ
ロセサ、プログラムメモリを用いた場合の上記シーケン
ス上の不都合を極力少なくすることができるようにした
もので、回転体に静霞潜像を形成しそれにより記録物を
得る装置のシーケンス制御装置に於いて、データプロセ
ッサと、記録プロセス処理のための高圧トランス，モー
タを含む複数の処理機器と、上記回転体の回転と同期的
なパルス発生手段と、上記処理機器のいくつかの動作シ
ーケンスプログラムを記録する読み出し専用メモリと、
上記パルス発生手段からのパルスを上記データプロセッ
サに入力するための入力部と、上記処理機器へ動作のた
めのラッチ信号群を出力する出力部と、上記出力部から
の各出力線に上記処理機器の各々の１対１で対応して接
続させる構成と、記録スタート命令及び上記パルス発生
手段からのパルスを入力して各々判別，計数処理し順次
上記プログラムを実行させることにより、シーケンス制
御のための各処理機器の制御タイミングを決定する手段
と、上記各出力線からの機器別のラッチされた信号を出
力し、各出力線に接続された機器を機器動作に必要な長
さの時間各々独立に動作させるべく上記タイミングの決
定により上記データプロセサからデータ線を介し上記出
力部に機器別のデータ線をセットし、上記出力部の特定
出力線の信号状態を変化させるときそれと同期して上記
出力部のそれ以外の機器への出力線にもその時期に必要
な信号を出力するよう、所定数のパルスをカウントした
ときその時期に対応した出力信号群を出力線に出力する
手段とを有するシーケンス制御装置を特徴とする。
ンス制御が不正確となる恐れがある。本発明はデータプ
ロセサ、プログラムメモリを用いた場合の上記シーケン
ス上の不都合を極力少なくすることができるようにした
もので、回転体に静霞潜像を形成しそれにより記録物を
得る装置のシーケンス制御装置に於いて、データプロセ
ッサと、記録プロセス処理のための高圧トランス，モー
タを含む複数の処理機器と、上記回転体の回転と同期的
なパルス発生手段と、上記処理機器のいくつかの動作シ
ーケンスプログラムを記録する読み出し専用メモリと、
上記パルス発生手段からのパルスを上記データプロセッ
サに入力するための入力部と、上記処理機器へ動作のた
めのラッチ信号群を出力する出力部と、上記出力部から
の各出力線に上記処理機器の各々の１対１で対応して接
続させる構成と、記録スタート命令及び上記パルス発生
手段からのパルスを入力して各々判別，計数処理し順次
上記プログラムを実行させることにより、シーケンス制
御のための各処理機器の制御タイミングを決定する手段
と、上記各出力線からの機器別のラッチされた信号を出
力し、各出力線に接続された機器を機器動作に必要な長
さの時間各々独立に動作させるべく上記タイミングの決
定により上記データプロセサからデータ線を介し上記出
力部に機器別のデータ線をセットし、上記出力部の特定
出力線の信号状態を変化させるときそれと同期して上記
出力部のそれ以外の機器への出力線にもその時期に必要
な信号を出力するよう、所定数のパルスをカウントした
ときその時期に対応した出力信号群を出力線に出力する
手段とを有するシーケンス制御装置を特徴とする。
それによりプログラム処理上装置の動きと同期をとるこ
とができ又ノイズ等で反転した信号を復帰でき、従って
信頼性の高いタイミング制御ができる。以下具体的に説
明すると、第２図は番地指定のための１個以上のレジス
タ、その他１次記憶用の１個以上のレジスター、データ
‐信号線より入力したデータの解読器、データを処理す
る加減算器、論理演算機能を持つデータプロセッサＣＰ
Ｕ、複数個のフリップ・フロップを１組としてこれを複
数組で構成し、番地指定信号により任意の粗が選択され
、その中の複数個のフリップ・フロツプヘデーターを書
込んだり、複数個のフリッブ・フロップのデータを読み
出したり出来るＲＡＭ、読み出し専用のメモリーで、固
定情報を収容しておくためのＲＯＭ、外部回路との信号
のやりとりを行なう入出力部１／８を複数ラインで結線
したものである。
とができ又ノイズ等で反転した信号を復帰でき、従って
信頼性の高いタイミング制御ができる。以下具体的に説
明すると、第２図は番地指定のための１個以上のレジス
タ、その他１次記憶用の１個以上のレジスター、データ
‐信号線より入力したデータの解読器、データを処理す
る加減算器、論理演算機能を持つデータプロセッサＣＰ
Ｕ、複数個のフリップ・フロップを１組としてこれを複
数組で構成し、番地指定信号により任意の粗が選択され
、その中の複数個のフリップ・フロツプヘデーターを書
込んだり、複数個のフリッブ・フロップのデータを読み
出したり出来るＲＡＭ、読み出し専用のメモリーで、固
定情報を収容しておくためのＲＯＭ、外部回路との信号
のやりとりを行なう入出力部１／８を複数ラインで結線
したものである。
即ち複写装置の制御シーケンスを予めプログラム化し、
ＲＯＭ又はＲＡＭの格納する方法、入出力部へ複写装置
の１個以上の状態検知信号を入力する回路（第３図）、
出力部の１個以上の出力信号線の各々を個々の負荷と一
対一で対応させる回路、出力信号線に１個以上のフリツ
プ・フロツプ２２をセット・リセットするための信号の
コードをＣＰＵより出力させ、前記フリップ・フロップ
の出力を複写装置２４の負荷と対応させる回路（第６図
のデコーダ２０）、複数個の複写装鷹の状態検知器の出
力をエンコーダー２１でコード化し、入力部の入力信号
線へ入力させる回路（第６図）とによりシーケンス制御
させる。ＣＰＵからまずシーケンスをプログラムしたＲ
ＯＭの番地を指定し、指定された番地の内容がデータ信
号線６を通して、ＣＰＵに読み込まれ、ＣＰＵはこれを
解読し、解読された内容に従い、電源投入から順次時系
列にある時はＣＰＵ自体の内部でデータを処理したり、
ある時はＣＰＵ内のデータ一をＲＡＭのある指定された
番地へ格納したり、ＲＡＭのある指定された番地のデー
タをＣＰＵ内へ入力したり、ある時はＣＰＵ内のデータ
を入出力部の出力信号線８へ出力したり入出力部の入力
信号線９上の内容をＣＰＵ内へ入力したりする。
ＲＯＭ又はＲＡＭの格納する方法、入出力部へ複写装置
の１個以上の状態検知信号を入力する回路（第３図）、
出力部の１個以上の出力信号線の各々を個々の負荷と一
対一で対応させる回路、出力信号線に１個以上のフリツ
プ・フロツプ２２をセット・リセットするための信号の
コードをＣＰＵより出力させ、前記フリップ・フロップ
の出力を複写装置２４の負荷と対応させる回路（第６図
のデコーダ２０）、複数個の複写装鷹の状態検知器の出
力をエンコーダー２１でコード化し、入力部の入力信号
線へ入力させる回路（第６図）とによりシーケンス制御
させる。ＣＰＵからまずシーケンスをプログラムしたＲ
ＯＭの番地を指定し、指定された番地の内容がデータ信
号線６を通して、ＣＰＵに読み込まれ、ＣＰＵはこれを
解読し、解読された内容に従い、電源投入から順次時系
列にある時はＣＰＵ自体の内部でデータを処理したり、
ある時はＣＰＵ内のデータ一をＲＡＭのある指定された
番地へ格納したり、ＲＡＭのある指定された番地のデー
タをＣＰＵ内へ入力したり、ある時はＣＰＵ内のデータ
を入出力部の出力信号線８へ出力したり入出力部の入力
信号線９上の内容をＣＰＵ内へ入力したりする。
以上が本発明に於けるデータのやりとりの概客である。
詳しく説明すると、アドレス信号線５の内容が、入出力
部４のアドレスと一致かつ議出し書込み信号線７の信号
が議出し信号である場合、入力信号ｌｏ〜ｌｎの内容が
データ信号線６に出力されＣＰＵ内のレジスタに受入れ
られる。
詳しく説明すると、アドレス信号線５の内容が、入出力
部４のアドレスと一致かつ議出し書込み信号線７の信号
が議出し信号である場合、入力信号ｌｏ〜ｌｎの内容が
データ信号線６に出力されＣＰＵ内のレジスタに受入れ
られる。
又アドレス信号線５の内容が入出力部４のアドレスと一
致かつ講出し書込み信号線７の信号が書込み信号である
場合、データ信号線６の内容が出力信号○ｏ〜○ｎとし
て出力される。次に第３図の如く具体的な複写装置に使
われる負荷１１を入出力部１／８の出力信号線からイン
ターフェイス回路１０を介して結線し、又、複写装置の
各種の状態検知器１３の出力をインターフェイズ（時と
して不用〉を介して、入力信号線に結線することで、複
写装置の全制御系を構成できる。
致かつ講出し書込み信号線７の信号が書込み信号である
場合、データ信号線６の内容が出力信号○ｏ〜○ｎとし
て出力される。次に第３図の如く具体的な複写装置に使
われる負荷１１を入出力部１／８の出力信号線からイン
ターフェイス回路１０を介して結線し、又、複写装置の
各種の状態検知器１３の出力をインターフェイズ（時と
して不用〉を介して、入力信号線に結線することで、複
写装置の全制御系を構成できる。
出力信号線○ｏは例えば光学系を往復駆動させるクラッ
チ、０・はドラム駆動及び上記クラッ升こ駆動伝達する
モ−ター、０２は感光体を露光同時コロナ帯電する高圧
トランス、０３は定着用ヒーターにインター・フェイス
１０を介して接続する。従って後述４ビット並列処理の
ＣＰＵ４００４例の場合○ｏ〜０３は各々４ビットの各
々に対応する。入力信号線１には周知のジャム検知回路
の出力が、同じく１，にはトナー量検知回路の出力が、
１２‘こは給紙台の紙残量検知回路の出力が１３にはク
ロツクパルスＢの出力がインター・フェイス１２を介し
て接続する。これらの出力が入出力部１／０４の入力条
件と同レベル電圧ならば、インター・フェイスは不用で
ある。又クロツクパルスＢは発振器により、感光ドラム
又はベルト等の回転運動の速度と比例する周波数に設定
し、これにより複写装置の全シーケンス制御する。この
とき、クロックパルスＢをドラムの回転に応じて多数個
発生させると、ドラムの慣性による影響を補正できる。
第３図はクラッチ，モーター，高圧トランス，ヒーター
等の負荷の動作タイミング及び各種検知回路の出力状態
を示す。
チ、０・はドラム駆動及び上記クラッ升こ駆動伝達する
モ−ター、０２は感光体を露光同時コロナ帯電する高圧
トランス、０３は定着用ヒーターにインター・フェイス
１０を介して接続する。従って後述４ビット並列処理の
ＣＰＵ４００４例の場合○ｏ〜０３は各々４ビットの各
々に対応する。入力信号線１には周知のジャム検知回路
の出力が、同じく１，にはトナー量検知回路の出力が、
１２‘こは給紙台の紙残量検知回路の出力が１３にはク
ロツクパルスＢの出力がインター・フェイス１２を介し
て接続する。これらの出力が入出力部１／０４の入力条
件と同レベル電圧ならば、インター・フェイスは不用で
ある。又クロツクパルスＢは発振器により、感光ドラム
又はベルト等の回転運動の速度と比例する周波数に設定
し、これにより複写装置の全シーケンス制御する。この
とき、クロックパルスＢをドラムの回転に応じて多数個
発生させると、ドラムの慣性による影響を補正できる。
第３図はクラッチ，モーター，高圧トランス，ヒーター
等の負荷の動作タイミング及び各種検知回路の出力状態
を示す。
各種検知回路の出力はＨレベル＝ＯＫ，Ｌレベル＝Ｎｏ
ｔＧ℃ｏｄと予め設計しておく。次に、第１図のシステ
ムにより第４図のタイミングが形成される過程第５図を
参照してを述べる。
ｔＧ℃ｏｄと予め設計しておく。次に、第１図のシステ
ムにより第４図のタイミングが形成される過程第５図を
参照してを述べる。
まず、コピー開始指令が来ると、ＣＰ山まＲＯＭ又はＲ
ＡＭに書込まれたシーケンシャルなプログラムに従って
入出力部１／６のｌｏ〜１３の内容ＣＰＵ内部へ読み込
み、ｌｏ〜１２がＨレベルになっているかどうか判断し
、ＮＧならばＯＫになるまで待つ。
ＡＭに書込まれたシーケンシャルなプログラムに従って
入出力部１／６のｌｏ〜１３の内容ＣＰＵ内部へ読み込
み、ｌｏ〜１２がＨレベルになっているかどうか判断し
、ＮＧならばＯＫになるまで待つ。
ＯＫならば１３すなわちクロツクパルスＢがＨレベルに
なると同時に、ＣＰＵ内の計数器をカウントアップし、
その値をＲＡＭへ記憶させても良い。同じくこの時にＣ
ＰＵから○ｏ＝０，０，＝１，０２＝０，０３＝０を出
力し、ラツチさせる。これでモータ−をオンさせる。更
にＣＰＵ内の計数器をクロックパルスＢが来る度にカウ
ントアップさせ、３になったら○。＝０，０，＝１，０
２＝０，０３＝１をＣＰＵから出力してラツチさせヒー
ターもオンさせる。以下同様にして、第４図の如きタイ
ミングを形成させる。この様な出力信号形成を具体的な
フローチャートで示すと第５図の如くなる。
なると同時に、ＣＰＵ内の計数器をカウントアップし、
その値をＲＡＭへ記憶させても良い。同じくこの時にＣ
ＰＵから○ｏ＝０，０，＝１，０２＝０，０３＝０を出
力し、ラツチさせる。これでモータ−をオンさせる。更
にＣＰＵ内の計数器をクロックパルスＢが来る度にカウ
ントアップさせ、３になったら○。＝０，０，＝１，０
２＝０，０３＝１をＣＰＵから出力してラツチさせヒー
ターもオンさせる。以下同様にして、第４図の如きタイ
ミングを形成させる。この様な出力信号形成を具体的な
フローチャートで示すと第５図の如くなる。
即ちコピー開始から順次クロツクパルスをカウントしつ
つ逐次カウント値の可非を判別してシーケンスを決定す
るもので、本例ではクラッチの作動制御迄を示したが、
複写終了迄このフローと同じ方式のフローチャートによ
りシーケンス制御は実行される。このように出力部１／
８からの各出力線○。〜０３に機器別のラッチ信号を出
力し、各出力線に１対１接続された機器を機器に応じた
長さの時間各々動作させるべくタイミング決定によりデ
ータプロセサＣＰＵから上記出力部に各データをセツト
するので、機器毎に出力部１／８を各々設ける必要がな
いし、各機器に対応したアドレスデータが不要となる。
又高圧トランスによる高圧動作中出力部の特定出力線の
信号状態を変化させるとき上記出力部のそれ以外の機器
への出力線にもその時期に必要な信号を出力するよう出
力部の一部にデータセットし他の部分にそれ以前のデー
タを再びセットするので、静電ノイズ等で出力線のデー
タが反転しても別の出力線の状態変化点で復帰すること
ができる。
つ逐次カウント値の可非を判別してシーケンスを決定す
るもので、本例ではクラッチの作動制御迄を示したが、
複写終了迄このフローと同じ方式のフローチャートによ
りシーケンス制御は実行される。このように出力部１／
８からの各出力線○。〜０３に機器別のラッチ信号を出
力し、各出力線に１対１接続された機器を機器に応じた
長さの時間各々動作させるべくタイミング決定によりデ
ータプロセサＣＰＵから上記出力部に各データをセツト
するので、機器毎に出力部１／８を各々設ける必要がな
いし、各機器に対応したアドレスデータが不要となる。
又高圧トランスによる高圧動作中出力部の特定出力線の
信号状態を変化させるとき上記出力部のそれ以外の機器
への出力線にもその時期に必要な信号を出力するよう出
力部の一部にデータセットし他の部分にそれ以前のデー
タを再びセットするので、静電ノイズ等で出力線のデー
タが反転しても別の出力線の状態変化点で復帰すること
ができる。
尚、多機能な複写（カラー，多数枚等）であっても同様
にして第７図の如きフローチャートによりシーケンスは
実行される。
にして第７図の如きフローチャートによりシーケンスは
実行される。
第７図中カラー判定とは三色フルカラーか一色カラーか
を判定するものであり、三色カラーのとき感光ドラム前
空転ＶＲ，，ＶＲ２を経てイエローＹ０，マゼンタＭｏ
，シアンＣＯ毎に前記複写プロセスと同様のプロセス（
フィル夕と現像器の組合せが異なるのみ）を繰り返す様
にしたものである。モード判定とは一色カラーのいずれ
を選択するもので１回だけのプロセスを実行させる様に
したものである。
を判定するものであり、三色カラーのとき感光ドラム前
空転ＶＲ，，ＶＲ２を経てイエローＹ０，マゼンタＭｏ
，シアンＣＯ毎に前記複写プロセスと同様のプロセス（
フィル夕と現像器の組合せが異なるのみ）を繰り返す様
にしたものである。モード判定とは一色カラーのいずれ
を選択するもので１回だけのプロセスを実行させる様に
したものである。
複数枚行なう錫合枚計数結果によりコピー止めか否かを
判定し、止めのときドラム後空転ＦＲ，，ＦＲ２をコピ
ー停止ＳＴＢ，とするものであり、その後７間にコピー
再開しないとき、コピー開始のセット状態を解除ＳＴＢ
２するものである。ＹＭＣ等のプロセスモー日こ於いて
作動する機器の選択制御は第５図と同様な方式のフロー
チャートを各プロセスモード‘こ対応させることで可能
となる。以上の様に本発明は複写機のシーケンスフロー
をプログラムしたＲＯＭを向い、データプロセッサいわ
ゆるマイクロプロセッサ，メモリ及び入出力手段を複写
機に設けて、入力手段を複写機の各状態検出部、出力手
段をプロセス処理等を実行する機器に対応させたのでプ
ログラム変更により簡単にシーケンスを変えることがで
き、複写機汎用の制御装置が大量に得ることが可能とな
る。
判定し、止めのときドラム後空転ＦＲ，，ＦＲ２をコピ
ー停止ＳＴＢ，とするものであり、その後７間にコピー
再開しないとき、コピー開始のセット状態を解除ＳＴＢ
２するものである。ＹＭＣ等のプロセスモー日こ於いて
作動する機器の選択制御は第５図と同様な方式のフロー
チャートを各プロセスモード‘こ対応させることで可能
となる。以上の様に本発明は複写機のシーケンスフロー
をプログラムしたＲＯＭを向い、データプロセッサいわ
ゆるマイクロプロセッサ，メモリ及び入出力手段を複写
機に設けて、入力手段を複写機の各状態検出部、出力手
段をプロセス処理等を実行する機器に対応させたのでプ
ログラム変更により簡単にシーケンスを変えることがで
き、複写機汎用の制御装置が大量に得ることが可能とな
る。
尚、本発明に於いてＣＰＵ，ＲＯＭ，ＲＡＭは周知のも
のであって、例えばメモリを有するＣＰＵとして４ビッ
ト逆列処理のマイクロプロセサのインテル社製マイクロ
ＣＰＵ４００４等がある。
のであって、例えばメモリを有するＣＰＵとして４ビッ
ト逆列処理のマイクロプロセサのインテル社製マイクロ
ＣＰＵ４００４等がある。
第１図は従来の複写機の制御部を示したもの、第２図は
本発明による制御方式の結線図、第３図は，第６図は本
発明による制御方式の入出力部、第４図は複写機におけ
る機器の作動タイミングチャート、第５図は本発明の制
御方式による機器の動作フローチャート、第７図は多機
能複写機に於けるプロセスフローチャートであり、第２
図に於いてＣＰＵはプロセッサ、ＲＯＭ、ＲＡＭはメモ
リ、１／ＯＧま入出力部である。 弟ノ図 第２図 整う図 髪よ図 髪イ ー幻 第６図 第ク図
本発明による制御方式の結線図、第３図は，第６図は本
発明による制御方式の入出力部、第４図は複写機におけ
る機器の作動タイミングチャート、第５図は本発明の制
御方式による機器の動作フローチャート、第７図は多機
能複写機に於けるプロセスフローチャートであり、第２
図に於いてＣＰＵはプロセッサ、ＲＯＭ、ＲＡＭはメモ
リ、１／ＯＧま入出力部である。 弟ノ図 第２図 整う図 髪よ図 髪イ ー幻 第６図 第ク図
Claims (1)
- １ 回転体に静電潜像を形成しそれにより記録物を得る
装置のシーケンス制御装置に於いて、データプロセツサ
と、記録プロセス処理のための高圧トランス，モータを
含む複数の処理機器と、上記回転体の回転と同期的なパ
ルス発生手段と、上記処理機器のいくつかの動作シーケ
ンスプログラムを記憶する読み出し専用メモリと、上記
パルス発生手段からのパルスを上記データプロセツサに
入力するための入力部と、上記処理機器へ動作のための
ラツチ信号群を出力する出力部と、上記出力部からの各
出力線に上記処理機器の各々を１対１で対応して接続さ
せる構成と、記録スタート命令及び上記パルス発生手段
からのパルスを入力して各々判別，計数処理し順次プロ
グラムを実行させることにより、シーケンス制御のため
の各処理機器の制御タイミングを決定する手段と、上記
各出力線から機器別のラツチされた信号を出力し、各出
力線に接続された機器を機器動作に必要な長さの時間各
々独立に動作させるべく上記タイミングの決定により上
記データプロセツサからデータ線を介し上記出力部に機
器別のデータをセツトし、上記出力部の特定出力線の信
号状態を変化させるときそれと同期して上記出力部のそ
れ以外の機器への出力線にもその時期に必要な信号を出
力するよう、所定数のパルスをカウントしたときその時
期に対応した出力信号群を出力線に出力する手段とを有
することを特徴とするシーケンス制御装置。
Priority Applications (11)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP50156671A JPS6039232B2 (ja) | 1975-12-27 | 1975-12-27 | シ−ケンス制御装置 |
| DE2658819A DE2658819C2 (de) | 1975-12-27 | 1976-12-24 | Kopier- oder Druckgerät |
| FR7639110A FR2336714A1 (fr) | 1975-12-27 | 1976-12-24 | Machine de reprographie |
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|---|---|---|---|
| JP50156671A JPS6039232B2 (ja) | 1975-12-27 | 1975-12-27 | シ−ケンス制御装置 |
Related Child Applications (4)
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|---|---|---|---|
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| JP57228452A Division JPS58130348A (ja) | 1982-12-27 | 1982-12-27 | 複写機等の制御方法 |
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Publications (2)
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Family
ID=15632750
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP50156671A Expired JPS6039232B2 (ja) | 1975-12-27 | 1975-12-27 | シ−ケンス制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6039232B2 (ja) |
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-
1975
- 1975-12-27 JP JP50156671A patent/JPS6039232B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5280837A (en) | 1977-07-06 |
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