JPS6027991B2 - electronic musical instrument practice device - Google Patents

electronic musical instrument practice device

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JPS6027991B2
JPS6027991B2 JP17140579A JP17140579A JPS6027991B2 JP S6027991 B2 JPS6027991 B2 JP S6027991B2 JP 17140579 A JP17140579 A JP 17140579A JP 17140579 A JP17140579 A JP 17140579A JP S6027991 B2 JPS6027991 B2 JP S6027991B2
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JP
Japan
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information
signal
circuit
key
performance
Prior art date
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JP17140579A
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Japanese (ja)
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晧 中田
栄作 岡本
清 吉田
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Nippon Gakki Co Ltd
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Nippon Gakki Co Ltd
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Description

【発明の詳細な説明】 この発明は、鍵盤部における演奏状態を基準演奏音情報
と対比判断し、演奏独習を効果的に実行させる電子楽器
の練習装置に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a practice device for an electronic musical instrument that compares and determines the performance state of a keyboard section with reference performance sound information, and allows self-study of performance to be carried out effectively.

鍵盤楽器を演奏練習するには、生徒が楽譜に対応して鍵
操作を行ない、これを繰り返して楽譜に表現された内容
を忠実に再現するもので、その演奏内容の判断は、先生
からの演奏を聴取して行なうものである。
To practice playing a keyboard instrument, students operate the keys in accordance with the musical score, and repeat this process to faithfully reproduce the content expressed in the musical score.The content of the performance is determined by the teacher's performance. This is done by listening to the

すなわち、先生は生徒の演奏を聴取しながらその誤りを
指通し、正確な押鍵操作と共に音楽感覚的に良好となる
ように指導している。したがって、このような教習手段
は、先生と生徒が1:1の個別教習で行なわれる場合に
は非常に効果的なものであるが、1人の先生に対して多
数の生徒が存在する集団的な教習を行なうことが非常に
困難である。また、先生自身も生徒の演奏技術を判断し
、採点するには、演奏の誤り発生状態を数学的に客観性
をもってとらえることが困難であり、主観のみによって
演奏練習進行状態を判断しなければならない。したがっ
て、生徒の演奏練習の指導方向も、先生の主観的判断に
たよるようになり、常に適切な指導を行なうことが困難
となる。この発明は、上記のような点に鑑みなされたも
ので、生徒の鍵盤の演奏操作状態を、特に基準演奏に対
してタイミング的に正解状態を判断して生徒の鍵操作進
行状態を、客観性をもって確実に判断し、指導できるよ
うにする電子楽器の練習装置を提供しようとするもので
ある。
In other words, the teacher listens to the student's performance, corrects any mistakes, and instructs the student to use accurate keystrokes and develop a good musical sense. Therefore, this type of teaching method is very effective when the teacher and student are teaching individually on a 1:1 basis, but when there is a large number of students for one teacher, it is very effective. It is extremely difficult to conduct proper training. Furthermore, in order for teachers themselves to judge and grade students' performance techniques, it is difficult to mathematically and objectively grasp the state of performance errors, and they must judge the progress of performance practice solely subjectively. . Therefore, the direction of guidance for students' performance practice comes to depend on the teacher's subjective judgment, making it difficult to always provide appropriate guidance. This invention was made in view of the above points, and it is possible to objectively judge the state of the student's keyboard performance, especially by determining the correct state in terms of timing with respect to a standard performance. The purpose of the present invention is to provide a practice device for electronic musical instruments that enables reliable judgment and instruction based on the user's knowledge.

すなわち、この発明に係る練習装置は、基準演奏音情報
に対応した第1のキーィング信号と、練習鍵盤の鍵操作
に対応する第2のキーィング信号とを、許容時間範囲を
設定してその同期性を対比し、鍵操作タイミングの正解
を判断するようにしたものである。
That is, the practice device according to the present invention sets a permissible time range and adjusts the synchronization of the first keying signal corresponding to the reference performance sound information and the second keying signal corresponding to the key operation of the practice keyboard. The correct key operation timing is determined by comparing the key operation timing.

以下図面を参照してこの発明の一実施例を説明する。An embodiment of the present invention will be described below with reference to the drawings.

第1図は1つの先生用親機に対して、複数の生徒用子機
の従属する集団的な演奏教習状態で、その概略的構成を
示したもので、11は親機の鍵盤であり、この鍵盤11
は先生によって演奏操作され、その鍵操作に対した例え
ば上鍵盤の音高情報(uk情報)が発生される。この音
高情銭は、適宜親機の楽音形成回路12に供給され、上
記血清報に対応した音高の楽音信号を形成する。この場
合、楽音形成回路12には、適宜自動演奏装置、自動リ
ズム発生装置等を含み、この楽音形成回路12で発生さ
れた楽音信号は、増幅器13で適宜増幅にスピーカ14
に供給し、親機演奏音として発音されるようになる。親
機鍵盤11から発生される音高情報は、基準演奏音情報
として複数の子機15a,15b・・・…・・・・・・
・・・に並列的に分配供給されるもので、この分配され
る情報には、適宜親機楽音形成回路12部におけるリズ
ム設定のためのテンポクロツク信号TCLも含ませられ
る。
FIG. 1 shows the general configuration of a collective performance training situation in which a plurality of slave units for students are subordinate to one master unit for the teacher, and 11 is the keyboard of the base unit; This keyboard 11
is played by the teacher, and pitch information (uk information) for the upper keyboard, for example, is generated in response to the key operation. This pitch information is appropriately supplied to the musical tone forming circuit 12 of the base unit to form a musical tone signal having a pitch corresponding to the above-mentioned serum information. In this case, the musical tone forming circuit 12 includes an automatic performance device, an automatic rhythm generating device, etc. as appropriate, and the musical tone signal generated by the musical tone forming circuit 12 is appropriately amplified by an amplifier 13 and sent to a speaker 14.
, and the sound will be produced as the main unit performance sound. The pitch information generated from the main unit keyboard 11 is used as reference performance sound information for the plurality of slave units 15a, 15b...
. . in parallel, and this distributed information also includes a tempo clock signal TCL for rhythm setting in the main unit musical tone forming circuit 12 as appropriate.

各子機15a,15b・・・・・・・・・・・・・・・
には、15aで代表して示すようにそれぞれ演奏練習用
の鍵盤16が設けられている。
Each slave unit 15a, 15b......
are each provided with a keyboard 16 for performance practice, as shown representatively by 15a.

すなわち、この鍵盤16は生徒によって演奏鍵操作のさ
れるもので、その鍵操作に対応した演奏情報は、楽音形
成回路17で楽音信号に変換され、増幅器18を介して
スピーカー9に供給し、子機演奏音として適宜生徒にお
いて聴取されるようにする。鍵盤16からの演奏情報は
、さらに前記親機からの基準演奏音情報と共に、正押鍵
判断部2川こ供給する。
That is, this keyboard 16 is used for performing key operations by the student, and the performance information corresponding to the key operations is converted into a musical tone signal by the musical tone forming circuit 17, and is supplied to the speaker 9 via the amplifier 18, and the musical tone signal is sent to the speaker 9 via the amplifier 18. The sound of the machine performance can be heard by students as appropriate. The performance information from the keyboard 16 is further supplied to the correctly pressed key determination section 2 together with the reference performance sound information from the base unit.

この判断部20は、タイミング判断部21、音高判断部
22、符長判断部23等を備え、それぞれ基準演奏音情
報と鍵盤16からの演奏情報とを、タイミング的、音高
的、符長的に対比し、鍵盤16の正解となる押鍵状態を
判断して正解率等を表示器24,25,26等で客観性
をもって表示させるものである。上記例‐乙は、先生の
演奏を基準にした演奏練習の場合であるが、独習の場合
には親機による先生の演奏は存在しない。
This judgment section 20 includes a timing judgment section 21, a pitch judgment section 22, a note length judgment section 23, etc., and each determines the reference performance sound information and the performance information from the keyboard 16 in terms of timing, pitch, and note length. The system compares the key press state of the keyboard 16 to determine the correct answer, and objectively displays the percentage of correct answers and the like on the displays 24, 25, 26, etc. The above example - B is a case of performance practice based on the teacher's performance, but in the case of self-study, there is no teacher's performance using the master unit.

したがって、この場合には記憶された基準演奏音情報を
利用するようにしなければならない。すなわち、第2図
に示すように例えばRAM等である記憶装置27を設け
、この記憶装置27に対して音符さらに休止符に対応す
る音高情報およびその各音符、休止符の音符長情報を記
憶設定させるようにする。
Therefore, in this case, it is necessary to use the stored reference performance sound information. That is, as shown in FIG. 2, a storage device 27 such as a RAM is provided, and pitch information corresponding to notes and rests and note length information of each note and rest are stored and set in this storage device 27. Do it like this.

例えば、第3図にそのフオーマツトを示すように、アド
レス番地順位に音高を示す肌情報、および符長情報を「
ukm」「LENGTH‘1ー」「帆【2}一「LEN
GTH(2}一・.……・・・・・・・のように設定し
て記憶装置27に書き込まれているもので、この記憶装
置27の記憶情報は、アドレスカウンタ28の計数アド
レス情報によって順次に1つづつ読み出されるものであ
る。
For example, as shown in the format shown in Figure 3, skin information indicating the pitch and note length information are added to the address order.
ukm” “LENGTH'1-” “Sail [2}1” “LEN
GTH(2}1............ is written in the storage device 27, and the information stored in the storage device 27 is determined by the count address information of the address counter 28. They are read out one by one in sequence.

そして、記憶装置27の記憶情報の最終アドレス位置に
は、演奏の終了コード「FINISH」が設定されてい
る。この記憶装置27からアドレス指定によって読み出
される情報は、第1図の場合と同様に構成される押鍵判
断部201こ供給されるもので、この押鍵判断部20で
は読み出し情報の中から音高情報(血清報)を基準演奏
音情報とに検知し、タイミング判断、音高判断、符長判
断に用いるようにする。また、記憶装置27から読み出
された情報は、ラッチ回路29に供給すると共に、符長
情報(LENGTH)に付属する符長マークを符長マー
ク検出回路30で検知し、このマーク検知信号をラッチ
回路29にラッチ指令として与えるようにする。すなわ
ち、記憶装置27から符長情報が読み出されると、符長
をあらわす数値情報がラッチ回路29にラッチ記憶され
るようになる。記憶装置27からの読み出し情報は、さ
らに終了コード検出回路31にも供給されており、終了
コード(FINISH)が読み出された時に、検出信号
を発生する。
A performance end code "FINISH" is set at the final address position of the storage information in the storage device 27. The information read out from the storage device 27 by address designation is supplied to a key press judgment unit 201 configured in the same manner as in the case of FIG. The information (serum report) is detected together with the standard performance sound information and used for timing judgment, pitch judgment, and note length judgment. Further, the information read from the storage device 27 is supplied to the latch circuit 29, and the note length mark attached to the note length information (LENGTH) is detected by the note length mark detection circuit 30, and this mark detection signal is latched. It is given to the circuit 29 as a latch command. That is, when the note length information is read from the storage device 27, numerical information representing the note length is latched and stored in the latch circuit 29. The read information from the storage device 27 is further supplied to an end code detection circuit 31, which generates a detection signal when the end code (FINISH) is read out.

上記うッチ回路29にラッチ記憶された符長情報は、比
較回路32に供給される。
The note length information latched in the latch circuit 29 is supplied to the comparison circuit 32.

この比較回路32には、後述する自動リズム発生用に用
いられるテンポ発振器33の発振テンポクロック信号を
計数する符長カゥンタ34の計数値情報も供給し、この
計数値情報が上記符長情報と一致する状態となった時に
、比較回路32からイコール信号EQが発生される。こ
のイコール信号EQは、微分回路35でその立ち上りが
検知され、微分回路35からの微分パルスは、オア回路
36を介して読み出し制御用のフリツプフロツプ回路3
7にセット指令として供給する。フリツプフロツプ回路
37は、そのセット時にアンド回路38にゲート信号を
与え、システムクロックJを出力してアドレスカゥンタ
28に計数歩進信号として供給するようになる。
This comparison circuit 32 is also supplied with count value information of a note length counter 34 that counts the oscillating tempo clock signal of a tempo oscillator 33 used for automatic rhythm generation, which will be described later, and this count value information matches the note length information described above. When the condition is reached, the comparison circuit 32 generates an equal signal EQ. The rising edge of this equal signal EQ is detected by a differentiating circuit 35, and the differential pulse from the differentiating circuit 35 is passed through an OR circuit 36 to a flip-flop circuit 3 for readout control.
7 as a set command. When set, the flip-flop circuit 37 applies a gate signal to the AND circuit 38, outputs the system clock J, and supplies the system clock J to the address counter 28 as a counting step signal.

すなわち、フリップフロップ回路37のセット状態で、
アドレスカウンタ28が歩進され、記憶装置27の記憶
情報が順次に読み出されるようになる。そして、このフ
リップフロップ回路37は、符長マーク検出回路30か
らの検出信号でリセットされ、比較回路32からイコー
ル信号が発生されてより、記憶装置27から符長情報が
読み出されるまでの間、セット状態とされるものである
。また、この装置には記憶装置27からの読み出いこ伴
なう練習演奏をスタートさせるスタートスイッチ39が
設けられる。
That is, in the set state of the flip-flop circuit 37,
The address counter 28 is incremented, and the stored information in the storage device 27 is read out sequentially. The flip-flop circuit 37 is reset by the detection signal from the note length mark detection circuit 30, and remains set until the note length information is read from the storage device 27 after the equal signal is generated from the comparison circuit 32. It is considered to be a state. Further, this device is provided with a start switch 39 for starting a practice performance accompanied by reading from the storage device 27.

このスイッチ39は、例えば自己復帰型で構成されるも
ので、操作時に「1」の信号を発生し、微分回路40か
ら操作投入に同期するスタートパルスが発生されるよう
になっている。このスタートパルスは、後述する各制御
部の初期設定をするスタート信号STRTとしても用い
られ、例えば押鍵判断部20のタイミング判断部21、
音高判断部22、符長判断部23に初期設定指令として
与える。また、このスタートパルスは、フリツプフロツ
プ回路41にリセット指令として供給すると共に、この
フリツプフロップ回路41のセット時出力信号の供給さ
れるオァ回路42に供給するもので、このオア回路42
からの出力信号はアドレスカウンタ28にリセツト指令
として供給する。フリップフロップ回路41は、動作指
令状態を記憶設定するもので、終了コード検出回路31
からの検出信号でセットされる。
This switch 39 is configured, for example, as a self-resetting type, and generates a signal of "1" when operated, and a start pulse is generated from the differentiating circuit 40 in synchronization with the operation. This start pulse is also used as a start signal STRT for initializing each control section, which will be described later. For example, the timing judgment section 21 of the key press judgment section 20,
It is given to the pitch determining section 22 and note length determining section 23 as an initial setting command. The start pulse is supplied to the flip-flop circuit 41 as a reset command, and is also supplied to the OR circuit 42 to which the set output signal of the flip-flop circuit 41 is supplied.
The output signal from the address counter 28 is supplied as a reset command. The flip-flop circuit 41 stores and sets the operation command state, and the end code detection circuit 31
It is set by the detection signal from.

そしてそのリセット時の出力信号は、自動リズム発生回
路43に対して動作指令を与えるスタート信号として用
いられる。この自動リズム発生回路43は、詳細は図示
してないが、テンポ発振器33からのテンポクロック信
号を計数するカウンタを備え、このカウンタのバィナリ
計数情報を構成する複数の信号をリズムパターンメモリ
で組み合わせて、各種リズムのパターン信号を形成する
もので、適宜選択指定された種類のリズムパターン信号
にもとづいてリズム音源信号を発生する。
The output signal at the time of reset is used as a start signal for giving an operation command to the automatic rhythm generating circuit 43. Although details are not shown, this automatic rhythm generation circuit 43 includes a counter that counts the tempo clock signal from the tempo oscillator 33, and combines a plurality of signals constituting binary count information of this counter in a rhythm pattern memory. , which forms pattern signals of various rhythms, and generates rhythm sound source signals based on appropriately selected and designated types of rhythm pattern signals.

そして、このリズム音源信号を増幅器18に供給し、フ
リップフロップ回路41からスタート指令の与えられて
いる間、自動的なりズム演奏音をスピーカ19から発生
させるものである。すなわち、第3図に示したフオーマ
ットの状態で記憶装置27に所定の曲を演奏するための
情報を書き込み設定した状態で、スタートスタートスイ
ッチ39を操作すると、まず微分回路40からの微分ス
タートパルスがオア回路42を介てアドレスカウンタ2
8に与えられ、これをリセットして初期設定する。
Then, this rhythm sound source signal is supplied to the amplifier 18, and while a start command is given from the flip-flop circuit 41, a rhythm performance sound is automatically generated from the speaker 19. That is, when the start switch 39 is operated with the information for playing a predetermined song written and set in the storage device 27 in the format shown in FIG. Address counter 2 via OR circuit 42
8 to reset and initialize it.

同時に、上記スタートパルスはオア回路36を介してフ
リツプフロツプ回路37をセットし、アンド回路38に
ゲート信号を与えるようになる。すなわち、アドレスカ
ウンタ28はクロツクJで計数歩進され、記憶装置27
からまず先頭番地の情報「ukm」が読み出され、押鍵
判断部20に供給される。
At the same time, the start pulse sets the flip-flop circuit 37 via the OR circuit 36 and provides a gate signal to the AND circuit 38. That is, the address counter 28 is incremented by the clock J, and the address counter 28 is incremented by the clock J.
First, the information "ukm" at the first address is read out and supplied to the key press determination section 20.

そして、次のアドレス歩進で符長情報「LENGTHO
’」が読み出されると、符長マーク検出回路30からの
ラツチ指令でラツチ回路29に符長情報がラッチ記憶さ
れる。また、符長マーク検出信号は符長カウンタ34を
リセットし‐て初期設定すると共に、フリップフロツプ
回路37をリセットし、記憶装置27からの読み出しを
停止させる。そして、符長カウンタ34は、符長マーク
検出時よりテンポ発振器33からのテンポクロック信号
を計数開始するようになるものであり、それよりラッチ
回路29に記憶された符長情報に相当する音符長時間が
経過すると、カゥンタ34の計数値は記憶符長情報と一
致し、比較回路22からイコール信号EQが発生される
ようになる。
Then, at the next address increment, the note length information "LENGTHO" is
When ''' is read out, the note length information is latched and stored in the latch circuit 29 in response to a latch command from the note length mark detection circuit 30. Further, the note length mark detection signal resets the note length counter 34 to initialize it, resets the flip-flop circuit 37, and stops reading from the storage device 27. The note length counter 34 starts counting the tempo clock signal from the tempo oscillator 33 when the note length mark is detected. As time passes, the count value of the counter 34 matches the stored note length information, and the comparison circuit 22 generates an equal signal EQ.

比較回路22からイコール信号EQが発生されると、前
述したようにフリップフロップ回路37がセットされ、
アドレスカウンタ28をクロツクぐで計数歩進して、記
憶装置27からつづく番地の情報「uk■」さらに「L
ENGTH■」を読み出すようになり、上記したような
動作が繰り返される。すなわち、記憶装置27に記憶さ
れた音符に対応する音高情報が、その音符の符長に相当
する時間間隔で順次読み出されて、押鍵判断部20に供
給されるようになる。
When the equal signal EQ is generated from the comparison circuit 22, the flip-flop circuit 37 is set as described above.
By clocking the address counter 28, the address counter 28 is incremented, and the address information continues from the storage device 27, ``uk■'' and ``L''.
ENGTH■'' is read out, and the above-described operation is repeated. That is, the pitch information corresponding to the musical note stored in the storage device 27 is sequentially read out at time intervals corresponding to the note length of the musical note, and is supplied to the key press determination section 20.

この場合、スタートスイッチ39の操作に対応してフリ
ップフロップ回路41がリセットされるため、そのスタ
ート動作に対応して自動リズム発生回路43にスタート
信号が与えられ、テンポ発振器33からのテンポクロッ
ク信号にもとづき、自動リズム演奏音が発生されるもの
で、この自動リズム演奏音は、記憶装置27から読み出
されている演奏情報と同期がとられているものである。
そして、演奏練習者は、上記スタートスイッチ39の操
作に対応し、上記自動リズム演奏音に合わせて、記憶装
置27に記憶された演奏情報を表現する楽譜通りに鍵盤
16を操作し、演奏練習を開始するものである。したが
って、鍵盤16において記憶装置27から読み出される
音高情報に対応して正確な鍵操作がされると、タイミン
グ判断部21、音高判断部22、符長判断部23におい
て、押鍵正解判断が行なわれるもので、表示器24〜2
6において、それぞれ練習者の鍵操作の正確度が数値化
して表示されるようになるものである。
In this case, since the flip-flop circuit 41 is reset in response to the operation of the start switch 39, a start signal is given to the automatic rhythm generation circuit 43 in response to the start operation, and the tempo clock signal from the tempo oscillator 33 is Basically, an automatic rhythm performance sound is generated, and this automatic rhythm performance sound is synchronized with the performance information read out from the storage device 27.
Then, in response to the operation of the start switch 39, the performance practitioner operates the keyboard 16 according to the score expressing the performance information stored in the storage device 27 in accordance with the automatic rhythm performance sound, and practices performance. It is a start. Therefore, when an accurate key operation is performed on the keyboard 16 in accordance with the pitch information read from the storage device 27, the timing judgment section 21, pitch judgment section 22, and note length judgment section 23 determine whether the key press is correct. Indicators 24-2
6, the accuracy of each practitioner's key operations is digitized and displayed.

また、鍵盤16の鍵操作に対応する楽音信号が楽音形成
回路17において得られ、スピーカ19からの演奏音に
よって練習生は自己の演奏状態を聡感で確認できる。す
なわち、練習生は、記憶装置27の記憶情報にもとずき
、自身の鍵操作の状態を客観性をもって知ることができ
、独習効果が向上されるものである。
Further, musical tone signals corresponding to key operations on the keyboard 16 are obtained in the musical tone forming circuit 17, and the trainee can intelligently check his/her performance state by the performance sound from the speaker 19. In other words, the trainee can objectively know the state of his or her key operations based on the information stored in the storage device 27, and the self-study effect is improved.

特に音楽を表現する上で感覚的に重要な秤鍵タイミング
を、効果的に監視することができ、独習効果を向上する
ために大きな効果が得られるものである。第4図は、上
記押鍵判断部2川こ関連する部分を詳細にして示したも
ので、特にこの場合は第2図に関連して記憶装置27か
らの読み出し音高3(叱)情報を用いる場合を例にして
示している。
In particular, it is possible to effectively monitor the scale key timing, which is sensually important in expressing music, and is highly effective in improving self-study effects. FIG. 4 shows in detail the parts related to the above-mentioned key press judgment section 2. In particular, in this case, in relation to FIG. An example of how to use it is shown below.

すなわち、記憶装置27から読み出された情報は、ラッ
チ回路43に供給され、このラッチ回路43は上記読み
出し情報に風情報に含まれるukマークを検出するuk
マーク検出回路44からの4検出信号でラッチ指令が与
えられる。したがって、このラッチ回路43には、記憶
装魔27から叱情報が読み出された時に、この情報を選
択し、uk情報に含まれる音高情報をラツチ記億するも
ので、このラッチ記憶情報は、記憶装置27から新しい
uk情報が読み出される毎に書き換えられる。ukマー
ク検出回路44からの検出信号は、さらにワンショツト
回路45によってワンショツトパルスに変換される。
That is, the information read from the storage device 27 is supplied to the latch circuit 43, and this latch circuit 43 detects the UK mark included in the wind information in the read information.
A latch command is given by four detection signals from the mark detection circuit 44. Therefore, when the scolding information is read out from the storage device 27, this latch circuit 43 selects this information and latches and stores the pitch information included in the uk information. , is rewritten every time new uk information is read from the storage device 27. The detection signal from the UK mark detection circuit 44 is further converted into a one-shot pulse by a one-shot circuit 45.

このパルス信号は、記憶装置27から、休止符を含み帆
情報の読み出し毎に発生され、テンポクロックTCLで
駆動されるディレードフリップフロップ等でなる遅延回
路46を介して、第1のキーオフ信号A△1として取り
出される。また、帆マーク検出回路44からの出力信号
は、アンド回路47に供給する。このアンド回路47に
は、入力uk情報がオール「0」の休止符でないことを
検知するオア回路48からの信号も供給し、したがって
アンド回路47から音符に対応するuk情報(休止符を
含まない)が記憶装置27から読み出される毎に出力信
号が発生され、ワンショット回路49でパルス状信号に
変換し、遅延回路50を介して第1のキーオン信号A△
2として取り出す。そしてこの第1のキーオン信号A△
2は、前記スタートスイッチ操作に対応するスタート信
号STRTでリセットされ初期設定される母数カゥンタ
51で計数され、母数信号「BOSU」として取り出さ
れるようにする。一方、練習用鍵盤16の鍵操作に対応
して得られた演奏情報は、比較回路52に比較情報Aと
して供給すると共に、クロックTCLで駆動される、遅
延回路53を介して比較情報Bして用いる。
This pulse signal is generated from the storage device 27 every time sail information including a rest mark is read out, and is sent to the first key-off signal A△1 via a delay circuit 46 consisting of a delayed flip-flop or the like driven by a tempo clock TCL. is extracted as. Further, the output signal from the sail mark detection circuit 44 is supplied to an AND circuit 47. This AND circuit 47 is also supplied with a signal from an OR circuit 48 that detects that the input uk information is not a rest mark with all "0"s, and therefore the AND circuit 47 receives uk information corresponding to a note (not including a rest mark). An output signal is generated every time it is read from the storage device 27, which is converted into a pulse-like signal by the one-shot circuit 49, and then sent through the delay circuit 50 to the first key-on signal A△.
Take it out as 2. And this first key-on signal A△
2 is counted by a parameter counter 51 which is reset and initialized by the start signal STRT corresponding to the start switch operation, and is taken out as a parameter signal "BOSU". On the other hand, performance information obtained in response to key operations on the practice keyboard 16 is supplied to the comparison circuit 52 as comparison information A, and is also supplied as comparison information B via a delay circuit 53 driven by the clock TCL. use

すなわち、鍵盤16において、押されていた鍵が離され
、あるいは異なる鍵に操作変換がされて、演奏情報が変
化した時に、比較回路12で「A≠B」の判断がされる
ものであり、その「AキB」の判断出力が第2のキーオ
フ信号AAIとして取り出される。また、上記比較回路
52からの判断出力は、アンド回路54にも供給される
。このァンド回路54には、入力演奏情報が押鍵状態の
ものであることを検出するオァ回路55からの信号も供
給し、このアンド回路54からは第2のキーオン信号M
△2を発生する。そして前記第1のキーオン信号A△1
、および第2のキーオン信号M△1は、それぞれクロッ
クTCLで駆動される遅延回路56,57に供給するも
ので、この遅延回路56,57のそれぞれ入力部および
出力部の信号をオア回路58,59で検知するようにし
てなる。すなわち、オア回路58,59からは、それぞ
れ信号A△1,M△2の立ち上りより、クロックTCL
2個分に相当する幅のパルス信号が出力され、このオア
回路58,59からの出力信号は、アンド回路6川こ供
給される。すなわち、記憶装置27からの読み出しuk
情報に同期する状態で、鍵盤16において鍵の操作がさ
れると、信号A△1とM△1との論理頚情報がアンド回
路60から取り出されるもので、これは鍵盤I Z6に
おける押鍵タイミングの一致信号として用いれるように
なる。この場合、鍵の操作タイミングが風情報の読み出
しと完全に一致することは、実質的にあり得ない。
That is, when a pressed key on the keyboard 16 is released or the operation is changed to a different key, and the performance information changes, the comparator circuit 12 determines that "A≠B". The "A/B" determination output is taken out as the second key-off signal AAI. Further, the judgment output from the comparison circuit 52 is also supplied to an AND circuit 54. This AND circuit 54 is also supplied with a signal from an OR circuit 55 that detects that the input performance information is in a key-pressed state, and a second key-on signal M is supplied from this AND circuit 54.
Generates △2. and the first key-on signal A△1
, and the second key-on signal MΔ1 are supplied to delay circuits 56 and 57 driven by the clock TCL, respectively, and the signals at the input and output parts of the delay circuits 56 and 57 are applied to OR circuits 58 and 57, respectively. 59 will be detected. That is, from the OR circuits 58 and 59, the clock TCL is output from the rising edge of the signals A△1 and M△2, respectively.
A pulse signal with a width equivalent to two pulses is output, and the output signals from the OR circuits 58 and 59 are supplied to six AND circuits. That is, reading from the storage device 27
When a key is operated on the keyboard 16 in synchronization with the information, the logical neck information of the signals A△1 and M△1 is taken out from the AND circuit 60, and this corresponds to the key press timing on the keyboard IZ6. It came to be used as a coincidence signal. In this case, it is virtually impossible for the key operation timing to completely coincide with the reading of the wind information.

しかし、信号A△1およびM△1は、遅延回路56,5
7およびオア回路58,59により、その立ち上りより
幅の広いパルス信号に変換され、この幅の広くされたパ
ルス信号をアンド回路60に供給するようにした。した
がって、このアンド回路6川こ供給されるパルス信号の
幅に対応して、鍵操作タイミングの誤差許容範囲が設定
され、鍵の正解タイミング操作とみなされる信号をァン
ド回路60から取り出すようになるものである。ここで
正解タイミングとみなされる誤差許容範囲は、遅延回路
56,57部の遅延時間で定まるものであり、したがっ
てこの遅延回路56,57部を、複数ビットのシフトレ
ジスタ等に変換すれば、上記誤差許容範囲は任意拡大設
定でなるものである。
However, the signals A△1 and M△1 are
7 and OR circuits 58 and 59, the pulse signal is converted into a pulse signal having a width wider than its rising edge, and this widened pulse signal is supplied to an AND circuit 60. Therefore, an error tolerance range for the key operation timing is set corresponding to the width of the pulse signal supplied to the AND circuit 60, and a signal that is considered to be an operation at the correct timing of the key is extracted from the AND circuit 60. It is. The error tolerance range that is considered to be the correct timing here is determined by the delay time of the delay circuits 56 and 57. Therefore, if the delay circuits 56 and 57 are converted to a multi-bit shift register, etc., the above error can be reduced. The permissible range is set by arbitrary expansion settings.

そして、このアンド回路60からの押鍵タイミング一致
信号は、信号STRTで初期設定されるカゥンタ61で
曲の演奏開始時から計数し、この計数値情報は演算回路
62で前記母数カウンタ51からの計数値「BOSU」
を分母として除算して、正解率を計算する。
The key pressing timing coincidence signal from the AND circuit 60 is counted from the start of the performance of the song by a counter 61 which is initialized by the signal STRT, and this count value information is inputted from the parameter counter 51 by an arithmetic circuit 62. Count value “BOSU”
Calculate the correct answer rate by dividing as the denominator.

この計算結果は、表示器63において、タイミング正解
率として例えばパーセントで数値表示される。その他、
ラッチ回路43に記億された音高情報と、鍵操作に対応
する演奏情報とは、比較回路64において比較され、u
k情報に対応する正藤の鍵が選択されて操作された時に
、この比較回路64から一致信号EQを発生する。
This calculation result is numerically displayed on the display 63 as a timing accuracy rate, for example, as a percentage. others,
The pitch information stored in the latch circuit 43 and the performance information corresponding to the key operation are compared in a comparison circuit 64.
When the Shoto key corresponding to the k information is selected and operated, the comparison circuit 64 generates a match signal EQ.

そしてこの一致信号EQは遅延回路65を介してフリツ
プフロツプ回路66をセットする。この場合このフリツ
プフロツプ回路66は、遅延回路65の遅延時間分先行
して、信号A△2によってリセット設定されているもの
であり、したがって、新しい鍵の操作が行なわれ、それ
が正解鍵であることが比較回路64で判定される毎に、
フリップフロップ回路66はセット反転制御されるよう
になる。このフリップフロップ回路66のセット反転は
、微分回路67において検知され、この微分回路67か
らは、操作鍵の音高が正解と判断された毎に微分パルス
出力が発生され、信号STRTで初期設定されるカウン
タ68を計数するようになる。
This match signal EQ then sets a flip-flop circuit 66 via a delay circuit 65. In this case, the flip-flop circuit 66 is reset by the signal A△2 in advance by the delay time of the delay circuit 65, and therefore a new key operation is performed and it is determined that it is the correct key. Each time the comparison circuit 64 determines
The flip-flop circuit 66 is now controlled to be set inverted. This set reversal of the flip-flop circuit 66 is detected by a differentiating circuit 67, and this differentiating circuit 67 generates a differential pulse output every time the pitch of the operation key is determined to be correct, and the output is initialized by the signal STRT. The counter 68 starts counting.

このカウンタ68の計数値は、演算回路69で母数情報
「80SU」で除算され、その計算結果である正解率は
、表示器70で音高正解率としてパーセント表示される
。信号A△2およびA△1は、それぞれクロツクTCL
で駆動されるシフトレジスタ71,72に供給する。
The counted value of the counter 68 is divided by the parameter information "80SU" in the arithmetic circuit 69, and the correct answer rate, which is the result of the calculation, is displayed as a percentage on the display 70 as the pitch correct answer rate. Signals A△2 and A△1 are clock TCL, respectively.
The signal is supplied to shift registers 71 and 72 which are driven by.

ここで、信号AA2の供給されるシフトレジスタ71は
4ビットで構成され、その1ビット目がrl」である時
にフリツプフロツプ回路73をセットし、最終4ビット
目が「1」となった時に、オア回路4を介して上記フリ
ップフロツプ回路73をリセットするようにしてなる。
オア回路4‘ま、初期設定用のスタート信号STRTを
供給する。また、信号A△1に対応するシフトレジスタ
72は3ビット構成であり、その入力端情報でセットさ
れるフリツプフロツプ回路75を、オア回路0 76を
介して供給される最終3ビット目出力でリセツトするよ
うにしてなる。
Here, the shift register 71 to which the signal AA2 is supplied is composed of 4 bits, and when the first bit is "rl", the flip-flop circuit 73 is set, and when the fourth and final bit is "1", the or The flip-flop circuit 73 is reset via the circuit 4.
The OR circuit 4' supplies a start signal STRT for initial setting. Furthermore, the shift register 72 corresponding to the signal A△1 has a 3-bit configuration, and the flip-flop circuit 75, which is set by the input terminal information, is reset by the output of the third and final bit supplied via the OR circuit 076. That's how it happens.

オア回路76には信号STRTを供V給する。すなわち
、記憶装置27において、第5図に音符、さらに休止符
で示す風情報が記憶され、こ夕れが順次読み出された時
には、クロツクTCLに対応して同図に示すように休止
符をも含んで信号A△1が発生され、また休止符を除く
状態で信号A△2が発生される。
The OR circuit 76 is supplied with a signal STRT. That is, in the storage device 27, the wind information shown in FIG. 5 as a musical note and a rest mark is stored, and when this information is sequentially read out, it also includes a rest mark as shown in the figure in response to the clock TCL. A signal A△1 is generated in the state, and a signal A△2 is generated in the state excluding the rest mark.

したがってフリツプフロツプ回路73,75のセット時
の出力信号は、それ0ぞれ第5図にFIおよびF2で示
す状態となる。鍵盤16において、記憶装置27に記憶
された情報に対応する楽譜が正確に演奏表現されたとす
ると、理想的には第5図で示すように信号A△1,A△
2と同期して、信号M△1,M△2が発生する。この信
号M△1,M△2はそれぞれクロックTCLの4倍の周
波数クロック4TCLで駆動される微分回路77,78
をそれぞれ介してシフトレジスタ79,80に供給され
る。このシフトレジスタ79,80は、共にクロツク4
TCLで駆動され、それぞれ8ビットおよび10ビット
で構成されるものであり、したがって、このシフトレジ
スタ79,80からは、それぞれ第5図に示すように信
号M△1およびM△2の立ち上りよりそれぞれクロツク
TCLの8/4クロツクおよび10/4クロツク遅れて
信号KOFFおよびKONを発生する。上記シフトレジ
スタ80からの出力信号KONは、前記信号FIと共に
アンド回路81に供給し、このアンド回路81からの第
5図にANDで示す出力信号は、フリツプフロツプ回路
82をセットする。このフリツプフロツプ回路82は、
シフトレジスタ79からの出力信号KOFFを遅延回路
83でクロック4TCL分遅延した信号でリセットされ
るもので、このフリツプフロツプ回路82は第5図にF
3で示すセット時出力信号を発生するようになる。そし
て、このフリツブフロツプ回路83からのセット時世力
信号F3は、前記フリップフロップ回路75のセット時
世力信号F2、およびシフトレジスタ79からの出力信
号KOFFと共にアンド回路84に供給し、このアンド
回路84から第5図にLRで示す出力信号を発生させる
。すなわち、このアンド回路84からは、鍵盤16にお
ける鍵の押鍵動作と離鍵動作が、記憶装置27から読み
出される1つのuk情報の読み出し間隔、すなわち記憶
音符長と一致する状態で出力信号LRが発生されるもの
で、この信号LRは信号STRTで初期設定されるカウ
ンタ85で計数する。
Therefore, the output signals of flip-flop circuits 73 and 75 when set are in the states shown by FI and F2 in FIG. 5, respectively. Assuming that the musical score corresponding to the information stored in the storage device 27 is accurately played on the keyboard 16, ideally the signals A△1, A△ as shown in FIG.
Signals MΔ1 and MΔ2 are generated in synchronization with MΔ2. These signals M△1 and M△2 are respectively driven by differentiating circuits 77 and 78 driven by a clock 4TCL with a frequency four times that of the clock TCL.
are supplied to shift registers 79 and 80, respectively. Both shift registers 79 and 80 are connected to clock 4.
The shift registers 79 and 80 are driven by a TCL and are composed of 8 bits and 10 bits, respectively. Therefore, as shown in FIG. Signals KOFF and KON are generated with a delay of 8/4 and 10/4 clocks of clock TCL. The output signal KON from the shift register 80 is supplied together with the signal FI to an AND circuit 81, and the output signal from the AND circuit 81, shown as AND in FIG. 5, sets a flip-flop circuit 82. This flip-flop circuit 82 is
The flip-flop circuit 82 is reset by a signal obtained by delaying the output signal KOFF from the shift register 79 by 4 TCL clocks in a delay circuit 83. This flip-flop circuit 82 is shown in FIG.
When set, the output signal shown in 3 is generated. The set power signal F3 from the flip-flop circuit 83 is supplied to the AND circuit 84 together with the set power signal F2 of the flip-flop circuit 75 and the output signal KOFF from the shift register 79. , an output signal indicated by LR in FIG. 5 is generated. That is, the output signal LR is output from the AND circuit 84 in a state in which the key press and release operations on the keyboard 16 match the read interval of one piece of uk information read out from the storage device 27, that is, the stored note length. This signal LR is counted by a counter 85 which is initialized by the signal STRT.

このカゥンタ85は符最正解を計数するようになり、そ
の計数値は演算回路86で母数情報「80SU」と除算
し、表示器87で符長正解率をパーセント表示するよう
になる。したがって、以上のように構成される電子楽器
の練習装置によれば、ある特定された練習曲に対する演
奏情報が記憶装置27に書き込み設定され4た状態で、
演奏練習者はその練習曲に対応する楽譜を設定し、この
楽譜によって鍵盤16部を用いて演奏練習をするもので
ある。
The counter 85 counts the most correct answer, and the calculated value is divided by the parameter information "80SU" in the arithmetic circuit 86, and the indicator 87 displays the correct answer rate in percentage. Therefore, according to the electronic musical instrument practice device configured as described above, when the performance information for a specified practice piece is written and set in the storage device 27,
A performance practitioner sets a musical score corresponding to the practice piece, and practices performance using this musical score using the 16 keyboards.

すなわち演奏開始をスタートスイッチ39により指令す
れば、前述したように記憶装置27から練習曲の楽譜に
表示された音符、休止符に対応する叱情報が、その各音
符長に対応する時間隔をもって順次読み出され、同時に
自動リズム発生回路43から、その読み出しテンポに対
応する自動リズム音源信号が発生され、自動リズム演奏
がされるようになる。すなわち、演奏者はこの自動リズ
ム演奏者に合わせて、指定された練習曲の楽譜にしたが
って、鍵盤16を演奏操作すれば、この鍵盤16から演
奏情報は、記憶装置27からの読み出し血清報と同期す
る状態となるものである。そして、その鍵盤16の鍵操
作タイミングが、記憶装置27からのuk情報読み出し
タイミングと、レジスタ56,57で許容される誤差範
囲内にあれば、演奏の進行に伴なつて、その正解タイミ
ング操作の回数がカウンタ61で計数これ、その正解率
が表示器63で表示されるようになるものである。上記
第4図では、基準となる演奏音情報を、記憶装置27か
ら電子制御内に読み出されるuk情報を用いた場合を例
にして示している。しかし、これは第1図で示したよう
に親機の鍵盤部からの先生の演奏に対応した演奏情報を
用いるようにしても同様に実施できる。具体的には、第
4図における練習用鍵盤16から演奏情報にもとづき信
号M△1,M△2を形成する手段を同機の構成で使用し
、入力情報として親機鍵盤からの演奏情報を用いればよ
い。
In other words, when the start switch 39 is used to command the start of the performance, the scolding information corresponding to the notes and rests displayed on the score of the practice piece is read out sequentially from the storage device 27 at time intervals corresponding to the length of each note, as described above. At the same time, an automatic rhythm sound source signal corresponding to the read tempo is generated from the automatic rhythm generating circuit 43, and an automatic rhythm performance is started. In other words, if the performer operates the keyboard 16 according to the music score of the specified practice piece in accordance with the automatic rhythm player, the performance information from the keyboard 16 will be synchronized with the readout information from the storage device 27. This is the state in which If the key operation timing on the keyboard 16 is within the error range allowed by the UK information reading timing from the storage device 27 and the registers 56 and 57, as the performance progresses, the correct timing operation will be corrected. The number of times is counted by the counter 61, and the correct answer rate is displayed on the display 63. FIG. 4 shows an example in which uk information read out from the storage device 27 within the electronic control is used as the reference performance sound information. However, this can be similarly implemented by using performance information corresponding to the teacher's performance from the keyboard section of the base unit, as shown in FIG. Specifically, the means for forming signals MΔ1 and MΔ2 based on the performance information from the practice keyboard 16 shown in FIG. Bye.

すなわち、先生の演奏を基準演奏音情報にもとづき、信
号A△1,A△2が得られる。したがって、このような
場合は、先生の指導にもとづく状態で生徒が鍵盤の演奏
練習を行ない、先生の演奏との差を明確に採点判断でき
るようになるもので、特に集団的な演奏練習に効果的に
使用することができ、特定されるフレーズの演奏練習に
効果的である。
That is, signals A△1 and A△2 are obtained based on the teacher's performance based on the reference performance sound information. Therefore, in such cases, students can practice playing the keyboard under the teacher's guidance and be able to clearly judge the difference in score from the teacher's performance, which is especially effective for group performance practice. It is effective for practicing playing specified phrases.

尚、実施例では鍵盤の正鱗操作の採点表示を正解率パー
セント表示で示したが、この採点評価手段は任意選定で
きるものであり、ある特定された曲を命令演奏するよう
な場合は、母数を最終値に設定し、演奏終了時において
最終採点評価が表示されるようにしてもよい。
In the example, the scoring for correct keyboard operation was shown as a percentage of correct answers, but this scoring evaluation method can be selected arbitrarily, and when a specified piece of music is to be played on command, The number may be set as the final value, and the final scoring evaluation may be displayed at the end of the performance.

その他、数値による表示に限らず、パターン的な正確率
表示であってもよい。以上のように、この発明によれば
練習する生徒の鍵の操作タイミングの状態が、常に監視
され、計数された評価されるものであるため、その生徒
の音楽に対する表現感覚の基準のものに対するずれの状
態が客観性をもつて認知されるものであり、特に練習す
る生徒に対して自覚をもたせるために効果的である。
In addition, the display is not limited to numerical values, and may be a patterned accuracy rate display. As described above, according to the present invention, the state of the key operation timing of the student practicing is constantly monitored, counted, and evaluated, so that there is no deviation from the standard of the student's sense of musical expression. This allows the state of the subject to be recognized objectively, and is particularly effective in making students aware of it when practicing.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例に係る練習装置を説明する
構成図、第2図はこの発明の他の実施例を説明する構成
図、第3図はこの実施例の記憶装置における記憶情報の
フオーマットを示す図、第4図は同じくこの実施例の押
鍵判断部の具体的構成例を示す図、第5図は第4図の装
置の動作を説明する信号波形図である。 11・・・・・・親機鍵盤、15a,15b・・・・・
・子機、16……鍵盤(練習用)、17……楽音形成回
路、20・・・・・・正押鍵判断部、21・・・・・・
タイミング判断部、22・・…・音高判断部、23・・
・・・・符長判断部、24〜26…・・・表示器、27
・・・・・・記憶装置、28……アドレスカウンタ、3
3……クロック発振器、43・・…・自動リズム発生回
路。 第1図 図 N 船 第3図 第5図 図 寸 船
FIG. 1 is a block diagram illustrating a practice device according to an embodiment of the present invention, FIG. 2 is a block diagram explaining another embodiment of the present invention, and FIG. 3 is a block diagram illustrating storage information in a storage device of this embodiment. FIG. 4 is a diagram showing a specific configuration example of the key press determination section of this embodiment, and FIG. 5 is a signal waveform diagram illustrating the operation of the device shown in FIG. 4. 11... Master unit keyboard, 15a, 15b...
・Slave unit, 16...Keyboard (for practice), 17...Tone formation circuit, 20...Correctly pressed key judgment unit, 21...
Timing judgment section, 22... Pitch judgment section, 23...
...Note length judgment unit, 24-26...Display device, 27
...Storage device, 28...Address counter, 3
3...Clock oscillator, 43...Automatic rhythm generation circuit. Figure 1 Figure N Ship Figure 3 Figure 5 Dimensions Ship

Claims (1)

【特許請求の範囲】 1 基準演奏音情報に対応する第1のキーオン信号発生
手段と、練習鍵盤部の演奏操作に対応する第2のキーオ
ン信号発生手段と、上記第1および第2のキーオン信号
発生手段の少なくとも一方に設けられ対応するキーオン
信号に同期して少なくともそのキーオン信号より広いパ
ルス幅に設定したタイミング信号を発生する手段と、こ
のタイミング信号と他のキーイング信号に関連する信号
との論理積情報を発生する手段とを具備し、この論理積
情報で上に鍵盤の操作鍵タイミングの正解を判断するよ
うにしたことを特徴とする電子楽器の練習装置。 2 上記基準演奏音情報は、先生用楽器の鍵盤の鍵操作
により発生するようにした特許請求の範囲第1項記載の
装置。 3 上記基準演奏音情報は、予め記憶設定された記憶装
置から音符長に対応して順次読み出される音高情報で構
成した特許請求の範囲第1項記載の装置。 4 上記論理積情報は、各押鍵タイミングに対応して計
数し、採点表示されるようにした特許請求の範囲第1項
記載の装置。
[Scope of Claims] 1. A first key-on signal generating means corresponding to reference performance sound information, a second key-on signal generating means corresponding to a performance operation of the practice keyboard section, and the first and second key-on signals. means for generating a timing signal provided in at least one of the generating means and set to have a pulse width wider than at least the key-on signal in synchronization with the corresponding key-on signal, and logic between this timing signal and signals related to other keying signals; 1. A practice device for an electronic musical instrument, comprising means for generating product information, and the correct timing of operating keys on a keyboard is determined based on the logical product information. 2. The device according to claim 1, wherein the reference performance sound information is generated by key operations on a keyboard of a teacher's musical instrument. 3. The apparatus according to claim 1, wherein the reference performance note information is constituted by pitch information sequentially read out from a storage device stored in advance in accordance with the note length. 4. The apparatus according to claim 1, wherein the logical product information is counted and displayed as a score corresponding to each key press timing.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0542870Y2 (en) * 1988-02-12 1993-10-28
JPH0623353Y2 (en) * 1988-01-26 1994-06-22 清 秋生 Whistle for toys

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