JPS60254756A - 樹脂封止型半導体装置およびその製造方法 - Google Patents
樹脂封止型半導体装置およびその製造方法Info
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- JPS60254756A JPS60254756A JP11125484A JP11125484A JPS60254756A JP S60254756 A JPS60254756 A JP S60254756A JP 11125484 A JP11125484 A JP 11125484A JP 11125484 A JP11125484 A JP 11125484A JP S60254756 A JPS60254756 A JP S60254756A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
+a+ 産業上の利用分野
本発明は封止により半導体チップ表面に生ずるストレス
を緩和する構造の樹脂封止型半導体装置に関する。
を緩和する構造の樹脂封止型半導体装置に関する。
近年集積回路の大規模化に伴い半導体チップも大型化さ
れ、その大きさが6IllI11角以上になると、樹脂
封止型半導体装置においては成形後の樹脂の収縮による
ストレスのため、半導体チップの表□面に被着されたパ
ンシベーション膜、多結晶珪素層、多層配線の場合は配
線層間の絶縁層、さらに半導体基板内部に形成された不
純物導入層にクランクを発生させる等の悪影響がでてき
た。
れ、その大きさが6IllI11角以上になると、樹脂
封止型半導体装置においては成形後の樹脂の収縮による
ストレスのため、半導体チップの表□面に被着されたパ
ンシベーション膜、多結晶珪素層、多層配線の場合は配
線層間の絶縁層、さらに半導体基板内部に形成された不
純物導入層にクランクを発生させる等の悪影響がでてき
た。
これに対して、集積回路の設計、組立、パッケージの面
より種々検討が行われている。
より種々検討が行われている。
(bl 従来の技術
成形後の樹脂の収縮によるストレスを緩和するため、つ
ぎのような方法がある。
ぎのような方法がある。
i、低応力樹脂の採用
ストレスを小さくするには、概念的には樹脂の歪、即ち
熱膨張係数と、剛性率を小さくすればよい。しかし、こ
れらの値はパッケージとしての機能をはだすためには、
極端に小さくできない。
熱膨張係数と、剛性率を小さくすればよい。しかし、こ
れらの値はパッケージとしての機能をはだすためには、
極端に小さくできない。
一般に封止樹脂は、エポキシ樹脂を基体とし、これにフ
ィラーとして二酸化珪素粉を70%程度混入する。フィ
ラーを増やすと熱膨張係数は小さくなるが、剛性率は大
きくなる。そのため珪素樹脂等ゴム状のものを混入する
方法がある。
ィラーとして二酸化珪素粉を70%程度混入する。フィ
ラーを増やすと熱膨張係数は小さくなるが、剛性率は大
きくなる。そのため珪素樹脂等ゴム状のものを混入する
方法がある。
しかしパ、2ケージ材料としての要件である、成形性、
捺印性、耐湿性等をバランスよく実現する材料の選択に
は自ずと限度がある。
捺印性、耐湿性等をバランスよく実現する材料の選択に
は自ずと限度がある。
ii 、半導体チップの表面被覆
通常J CR(Junction Coating R
e5in)と呼ばれるゲル状の珪素樹脂を半導体チップ
表面に滴下した後に、樹脂成形を行い封止する。
e5in)と呼ばれるゲル状の珪素樹脂を半導体チップ
表面に滴下した後に、樹脂成形を行い封止する。
この方法は工程が増え、また薄ものパンケージには適用
できない等の欠点を有する。
できない等の欠点を有する。
iii 、その他
ウェハ・プロセス上では、半導体チップのパッシベーシ
ョン膜の強化が検討されている。
ョン膜の強化が検討されている。
(C) 発明が解決しようとする問題点従来の樹脂封止
型半導体装置においては、成形後の樹脂の収縮によるス
トレスにより、半導体チップ表面を損傷する点である。
型半導体装置においては、成形後の樹脂の収縮によるス
トレスにより、半導体チップ表面を損傷する点である。
tdl 問題点を解決するための手段
上記問題点の解決は、半導体チップの上部に、孔もしく
はくぼみを有し、且つ封止樹脂より膨張係数の低い板部
材を配設してなる本発明による樹脂封止型半導体装置、
および第1のリードフレームのチップ・ステージに半導
体チップを、該半導体チップと該第1のリードフレーム
の外部リードに内部リード線をボンディングした後、孔
もしくはくぼみを有し、且つ封止樹脂より膨張係数の低
い板部材を具備する第2のリードフレームを、該半導体
チップ上を覆うように該第1のリードフレーム上に重ね
て後樹脂封止する本発明による樹脂封止型半導体装置の
製造方法により達成される。
はくぼみを有し、且つ封止樹脂より膨張係数の低い板部
材を配設してなる本発明による樹脂封止型半導体装置、
および第1のリードフレームのチップ・ステージに半導
体チップを、該半導体チップと該第1のリードフレーム
の外部リードに内部リード線をボンディングした後、孔
もしくはくぼみを有し、且つ封止樹脂より膨張係数の低
い板部材を具備する第2のリードフレームを、該半導体
チップ上を覆うように該第1のリードフレーム上に重ね
て後樹脂封止する本発明による樹脂封止型半導体装置の
製造方法により達成される。
(e) 作用
前述のように材料を変えてもストレスを0にすることは
できない。そのため半導体チップ上に多数の孔の開いた
低膨張係数の金属板を板部材として設けて樹脂中に埋め
込むことにより、孔に浸入した樹脂が丁度アンカー・ボ
ルトのような役目をして、成形後の冷却によって生ずる
樹脂の収縮を抑制する。
できない。そのため半導体チップ上に多数の孔の開いた
低膨張係数の金属板を板部材として設けて樹脂中に埋め
込むことにより、孔に浸入した樹脂が丁度アンカー・ボ
ルトのような役目をして、成形後の冷却によって生ずる
樹脂の収縮を抑制する。
即ち、この金属板により半導体チップ表面近傍の樹脂の
自由膨張、収縮を抑制し、従って半導体チップと樹脂間
の辷りを減らし、半導体チップに生ずるストレスを軽減
する。
自由膨張、収縮を抑制し、従って半導体チップと樹脂間
の辷りを減らし、半導体チップに生ずるストレスを軽減
する。
if) 実施例
以下に本発明の実施例を組立工程を含めて説明する。
第2図は本発明によるストレス抑制用筒2のリードフレ
ームの1駒分の平面図と断面図である。
ームの1駒分の平面図と断面図である。
図において、リードフレームは例えば42合金(鉄−4
2%ニッケル)を用い、これに同じ材料で板部材として
ストレス抑制金属板1を具備させ、これには多数の孔ま
たは(ぼみ2を設ける。3はリードフレームの送り孔で
ある。
2%ニッケル)を用い、これに同じ材料で板部材として
ストレス抑制金属板1を具備させ、これには多数の孔ま
たは(ぼみ2を設ける。3はリードフレームの送り孔で
ある。
第3図は第1のリードフレームの1駒分の平面図である
。
。
図において、4はチップ・ステージでこの上に半導体チ
ップ5をソルダ付けする。6は外部り一ドで、これと半
導体チップのボンディング・パッドとに内部リード線7
をボンディングする。8はリードフレームの送り孔であ
る。
ップ5をソルダ付けする。6は外部り一ドで、これと半
導体チップのボンディング・パッドとに内部リード線7
をボンディングする。8はリードフレームの送り孔であ
る。
この第1のリードフレームの上に、第2のリードフレー
ムを送り孔が一致するように重ねて、鎖線で示されるよ
うに封止樹脂9を注入成形する。
ムを送り孔が一致するように重ねて、鎖線で示されるよ
うに封止樹脂9を注入成形する。
つぎに外部リードを結ぶタイバー10と、上下のリード
フレームの耳を切断除去し、外部リードをパッケージの
根本近傍より下向きに直角に近く折り曲げて組立工程を
終わる。
フレームの耳を切断除去し、外部リードをパッケージの
根本近傍より下向きに直角に近く折り曲げて組立工程を
終わる。
なお、第2のリードフレームに、内部リード線7との接
触短絡を防ぐため絶縁性樹脂を被覆する場合もをる。
触短絡を防ぐため絶縁性樹脂を被覆する場合もをる。
第1図は上記の組立工程が終わり、完成した状態を示す
本発明による樹脂封止型半導体装置のX−X矢視断面図
である。
本発明による樹脂封止型半導体装置のX−X矢視断面図
である。
(g) 発明の効果
以上詳細に説明したように本発明によれば、成形後の樹
脂の収縮によるストレスを緩和し、半導体チップ表面の
損傷を軽減できる。従って大型半導体チップの樹脂封止
が可能となる。
脂の収縮によるストレスを緩和し、半導体チップ表面の
損傷を軽減できる。従って大型半導体チップの樹脂封止
が可能となる。
第1図は本発明による樹脂封止型半導体装置のX−X矢
視断面図、 第2図は本発明によるストレス抑制用筆2のリードフレ
ームの1駒分の平面図と断面図、第3図は第1のリード
フレームの1駒分の平面図である。 図において、 1はストレス抑制金属板、 2は孔またはくぼみ、 3は送り孔、 4はチップ・ステージ、5は半導体チップ、6は外部リ
ード、 7は内部リード線、8は送り孔、 9は封止樹
脂、 IOはタイバー を示す。
視断面図、 第2図は本発明によるストレス抑制用筆2のリードフレ
ームの1駒分の平面図と断面図、第3図は第1のリード
フレームの1駒分の平面図である。 図において、 1はストレス抑制金属板、 2は孔またはくぼみ、 3は送り孔、 4はチップ・ステージ、5は半導体チップ、6は外部リ
ード、 7は内部リード線、8は送り孔、 9は封止樹
脂、 IOはタイバー を示す。
Claims (2)
- (1)半導体チップの上部に、孔もしくはくぼみを有し
、且つ封止樹脂より膨張係数の低い板部材を配設してな
ることを特徴とする樹脂封止型半導体装置。 - (2)第1のリードフレームのチップ・ステージに半導
体チップを、該半導体チップと該第1のリードフレーム
の外部リードに内部リード線をボンディングした後、孔
もしくはくぼみを有し、且つ封止樹脂より膨張係数の低
い板部材を具備する第2のリードフレームを、該半導体
チップ上を覆うように該第1のリードフレーム上に重ね
て後、樹脂封止することを特徴とする樹脂封止型半導体
装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11125484A JPS60254756A (ja) | 1984-05-31 | 1984-05-31 | 樹脂封止型半導体装置およびその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11125484A JPS60254756A (ja) | 1984-05-31 | 1984-05-31 | 樹脂封止型半導体装置およびその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60254756A true JPS60254756A (ja) | 1985-12-16 |
Family
ID=14556519
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11125484A Pending JPS60254756A (ja) | 1984-05-31 | 1984-05-31 | 樹脂封止型半導体装置およびその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60254756A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2684803A1 (fr) * | 1991-12-04 | 1993-06-11 | Gemplus Card Int | Boitier a structure renforcee pour circuit integre, et carte comprenant un tel boitier. |
US5901043A (en) * | 1993-03-02 | 1999-05-04 | National Semiconductor Corporation | Device and method for reducing thermal cycling in a semiconductor package |
-
1984
- 1984-05-31 JP JP11125484A patent/JPS60254756A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
FR2684803A1 (fr) * | 1991-12-04 | 1993-06-11 | Gemplus Card Int | Boitier a structure renforcee pour circuit integre, et carte comprenant un tel boitier. |
US5901043A (en) * | 1993-03-02 | 1999-05-04 | National Semiconductor Corporation | Device and method for reducing thermal cycling in a semiconductor package |
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