JPS60244129A - 双方向伝送方式 - Google Patents
双方向伝送方式Info
- Publication number
- JPS60244129A JPS60244129A JP9991284A JP9991284A JPS60244129A JP S60244129 A JPS60244129 A JP S60244129A JP 9991284 A JP9991284 A JP 9991284A JP 9991284 A JP9991284 A JP 9991284A JP S60244129 A JPS60244129 A JP S60244129A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- burst signal
- transmission
- repeater
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
- H04L5/16—Half-duplex systems; Simplex/duplex switching; Transmission of break signals non-automatically inverting the direction of transmission
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Bidirectional Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、時分割制御による双方向伝送方式に関する。
第１図は、従来の時分割制御による双方向伝送方式の一
例を示すブロック図である。すなわち、主局と従局間は
直接、２線式線路りによって結合されている。主局側で
は送信バッファメモリ１に格納された送信データをフレ
ーム発生回路５０発生する一定周期のフレーム同期信号
に引続いてバースト的に読み出し、送信回路３で、線路
上に送出するのに適した波形の符号（例えばバイポーラ
符号）に変換して線路変成器８を介して２線式線路りに
バースト信号を送出する。上記バースト信号は前記一定
周期ごとに送出され、バースト信号間には適当な間隙が
ある。従局側では、受信４号を線路変成器１６および受
信スイッチ１５を介して受信回路１２に入力させる。受
信回路１２は受信々号の等化増幅ビットタイミングの抽
出、受信符号の識別再生等を行う。受信回路１２の出力
信号によシ、フレーム同期回路１４でフレーム同期信号
を検出して受信側のフレーム同期を確立する。
例を示すブロック図である。すなわち、主局と従局間は
直接、２線式線路りによって結合されている。主局側で
は送信バッファメモリ１に格納された送信データをフレ
ーム発生回路５０発生する一定周期のフレーム同期信号
に引続いてバースト的に読み出し、送信回路３で、線路
上に送出するのに適した波形の符号（例えばバイポーラ
符号）に変換して線路変成器８を介して２線式線路りに
バースト信号を送出する。上記バースト信号は前記一定
周期ごとに送出され、バースト信号間には適当な間隙が
ある。従局側では、受信４号を線路変成器１６および受
信スイッチ１５を介して受信回路１２に入力させる。受
信回路１２は受信々号の等化増幅ビットタイミングの抽
出、受信符号の識別再生等を行う。受信回路１２の出力
信号によシ、フレーム同期回路１４でフレーム同期信号
を検出して受信側のフレーム同期を確立する。
バッファメモリ１０はフレーム同期回路１４の出力する
フレーム同期信号によシ受信回路１２の出力するバース
ト状のデータを格納する。一方、フレーム発生回路１３
は、上記フレーム同期回路１４の出力するフレーム同期
信号からある時間遅れたフレーム同期信号を発生して送
信回路１１に送、シ、引続いてバッファメモリ９に格納
された送信データがバースト的に読出される。送信回路
１１は上記フレーム同期信号およびデータをバースト信
号として２線式線路りに送出する。この際、受信スイッ
チ１５は閉じられていて、送信回路１１の出力が受信回
路１２に入力することを阻止している。
フレーム同期信号によシ受信回路１２の出力するバース
ト状のデータを格納する。一方、フレーム発生回路１３
は、上記フレーム同期回路１４の出力するフレーム同期
信号からある時間遅れたフレーム同期信号を発生して送
信回路１１に送、シ、引続いてバッファメモリ９に格納
された送信データがバースト的に読出される。送信回路
１１は上記フレーム同期信号およびデータをバースト信
号として２線式線路りに送出する。この際、受信スイッ
チ１５は閉じられていて、送信回路１１の出力が受信回
路１２に入力することを阻止している。
なお上記の信号送出は、主局から送られるバースト信号
の間隙の期間に行われるから受信スイッチ１５が閉じて
いることによって主局から従局へのバースト信号への受
信が妨げられることはない。
の間隙の期間に行われるから受信スイッチ１５が閉じて
いることによって主局から従局へのバースト信号への受
信が妨げられることはない。
従局側から送出されたバースト信号は２線式線路りを伝
送され線路変成器８および受信スイッチ７を介して主局
側の受信回路４に入力される。受信回路４は、受信信号
の等化再生等を行う。フレーム同期回路６は受信回路４
の出力によシ受信側のフレーム同期をとシ、バッファメ
モリ２にハ受信回路４の出力するデータが格納される。
送され線路変成器８および受信スイッチ７を介して主局
側の受信回路４に入力される。受信回路４は、受信信号
の等化再生等を行う。フレーム同期回路６は受信回路４
の出力によシ受信側のフレーム同期をとシ、バッファメ
モリ２にハ受信回路４の出力するデータが格納される。
上述の従来方式では、２線式伝送路りの線路が長くなシ
受信レベルが低下すると識別誤シが発生゛し正確なデー
タ伝譲ができないという欠点がおる・また、伝送速度を
上げると使用帯域の高周波成分が増加し、線路損失が増
大して伝送距離が短くなる。また、同一ケーブル内に同
時に収容されている他の線路中の信号から発生する近端
漏話、遠端漏話、インパルス性雑音の混入によシ伝送距
離および速度が制限される。
受信レベルが低下すると識別誤シが発生゛し正確なデー
タ伝譲ができないという欠点がおる・また、伝送速度を
上げると使用帯域の高周波成分が増加し、線路損失が増
大して伝送距離が短くなる。また、同一ケーブル内に同
時に収容されている他の線路中の信号から発生する近端
漏話、遠端漏話、インパルス性雑音の混入によシ伝送距
離および速度が制限される。
本発明の目的は、伝送路に中継器を挿入することができ
、１もって線路長伝送速度限界点を波長することのでき
る時分割制御による２＃式の双方向伝送方式を提供する
ことにある。
、１もって線路長伝送速度限界点を波長することのでき
る時分割制御による２＃式の双方向伝送方式を提供する
ことにある。
本発明の双方向伝送方式は、主局は一定周期で第一の伝
送路を経由して中継器に下シバースト信号を送出し、中
継器は前記下シバースト信号に対してフレーム同期をと
シ、記憶された下シ状態信号に応じて前記下シバースト
信号を等化して第二の伝送路を経由して従局に送出し、
従局は前記下シバースト信号の間隙に第二の伝送路を経
由して上シバースト信号を前記中継器に送出し、前記中
継器は゛前転上シバースト信号に対してフレーム同期を
とシ、記憶された上シ状態信号に応じて前記上シバ−ス
ト信号を等化して第一の伝送路を経由して前記主局に送
出し、前記中継器はそのフレーム同期がはずれると前記
下シバースト信号を等化し、この等化出力の第二の伝送
路への送出をフレーム同期が回復するまで停止するよう
にしたことを特徴とする。
送路を経由して中継器に下シバースト信号を送出し、中
継器は前記下シバースト信号に対してフレーム同期をと
シ、記憶された下シ状態信号に応じて前記下シバースト
信号を等化して第二の伝送路を経由して従局に送出し、
従局は前記下シバースト信号の間隙に第二の伝送路を経
由して上シバースト信号を前記中継器に送出し、前記中
継器は゛前転上シバースト信号に対してフレーム同期を
とシ、記憶された上シ状態信号に応じて前記上シバ−ス
ト信号を等化して第一の伝送路を経由して前記主局に送
出し、前記中継器はそのフレーム同期がはずれると前記
下シバースト信号を等化し、この等化出力の第二の伝送
路への送出をフレーム同期が回復するまで停止するよう
にしたことを特徴とする。
次に本発明について図面を用いて詳細に説明する。
第２図は、本発明の一実施例における中継器を示すブロ
ック図である。すなわち、スイッチ回路２１には主局側
伝送路Ｌｌ、従局側伝送路Ｌ２゜等化回路２２．送信回
路２３が接続され、フレーム同期回路２６から出力され
るスイッチ制御信号によシ伝送路Ｌ１からの入力バース
ト信号を等化回路２２に接続し、送信回路２３の出力バ
ースト信号を伝送路Ｌ２に接続するか、伝送路Ｌ２から
の入力バースト信号を等化回路２２に接続し、送信回路
２３の出力バースト信号を伝送路Ｌ１に接続するかの切
シ替えを行う。また、等化回路２２はメモリ回路２４に
接続され、等化回路２２はメモリ回路２４からの入力信
号の状態に応じて等化特性の設定がなされ、スイッチ回
路２１からの受信バースト信号を等化増幅し、ビットタ
イミングを抽出して、識別再生を行い、識別結果を送信
回路２３に送出する。また、メモリ回路２４の内容はフ
レーム同期回路２６の制御によシ等化回路２２が上シバ
ースト信号を受信する直前に下り状態信号メモリ２８に
転送された彼、上υ状態信号メモリ２７の内容がメモリ
回路２４にロードされる。
ック図である。すなわち、スイッチ回路２１には主局側
伝送路Ｌｌ、従局側伝送路Ｌ２゜等化回路２２．送信回
路２３が接続され、フレーム同期回路２６から出力され
るスイッチ制御信号によシ伝送路Ｌ１からの入力バース
ト信号を等化回路２２に接続し、送信回路２３の出力バ
ースト信号を伝送路Ｌ２に接続するか、伝送路Ｌ２から
の入力バースト信号を等化回路２２に接続し、送信回路
２３の出力バースト信号を伝送路Ｌ１に接続するかの切
シ替えを行う。また、等化回路２２はメモリ回路２４に
接続され、等化回路２２はメモリ回路２４からの入力信
号の状態に応じて等化特性の設定がなされ、スイッチ回
路２１からの受信バースト信号を等化増幅し、ビットタ
イミングを抽出して、識別再生を行い、識別結果を送信
回路２３に送出する。また、メモリ回路２４の内容はフ
レーム同期回路２６の制御によシ等化回路２２が上シバ
ースト信号を受信する直前に下り状態信号メモリ２８に
転送された彼、上υ状態信号メモリ２７の内容がメモリ
回路２４にロードされる。
一方、下りバースト信号を受信する直前には、メモリ回
路２４の内容は上シ状態信号メモリ２７に転送された後
、下シ状態信号メモリ２８の内容がメモリ回路２４にロ
ードされる。また、メモリ２４にロードされた等化回路
２２の状態設定用のデータは制御回路２５の制御によシ
、受信信号歪が少くなる様に更新され、等化回路２２．
メモリ回路２４、制御回路２５は全体として下シバース
ト信号受信時には下シバースト信号等化器として動作し
、上シバースト信号受信時には上シバースト信−号等化
器として動作する自動等化回路を構成する。
路２４の内容は上シ状態信号メモリ２７に転送された後
、下シ状態信号メモリ２８の内容がメモリ回路２４にロ
ードされる。また、メモリ２４にロードされた等化回路
２２の状態設定用のデータは制御回路２５の制御によシ
、受信信号歪が少くなる様に更新され、等化回路２２．
メモリ回路２４、制御回路２５は全体として下シバース
ト信号受信時には下シバースト信号等化器として動作し
、上シバースト信号受信時には上シバースト信−号等化
器として動作する自動等化回路を構成する。
また送信回路２３はフレーム同期が確立した状態では等
化回路２２からの入力データを送信するが、同期がはず
れた状態では送信を止め、従局側へ誤ったデータが流れ
るのを防止する。
化回路２２からの入力データを送信するが、同期がはず
れた状態では送信を止め、従局側へ誤ったデータが流れ
るのを防止する。
上記スイッチ回路２１はフレーム同期がはずれた状態で
は伝送路Ｌ１からの下シバースト信号を受信信号等化器
２２に接続し、送信回路２３の送信バースト信号を伝送
路Ｌ２に接続する。伝送路Ｌ１からの受信信号は等化回
路２２メモリ回路２４制御回路２５から構成される自動
等化回路により等化されるが送信回路２３は送信を停止
する。フレーム同期回路２６の同期が確立し、下りバー
スト信号の時間位置が確定すると、送信回路２３が送信
を開始し伝送路Ｌ２を介して下シバースト信号が従局側
へ送出される。下りバースト信号を従局側へ送出し終る
と、スイッチ回路２１は゛伝送路Ｌ２を等化回路２２に
接続し、送信回路２３を伝送路Ｌ１に接続する。また、
メモリ回路２４にロードされていたデータは下シ状態信
号メモリ２８に転送され、上υ状態信号メモリ２７の内
容がメモリ回路２４にロードされ、等化器は上り信号等
化器として動作する。以上の動作を繰り返すことによシ
、この中継器は、下シバースト信号通過時には下りバー
スト信号用再生中継器として働き、化シバースト信号通
過時には上シバースト信号用再生中継器として働く。ま
た、フレーム同期回路２６は引続いて該バースト信号中
のフレーム信号を検出しフレーム同期は継続的に維持さ
れる。
は伝送路Ｌ１からの下シバースト信号を受信信号等化器
２２に接続し、送信回路２３の送信バースト信号を伝送
路Ｌ２に接続する。伝送路Ｌ１からの受信信号は等化回
路２２メモリ回路２４制御回路２５から構成される自動
等化回路により等化されるが送信回路２３は送信を停止
する。フレーム同期回路２６の同期が確立し、下りバー
スト信号の時間位置が確定すると、送信回路２３が送信
を開始し伝送路Ｌ２を介して下シバースト信号が従局側
へ送出される。下りバースト信号を従局側へ送出し終る
と、スイッチ回路２１は゛伝送路Ｌ２を等化回路２２に
接続し、送信回路２３を伝送路Ｌ１に接続する。また、
メモリ回路２４にロードされていたデータは下シ状態信
号メモリ２８に転送され、上υ状態信号メモリ２７の内
容がメモリ回路２４にロードされ、等化器は上り信号等
化器として動作する。以上の動作を繰り返すことによシ
、この中継器は、下シバースト信号通過時には下りバー
スト信号用再生中継器として働き、化シバースト信号通
過時には上シバースト信号用再生中継器として働く。ま
た、フレーム同期回路２６は引続いて該バースト信号中
のフレーム信号を検出しフレーム同期は継続的に維持さ
れる。
この中継器は、主局と従局間の線路中に複数個挿入でき
る。従って主局と従局間の距離制限は緩和される。また
中継間隔を短くすることによシ高速化を行う場合に従来
問題となっていた線路損失の増大、ノイズに対する耐力
の低下を防ぐことも可能である。
る。従って主局と従局間の距離制限は緩和される。また
中継間隔を短くすることによシ高速化を行う場合に従来
問題となっていた線路損失の増大、ノイズに対する耐力
の低下を防ぐことも可能である。
以上の様に、本発明によれば、下クバースト信号、上シ
バースト信号の双方に対して、再生中継機能をもたせ、
時分割制御による双方向伝送方式の距離制限、速度制限
を緩和することが可能となる効果がある。
バースト信号の双方に対して、再生中継機能をもたせ、
時分割制御による双方向伝送方式の距離制限、速度制限
を緩和することが可能となる効果がある。
第１図は従来例を示すブロック図、第２図は本発明の夾
施例を示すブロック図である。 １．２．ｔ９，１０ ・バッファメモリ、３，１１・・
送信回路、４，１２・受信回路、５．１３ フレーム発
生回路、６，１４・・フレーム同期回路、７，１５・・
・受信スイッチ、８，１６・線路変成器、Ｌ・２線式線
路、２１ ・スイッチ回路、２２ 等化回路、２３・・
送信回路、２４ メモリ回路、２５ 制御回路、２６・
フレーム同期回路、２７・・上シ状態信号メモリ・２８
下υ状態信号メモリ、Ｌｌ 主局側伝送路、Ｌ２・従
局側伝送路。 代理人 弁理士 内 原 晋″パ
施例を示すブロック図である。 １．２．ｔ９，１０ ・バッファメモリ、３，１１・・
送信回路、４，１２・受信回路、５．１３ フレーム発
生回路、６，１４・・フレーム同期回路、７，１５・・
・受信スイッチ、８，１６・線路変成器、Ｌ・２線式線
路、２１ ・スイッチ回路、２２ 等化回路、２３・・
送信回路、２４ メモリ回路、２５ 制御回路、２６・
フレーム同期回路、２７・・上シ状態信号メモリ・２８
下υ状態信号メモリ、Ｌｌ 主局側伝送路、Ｌ２・従
局側伝送路。 代理人 弁理士 内 原 晋″パ
Claims (1)
- 主局は一定周期で第一の伝送路を経由して中継器に下シ
バースト信号を送出し、中継器は前記下シバースト信号
に対してフレーム同期をとシ、記憶された下シ状態信号
に応じて前記下シバースト信号を等化して第二の伝送路
を経由して従局に送出し、従局は前記下シバースト信号
の間隙に第二の伝送路を経由して上シバースト信号を前
記中継器に送出し、前記中継器は前記上シバ−スト信号
に対してフレーム同期をとシ、記憶された上シ状態信号
に応じて前記上シバ−スト信号を等化して第一の伝送路
を経由して前記主局に送出し、前記中継器はそのフレー
ム同期がはずれると前記下シバースト信号を等化し、こ
の等化出力の第二の伝送路への送出をフレーム同期が回
復するまで停止するようにしたことを特徴とする双方向
伝送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9991284A JPS60244129A (ja) | 1984-05-18 | 1984-05-18 | 双方向伝送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9991284A JPS60244129A (ja) | 1984-05-18 | 1984-05-18 | 双方向伝送方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60244129A true JPS60244129A (ja) | 1985-12-04 |
Family
ID=14259983
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9991284A Pending JPS60244129A (ja) | 1984-05-18 | 1984-05-18 | 双方向伝送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60244129A (ja) |
-
1984
- 1984-05-18 JP JP9991284A patent/JPS60244129A/ja active Pending
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