JPS6022660Y2 - 可変等化器 - Google Patents
可変等化器Info
- Publication number
- JPS6022660Y2 JPS6022660Y2 JP2172877U JP2172877U JPS6022660Y2 JP S6022660 Y2 JPS6022660 Y2 JP S6022660Y2 JP 2172877 U JP2172877 U JP 2172877U JP 2172877 U JP2172877 U JP 2172877U JP S6022660 Y2 JPS6022660 Y2 JP S6022660Y2
- Authority
- JP
- Japan
- Prior art keywords
- variable
- output
- input terminal
- resistor
- inverting input
- Prior art date
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- Expired
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- Filters And Equalizers (AREA)
- Networks Using Active Elements (AREA)
- Time-Division Multiplex Systems (AREA)
Description
【考案の詳細な説明】
本考案は周波数分割多重伝送路の振幅を等化するための
等化器、特にそのモツプアップ状に振幅を変化できる可
変等化器に関する。
等化器、特にそのモツプアップ状に振幅を変化できる可
変等化器に関する。
従来のこの種の可変等化器を第１図に示す。
この種の可変等化器は特願昭４６−４１２９６号（特公
昭５３−３４６９８号）による。
昭５３−３４６９８号）による。
第１図で入力端子１０１に加えられた信号は分岐用ハイ
ブリッドトランス１０１で主伝送路（分岐用ハイブリッ
ドトランスから減衰器１０３を経て結合用ハイブリッド
トランス１０４に至る伝送路）と副伝送路（分岐用ハイ
ブリットランス１０２から増幅器１０６、加算回路１１
５を経て結合用ハイブリッドトランス１０４に至る伝送
路）に分岐され、結合用ハイブリッドトランス１０４で
主伝送路と副伝送路の電圧との差をとり出力端子１０５
から取り出される。
ブリッドトランス１０１で主伝送路（分岐用ハイブリッ
ドトランスから減衰器１０３を経て結合用ハイブリッド
トランス１０４に至る伝送路）と副伝送路（分岐用ハイ
ブリットランス１０２から増幅器１０６、加算回路１１
５を経て結合用ハイブリッドトランス１０４に至る伝送
路）に分岐され、結合用ハイブリッドトランス１０４で
主伝送路と副伝送路の電圧との差をとり出力端子１０５
から取り出される。
副伝送路は、所要の周波数特性を決定する周波数特性回
路１０９、抵抗器１１０、可変抵抗器１１１で構成され
る可変抵抗回路網１０８，１１２・・・が多数並列に接
続されており、おのおの違った周波数特性を持っている
。
路１０９、抵抗器１１０、可変抵抗器１１１で構成され
る可変抵抗回路網１０８，１１２・・・が多数並列に接
続されており、おのおの違った周波数特性を持っている
。
また増幅器１０６の出力インピーダンスおよび加算回路
１１５の入力インピーダンスは、並列に接続された可変
抵抗回路網１０８．１１２・・・の合計の入出力インピ
ーダンスより非常に小さくしている。
１１５の入力インピーダンスは、並列に接続された可変
抵抗回路網１０８．１１２・・・の合計の入出力インピ
ーダンスより非常に小さくしている。
従って可変抵抗回路網１０８，１１２・・・はそれぞれ
他の可変抵抗回路網の影響をあまり受けない。
他の可変抵抗回路網の影響をあまり受けない。
加算回路１１５は差動増幅器で、非反転入力端子１１３
と反転入力端子１１４に流入する電流の差を増幅してい
る。
と反転入力端子１１４に流入する電流の差を増幅してい
る。
本可変等化器の振幅の可変幅は抵抗器１１０と可変抵抗
器１１１の差により決まる。
器１１１の差により決まる。
この差がないときは、非反転入力端子１１３と反転入力
端子１１４に流れる電流は等しくなり加算回路１１５の
出力１１６は零となり、本可変等化器の損失は、減衰器
１０３、ハイブリッドトランス１０２，１０４の損失に
より決まる。
端子１１４に流れる電流は等しくなり加算回路１１５の
出力１１６は零となり、本可変等化器の損失は、減衰器
１０３、ハイブリッドトランス１０２，１０４の損失に
より決まる。
このときの損失が定損失になる。
抵抗器１１０〈可変抵抗器１１１のときは非反転入力端
子１１３に流れる電流が反転入力端子１１４に流れる電
流より多くなり加算回路１１５の出力は非反転出力とな
り、結合用ハイブリッドトランス１０４で主伝送路の出
力との差がとられ本可変等化器の損失は定損失から正側
に変化する。
子１１３に流れる電流が反転入力端子１１４に流れる電
流より多くなり加算回路１１５の出力は非反転出力とな
り、結合用ハイブリッドトランス１０４で主伝送路の出
力との差がとられ本可変等化器の損失は定損失から正側
に変化する。
抵抗器１１０〉可変抵抗器１１１のときは反転入力端子
１１４に流れる電流が非反転入力端子１１３に流れる電
流が多くなり加算回路１１５の出力は反転出力となり、
結合用ハイブリッドトランス１０４で主伝送路の出力と
の差がとられ本可変等化器の損失は定損失から負側に変
化する。
１１４に流れる電流が非反転入力端子１１３に流れる電
流が多くなり加算回路１１５の出力は反転出力となり、
結合用ハイブリッドトランス１０４で主伝送路の出力と
の差がとられ本可変等化器の損失は定損失から負側に変
化する。
また、可変抵抗器１１１を可変したときの振幅周波数特
性は周波数特性回路１０９により決まる。
性は周波数特性回路１０９により決まる。
本可変等化器による可変特性の１例を第３図に示す。
第１図では加算回路１１５に差動増幅器を使用したが、
第２図の１次巻線に中間タップを有し、巻数比が１ニー
１：ｎの変成器２１７と増幅器２１８の構成でも加算回
路を構成できる。
第２図の１次巻線に中間タップを有し、巻数比が１ニー
１：ｎの変成器２１７と増幅器２１８の構成でも加算回
路を構成できる。
このように、従来の可変等化器では加算回路１１５と、
主伝送路と副伝送路を結合する結合用ノ＼イブリッドト
ランス１０４の２個の加算回路が必要であった。
主伝送路と副伝送路を結合する結合用ノ＼イブリッドト
ランス１０４の２個の加算回路が必要であった。
本考案は、１個の加算回路を共通に使用し、簡単な構成
の可変等化器を提供するものである。
の可変等化器を提供するものである。
本考案は、副伝送路の増幅器１０６の出力インピーダン
スおよび加算回路１１５の入力インピーダンスが非常に
小さいためそれらを抵抗器で接続しても可変抵抗回路網
１０８，１１２・・・の伝達関数には何等影響しない点
に着目し、抵抗器を主電送路として使用し加算回路を１
個で構成することができるものである。
スおよび加算回路１１５の入力インピーダンスが非常に
小さいためそれらを抵抗器で接続しても可変抵抗回路網
１０８，１１２・・・の伝達関数には何等影響しない点
に着目し、抵抗器を主電送路として使用し加算回路を１
個で構成することができるものである。
次に本考案の実施例について図面を参照して説明する。
第４図は本考案に係る一実施例を示し増幅器１０６の出
力インピーダンスは定電圧源とみなせるほど十分小さく
、加算回路１１５′は差動増幅器で非反転入力端子１１
３、反転入力端子１１４それぞれの入力インピーダンス
は、可変抵抗回路網１０８，１１２・・・のインピーダ
ンスより十分小さい。
力インピーダンスは定電圧源とみなせるほど十分小さく
、加算回路１１５′は差動増幅器で非反転入力端子１１
３、反転入力端子１１４それぞれの入力インピーダンス
は、可変抵抗回路網１０８，１１２・・・のインピーダ
ンスより十分小さい。
従って抵抗器１０３を第４図のように可変抵抗回路網の
入力１０７、加算回路の非反転入力端子１１３または反
転入力端子１１４に接続しても可変抵抗回路網１０８，
１１２・・・の伝達関数には影響を与えず、第１図の減
衰器１０３と同じ動きをする。
入力１０７、加算回路の非反転入力端子１１３または反
転入力端子１１４に接続しても可変抵抗回路網１０８，
１１２・・・の伝達関数には影響を与えず、第１図の減
衰器１０３と同じ動きをする。
第４図では加算回路１１５′は差動増幅器を使用したが
第１図と同様に第２図の回路を使用することも可能であ
る。
第１図と同様に第２図の回路を使用することも可能であ
る。
上記のように可変抵抗回路網を定電圧源で駆動し、はぼ
零インピーダンスで受けとると分岐用ハイブリットラン
ス、結合用ハイブリッドトランスは不用で減衰器も抵抗
１本で構成できるので低周波でも使用でき、構成も簡単
になる等の効果がある。
零インピーダンスで受けとると分岐用ハイブリットラン
ス、結合用ハイブリッドトランスは不用で減衰器も抵抗
１本で構成できるので低周波でも使用でき、構成も簡単
になる等の効果がある。
第１図は従来の可変等化器の一構成例を示し、第２図は
第１図の一部変形例を示し、第３図は、本可変等化器に
よる可変特性の１例を示し、第４図は本考案の可変等化
器の実施例を示す。 １０１・・・・・・入力端子、１０２，１０４・・・・
・・ハイブリッドトランス、１０３・・・・・・減衰器
、１０５・・・・・・出力端子、１０６，１０６’・・
・・・・増幅器、１０７・・・・・・可変抵抗回路網入
力、１０８，１１２・・・・・・可変抵抗回路網、１０
９・・・・・・周波数特性回路、１１０・・・・・・抵
抗器、１１１・・・・・・可変抵抗器 １１４・・・・
・・反転入力端子、１１５，１１５’・・・・・・加算
回路、１１６・・・・・・加算回路出力端子、２１７・
・・・・・変成器、２１８・・・・・・増幅器。
第１図の一部変形例を示し、第３図は、本可変等化器に
よる可変特性の１例を示し、第４図は本考案の可変等化
器の実施例を示す。 １０１・・・・・・入力端子、１０２，１０４・・・・
・・ハイブリッドトランス、１０３・・・・・・減衰器
、１０５・・・・・・出力端子、１０６，１０６’・・
・・・・増幅器、１０７・・・・・・可変抵抗回路網入
力、１０８，１１２・・・・・・可変抵抗回路網、１０
９・・・・・・周波数特性回路、１１０・・・・・・抵
抗器、１１１・・・・・・可変抵抗器 １１４・・・・
・・反転入力端子、１１５，１１５’・・・・・・加算
回路、１１６・・・・・・加算回路出力端子、２１７・
・・・・・変成器、２１８・・・・・・増幅器。
Claims (1)
- それぞれ所要の周波数特性を決定する周波数特性回路と
該周波数特性回路の出力端に一端が接続された抵抗器と
前記周波数特性回路の出力端に一端が接続された可変抵
抗器とを有し前記抵抗器および前記可変抵抗器の他端を
それぞれ第１および第２の出力端とする複数の可変抵抗
回路網と、該各抵抗回路網の前記周波数特性回路の入力
端に出力端が接続され定電圧源と見なせる信号源と、前
記可変抵抗回路網の第１および第２の出力端のうちの一
方が接続され該可変抵抗回路網の出力インピーダンスよ
り小さに入力インピーダンスを有スる非反転入力端子と
該第１および第２の出力端のうちの他方が接続され、該
可変抵抗回路網の出力インピーダンスより小さい入力イ
ンピーダンスを有する反転入力端子とを有し該非反転入
力端子および該反転入力端子にそれぞれ流入する電流の
差に比例した電流を等花器出力として出力する加算回路
と、前記非反転入力端子または前記反転入力端子に一端
が接続され前記信号源の出力端に他端が接続された減衰
器とから構成したことを特徴とする可変等化器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2172877U JPS6022660Y2 (ja) | 1977-02-23 | 1977-02-23 | 可変等化器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2172877U JPS6022660Y2 (ja) | 1977-02-23 | 1977-02-23 | 可変等化器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS53116239U JPS53116239U (ja) | 1978-09-16 |
| JPS6022660Y2 true JPS6022660Y2 (ja) | 1985-07-05 |
Family
ID=28855155
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2172877U Expired JPS6022660Y2 (ja) | 1977-02-23 | 1977-02-23 | 可変等化器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6022660Y2 (ja) |
-
1977
- 1977-02-23 JP JP2172877U patent/JPS6022660Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS53116239U (ja) | 1978-09-16 |
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