JPS6226208B2 - - Google Patents

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JPS6226208B2
JPS6226208B2 JP12596079A JP12596079A JPS6226208B2 JP S6226208 B2 JPS6226208 B2 JP S6226208B2 JP 12596079 A JP12596079 A JP 12596079A JP 12596079 A JP12596079 A JP 12596079A JP S6226208 B2 JPS6226208 B2 JP S6226208B2
Authority
JP
Japan
Prior art keywords
circuit
resistor
terminal
input
balanced
Prior art date
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Expired
Application number
JP12596079A
Other languages
English (en)
Other versions
JPS5650610A (en
Inventor
Hitoshi Yoshizawa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Publication date
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Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04B—TRANSMISSION
    • H04B3/00—Line transmission systems
    • H04B3/02—Details
    • H04B3/04—Control of transmission; Equalising

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Filters And Equalizers (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)

Description

【発明の詳細な説明】 この発明は、電気通信装置の周波数特性を可変
するための可変等化器に関し、特に平衡形前置等
化器に使用される定抵抗入力形ステツプ可変等化
器に関する。
従来、構成が容易な平衡入出力を有する定抵抗
入力形等化器として、第１図に示す回路が知られ
ている。１，２は入力端子、３，４は出力端子、
R1，R2，R3，R4は抵抗器であり、R3とR4は同一
抵抗値を持つ。またZ1とZ2は同一特性を有する回
路網である。回路網Z1及びZ2の持つインピーダン
ス周波数特性に対して入力端子での不整合減衰量
を一定値以上に保つため、R2はR1に比べて充分
高く設定される。ここで第２図の如く端子５を６
に、端子５′を６′に接続することによつてR2と
並列に回路網Z3を接続して損失周波数特性を可変
しようとすると、入力インピーダンスが低下し、
入力端子での不整合減衰量特性が劣化するためこ
の形ではステツプ可変等化器を構成出来なかつ
た。従つてステツプ可変等化器を構成するには、
これまでは第１図のR1以外の素子をすべて別の
ものに切替えるようにしており、回路が複雑にな
るという欠点があつた。
本発明の目的はこのような欠点を解消して簡単
な回路で構成できる平衡形可変等化回路を提供す
ることにある。
本発明では損失周波数特性可変のための回路網
を出力端子間に接続する時に回路網Z1，Z2を切り
離すことにより入力不整合減衰量劣化の少ない定
抵抗入力形ステツプ可変等化器を実現している。
第３図において端子７を端子８に端子１０を端
子１１に接続すれば第１図と同一回路となり、こ
こで端子７を端子８から、端子１０を端子１１か
ら切り離し、端子８を端子９に、端子１１を端子
１２に接続することにより損失周波数特性を可変
している。ここでR2＞＞R1、R3＋R4＞＞R1とす
れば、回路網Z1，Z2を接続した時には回路網Z1及
びZ2のインピーダンスが低い場合でもR2の存在
により、また回路網Z4を接続した時には回路網Z4
のインピーダンスが低い場合でもR3とR4の存在
により、前置等化回路の入力不整合減衰量特性劣
化を抑えることができるため、定抵抗入力側前置
等化回路にステツプ形可変等化機能を持たせるこ
とができるようになつた。
【図面の簡単な説明】
第１図は従来の固定特性を持つ平衡形等化回路
を示す回路図、第２図は仮想的な平衡形可変等化
回路を示す回路図、第３図は本発明による平衡形
可変等化回路の実施列を示す回路図である。 R1，R2，R3，R4……抵抗器、Z1，Z2，Z3，Z4
……回路網、１，２……入力端子、３，４……出
力端子、５，６，７，８，９，１０，１１，１２
……切り換え端子。

Claims (1)

    【特許請求の範囲】
  1. １ 入力端子間及び出力端子間にそれぞれ第一の
    抵抗器及び第二の抵抗器を接続し、該入力端子の
    一方と該出力端子の一方との間及び該入力端子の
    他方と該出力端子の他方との間にそれぞれ特性の
    等しい第三の抵抗器及び第四の抵抗器を接続し、
    該第三および第四の抵抗器とそれぞれ並列に特性
    の等しい第一および第二の回路網を接続した平衡
    形等化回路において、該第一および第二の接続を
    切り離し、該出力端子間に第三の回路網を接続す
    ることにより損失周波数特性を可変するようにし
    たことを特徴とする平衡形可変等化回路。
JP12596079A 1979-09-29 1979-09-29 Balanced variable equalizing circuit Granted JPS5650610A (en)

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JP12596079A JPS5650610A (en) 1979-09-29 1979-09-29 Balanced variable equalizing circuit

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JPS5650610A JPS5650610A (en) 1981-05-07
JPS6226208B2 true JPS6226208B2 (ja) 1987-06-08

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6093878A (ja) * 1983-10-28 1985-05-25 Canon Inc 画像読取装置
JPS6223425A (ja) * 1985-07-20 1987-01-31 Kurabo Ind Ltd Ｎｈ↓３注入量制御装置

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JPS5650610A (en) 1981-05-07

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