JPS60226196A - プリント配線端子装置 - Google Patents

プリント配線端子装置

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JPS60226196A
JPS60226196A JP59083332A JP8333284A JPS60226196A JP S60226196 A JPS60226196 A JP S60226196A JP 59083332 A JP59083332 A JP 59083332A JP 8333284 A JP8333284 A JP 8333284A JP S60226196 A JPS60226196 A JP S60226196A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明はプリント配線端子装置に関し、特に放電表示装
置(プラズマディスプレイパネル)に用いて最適なもの
である。
背景技術とその問題点 文字や映像の表示手段の一つと、してXYマトリックス
型の放電表示パネルが知られている。X電極群(情報電
極)は例えばアノードで表示情報に対応した高電圧と低
電圧が与えられる。Y電1極群(走査電極)は例えばカ
ソードでmtra次で走査(負電圧パルスの印加)が行
われる。
このような放電表示パネルの7ノ一ド駆動回路は、例え
ば第1図のようなシリアルの表示データをパラレルデー
タに変換するシフトレジスタ10A、10B(ドライブ
段付き)を備えている。ところが表パネルの分解能を高
めるため−ご放電電極を高密度にすると、アノード本数
が増大した分だけシフトレジスタの段数が増え、シフト
レジスタの転送スピードが足らなくなる。
そこで第2図のように表示データを2ビツトパラレルに
変換してから並列的な二つのシフトレジスタ10A%1
0Bに供給することが考えられる。
この場合、各シフトレジスタ10A1 ’IOHのパラ
レル出力線を第2図のように交互に織り込んで表示パネ
ルのアノード電極の引出し部lこ接続しなければならな
い。回路とパネルとの電気接続は−般に駆動ICをマウ
ントしたフレキシブルプリント基板によって行われるか
ら、第2図のような構成では、フレキシブルプリント基
板を両面パターンとするに共にまたスルーホールを用い
てラインの織り込み部分を作らなければならない。従っ
て非常にコスト高となる上、信頼性が著しく低下するO また第1図のような構成においても、電極が超極細ピッ
チである場合には、第3図のようにフレキシブルプリン
ト基板の接続端子11のピッチpもそれに応じて製造限
界談で狭くされる。このため工010(!:端子11と
の間の導体ライン12を、第3図のように両側部におい
て大きく膨出させて引き回わさせなければならない。従
ってフレキシブルプリント基板のサイズは実際の放電パ
ネルの巾Wよりもかなり大きなものとなる。
更に、第4図に示すように、アノードドライバーとアノ
ード電極との間のライン12には放電負荷抵抗孔を挿入
する必髪があるので、抵抗取付部分のパターンピッチを
広げなければならない。従つて放電パネルと同一サイズ
のフレキシブルプリント基板にアノード駆動回路をおさ
めることが困雌となる。
発明の目的 本発明は上述の問題を解消するためになさねたものであ
って、印刷配線端子の構造を工夫して、超極細ピッチの
電極端子に容易に信頼性高く結合することができるよう
にし、また配線の引目回し面積を低減して高密度実装が
図れるようにすることを目的とする。
発明の概要 本発明は、微細ピッチの列状端子と回路部分からの導出
ラインとを結合する端子装置であって、上記列状端子に
対応する列状端子パターンと、この列状端子パターンの
両側方向に端子交互に振分けて導出された配線パターン
とを有するフレキシブルプリント基板を具備している。
そして上記列状端子と列状端子パターンとを重ね合わせ
て電気接続すると共に、上記配線パターンの先に二群に
分けた上記回路部分を結合するように成されている。こ
の構成により、コスト低減、高信頼性、高実装密度が図
れる。
実施例 以下本発明を実施例に基いて説明する。
第5図は本発明の印刷配線端子装置が適用される放電表
示装置(プラズマ・ディスプレイ・パネルFDP )の
略平面図で、第6図は部分断面図である。この放電パネ
ルは前面ガラス1、背面ガラス2及びこれらに挾まれ微
小放電空間を隔てたXYマトリックス形状のアノード電
極3(情報重接)、カソード電極4(走査電極)から成
っている。カソード電極4の下には、絶縁層5を介して
複数相(8相)に分離されたトリガー電極6がカソード
電極4に沿って(平行に)配設されている。
アノード電極3は一本置きに上側及び下側のアノード駆
動回路7A、7Bに結合され、表示データ入力(シリア
ル)に基いて駆動回路7A17Bのシフトレジスタ(パ
ラレル出力)及びスイッチング出力素子を介して表示情
報電圧がカソードの走査に同期して与えられる。
カソード電極4にはカソード走査回路8によって上から
下に線順次で負電圧が与えられ、選択されたカソード電
極4と高圧が印加されたアノード電極3きの間で放電発
光が生じる。
トリガー電極6はトリガー回路9によって相順状で駆動
され、選択された相のトリカー電極6にはカソード走査
タイミングと合わせて高圧のパルス状トリガー宵圧が与
えられる。するとトリガー電極6と対向するカソード電
極4との間で種火放雷(誘引放電)が生じ、この放雷、
による空間イオンによりカソード−アノード間の放電開
始電圧が引を下げられ、アノード−カソード間の主放電
が誘引される。
胎7図は本発明の実施例における第5図のアノード駆動
回路7A、 γBの概要を示す回路図で、点線が表示パ
ネル20の外形を示している。表示パネル20の上端及
び下端にはアノード電極3の導出端子部21A121B
が設けられている。駆動回路7Aは導出端子部21Aの
両側に駆動回路71.72として分離され、2ピツトパ
ラレルの表示データ1及び2が対応する回路に供給され
る。
才た駆動回路7Bも同様に導出端子21Bの両側に駆動
回路73.74として分離され、2ビツトパラレルの表
示データ3.4が供給される。従ってこの場合には4ビ
ツトパラレルの表示データが供給される。
各駆動回路71.72(又は73.74)はシフトレジ
スタとそのパラレル出力によって駆動されるドライブト
ランジスタから成り、数個のICでもって構成されてい
る。そして各駆動回路71.72(又は73.74)の
各信号出力ライン710.720(又は730.740
)は1本ずつ交互に導出端子部21A(21B)に結合
される。従ってこれらの信号出力ライン710.720
.730.740のパターンピッチは、パネル20の導
出端子部21A121Bのピッチの2倍となる。
第8図は第7図の上側の駆動回路7Aの実装態様を示す
斜視図で、駆動回路71.72を構成するIC及び信号
出力ライン710.720はフレキシブルプリント基板
22の一方の面に設けられている。回路71.72の中
間部には、第9図の部分詳細図に示すような端子パター
ン23が、第7図のパネル20側の導出端子部21A、
21Bの端子と同じピッチで形成され、各端子パターン
23に回路71.72からの信号出力ライン710.7
20が交互に結合されている。
更に、各ライン710.720の途中には、第10図の
部分詳細図に示すように、放電負荷抵抗用のランドパタ
ーン24が形成され、ここに第8図に示すようにチップ
抵抗25が取付けられている。なお抵抗25は印刷抵抗
でもよい。信号出力5イ”/710.720のパターン
ピッチが端子パターン23の2倍であるから、パターン
ピッチを広げるこさなく抵抗25の取付スペース又は印
刷スペースを確保することができる0 第11図は表示パネル20へのフレキシブルプリント基
板22の取付は状態を示す斜視図で、第8図のプリント
基板22は裏返されて、その端子パターン23かパネル
20の導出端子部21A121Bの各端子と一致した状
態で結合される0結合方法は、第12図の部分断面で示
すように弾性スペーサ27と圧着バネ部材26とを用い
た圧接結合であってよい0 或いは、第13図のようなマイクロソルダリングツール
28を用いた半田ペースト結合方法を用いることもでき
る。
以上のように本発明を用いれば、駆動回路(IC)から
の信号出力ライン710〜740のパターンピッチが従
来の2倍となるから、信頼性や歩留が著しく向上する。
また第14図の回路71のIC部分の詳細図に示すよう
に出力ラインを1つ置きに交互に織り込まなくてよいか
ら、出力ラインを大きく引き回わさずに直線的に端子パ
ターン23に導出することができる。従って非常にコン
パクトな高密度実装が可能となり、フレキシブルプリン
ト基板22の巾サイズも表示パネル20の巾以内に納め
ることができる。
なおフレキシブルプリント基板22を表示パネル20の
端子部分に結合した後は、第12図に示オ士ろ1ここり
1番析杓たたすtこμがで去る力1ら、駆動回路の実装
配置スペースは非常に小さくなる。
この場合、第12図の回路71.72を構成しているI
Cの取付は位置をずらして回路71.72が上下に重な
らないようにして、より偏平な構造にすることが可能と
なる。また第12図において、回路71のICをフレキ
シブルプリント基板22のパターン面の裏面に取付けて
、回路γ1、T2が同じ向きになるようにしてもよい。
第15図は変形例を示す部分平面図であって、この例で
は駆動回路71.72等のICを通常のガラスエポキシ
等のプリント基板に取付け、端子パターン23及びその
リード導体23Hの一部のみをフレキシブルプリント基
板22に形成している。プリント基板29.30との結
合は半田付は等によるが、パターンピッチが犬であるの
で、その作業性及び信頼性は良好である。表示パネル2
0への増付けは第11図と同様であって、取付表示パネ
ル20の層側で重ね合わされる。
発明の効果 本発明は上述の如く、結合すべき列状端子に対応する列
状端子パターンをフレキシブルプリント基板に形成し、
このパターンに連らなる配線パターンを列の両側に端子
交互に振分けて導出するようにしたので、配線パターン
のピッチが列状端子ピッチの2倍となる。従って超極細
ピッチの電極端子に容易に信頼性高く回路部分を結合す
ることができる。また回路部との結合部における配線パ
ターンの引き回しが楽になり、よりコンパクトに実装で
きる。更にフレキシブルプリント基板を低コストにし歩
留の向上も図れる。また必要があれば配線パターン中に
抵抗等の部品を取付けることも可能である。
【図面の簡単な説明】
第1図及び第2図は本発明のプリント配線端子装置が適
用される放電表示パネルの7ノ一ド駆動回路の回路図、
第3図及び第4図は従来の接続パターンの構造を示す部
分平面図、第5図は本発明が適用される放電表示パネル
の概要を示す略平面図、第6図は第5図の部分断面図、
第1図は本発明のプリント配線端子装置の実施例の回路
構造を示す第5図のアノード駆動回路の回路図、第8図
は本発明の実施例のプリント配線端子装置を示す斜視図
、第9図及び第10図は第8図の配線パターンの詳細を
示す部分平面図、第11図は第8図のフレキシブルプリ
ント基板の実装状態を示す斜視図、第12図及び第13
図は電極端子の結合方法を示す部分断面図、第14図は
框8図の回路部分の詳細を示す部分平面図、第15図は
実施例のプリント配線端子装置の変形例を示す部分平面
図である。 なお図面に用いられた符号において、 3・・・・・・・・・・・・・・・アノード電極4・・
・・・・・・・・・・・・・カソード電極6・・・・・
・・・・・・・・・・トリガ゛−tr極7A、7B・・
・・・・・・・アノード駆動回路8・・・・・・・・・
・・・・・・カソード走査回路9・・・・・・・・・・
・・・・・ トリガー回路20・・・・・・・・・・・
・表示パネル 。 21A、21B・・・導出端子部 22・・・・・・・・・・・・フレキシブルプリント基
板23・・・・・・・・・・・・端子パターン710.
720,730,740 ・・・・・・・・・・・・・・・信号出力ライン71〜
74・・・・・・駆動回路 である。 代理人 上屋 勝 〃 常 包 芳 男 第1−図 第2図

Claims (1)

    【特許請求の範囲】
  1. 微細ピッチの列状端子と回路部分からの導出ラインとを
    結合する端子装置であって、上記列状端子に対応する列
    状端子パターンと、この列状端子パターンの両側方向に
    端子交互に振分けて導出された配線パターンとを有する
    フレキシブルプリント基板を具備し、上記列状端子り列
    状端子パターンとを重ね合わせて電気接続すると共に、
    上記配線パターンの先に二群に分けた上記回路部分を結
    合するように構成したプリント配線端子装置。
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