JPS60182870A - 画像処理装置 - Google Patents
画像処理装置Info
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- JPS60182870A JPS60182870A JP59037342A JP3734284A JPS60182870A JP S60182870 A JPS60182870 A JP S60182870A JP 59037342 A JP59037342 A JP 59037342A JP 3734284 A JP3734284 A JP 3734284A JP S60182870 A JPS60182870 A JP S60182870A
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- JP
- Japan
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- signal line
- comparator
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Links
- 238000007599 discharging Methods 0.000 claims description 4
- 239000003990 capacitor Substances 0.000 abstract description 8
- 238000006243 chemical reaction Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 238000003705 background correction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 238000013500 data storage Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/403—Discrimination between the two tones in the picture signal of a two-tone original
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Facsimile Image Signal Circuits (AREA)
- Facsimile Scanning Arrangements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[技術分野]
本発明は画像処理装置に係り、さらに詳細には基準部材
を走査して得たシェーディング歪データに基づきシェー
ディング歪補正を行なう画像処理装置に関する。
を走査して得たシェーディング歪データに基づきシェー
ディング歪補正を行なう画像処理装置に関する。
[従来技術]
従来、ファクシミリ装置や複写機などの様々な画像処理
を行なう装置が知られているが、これらの多くは原稿を
光源により照明してその反射光を用いて読み取りを行な
っている。蛍光灯などの光源はその全長に渡って均一な
光量を得るのが困難であるので、通常この種の装置では
読み取った画信号をシェーディング歪補正する機構が設
けられる。
を行なう装置が知られているが、これらの多くは原稿を
光源により照明してその反射光を用いて読み取りを行な
っている。蛍光灯などの光源はその全長に渡って均一な
光量を得るのが困難であるので、通常この種の装置では
読み取った画信号をシェーディング歪補正する機構が設
けられる。
第1図に従来のシェーディング歪補正を行なう画像処理
装置の構造を示す。
装置の構造を示す。
第1図において符号lで示されているものは光電変換素
子としてのCCDセンサで、原稿の反射光はレンズ、プ
リズムなどの光学系を介してCCDセンサl上に結像さ
−れる。
子としてのCCDセンサで、原稿の反射光はレンズ、プ
リズムなどの光学系を介してCCDセンサl上に結像さ
−れる。
CCDセンサ1からの画像データ読み出しタイミングは
読取制御部7により制御される。CCDセンサ1の出力
は増幅器3により所定レベルまで増幅され、続いてコン
パレータ11により2値化されて出力される。この際、
コンパレータ11の基準電圧を変化させることによりシ
ェーディング歪補正が行なわれる。
読取制御部7により制御される。CCDセンサ1の出力
は増幅器3により所定レベルまで増幅され、続いてコン
パレータ11により2値化されて出力される。この際、
コンパレータ11の基準電圧を変化させることによりシ
ェーディング歪補正が行なわれる。
コンパレータ11の基準電圧は、ランダムアクセスメモ
リなどから構成されたメモリ9に格納されているシェー
ディング歪データに基づいて決定される。すなわち、読
取制御部7がCCDセンサ1からのデータ出刃と、メモ
リ9に格納されているシェーディング歪データの読み出
しを連動させ、CCDセンサ1の読み取り位置に対応し
てA/D 、D/A変換器5を介してコンパレータ11
の2 (ifj化基準基準電圧化させ、光源の光量分布
に対応してシェーディング歪補正が行なわれる。
リなどから構成されたメモリ9に格納されているシェー
ディング歪データに基づいて決定される。すなわち、読
取制御部7がCCDセンサ1からのデータ出刃と、メモ
リ9に格納されているシェーディング歪データの読み出
しを連動させ、CCDセンサ1の読み取り位置に対応し
てA/D 、D/A変換器5を介してコンパレータ11
の2 (ifj化基準基準電圧化させ、光源の光量分布
に対応してシェーディング歪補正が行なわれる。
シェーディング歪データの入力はCCDセンサ1により
標憎白色板などの基準部材を走査することにより行なわ
れる。基準部材を走査して得たCCDセンサ1の出力は
A/D 、D/A変換器5によりデジタル値に変換され
、読み取り位置に対応してメモリ9に格納される。
標憎白色板などの基準部材を走査することにより行なわ
れる。基準部材を走査して得たCCDセンサ1の出力は
A/D 、D/A変換器5によりデジタル値に変換され
、読み取り位置に対応してメモリ9に格納される。
読み取り速度を高速化したい場合、上記のような構成の
画像処理装置では、A/D 、 D/A変換器5の高速
化が要求される。一般に高速なA/D 、D/A変換器
は構造が複雑で、コストも高く、画像処理装置全体の価
格を上昇させる、という欠点があった。
画像処理装置では、A/D 、 D/A変換器5の高速
化が要求される。一般に高速なA/D 、D/A変換器
は構造が複雑で、コストも高く、画像処理装置全体の価
格を上昇させる、という欠点があった。
[目 的]
本発明は以上の点に鑑みてなされたもので、確実なシェ
ーディング歪補正を行なえ、また簡単安価で高速な画像
処理装置を提供することを目的とする。
ーディング歪補正を行なえ、また簡単安価で高速な画像
処理装置を提供することを目的とする。
[実施例]
以下、図面に示す実施例に基づいて本発明の詳細な説明
する。ただし、以下では第1図の従来例と同一ないし相
当する部材には同一符号を付し、その詳細な説明は省略
する。
する。ただし、以下では第1図の従来例と同一ないし相
当する部材には同一符号を付し、その詳細な説明は省略
する。
第2図に示すように、本発明ではCCDセンサ1の出力
は増幅器3で増幅された後、コンパレータ11の外、ピ
ークホールド回路23およびコンパレータ41の十入力
端子に入力される。ピークホールド回路23の出力信号
線23aはアナログスイッチ35の接点の1つに接続さ
れる。このアナログスイッチ35の他方の接点は接地さ
れており、さらにそのコモン接点には゛抵抗37および
コンデンサ39から成る充放電回路が接続されている。
は増幅器3で増幅された後、コンパレータ11の外、ピ
ークホールド回路23およびコンパレータ41の十入力
端子に入力される。ピークホールド回路23の出力信号
線23aはアナログスイッチ35の接点の1つに接続さ
れる。このアナログスイッチ35の他方の接点は接地さ
れており、さらにそのコモン接点には゛抵抗37および
コンデンサ39から成る充放電回路が接続されている。
この充放電回路の出力はコンパレータ41の一入力端子
に接続されるとともに抵抗43.45により分圧されて
コンパレータ11の2値化基準電圧とされる。
に接続されるとともに抵抗43.45により分圧されて
コンパレータ11の2値化基準電圧とされる。
一方、コンパレータ41の出力信号線41aはアンドゲ
ート29.31およびオアゲート27から構成されたゲ
ート回路に接続されている。すなわち、アンドゲート2
9の一方の入力端子にコンパレータ41の出力が接続さ
れており、アントゲ−1・31の一方の入力端子にはメ
モリ9の出力データが入力されている。アンドゲート2
9.31は読取制御部7の信号線7bによりゲートされ
るようになっている。このとき、アンドゲート31のゲ
ート入力は反転されているので、アンドゲート29.3
1は一方が開いているときには他方が閉じるようになっ
ている。アンドゲート29.31の出力はオアゲート2
7に入力され、その論理和がDフリップフロップ25の
データ入力とされている。
ート29.31およびオアゲート27から構成されたゲ
ート回路に接続されている。すなわち、アンドゲート2
9の一方の入力端子にコンパレータ41の出力が接続さ
れており、アントゲ−1・31の一方の入力端子にはメ
モリ9の出力データが入力されている。アンドゲート2
9.31は読取制御部7の信号線7bによりゲートされ
るようになっている。このとき、アンドゲート31のゲ
ート入力は反転されているので、アンドゲート29.3
1は一方が開いているときには他方が閉じるようになっ
ている。アンドゲート29.31の出力はオアゲート2
7に入力され、その論理和がDフリップフロップ25の
データ入力とされている。
Dフリップフロップ25は信号線7aを介して読取制御
部7によりCCDセンサ1の1ビ・ントの読み出しごと
にクロックされる。Dフリップフロップ25の出力信号
線25aはメモリ9の入力端子およびアナログスイッチ
35の制御端子に接続されている。ここでは信号線25
aハイレベルの際にアナログスイ・ンチ35がト側の信
号線23aに接続されるものとする。メモリ9のり−ド
/ライ)・のタイミング制御は読取制御部7により信号
線7cを介して行なわれる。
部7によりCCDセンサ1の1ビ・ントの読み出しごと
にクロックされる。Dフリップフロップ25の出力信号
線25aはメモリ9の入力端子およびアナログスイッチ
35の制御端子に接続されている。ここでは信号線25
aハイレベルの際にアナログスイ・ンチ35がト側の信
号線23aに接続されるものとする。メモリ9のり−ド
/ライ)・のタイミング制御は読取制御部7により信号
線7cを介して行なわれる。
次に以上の構成における動作を第3図のタイミングチャ
ート図を参照して詳細に説明する。第3図は第2図中の
各信号線7a、41a、各接続点3a、25a、41b
およびメモリ9のメモリアドレスの変化を示している。
ート図を参照して詳細に説明する。第3図は第2図中の
各信号線7a、41a、各接続点3a、25a、41b
およびメモリ9のメモリアドレスの変化を示している。
シェーディング歪データ読み取りの際、第3図の最下段
に示すピークホールド回路23を介してコンデンサ39
に充電された電圧、すなわち接続点41bの電圧と、信
号113aの増幅器3の出力はコンパレータ41により
比較され、その結果コンパレータ41の出力信号線41
aの波形は第3図3段目に示されるように、増幅器3の
出力の方が高い場合にハイレベルになる。
に示すピークホールド回路23を介してコンデンサ39
に充電された電圧、すなわち接続点41bの電圧と、信
号113aの増幅器3の出力はコンパレータ41により
比較され、その結果コンパレータ41の出力信号線41
aの波形は第3図3段目に示されるように、増幅器3の
出力の方が高い場合にハイレベルになる。
このとき、信号線7bはハイレベルにされており、信号
線41aのデータは信号線7aの読み取りクロックに同
期してDフリップフロップ25にラッチされる。この結
果、信号線25aの波形は第3図4段目に示される波形
となる。
線41aのデータは信号線7aの読み取りクロックに同
期してDフリップフロップ25にラッチされる。この結
果、信号線25aの波形は第3図4段目に示される波形
となる。
信号線3aの電圧が接続点41bよりも高い場合には信
号線25aはクロックに同期してハイレベルになり、こ
れによりアナログスイッチ35が信号線23a側に接続
される。したがってピークホールド回路23により保持
された増幅器3の出力ピーク値によりコンデンサ39が
抵抗37を介して充電され、この結果接続点41bの電
圧が上昇する。
号線25aはクロックに同期してハイレベルになり、こ
れによりアナログスイッチ35が信号線23a側に接続
される。したがってピークホールド回路23により保持
された増幅器3の出力ピーク値によりコンデンサ39が
抵抗37を介して充電され、この結果接続点41bの電
圧が上昇する。
一方、信号線3aの電圧が接続点41bよりも低い場合
には上記と逆の動作によりアナログスイッチ35が接地
側に切り換えられるので、コンデンサ39が抵抗37を
介して放電され、接続点41bの電圧が下げられる。
には上記と逆の動作によりアナログスイッチ35が接地
側に切り換えられるので、コンデンサ39が抵抗37を
介して放電され、接続点41bの電圧が下げられる。
以上のような動作により、第3図最下段に示すように接
続点41bにCCDセンサ1の出力に対応した波形が現
われる。以上の動作の際、接続点25aのデータは、信
号線7aの読み取りクロックに同期してアドレスを変え
ながらメモリ9に保存しておく。
続点41bにCCDセンサ1の出力に対応した波形が現
われる。以上の動作の際、接続点25aのデータは、信
号線7aの読み取りクロックに同期してアドレスを変え
ながらメモリ9に保存しておく。
一方、画像処理の際には読取制御部7が信号線7bをロ
ーレベルにし、Dフリップフロップ25に−イモリ9の
出力信号が入力されるようにする。
ーレベルにし、Dフリップフロップ25に−イモリ9の
出力信号が入力されるようにする。
その結果アナログスイッチ35がシェーディング歪デー
タ読み取りの際と同様のパターンで切り換えられる。こ
のとき、ピークホールド回路23の出力(23a)は原
稿の白(背景)部分の濃度に応じて変化するので、この
白部分の領域では接続点41bの電圧は基準部材の走査
の際とほぼ同様に変化する。すなわち、接続点41bに
は第3図最下段とほぼ相似の電圧波形が再生される。
タ読み取りの際と同様のパターンで切り換えられる。こ
のとき、ピークホールド回路23の出力(23a)は原
稿の白(背景)部分の濃度に応じて変化するので、この
白部分の領域では接続点41bの電圧は基準部材の走査
の際とほぼ同様に変化する。すなわち、接続点41bに
は第3図最下段とほぼ相似の電圧波形が再生される。
接続点41bに第3図最下段の波形が再生される。
したがって、このシェーディング歪データに応じた接続
点41bの電圧変化が分圧用の抵抗43.45を介して
コンパレータ11に与えられ、しきい値レベルが変化さ
せられシェーディング歪に応じた画像データ補正が行な
われる。
点41bの電圧変化が分圧用の抵抗43.45を介して
コンパレータ11に与えられ、しきい値レベルが変化さ
せられシェーディング歪に応じた画像データ補正が行な
われる。
以上のような充放電回路を用いた構成は従来のD/Aな
いしA/D変換器による構成より比較的簡単に高速化で
きるので従来より安価かつ高速にシェーディング補正処
理を行なうことが可能になる。したがって、従来と同等
の製造コストによりより高速なシェーディング歪補正処
理を含む画像処理を行なうことができる。
いしA/D変換器による構成より比較的簡単に高速化で
きるので従来より安価かつ高速にシェーディング補正処
理を行なうことが可能になる。したがって、従来と同等
の製造コストによりより高速なシェーディング歪補正処
理を含む画像処理を行なうことができる。
また、従来のA/D、D/A変換による構成ではCOD
の画素1ビツトにつき、数ビット(多くの場合8ビツト
)を割り当てて濃度レベルを表現し、これをメモリに保
存していたが、本実施例によれば上記のようにCODの
画素1ビツトあたり1ビツトのメモリを確保すればよい
ので、必要なメモリを容量を従来の数分の1に低減でき
る、という効果がある。また、メモリアクセスの時間を
大幅に短縮できるので、高速なメモリ素子を用いる必要
もなくなる、という利点がある。ただし。
の画素1ビツトにつき、数ビット(多くの場合8ビツト
)を割り当てて濃度レベルを表現し、これをメモリに保
存していたが、本実施例によれば上記のようにCODの
画素1ビツトあたり1ビツトのメモリを確保すればよい
ので、必要なメモリを容量を従来の数分の1に低減でき
る、という効果がある。また、メモリアクセスの時間を
大幅に短縮できるので、高速なメモリ素子を用いる必要
もなくなる、という利点がある。ただし。
COD画素1つにDフリップフロップ25複数のクロッ
クを対応させるようにし、より精密なシェーディング歪
波形の保存、再生を行なうようにしてもよい。このクロ
ックレートを上げ、より精密なシェーディング歪波形の
保存、再生を行なうようにしてもよい。
クを対応させるようにし、より精密なシェーディング歪
波形の保存、再生を行なうようにしてもよい。このクロ
ックレートを上げ、より精密なシェーディング歪波形の
保存、再生を行なうようにしてもよい。
[効 果]
以上の説明から明らかなように、本発明によれば、基準
部材を走査して得たシェーディング歪データに基づきシ
ェーディング歪補正を行なう画像処理装置において、前
記シェーディング歪データの記憶手段への保存および再
生を行なう充放電回路を設けた構成を採用しているため
、簡単な構成により安価に高速なシェーディング歪補正
処理を含む画像処理動作を行なえる優れた画像処理装置
を提供することができる。
部材を走査して得たシェーディング歪データに基づきシ
ェーディング歪補正を行なう画像処理装置において、前
記シェーディング歪データの記憶手段への保存および再
生を行なう充放電回路を設けた構成を採用しているため
、簡単な構成により安価に高速なシェーディング歪補正
処理を含む画像処理動作を行なえる優れた画像処理装置
を提供することができる。
第1図は従来の画像処理装置の構成を説明する点の信号
波形を示す波形図である。 l・・・CCDセンサ 7・・・読取制御部9・・・メ
モリ 11.41・・・コンパレータ 23・・・ピークホールド回路 25・・・Dフリップフロップ 27・・・オアゲート 29・・・アンドゲート35・
・・アナログスイッチ 37.43.35・・・抵抗 39・・・コンデンサ
波形を示す波形図である。 l・・・CCDセンサ 7・・・読取制御部9・・・メ
モリ 11.41・・・コンパレータ 23・・・ピークホールド回路 25・・・Dフリップフロップ 27・・・オアゲート 29・・・アンドゲート35・
・・アナログスイッチ 37.43.35・・・抵抗 39・・・コンデンサ
Claims (1)
- 基準部材を走査して得たシェーディング歪データに基づ
きシェーディング歪補正を行なう画像処理装置において
、前記シェーディング歪データの記憶手段への保存およ
び再生を行なう充放電回路を設けたことを特徴とする画
像処理装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59037342A JPS60182870A (ja) | 1984-03-01 | 1984-03-01 | 画像処理装置 |
US07/188,755 US4947445A (en) | 1984-03-01 | 1988-05-02 | Shading correction using variable slicing threshold |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59037342A JPS60182870A (ja) | 1984-03-01 | 1984-03-01 | 画像処理装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60182870A true JPS60182870A (ja) | 1985-09-18 |
JPH0560297B2 JPH0560297B2 (ja) | 1993-09-02 |
Family
ID=12494929
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59037342A Granted JPS60182870A (ja) | 1984-03-01 | 1984-03-01 | 画像処理装置 |
Country Status (2)
Country | Link |
---|---|
US (1) | US4947445A (ja) |
JP (1) | JPS60182870A (ja) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US5606160A (en) * | 1993-03-25 | 1997-02-25 | Asahi Kogaku Kogyo Kabushiki Kaisha | Symbol reading device |
JPH0787312A (ja) * | 1993-09-13 | 1995-03-31 | Canon Inc | 画像読取装置 |
KR100193795B1 (ko) * | 1995-07-21 | 1999-06-15 | 윤종용 | 쉐이딩 보정회로 및 방법 |
US5901243A (en) * | 1996-09-30 | 1999-05-04 | Hewlett-Packard Company | Dynamic exposure control in single-scan digital input devices |
US7391450B2 (en) * | 2002-08-16 | 2008-06-24 | Zoran Corporation | Techniques for modifying image field data |
US7408576B2 (en) * | 2002-08-16 | 2008-08-05 | Zoran Corporation | Techniques for modifying image field data as a function of radius across the image field |
US7388610B2 (en) * | 2002-08-16 | 2008-06-17 | Zoran Corporation | Techniques of modifying image field data by extrapolation |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JPS5317034A (en) * | 1976-07-30 | 1978-02-16 | Sharp Corp | Image sensor output correcting system |
US4174528A (en) * | 1978-06-30 | 1979-11-13 | International Business Machines Corporation | Exposure control for document scanner arrays |
US4420742A (en) * | 1980-05-09 | 1983-12-13 | Hitachi, Ltd. | Scan signal processing system |
US4589034A (en) * | 1980-12-05 | 1986-05-13 | Canon Kabushiki Kaisha | Image processing apparatus |
US4408231A (en) * | 1981-07-31 | 1983-10-04 | International Business Machines Corporation | Method and apparatus for calibrating a linear array scanning system |
US4524388A (en) * | 1981-08-11 | 1985-06-18 | Konishiroku Photo Industry Co., Ltd. | Shading correction device |
US4454539A (en) * | 1982-01-26 | 1984-06-12 | Sperry Corporation | Automatic level control circuitry |
JPS58177071A (ja) * | 1982-04-09 | 1983-10-17 | Fuji Xerox Co Ltd | シエ−デイング補正装置 |
JPS5927675A (ja) * | 1982-08-04 | 1984-02-14 | Toshiba Corp | シエ−デイング補正方式 |
US4691239A (en) * | 1982-12-23 | 1987-09-01 | Nelson Martin N | Dynamic video system and method |
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-
1984
- 1984-03-01 JP JP59037342A patent/JPS60182870A/ja active Granted
-
1988
- 1988-05-02 US US07/188,755 patent/US4947445A/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH0560297B2 (ja) | 1993-09-02 |
US4947445A (en) | 1990-08-07 |
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