JPS60178557A - 入出力制御装置 - Google Patents
入出力制御装置Info
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- JPS60178557A JPS60178557A JP3230784A JP3230784A JPS60178557A JP S60178557 A JPS60178557 A JP S60178557A JP 3230784 A JP3230784 A JP 3230784A JP 3230784 A JP3230784 A JP 3230784A JP S60178557 A JPS60178557 A JP S60178557A
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- JP
- Japan
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- interface
- input
- connector
- circuit
- external
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/10—Program control for peripheral devices
- G06F13/12—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
- G06F13/122—Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4063—Device-to-bus coupling
- G06F13/4068—Electrical coupling
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- General Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は入出力制御装置に係り、特に複数のインタフェ
ース仕様のためのバフフッ１ｇ回路を恰載し、接続する
外部装置のインタフェース仕様に応じて１つのバッファ
回路を選択、動作させる入出力制御装置に関する。
ース仕様のためのバフフッ１ｇ回路を恰載し、接続する
外部装置のインタフェース仕様に応じて１つのバッファ
回路を選択、動作させる入出力制御装置に関する。
近年、入出力制御装置等の電子装置における論理回路実
装用のツーリント基板は大形化してきており、また、論
理回路のＬＳＩ化も進められつつある。例えは、入出力
制御装置について１えは、そ石か複数の相異なるインタ
フェース仕様に対応するバッファ回路と、共通な制御部
で構成されているような場合、すべてのバッファ回路と
共通な制御部を１つのツーリント基板（以下単に基板と
いう）に実装するようになりつつある。これは、各バッ
ファＮ路と共通な制御部を相異ち゛る基板イこ分割して
実装し、組み合わせて使用すると、基板の大形化ができ
なくなり、かえって経済的でなくなることなどの理由か
ある。
装用のツーリント基板は大形化してきており、また、論
理回路のＬＳＩ化も進められつつある。例えは、入出力
制御装置について１えは、そ石か複数の相異なるインタ
フェース仕様に対応するバッファ回路と、共通な制御部
で構成されているような場合、すべてのバッファ回路と
共通な制御部を１つのツーリント基板（以下単に基板と
いう）に実装するようになりつつある。これは、各バッ
ファＮ路と共通な制御部を相異ち゛る基板イこ分割して
実装し、組み合わせて使用すると、基板の大形化ができ
なくなり、かえって経済的でなくなることなどの理由か
ある。
上記のような例として、Ｃ，Ｃ，１，Ｔ、Ｔ Ｖ、 ２
４およびＸ、２１の２つのインタフェース用のバッファ
回路を持つ通信制御装置がある。
４およびＸ、２１の２つのインタフェース用のバッファ
回路を持つ通信制御装置がある。
以上、説明したような入出力制御装置においては、使用
するバッファ回路の切り換え、選択を行なう必要がある
。
するバッファ回路の切り換え、選択を行なう必要がある
。
従来の入出力制御装置においては、バッファ（ロ）路の
選択を、スイッチ等を用いて行っている。第１図、第２
図に、従来の入出力制御装置の一例を示す。ここで、第
１図と第２図の引用符号は、説明を分り易くするために
同一のものを用いる。
選択を、スイッチ等を用いて行っている。第１図、第２
図に、従来の入出力制御装置の一例を示す。ここで、第
１図と第２図の引用符号は、説明を分り易くするために
同一のものを用いる。
第１図および第２図において、１は入出力制御装置、２
および３はインタフェース・クーフル・コネクタ、４お
よび５は外部装置である。さらに入出力制御装置ｉｋｌ
は、第１図と第２図に示すような構成になっている。す
なわち、６は共通制御部、７および８はバッファ回路、
９および１０は外部接続用コネクタ、１１および１２は
スイッチである。第１図、第２図は異なるインタフェー
ス仕様を持つ外部装置ＩＬ４または５を、入出力制御装
置１に接続する例を示している。第１図においては、バ
ッフ７回路７を選択し、外部接続用コネクタ９にインタ
フェース・クーフル・コネクタ２を接続し、外部装置４
を制御するために、スイッチ１１か接続され、スイッチ
１２が切断される。一方、第２図においては、バッファ
回路８を選択し、外部接続用コネクタ１０にインクフェ
ース・ケーフルφコネクタ３を接続し、外部装ｆＭＪ−
５を制御１−るために、スイッチ１１が切断され、スイ
ッチ１２か接続される。このように、インタフェース仕
様の相異なる外部装置１［４または５？！−インタフゴ
ース・クーフル２または３および外部接続用コネクタ９
または１０を介して入出力制御装置１に接続する場合、
バッフ１回路７または８４ｒ選択］−るたｙ）に、スイ
ッチ１１７たは１２を切断あるいは接続する作業を必要
とする。
および３はインタフェース・クーフル・コネクタ、４お
よび５は外部装置である。さらに入出力制御装置ｉｋｌ
は、第１図と第２図に示すような構成になっている。す
なわち、６は共通制御部、７および８はバッファ回路、
９および１０は外部接続用コネクタ、１１および１２は
スイッチである。第１図、第２図は異なるインタフェー
ス仕様を持つ外部装置ＩＬ４または５を、入出力制御装
置１に接続する例を示している。第１図においては、バ
ッフ７回路７を選択し、外部接続用コネクタ９にインタ
フェース・クーフル・コネクタ２を接続し、外部装置４
を制御するために、スイッチ１１か接続され、スイッチ
１２が切断される。一方、第２図においては、バッファ
回路８を選択し、外部接続用コネクタ１０にインクフェ
ース・ケーフルφコネクタ３を接続し、外部装ｆＭＪ−
５を制御１−るために、スイッチ１１が切断され、スイ
ッチ１２か接続される。このように、インタフェース仕
様の相異なる外部装置１［４または５？！−インタフゴ
ース・クーフル２または３および外部接続用コネクタ９
または１０を介して入出力制御装置１に接続する場合、
バッフ１回路７または８４ｒ選択］−るたｙ）に、スイ
ッチ１１７たは１２を切断あるいは接続する作業を必要
とする。
このような作業は、いわゆるオプション設足作業である
か、オフーシ薗ン設定作業かあると、たとえば、第１図
において、瞑ってスィッチ１１ケ切断シパンフア回路７
を選択できなくなるというよっな誤り作業か発生し易い
という欠点かある。
か、オフーシ薗ン設定作業かあると、たとえば、第１図
において、瞑ってスィッチ１１ケ切断シパンフア回路７
を選択できなくなるというよっな誤り作業か発生し易い
という欠点かある。
第１図において、誤って外部接続用コネクタ１゜にイン
タフェース・ケーブルｅコネクタ２を接続するというよ
うな誤り作業も考えられるか、このような誤り対策とし
ては、外部接続用コネクタ９および１０の形状を変える
１等の対策か一般に用いられているものの、バッファ回
路の選択においてはｈり作業の防止を、人手による確認
で行なっでおり、誤る率が高く、作業工数かかかるとい
う欠点がある。
タフェース・ケーブルｅコネクタ２を接続するというよ
うな誤り作業も考えられるか、このような誤り対策とし
ては、外部接続用コネクタ９および１０の形状を変える
１等の対策か一般に用いられているものの、バッファ回
路の選択においてはｈり作業の防止を、人手による確認
で行なっでおり、誤る率が高く、作業工数かかかるとい
う欠点がある。
本発明の目的は、誤り作業か発生しに＜＜、人手による
確認作業の不要な、バッファ回路の選択手段を持った入
出力制御装置を提供することにある。
確認作業の不要な、バッファ回路の選択手段を持った入
出力制御装置を提供することにある。
本発明による入出力制御装置は、外部装置からインタフ
ェース・クーフル・コネクタを経由、あるいはインタフ
ェース・ケーブル・コネクタそのものから供給されるイ
ンタフェース仕様を規定する′電気信号を、インタフェ
ース・クーフル・コネクタを接続するための外部接続用
コネクタから取り込み、その電気信号によって、バッフ
ァｌ′Ｉｌｌ！１路の選択を行なわせ、スイッチ等の切
り換え無しに、バッファ回路の選択が自動的に行なわれ
るようにするところに％黴かある。具体例においては、
上記、インタフェース仕様を規矩する電気イム号は、外
部装置゛において作成されインタフェース・クーフル・
コネクタを介して該入出力制御１装置、にルリ込まれて
も艮いし、外部装置に無関係に、インタフェース・ケー
フル拳コネクタで作成され、し入出力制御装置に取り違
法れでも良い。
ェース・クーフル・コネクタを経由、あるいはインタフ
ェース・ケーブル・コネクタそのものから供給されるイ
ンタフェース仕様を規定する′電気信号を、インタフェ
ース・クーフル・コネクタを接続するための外部接続用
コネクタから取り込み、その電気信号によって、バッフ
ァｌ′Ｉｌｌ！１路の選択を行なわせ、スイッチ等の切
り換え無しに、バッファ回路の選択が自動的に行なわれ
るようにするところに％黴かある。具体例においては、
上記、インタフェース仕様を規矩する電気イム号は、外
部装置゛において作成されインタフェース・クーフル・
コネクタを介して該入出力制御１装置、にルリ込まれて
も艮いし、外部装置に無関係に、インタフェース・ケー
フル拳コネクタで作成され、し入出力制御装置に取り違
法れでも良い。
以下、本発明の一丈施例についで、１喧１を用いて゛舒
Ｉ！頃」１−る。
Ｉ！頃」１−る。
第３図および第４図は、本発明の一実施例による入出力
制御装置と、外部装置の接続と人山力制御装置内部のフ
ロック図を示′？ｌ−０第３図は前述した第１図の例を
改良したものでｉ）す、泥４図は前述した紀２図の例を
改良したものであるうまた、第３図と第４図は、１つの
入出力匍」御１１こインタフェース仕４Ｊ）のＸ Ｙ、
Ｌる２つの夕り部装旭のうち、１つを各々接続したもの
であり、第３図と第４図に示す入出力制御装置は同一の
ものを表わしている。ここで、説明を簡易にするため、
第３図および第４区１の引用符号は、第１図および第２
し１と対応させた符号で座す。すなわち、同一引用符ｇ
を用いることがある。
制御装置と、外部装置の接続と人山力制御装置内部のフ
ロック図を示′？ｌ−０第３図は前述した第１図の例を
改良したものでｉ）す、泥４図は前述した紀２図の例を
改良したものであるうまた、第３図と第４図は、１つの
入出力匍」御１１こインタフェース仕４Ｊ）のＸ Ｙ、
Ｌる２つの夕り部装旭のうち、１つを各々接続したもの
であり、第３図と第４図に示す入出力制御装置は同一の
ものを表わしている。ここで、説明を簡易にするため、
第３図および第４区１の引用符号は、第１図および第２
し１と対応させた符号で座す。すなわち、同一引用符ｇ
を用いることがある。
叱３図および第４１￥ｉに４５いて、１は入出力筒ｊ御
装脇、２および３番ゴインタフェース・ケーブル・コネ
クタ、４および５は外部装動、６は共通Ｉ制御部、７お
よび８はバッファ回路、９および１０は外部接続用コネ
クタである。ここて、ノ＼°ンファ１９回路７目、夕）
部装置４とインタフェース・ケーブル・コネクタ２のイ
ンタフェース仕様に合致しておりバッファ回路８は、外
部装置５とインタフェース・ケーブル自コネクタ３のイ
ンタフェース仕様に。
装脇、２および３番ゴインタフェース・ケーブル・コネ
クタ、４および５は外部装動、６は共通Ｉ制御部、７お
よび８はバッファ回路、９および１０は外部接続用コネ
クタである。ここて、ノ＼°ンファ１９回路７目、夕）
部装置４とインタフェース・ケーブル・コネクタ２のイ
ンタフェース仕様に合致しておりバッファ回路８は、外
部装置５とインタフェース・ケーブル自コネクタ３のイ
ンタフェース仕様に。
合致している。さらに、２１および２２は、外部接続用
コネクタ９および１旧こ用意されたインタフェース仕様
を電気的信号として入出力制御装置内に取り込む手段と
しての接栓ビン、２３は上記ｍ気的伯号によって、複数
のバッファ回路のうち、１つのバッファ回路を選択する
手段としての選択回路、２４はバッファ回路を選択する
ために選択回路２３に与えられる選択信号、２５は選択
信号２３に外部から信号が与えられないときＨｉ ｇ
ｈレベルを保ったｙ）の抵抗器、２６はインタフェース
仕様を規定１−る−例として、インタフェース・ケーブ
ル・コネクタ２にもうけた折り返し回路である。
コネクタ９および１旧こ用意されたインタフェース仕様
を電気的信号として入出力制御装置内に取り込む手段と
しての接栓ビン、２３は上記ｍ気的伯号によって、複数
のバッファ回路のうち、１つのバッファ回路を選択する
手段としての選択回路、２４はバッファ回路を選択する
ために選択回路２３に与えられる選択信号、２５は選択
信号２３に外部から信号が与えられないときＨｉ ｇ
ｈレベルを保ったｙ）の抵抗器、２６はインタフェース
仕様を規定１−る−例として、インタフェース・ケーブ
ル・コネクタ２にもうけた折り返し回路である。
第３図、第４図の例では、外部装置４と外部装置５のイ
ンタフェース仕様の相異は、インタフェース・ケーブル
・コネクタ２にもうけられた折り返し回路２６で規定さ
れている。たたし、インタフー−ス・ケーブル・コネク
タ３に折り返し回路２６に相当する回路がないことは、
インタフェース・ケーブル・コネクタ３あるいは外部装
置５でインタフェース仕様を規定しないのではなく、折
り返し回路２６に相当する回路がないことで、外部？＃
ｅａ１５のインタフェース仕様であること＜Ｂ規定して
いる。こ１１は２進法での′ ｌ“と１０“を折り返し
回路の１有“とゝ無“で表現しているとみなすことがで
きる。
ンタフェース仕様の相異は、インタフェース・ケーブル
・コネクタ２にもうけられた折り返し回路２６で規定さ
れている。たたし、インタフー−ス・ケーブル・コネク
タ３に折り返し回路２６に相当する回路がないことは、
インタフェース・ケーブル・コネクタ３あるいは外部装
置５でインタフェース仕様を規定しないのではなく、折
り返し回路２６に相当する回路がないことで、外部？＃
ｅａ１５のインタフェース仕様であること＜Ｂ規定して
いる。こ１１は２進法での′ ｌ“と１０“を折り返し
回路の１有“とゝ無“で表現しているとみなすことがで
きる。
さて、第３図において、外部接続用コネクタ９にインタ
フェース・ケーブルのコネクタ２が接続され、さらに外
部装置４か接＃＆されている。外部ｍ［４はインタフェ
ース・ケーブル・コネクタ２、外部接続用コネクタ９を
介して、バッファ回路７に接続されなけれはならない。
フェース・ケーブルのコネクタ２が接続され、さらに外
部装置４か接＃＆されている。外部ｍ［４はインタフェ
ース・ケーブル・コネクタ２、外部接続用コネクタ９を
介して、バッファ回路７に接続されなけれはならない。
このためのインクフェース仕様は、インタフェース・ケ
ーブル・コネクタの折り返し回路２６によって帆現化さ
れ、外部接続用コネクタ９にもうけられた接栓ビン２１
により電気信号として取り込まれ、選択４８号２４によ
って、選択回路２３に供給される。選択回路２３は、ウ
ヘ択情号２４が折り返し回路２６と１シに栓ビン２１に
よって、地電位に４Ｃろため、共通制御部６とバッファ
回路７を接続し、共通制御部６とバッファ回路８を切断
する。以上のように、外部接続用コネクタ９にインタフ
ェース・ケーブル自コネクタ２を接続することによって
、入出力掩」押装置１は、折り返し回路２６によって示
されたインタフ −ス仕様を外部接続用コネクタ９の接
栓ビン２１の電気１１号として取り込み、選択回路２３
によってバッファ回路７を選択する機能を自動的に実現
する。
ーブル・コネクタの折り返し回路２６によって帆現化さ
れ、外部接続用コネクタ９にもうけられた接栓ビン２１
により電気信号として取り込まれ、選択４８号２４によ
って、選択回路２３に供給される。選択回路２３は、ウ
ヘ択情号２４が折り返し回路２６と１シに栓ビン２１に
よって、地電位に４Ｃろため、共通制御部６とバッファ
回路７を接続し、共通制御部６とバッファ回路８を切断
する。以上のように、外部接続用コネクタ９にインタフ
ェース・ケーブル自コネクタ２を接続することによって
、入出力掩」押装置１は、折り返し回路２６によって示
されたインタフ −ス仕様を外部接続用コネクタ９の接
栓ビン２１の電気１１号として取り込み、選択回路２３
によってバッファ回路７を選択する機能を自動的に実現
する。
次に、入出力制御装置１に外部装置４と異なるインタフ
ェース仕様をもつ外部装動を接続する例を第４図を用い
て説明する。
ェース仕様をもつ外部装動を接続する例を第４図を用い
て説明する。
第４図において、外部接続用コネクタ１ｏにインタフェ
ース・ケーブル・コネクタ３か接続さね、さらに外部装
に５か接にされている。外部装置ｉｃ＋５はインタフェ
ース・ケーブル・コネクタ３、外部接続用コネクタ１０
を介して、バッファ回路８に接続されなけれはならない
。このためのインタフェース仕様は、第３図の折り返し
回路２５ｉこ相当するものかインタフェース・ケーブル
・コネクタ３に無いということで具現化ざ才１、外部接
続用コネクタ１０にもうけられた接栓ビン２２から（才
選′ＶＣ色号２４を介して選択回路２３に１折り返し回
路が無い」ということか伝えられる。この情報は穎、シ
、的悟号としては、接栓ビン２２が、入出力ｔｉｉ制御
装餉−１０外剖で地電位にさｔｌ、 Ｉｉいことか理由
になり、抵和器２５の倫〕きで、選択信号２４はＨｉ
ｇ ｈレベルになることによって選択回路２３に伝達さ
れる。連択回路２：３ｉ、ｊ選択信号２４かＨｉ ｇ
ｈレベルになるため、共通制御部６とバッファ回路７を
切断し、共通制御部６とバッファ回路８を接続する。以
上のように、外部接続用コネクタ１０にインタフェース
・ケ゛−フ゛ル・コネクタ３を接続することによって、
入出力１ｔｒｌｊ御装９１は、インタフェースφケーフ
ル・コネクタ３にシ［り返し回路か無いことによって示
されたインタフェース仕様を外部接続用コネクタ１０の
接栓ビン２２の驚気伯号として取り込り１違択回路２３
によってバッファ回路８を選択する機能を自動的に冥現
］−る。
ース・ケーブル・コネクタ３か接続さね、さらに外部装
に５か接にされている。外部装置ｉｃ＋５はインタフェ
ース・ケーブル・コネクタ３、外部接続用コネクタ１０
を介して、バッファ回路８に接続されなけれはならない
。このためのインタフェース仕様は、第３図の折り返し
回路２５ｉこ相当するものかインタフェース・ケーブル
・コネクタ３に無いということで具現化ざ才１、外部接
続用コネクタ１０にもうけられた接栓ビン２２から（才
選′ＶＣ色号２４を介して選択回路２３に１折り返し回
路が無い」ということか伝えられる。この情報は穎、シ
、的悟号としては、接栓ビン２２が、入出力ｔｉｉ制御
装餉−１０外剖で地電位にさｔｌ、 Ｉｉいことか理由
になり、抵和器２５の倫〕きで、選択信号２４はＨｉ
ｇ ｈレベルになることによって選択回路２３に伝達さ
れる。連択回路２：３ｉ、ｊ選択信号２４かＨｉ ｇ
ｈレベルになるため、共通制御部６とバッファ回路７を
切断し、共通制御部６とバッファ回路８を接続する。以
上のように、外部接続用コネクタ１０にインタフェース
・ケ゛−フ゛ル・コネクタ３を接続することによって、
入出力１ｔｒｌｊ御装９１は、インタフェースφケーフ
ル・コネクタ３にシ［り返し回路か無いことによって示
されたインタフェース仕様を外部接続用コネクタ１０の
接栓ビン２２の驚気伯号として取り込り１違択回路２３
によってバッファ回路８を選択する機能を自動的に冥現
］−る。
以上、ワト明したように、入出力装飯に外部接続用コネ
クタを設け、該外部液Ｕ用コネクタを介しで、外部装置
のインタフェース仕様を規足する電気イぎ号を取り込み
、該に１気ｉＦｊ号によって、上記・インタフェース仕
様に曾致したバッフ１回路せ選択できるようにしたこと
により、入出力制御装置内のスイッチ等の作業、および
人手による確認作業を不をにし、誤り作業が発生しに＜
＜、人手による確認作業の工費なバッファ回路の選択手
段を持った入出力制御装置ｘｔを提供できる。
クタを設け、該外部液Ｕ用コネクタを介しで、外部装置
のインタフェース仕様を規足する電気イぎ号を取り込み
、該に１気ｉＦｊ号によって、上記・インタフェース仕
様に曾致したバッフ１回路せ選択できるようにしたこと
により、入出力制御装置内のスイッチ等の作業、および
人手による確認作業を不をにし、誤り作業が発生しに＜
＜、人手による確認作業の工費なバッファ回路の選択手
段を持った入出力制御装置ｘｔを提供できる。
第１図、第２図は従来技術による入出力制御装置及びそ
れに接続される外部装置の関係を示すプロ′ツク図、第
３図、第４図は本発明の一実施例による入出力制御装置
及びそれに接続される外部装置の関係を示すブロック図
。 １・・・入出力ｔｌＩｌｊ御装置 ２．３・・インタフェースｅケーフ゛ル・コネクタ４．
５・・外部装置 ６・・・共通制御部 ７．８・・・バッファ回路 ９．１０・・・力部接続用コネクタ 代理人弁理士 高 橋 明 夫 羊 ｌ 図 第２図 第 ３ 図 第 呼 図
れに接続される外部装置の関係を示すプロ′ツク図、第
３図、第４図は本発明の一実施例による入出力制御装置
及びそれに接続される外部装置の関係を示すブロック図
。 １・・・入出力ｔｌＩｌｊ御装置 ２．３・・インタフェースｅケーフ゛ル・コネクタ４．
５・・外部装置 ６・・・共通制御部 ７．８・・・バッファ回路 ９．１０・・・力部接続用コネクタ 代理人弁理士 高 橋 明 夫 羊 ｌ 図 第２図 第 ３ 図 第 呼 図
Claims (1)
- 相異なるインタフェース仕様を持つ複数の外部装置とイ
ンタフェース・ケーブル・コネクタを介して接続される
入出力制御装置において、各々のインタフェース仕様に
対応するバッファ回路と、該バッファ回路とインタフェ
ース・ケーブル・コネクタを接続する外部接続用コネク
タと、該外部接続用コネクタにインタフェース−ケーブ
ル・コネクタを接続したとき、該インタフェース・ケー
ブル・コネクタを介して、接続される外部装置のインタ
フェース仕様を、外部接続用コネクタを介して、電気的
信号として入出力制御装置内に取り込む手段と、前記取
り１込み手段によって、前記被数のバッファ回路のうち
、１つのバッファ回路を選択する手段を持つことを特徴
とする入出力制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3230784A JPS60178557A (ja) | 1984-02-24 | 1984-02-24 | 入出力制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3230784A JPS60178557A (ja) | 1984-02-24 | 1984-02-24 | 入出力制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60178557A true JPS60178557A (ja) | 1985-09-12 |
Family
ID=12355284
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3230784A Pending JPS60178557A (ja) | 1984-02-24 | 1984-02-24 | 入出力制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60178557A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62172476A (ja) * | 1986-01-24 | 1987-07-29 | Asahi Optical Co Ltd | 測定デ−タ処理装置 |
| EP0462786A2 (en) * | 1990-06-19 | 1991-12-27 | Dell Usa L.P. | Address-enabling system and method for memory modules |
-
1984
- 1984-02-24 JP JP3230784A patent/JPS60178557A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62172476A (ja) * | 1986-01-24 | 1987-07-29 | Asahi Optical Co Ltd | 測定デ−タ処理装置 |
| EP0462786A2 (en) * | 1990-06-19 | 1991-12-27 | Dell Usa L.P. | Address-enabling system and method for memory modules |
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