JPS60116538U - 制御システム - Google Patents

制御システム

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JPS60116538U
JPS60116538U JP153584U JP153584U JPS60116538U JP S60116538 U JPS60116538 U JP S60116538U JP 153584 U JP153584 U JP 153584U JP 153584 U JP153584 U JP 153584U JP S60116538 U JPS60116538 U JP S60116538U
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JP
Japan
Prior art keywords
cpu
system bus
microprogram control
storage device
main storage
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP153584U
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English (en)
Inventor
久保 典夫
Original Assignee
横河電機株式会社
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Filing date
Publication date
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Priority to JP153584U priority Critical patent/JPS60116538U/ja
Publication of JPS60116538U publication Critical patent/JPS60116538U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は本考案にかかる制御システムの一実施例の構成
ブロック図、第2図は第1図の制御システムの動作信号
のタイムチャートである。 10−・・CPU、20・・・マイクロプログラム制御
部、30・・・主記憶装置、40・・・フリーズ手段、
50…システムバス。

Claims (1)

    【実用新案登録請求の範囲】
  1. 汎用のマイクロコンピュータチップを用いたCPUと、
    該CPUにシステムバスを介して接続されていてマイク
    ロプログラム制御によって動作するマイクロプログラム
    制御部と、前記システムバ゛ スに接続されている主記
    憶装置と、前記マイクロプログラム制御部が実行中には
    前記CPUをシステムバスから切り離すとともに前記主
    記憶装置に対してDMA動作可能な状態にするフリーズ
    手段′  とを具備し、前記CPUから発生する汎用の
    命令の間にマイクロプログラム制御部により所定の処理
    を実行することを特徴とする制御システム。
JP153584U 1984-01-10 1984-01-10 制御システム Pending JPS60116538U (ja)

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JP153584U JPS60116538U (ja) 1984-01-10 1984-01-10 制御システム

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JP153584U JPS60116538U (ja) 1984-01-10 1984-01-10 制御システム

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JPS60116538U true JPS60116538U (ja) 1985-08-07

Family

ID=30474372

Family Applications (1)

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JP153584U Pending JPS60116538U (ja) 1984-01-10 1984-01-10 制御システム

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JP (1) JPS60116538U (ja)

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