JPS60100836U - 接続回路 - Google Patents
接続回路Info
- Publication number
- JPS60100836U JPS60100836U JP1983193621U JP19362183U JPS60100836U JP S60100836 U JPS60100836 U JP S60100836U JP 1983193621 U JP1983193621 U JP 1983193621U JP 19362183 U JP19362183 U JP 19362183U JP S60100836 U JPS60100836 U JP S60100836U
- Authority
- JP
- Japan
- Prior art keywords
- output
- connection circuit
- switching means
- transistor
- turned
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Bidirectional Digital Transmission (AREA)
- Television Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は電圧シンセサイザ方式の選局装置の概略構成を
示す為のブロック図、第2図は従来の接続回路を説明す
る為の回路図である。第3図は本考案の接続回路の一実
施例を示す回路図、第4図はメモリの書込み時の手順の
フローチャートを示す図、第5図はメモリの書込み時の
動作を説明する為のタイムチャートを示す図、第6図は
メモリの読出し時の手順のフローチャートを示す図、第
□7図はメモリの読出し時の動作を説明する為の
タイムチャートを示す図、第8図は本考案の他の実施例
の回路図である。 103・・・データバス、104・・・第1電源ライ
□ン、105・・・第2電源ライン、107・・
・クロックバス、108・・・第1モート設定ハス、1
09・・・第2モード設定バス、110・・・第3モー
ド設定バス、111・・・スイッチング手段、MC・・
・マイクロコンピュータ(第1IC)、■・・・下揮発
性メモリ(第’2IC)、Ql、Q2・・・出力トラン
ジスタ、R1・・・・プルダウン抵抗、R2t R3t
R4t R5t R6・・・プルアップ抵抗。
示す為のブロック図、第2図は従来の接続回路を説明す
る為の回路図である。第3図は本考案の接続回路の一実
施例を示す回路図、第4図はメモリの書込み時の手順の
フローチャートを示す図、第5図はメモリの書込み時の
動作を説明する為のタイムチャートを示す図、第6図は
メモリの読出し時の手順のフローチャートを示す図、第
□7図はメモリの読出し時の動作を説明する為の
タイムチャートを示す図、第8図は本考案の他の実施例
の回路図である。 103・・・データバス、104・・・第1電源ライ
□ン、105・・・第2電源ライン、107・・
・クロックバス、108・・・第1モート設定ハス、1
09・・・第2モード設定バス、110・・・第3モー
ド設定バス、111・・・スイッチング手段、MC・・
・マイクロコンピュータ(第1IC)、■・・・下揮発
性メモリ(第’2IC)、Ql、Q2・・・出力トラン
ジスタ、R1・・・・プルダウン抵抗、R2t R3t
R4t R5t R6・・・プルアップ抵抗。
Claims (1)
- 出力電極がオープンの出力トランジスタが内部で接続さ
れていて、該トランジスタからの信号を出力するととも
に外部からの入力を受ける第1人出力端子を有する第1
Icと、出力電磁が内部でプルダウン抵抗を介して接地
された出力トランジスタの出力電極が接続されるととも
に外部からの入力を受ける第2人出力端子を有する第2
ICとの間に設けられ前記第1xcと第2IC間で双方
向のデータ転送を行なうための接続回路であって、前記
第1、第2人出力端子を結ぶデータバスと電源ライン間
にプルアップ抵抗とスイッチング手段の直列回路とを接
続するとともに前記第1Icから第2ICへのデータ転
送時には前記スイッチング手段をオンにし、前記第2I
Cから第11Cへのデータ転送時には前記スイッチング
手段をオフにする手段を設けたことを特徴とする接続回
路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1983193621U JPS60100836U (ja) | 1983-12-15 | 1983-12-15 | 接続回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1983193621U JPS60100836U (ja) | 1983-12-15 | 1983-12-15 | 接続回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60100836U true JPS60100836U (ja) | 1985-07-09 |
JPS6336429Y2 JPS6336429Y2 (ja) | 1988-09-27 |
Family
ID=30416397
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1983193621U Granted JPS60100836U (ja) | 1983-12-15 | 1983-12-15 | 接続回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60100836U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2015045338A1 (ja) * | 2013-09-30 | 2015-04-02 | パナソニックIpマネジメント株式会社 | 通信装置ならびにモータ制御装置 |
-
1983
- 1983-12-15 JP JP1983193621U patent/JPS60100836U/ja active Granted
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2015045338A1 (ja) * | 2013-09-30 | 2015-04-02 | パナソニックIpマネジメント株式会社 | 通信装置ならびにモータ制御装置 |
JPWO2015045338A1 (ja) * | 2013-09-30 | 2017-03-09 | パナソニックIpマネジメント株式会社 | 通信装置ならびにモータ制御装置 |
US10205485B2 (en) | 2013-09-30 | 2019-02-12 | Panasonic Intellectual Property Management Co., Ltd. | Communication apparatus and motor control apparatus |
Also Published As
Publication number | Publication date |
---|---|
JPS6336429Y2 (ja) | 1988-09-27 |
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